JPH02128438A - 半導体集積回路 - Google Patents
半導体集積回路Info
- Publication number
- JPH02128438A JPH02128438A JP63283021A JP28302188A JPH02128438A JP H02128438 A JPH02128438 A JP H02128438A JP 63283021 A JP63283021 A JP 63283021A JP 28302188 A JP28302188 A JP 28302188A JP H02128438 A JPH02128438 A JP H02128438A
- Authority
- JP
- Japan
- Prior art keywords
- vss
- vcc
- wiring
- integrated circuit
- semiconductor integrated
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/5449—Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
- H10W72/932—Plan-view shape, i.e. in top view
Landscapes
- Read Only Memory (AREA)
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は一半導体集積回路のVcc−Vssの供給方法
に関するものである。
に関するものである。
@2図に示しであるように一従来の半導体集積回路は−
Vcc、 Vss端子から半導体基盤へは1箇所しかワ
イヤーボンドされていなかった。このためVcc 、
Vss端子と反対側の半導体基盤上では−Vcc−Vs
s端子から離れているので、どうしてもVcc、Vss
配線につく寄生抵抗が大きくなり、Vcc、 Vss配
線が高インピーダンスになっていた。したがって反対側
では、電圧降下が起きる。
Vcc、 Vss端子から半導体基盤へは1箇所しかワ
イヤーボンドされていなかった。このためVcc 、
Vss端子と反対側の半導体基盤上では−Vcc−Vs
s端子から離れているので、どうしてもVcc、Vss
配線につく寄生抵抗が大きくなり、Vcc、 Vss配
線が高インピーダンスになっていた。したがって反対側
では、電圧降下が起きる。
従来ノvCC,vSSノ供給方法テハ、Vcc−Vss
配線につく寄生抵抗により配線が高インピーダンスにな
り、電圧降下が起きる。
配線につく寄生抵抗により配線が高インピーダンスにな
り、電圧降下が起きる。
この発明は、上記のような問題点を解決するためになさ
れたもので、半導体基盤全体に低インピーダンスでVc
c、 Vssを供給できる。
れたもので、半導体基盤全体に低インピーダンスでVc
c、 Vssを供給できる。
〔課題を解決するための手段]
この発明に係る、Vcc、 Vssの供給方法は、ダイ
パッド上の配線を通じて半導体基盤上の任意の部分ニ、
vCC,vSS端子カラVCC−vSSヲ供給供給スル
コマきる。
パッド上の配線を通じて半導体基盤上の任意の部分ニ、
vCC,vSS端子カラVCC−vSSヲ供給供給スル
コマきる。
この発明におけるVcc−Vssの供給方法は、ダイパ
ッド上の配線によって行なわれるので一低インピーダン
スでVcc−Vssを供給することができる。
ッド上の配線によって行なわれるので一低インピーダン
スでVcc−Vssを供給することができる。
以下、この発明の一実施例を図について説明する。第1
図は、その実施例を示す。まず、3のVcc配線−4の
vSS配線を5のダイパッド上に一図のようlこ配線す
る。ここでVc+、 Vss配線とダイパッド間は絶縁
しておく。そして−1−3間−3−7間、2−4間、4
−7間をワイヤーボンドしてやる。そうすれば、Vcc
、 Vss端子の反対側にもVcc、Vss端子から直
接Vcc−Vssが供給できるので一半導体基盤全体に
低インピーダンスでVcc−Vssの供給が可能になる
。
図は、その実施例を示す。まず、3のVcc配線−4の
vSS配線を5のダイパッド上に一図のようlこ配線す
る。ここでVc+、 Vss配線とダイパッド間は絶縁
しておく。そして−1−3間−3−7間、2−4間、4
−7間をワイヤーボンドしてやる。そうすれば、Vcc
、 Vss端子の反対側にもVcc、Vss端子から直
接Vcc−Vssが供給できるので一半導体基盤全体に
低インピーダンスでVcc−Vssの供給が可能になる
。
以上のように、この発明によれば−ダイパッド上にVc
c、 Vss配線を作り、この配線を通してVcc、V
ssを供給しているので、たとえ基盤の大きさが大きく
なっても半導体基盤のどこにでも低インピーダンスでV
cc、Vssを供給できる。
c、 Vss配線を作り、この配線を通してVcc、V
ssを供給しているので、たとえ基盤の大きさが大きく
なっても半導体基盤のどこにでも低インピーダンスでV
cc、Vssを供給できる。
@1図は、この発明の一実施例を示す関−第2図は一従
来のVcc、Vssの供給方法を示す図である。 第1 図ノ1 ハVcc端子−21;!Vss端子−3
1tVcc配線−4はVss配線−5はダイパッド、6
は半導体基盤、7はコンタクトホール、第2図において
、1はVcc端子、2はVss端子、3はダイパッド、
4は半導体基盤である。 なお− 各図中同一符号は− 同一または相当部分 を示す。
来のVcc、Vssの供給方法を示す図である。 第1 図ノ1 ハVcc端子−21;!Vss端子−3
1tVcc配線−4はVss配線−5はダイパッド、6
は半導体基盤、7はコンタクトホール、第2図において
、1はVcc端子、2はVss端子、3はダイパッド、
4は半導体基盤である。 なお− 各図中同一符号は− 同一または相当部分 を示す。
Claims (1)
- 半導体基盤全体に低インピーダンスでV_c_c、V_
s_sを供給可能にするため、ダイパッド上に配線をほ
どこしたことを特徴とする半導体集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63283021A JPH02128438A (ja) | 1988-11-08 | 1988-11-08 | 半導体集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63283021A JPH02128438A (ja) | 1988-11-08 | 1988-11-08 | 半導体集積回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02128438A true JPH02128438A (ja) | 1990-05-16 |
Family
ID=17660198
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63283021A Pending JPH02128438A (ja) | 1988-11-08 | 1988-11-08 | 半導体集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02128438A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62216240A (ja) * | 1986-03-17 | 1987-09-22 | Nec Ic Microcomput Syst Ltd | 集積回路パツケ−ジ |
-
1988
- 1988-11-08 JP JP63283021A patent/JPH02128438A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62216240A (ja) * | 1986-03-17 | 1987-09-22 | Nec Ic Microcomput Syst Ltd | 集積回路パツケ−ジ |
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