JPH0213508B2 - - Google Patents
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- JPH0213508B2 JPH0213508B2 JP59115066A JP11506684A JPH0213508B2 JP H0213508 B2 JPH0213508 B2 JP H0213508B2 JP 59115066 A JP59115066 A JP 59115066A JP 11506684 A JP11506684 A JP 11506684A JP H0213508 B2 JPH0213508 B2 JP H0213508B2
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- 238000006243 chemical reaction Methods 0.000 claims description 3
- RRLHMJHRFMHVNM-BQVXCWBNSA-N [(2s,3r,6r)-6-[5-[5-hydroxy-3-(4-hydroxyphenyl)-4-oxochromen-7-yl]oxypentoxy]-2-methyl-3,6-dihydro-2h-pyran-3-yl] acetate Chemical compound C1=C[C@@H](OC(C)=O)[C@H](C)O[C@H]1OCCCCCOC1=CC(O)=C2C(=O)C(C=3C=CC(O)=CC=3)=COC2=C1 RRLHMJHRFMHVNM-BQVXCWBNSA-N 0.000 description 11
- 238000010586 diagram Methods 0.000 description 4
- 101100524644 Toxoplasma gondii ROM4 gene Proteins 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000003384 imaging method Methods 0.000 description 2
- 230000003287 optical effect Effects 0.000 description 2
- 238000013139 quantization Methods 0.000 description 2
- 230000002238 attenuated effect Effects 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
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- Image Input (AREA)
- Facsimile Image Signal Circuits (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明はシエーデイング歪みの補正係数を高精
度で求めることのできるシエーデイング歪み補正
装置に関するものである。
度で求めることのできるシエーデイング歪み補正
装置に関するものである。
従来例の構成とその問題点
フアクシミリ等の画像装置は、第１図に示すよ
うな光学系を組込んだスキヤナによつて書画情報
の読取りを行うのが一般的である。このスキヤナ
は、白基準板１０又は原稿１１を照明するランプ
１２と、上記白基準板１０又は原稿１１の像を結
像させるためのレンズ１３と、レンズ１３によつ
て結像させた光学像を光電変換するCCDイメー
ジセンサ１４と、CCDイメージセンサ１４の出
力を増幅し、アナログ画信号ａを出力するプリア
ンプ１５とから構成されている。このスキヤナか
ら出力されたアナログ画信号ａはシエーデイング
歪み補正装置によつて歪み補正されるが、かかる
シエーデイング歪み補正装置の従来例としては、
例えば第２図に示すようなものがある。
うな光学系を組込んだスキヤナによつて書画情報
の読取りを行うのが一般的である。このスキヤナ
は、白基準板１０又は原稿１１を照明するランプ
１２と、上記白基準板１０又は原稿１１の像を結
像させるためのレンズ１３と、レンズ１３によつ
て結像させた光学像を光電変換するCCDイメー
ジセンサ１４と、CCDイメージセンサ１４の出
力を増幅し、アナログ画信号ａを出力するプリア
ンプ１５とから構成されている。このスキヤナか
ら出力されたアナログ画信号ａはシエーデイング
歪み補正装置によつて歪み補正されるが、かかる
シエーデイング歪み補正装置の従来例としては、
例えば第２図に示すようなものがある。
この従来のシエーデイング歪み補正装置は、バ
ツフア・アンプ１と、アナログ画信号をデジタル
化するＡ／Ｄ変換器２と、デジタル化された画信
号に応じた補正係数を決定するROM４と、
ROM４で決定された補正係数を走査一ライン分
記憶するRAM５と、デジタル画信号に対して歪
み補正を施す乗算器３とから成る。スキヤナから
出力されたアナログ画信号ａは、先ずバツフア・
アンプ１に入力され、増幅されてアナログ画信号
ｂとなり、Ａ／Ｄ変換器２に入力される。この
Ａ／Ｄ変換器２は、アナログ画信号ｂをデジタル
画信号ｃに変換して出力する。デジタル画信号ｃ
の一方は、ROM４に出力され、ROM４はデジ
タル画信号ｃに応じて補正係数ｄを決定し、この
補正係数をRAM５に出力する。RAM５は、上
記補正係数を一ライン走査分記憶する。デジタル
画信号ｃのもう一方は乗算器３に入力され、さら
にRAM５から読み出された補正係数データd′が
乗算器３に入力されて、乗算が行なわれ、画信号
に歪み補正が施される。
ツフア・アンプ１と、アナログ画信号をデジタル
化するＡ／Ｄ変換器２と、デジタル化された画信
号に応じた補正係数を決定するROM４と、
ROM４で決定された補正係数を走査一ライン分
記憶するRAM５と、デジタル画信号に対して歪
み補正を施す乗算器３とから成る。スキヤナから
出力されたアナログ画信号ａは、先ずバツフア・
アンプ１に入力され、増幅されてアナログ画信号
ｂとなり、Ａ／Ｄ変換器２に入力される。この
Ａ／Ｄ変換器２は、アナログ画信号ｂをデジタル
画信号ｃに変換して出力する。デジタル画信号ｃ
の一方は、ROM４に出力され、ROM４はデジ
タル画信号ｃに応じて補正係数ｄを決定し、この
補正係数をRAM５に出力する。RAM５は、上
記補正係数を一ライン走査分記憶する。デジタル
画信号ｃのもう一方は乗算器３に入力され、さら
にRAM５から読み出された補正係数データd′が
乗算器３に入力されて、乗算が行なわれ、画信号
に歪み補正が施される。
このような、シエーデイング歪み補正装置は、
後述するトレーニング・モードで白基準板１０を
読取り、ROM４は、この読取り操作で得られた
デジタル画信号ｃから補正係数ｄを求めて出力
し、RAM５に記憶させる。このときの補正係数
値Ｍは次式で表わされる。
後述するトレーニング・モードで白基準板１０を
読取り、ROM４は、この読取り操作で得られた
デジタル画信号ｃから補正係数ｄを求めて出力
し、RAM５に記憶させる。このときの補正係数
値Ｍは次式で表わされる。
Vio×Ｍ／2n＝Ｋ ……(1)
ここで、
Vio：白基準板で読取走査した時のデジタル画信
号値、 ｎ：量子化ビツト数、 Ｋ：シエーデイング歪み補正範囲の下限値に相当
する定数、 である。
号値、 ｎ：量子化ビツト数、 Ｋ：シエーデイング歪み補正範囲の下限値に相当
する定数、 である。
ところが、上記第(1)式中、Ｍ／2n≦１だから、
VioはＫの値以下をとると、第(1)式における乗算
結果はＫとなることが出来ない。よつて、デジタ
ル画信号値VioはＫを下限値、2nを上限値とする
範囲中になければならない。
VioはＫの値以下をとると、第(1)式における乗算
結果はＫとなることが出来ない。よつて、デジタ
ル画信号値VioはＫを下限値、2nを上限値とする
範囲中になければならない。
次に、スキヤン・モードでは、スキヤナに原稿
が送り込まれ、原稿の読取りを行なう。この読取
り操作において、乗算器３は、このときのデジタ
ル画信号ｃを受取ると共に、上記トレーニング・
モード時に書込まれた補正係数d′をRAM５から
読出して来て、これらを乗算し、積としてデジタ
ル画信号ｆ、即ちシエーデイング歪み補正の施さ
れた画信号ｆを得る。ここで、補正係数d′は上記
ｄと同じ内容である。このときのデジタル画信号
ｆの値をVputとすると、Vputは次式で求められ
る。
が送り込まれ、原稿の読取りを行なう。この読取
り操作において、乗算器３は、このときのデジタ
ル画信号ｃを受取ると共に、上記トレーニング・
モード時に書込まれた補正係数d′をRAM５から
読出して来て、これらを乗算し、積としてデジタ
ル画信号ｆ、即ちシエーデイング歪み補正の施さ
れた画信号ｆを得る。ここで、補正係数d′は上記
ｄと同じ内容である。このときのデジタル画信号
ｆの値をVputとすると、Vputは次式で求められ
る。
Vput＝Vp×Ｍ／2n ……(2)
ここで、
Vp：原稿を読取走査した時のデジタル画信号値、
である。
なお、トレーニング・モードで補正係数の
RAM５への書込み、或はスキヤン・モードでの
補正係数のRAM５からの読出し及び乗算は、
CCDイメージセンサ１４の各画素毎に行なわれ
る。これらの二つのモードでRAMアドレスの同
期をとるために、信号ｅによつてアドレスが選択
される。
RAM５への書込み、或はスキヤン・モードでの
補正係数のRAM５からの読出し及び乗算は、
CCDイメージセンサ１４の各画素毎に行なわれ
る。これらの二つのモードでRAMアドレスの同
期をとるために、信号ｅによつてアドレスが選択
される。
しかしながら、このような従来のシエーデイン
グ歪み補正装置にあつては、補正が施された画信
号ｆの値Vputは、その補正精度が白基準板１０読
取走査時の画信号値Vioに左右されるという特質
を持つ。即ち、Vp、Vioに付随する量子化誤差
ΔVp、ΔVioを考えると、誤差を含まない形の理
論上のVputと、現実の誤差を持つV′putとは、上記
(1)、(2)式より以下のように表わされる。
グ歪み補正装置にあつては、補正が施された画信
号ｆの値Vputは、その補正精度が白基準板１０読
取走査時の画信号値Vioに左右されるという特質
を持つ。即ち、Vp、Vioに付随する量子化誤差
ΔVp、ΔVioを考えると、誤差を含まない形の理
論上のVputと、現実の誤差を持つV′putとは、上記
(1)、(2)式より以下のように表わされる。
Vput＝Vp×Ｋ／Vio ……(3)
V′put＝（Vp＋ΔVp）×Ｋ／（Vio＋ΔVio）
Vp×Ｋ／Vio＋ΔVp×Ｋ／Vio
＝Vput＋ΔVp×Ｋ／Vio ……(4)
即ち、補正された画信号ｆの値V′putの誤差は、
白基準板１０の読取り走査時の画信号ｃの値Vio
が大きい程小さくなる。したがつて、Vioは、 Ｋ≦Vio≦2n という条件を満たす他に補正精度を高めるために
はVioを2nのレベルに出来るだけ近づけることが
必要である。
白基準板１０の読取り走査時の画信号ｃの値Vio
が大きい程小さくなる。したがつて、Vioは、 Ｋ≦Vio≦2n という条件を満たす他に補正精度を高めるために
はVioを2nのレベルに出来るだけ近づけることが
必要である。
ところが、スキヤナに組込まれたランプ１２等
は、点灯時間の経過に伴なつて光量が変化し、こ
の為に、白基準板１０を読取つた時の画信号の値
Vioは、時間と共に変化してしまい、この値を2n
のレベルに近づけておくことは容易ではない。し
たがつて、時間と共にシエーデイング歪み補正装
置の出力として得られる画信号の濃淡レベルが変
化するという欠点の他に、補正精度を高いレベル
に維持できないという問題点を生ずる。
は、点灯時間の経過に伴なつて光量が変化し、こ
の為に、白基準板１０を読取つた時の画信号の値
Vioは、時間と共に変化してしまい、この値を2n
のレベルに近づけておくことは容易ではない。し
たがつて、時間と共にシエーデイング歪み補正装
置の出力として得られる画信号の濃淡レベルが変
化するという欠点の他に、補正精度を高いレベル
に維持できないという問題点を生ずる。
かかる問題に対して、バツフアアンプ１の前段
にAGC回路を設けて、アナログ画信号の振幅を
最適値に制御することで対処できる。
にAGC回路を設けて、アナログ画信号の振幅を
最適値に制御することで対処できる。
しかし、上記アナログ画信号の振幅は一定値で
はなく、上述したように、シエーデイング歪みを
持つており、しかも、その歪もスキヤナ毎に異な
つているから、波形によつてゲイン量が左右され
るAGC回路では、最適値に対する制御が不安定
となつてしまう。
はなく、上述したように、シエーデイング歪みを
持つており、しかも、その歪もスキヤナ毎に異な
つているから、波形によつてゲイン量が左右され
るAGC回路では、最適値に対する制御が不安定
となつてしまう。
発明の目的
本発明は、上記従来の問題点に着目してなされ
たもので、補正精度を高いレベルに維持しながら
画信号のシエーデイング歪みを補正することの可
能な装置を提供し、上記従来の問題点を解決する
ことを目的とするものである。
たもので、補正精度を高いレベルに維持しながら
画信号のシエーデイング歪みを補正することの可
能な装置を提供し、上記従来の問題点を解決する
ことを目的とするものである。
発明の構成
本発明は、上記目的を達成するため、アナログ
画信号を増幅するバツフアアンプの前段に減衰器
を設け、その減衰比を決定するに当り、シエーデ
イング歪み補正装置のトレーニング・モード時に
はアナログ画信号の大小レベルを比較する比較器
の出力信号を用いる一方、スキヤン・モード時に
はシエーデイング歪み補正装置のオーバーフロー
信号を用いる、というように各信号を切替えて用
い、それぞれのパルス信号を積分回路を通して得
たアナログ電圧により制御するようにしたことを
要旨とするものである。
画信号を増幅するバツフアアンプの前段に減衰器
を設け、その減衰比を決定するに当り、シエーデ
イング歪み補正装置のトレーニング・モード時に
はアナログ画信号の大小レベルを比較する比較器
の出力信号を用いる一方、スキヤン・モード時に
はシエーデイング歪み補正装置のオーバーフロー
信号を用いる、というように各信号を切替えて用
い、それぞれのパルス信号を積分回路を通して得
たアナログ電圧により制御するようにしたことを
要旨とするものである。
実施例の説明
本発明の一実施例を添付の図面を参照して詳細
に説明する。
に説明する。
第３図は、本発明の一実施例に係るシエーデイ
ング歪み補正装置を示す図である。この図におい
て、７はスキヤナから入力されるアナログ画信号
ａを減衰させる減衰器、１は上記減衰器７の出力
信号b′を後段にして増幅するバツフア・アンプ、
２はアナログ画信号ｂをデジタル画信号ｃに変換
するＡ／Ｄ変換器、４はデジタル画信号ｃに対し
て補正係数ｄを出力するROM、５は補正係数ｄ
を記憶するRAM、３はデジタル画信号ｃと補正
係数d′とを乗算するための乗算器である。また、
９はアナログ画信号b′を、画信号を制御したいあ
る一定の固定レベルと比較する比較器、８はトレ
ーニング・モード時には比較器９の出力信号ｈ
を、スキヤン・モード時には乗算器３のオーバー
フロー信号ｇを選択して出力するセレクタ、６は
セレクタ８の出力ｊをパルス積分してアナログ電
圧信号ｋに変換し、この信号ｋによつて定められ
るゲインを減衰器７に出力する積分回路である。
ング歪み補正装置を示す図である。この図におい
て、７はスキヤナから入力されるアナログ画信号
ａを減衰させる減衰器、１は上記減衰器７の出力
信号b′を後段にして増幅するバツフア・アンプ、
２はアナログ画信号ｂをデジタル画信号ｃに変換
するＡ／Ｄ変換器、４はデジタル画信号ｃに対し
て補正係数ｄを出力するROM、５は補正係数ｄ
を記憶するRAM、３はデジタル画信号ｃと補正
係数d′とを乗算するための乗算器である。また、
９はアナログ画信号b′を、画信号を制御したいあ
る一定の固定レベルと比較する比較器、８はトレ
ーニング・モード時には比較器９の出力信号ｈ
を、スキヤン・モード時には乗算器３のオーバー
フロー信号ｇを選択して出力するセレクタ、６は
セレクタ８の出力ｊをパルス積分してアナログ電
圧信号ｋに変換し、この信号ｋによつて定められ
るゲインを減衰器７に出力する積分回路である。
なお、スキヤナについては第１図に関連して説
明したスキヤナの一般例と同様な構成を有し、ラ
ンプ１２によつて照明された白基準板１０又は原
稿１１の画像は、レンズ１３を介してCCDイメ
ージセンサ１４の受光面に結像され、CCDイメ
ージセンサ１４によりアナログ画信号に光電変換
される。白基準板１０又は原稿１１に対する読取
走査のうち、主走査はCCDイメージセンサによ
つて行なわれ、副走査は原稿の移動によつて行な
われる（但し白基準板１０に対する副走査は行な
われない）。CCDイメージセンサ１４から出力さ
れたアナログ画信号は、プリアンプ１５によつて
増幅された後、アナログ画信号ａとなつてシエー
デイング歪み補正装置に入力される。
明したスキヤナの一般例と同様な構成を有し、ラ
ンプ１２によつて照明された白基準板１０又は原
稿１１の画像は、レンズ１３を介してCCDイメ
ージセンサ１４の受光面に結像され、CCDイメ
ージセンサ１４によりアナログ画信号に光電変換
される。白基準板１０又は原稿１１に対する読取
走査のうち、主走査はCCDイメージセンサによ
つて行なわれ、副走査は原稿の移動によつて行な
われる（但し白基準板１０に対する副走査は行な
われない）。CCDイメージセンサ１４から出力さ
れたアナログ画信号は、プリアンプ１５によつて
増幅された後、アナログ画信号ａとなつてシエー
デイング歪み補正装置に入力される。
この実施例に係るシエーデイング歪み補正装置
の作用について以下説明する。
の作用について以下説明する。
原稿１１の読取走査に先立つて、白基準板１０
の読取走査がスキヤナによつて行なわれ、当該白
基準板１０の反射率に比例したレベルのアナログ
画信号ａがシエーデイング歪み補正装置に入力さ
れる。この時は、シエーデイング歪み補正装置は
トレーニング・モードで動作する。減衰器７で減
衰されたアナログ画信号ａは、バツフアアンプ１
で増幅された後アナログ画信号ｂとなり、Ａ／Ｄ
変換器２に入力される。Ａ／Ｄ変換器２は、アナ
ログ画信号ｂをデジタル画信号ｃに変換し、
ROM４に出力する。ROM４は、トレーニン
グ・モード期間に動作するもので、入力されるデ
ジタル画信号ｃで指定されるアドレスから、上記
(1)式で決る補正係数ｄを出力し、この補正係数ｄ
はRAM５に書き込まれる。一方、このトレーニ
ング・モード時にセレクタ８は、比較器９がアナ
ログ画信号b′をある一定の固定レベルと比較して
出力する判定信号ｈを選択して信号ｊとして積分
回路６に出力する。積分回路６は、パルス信号で
ある信号ｊを積分することにより、信号ｊの
“Ｈ”状態の頻度をアナログ電圧の大小に変換し、
信号ｋとして減衰器７に出力する。減衰器７は、
信号ｋが大のときは、減衰比を大きくし、信号ｋ
が小のときは減衰比を小さくして画信号ａを減衰
し、その結果信号b′を出力する。即ち、減衰器
７、比較器９、セレクタ８、積分回路６で形成さ
れる負帰還ループは、画信号b′が大レベルのとき
は減衰器７の減衰比を大きくし、画信号b′が小レ
ベルのときは減衰器７の減衰比を小さくすること
で、画信号b′を一定レベルに制御する機能があ
り、いわゆるABC回路を構成している。従つて、
比較器９の比較基準となる固定レベルを予め高く
設定しておくことにより、画信号b′を高いレベル
に保持することができる。この状態で、先り述べ
た補正係数ｄがRAM５に書き込まれ、主走査１
ライン分の書込みが終了すると、トレーニング・
モードは終了する。
の読取走査がスキヤナによつて行なわれ、当該白
基準板１０の反射率に比例したレベルのアナログ
画信号ａがシエーデイング歪み補正装置に入力さ
れる。この時は、シエーデイング歪み補正装置は
トレーニング・モードで動作する。減衰器７で減
衰されたアナログ画信号ａは、バツフアアンプ１
で増幅された後アナログ画信号ｂとなり、Ａ／Ｄ
変換器２に入力される。Ａ／Ｄ変換器２は、アナ
ログ画信号ｂをデジタル画信号ｃに変換し、
ROM４に出力する。ROM４は、トレーニン
グ・モード期間に動作するもので、入力されるデ
ジタル画信号ｃで指定されるアドレスから、上記
(1)式で決る補正係数ｄを出力し、この補正係数ｄ
はRAM５に書き込まれる。一方、このトレーニ
ング・モード時にセレクタ８は、比較器９がアナ
ログ画信号b′をある一定の固定レベルと比較して
出力する判定信号ｈを選択して信号ｊとして積分
回路６に出力する。積分回路６は、パルス信号で
ある信号ｊを積分することにより、信号ｊの
“Ｈ”状態の頻度をアナログ電圧の大小に変換し、
信号ｋとして減衰器７に出力する。減衰器７は、
信号ｋが大のときは、減衰比を大きくし、信号ｋ
が小のときは減衰比を小さくして画信号ａを減衰
し、その結果信号b′を出力する。即ち、減衰器
７、比較器９、セレクタ８、積分回路６で形成さ
れる負帰還ループは、画信号b′が大レベルのとき
は減衰器７の減衰比を大きくし、画信号b′が小レ
ベルのときは減衰器７の減衰比を小さくすること
で、画信号b′を一定レベルに制御する機能があ
り、いわゆるABC回路を構成している。従つて、
比較器９の比較基準となる固定レベルを予め高く
設定しておくことにより、画信号b′を高いレベル
に保持することができる。この状態で、先り述べ
た補正係数ｄがRAM５に書き込まれ、主走査１
ライン分の書込みが終了すると、トレーニング・
モードは終了する。
次に、スキヤナに原稿１１が送り込まれ、原稿
１１の読取走査が開始されると、シエーデイング
歪み補正装置はスキヤン・モードで動作する。上
述のトレーニング・モードと同様の動作によつて
得られるデジタル画信号ｃと、トレーニング・モ
ードでRAM５に書込まれた補正係数を信号d′と
して読出し、上記デジタル画信号ｃと補正係数
d′とを乗算器３で乗算して、補正を施されたデジ
タル画信号ｆを出力する。このスキヤンモードで
は、セレクタ８は、乗算器３から出力されるオー
バーフロー信号ｇを選択し、積分回路６に信号ｊ
を出力する。
１１の読取走査が開始されると、シエーデイング
歪み補正装置はスキヤン・モードで動作する。上
述のトレーニング・モードと同様の動作によつて
得られるデジタル画信号ｃと、トレーニング・モ
ードでRAM５に書込まれた補正係数を信号d′と
して読出し、上記デジタル画信号ｃと補正係数
d′とを乗算器３で乗算して、補正を施されたデジ
タル画信号ｆを出力する。このスキヤンモードで
は、セレクタ８は、乗算器３から出力されるオー
バーフロー信号ｇを選択し、積分回路６に信号ｊ
を出力する。
上述のオーバーフロー信号ｇは、(2)式における
Vputが(1)式で示すＫの値より大きくなつた場合
に、即ち、原稿読取時（スキヤン・モード）の画
信号の値Vpが、白基準板読取時（トレーニン
グ・モード）の画信号の値Vioより大きくなつた
場合に“Ｈ”レベルとなる信号である。
Vputが(1)式で示すＫの値より大きくなつた場合
に、即ち、原稿読取時（スキヤン・モード）の画
信号の値Vpが、白基準板読取時（トレーニン
グ・モード）の画信号の値Vioより大きくなつた
場合に“Ｈ”レベルとなる信号である。
減衰器７、バツフアアンプ１、Ａ／Ｄ変換器
２、乗算器３、セレクタ８、積分回路６で形成さ
れる負帰還ループは、画信号ｃの値VpがVioを越
えると減衰器７の減衰比を大きくし、VpがVioを
下回つたときには減衰器７の減衰比を小さくする
ことで、画信号ｃを外部の影響を受けず一定レベ
ルに制御するという、いわゆるABC回路として
の機能を発揮するのである。
２、乗算器３、セレクタ８、積分回路６で形成さ
れる負帰還ループは、画信号ｃの値VpがVioを越
えると減衰器７の減衰比を大きくし、VpがVioを
下回つたときには減衰器７の減衰比を小さくする
ことで、画信号ｃを外部の影響を受けず一定レベ
ルに制御するという、いわゆるABC回路として
の機能を発揮するのである。
発明の効果
以上説明したように、本発明によれば、トレー
ニング・モード操作時に動作するABC回路によ
つて、画信号が高いレベルで保持されるので、シ
エーデイング歪み補正係数が高精度で求められ、
又スキヤン・モード時に動作する新しい方式の
ABC回路によつて、画信号のシエーデイング歪
みに沿つて画信号レベルの大小を制御するので、
外部の影響を受けず、安定して精度の高いシエー
デイング歪み補正のなされた画信号を得るという
効果を有する。
ニング・モード操作時に動作するABC回路によ
つて、画信号が高いレベルで保持されるので、シ
エーデイング歪み補正係数が高精度で求められ、
又スキヤン・モード時に動作する新しい方式の
ABC回路によつて、画信号のシエーデイング歪
みに沿つて画信号レベルの大小を制御するので、
外部の影響を受けず、安定して精度の高いシエー
デイング歪み補正のなされた画信号を得るという
効果を有する。
第１図は画像装置において用いられるスキヤナ
のブロツク図、第２図は画像装置内に備え付けら
れるシエーデイング歪み補正装置のブロツク図、
第３図は本発明の一実施例によるシエーデイング
歪み補正装置のブロツク図である。 ２……Ａ／Ｄ変換器、３……乗算器、４……
ROM、５……RAM、６……積分回路、７……
減衰器、８……セレクタ、９……比較器、１０…
…積分回路、１１……原稿、１２……ランプ、１
４……CCDイメージセンサ。
のブロツク図、第２図は画像装置内に備え付けら
れるシエーデイング歪み補正装置のブロツク図、
第３図は本発明の一実施例によるシエーデイング
歪み補正装置のブロツク図である。 ２……Ａ／Ｄ変換器、３……乗算器、４……
ROM、５……RAM、６……積分回路、７……
減衰器、８……セレクタ、９……比較器、１０…
…積分回路、１１……原稿、１２……ランプ、１
４……CCDイメージセンサ。
Claims (1)
- １ スキヤナから入力されるアナログ画信号を減
衰させる減衰器と、この減衰器から出力されるア
ナログ画信号をデイジタル画信号に変換し出力す
るＡ／Ｄ変換手段と、補正係数データを記憶する
記憶手段と、前記Ａ／Ｄ変換手段から出力される
デイジタル画信号と前記記憶手段から読出される
補正係数データとを演算し、シエーデイング歪み
補正を施したデイジタル画信号を出力するととも
に、このデイジタル画信号のレベルの大小を判定
するオーバーフロー信号を出力するデイジタル演
算手段と、前記減衰器から出力されたアナログ画
信号のレベルと一定の固定レベルの大小を判定す
る判定信号を出力する比較手段と、トレーニング
モード時には前記判定信号の大小の状態により、
スキヤンモード時には前記オーバーフロー信号の
大小の状態により前記減衰器の減衰比を制御する
制御手段とを有するシエーデイング歪み補正装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59115066A JPS60259063A (ja) | 1984-06-05 | 1984-06-05 | シエ−デイング歪み補正装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59115066A JPS60259063A (ja) | 1984-06-05 | 1984-06-05 | シエ−デイング歪み補正装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60259063A JPS60259063A (ja) | 1985-12-21 |
| JPH0213508B2 true JPH0213508B2 (ja) | 1990-04-04 |
Family
ID=14653328
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59115066A Granted JPS60259063A (ja) | 1984-06-05 | 1984-06-05 | シエ−デイング歪み補正装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60259063A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2557867B2 (ja) * | 1987-01-28 | 1996-11-27 | キヤノン株式会社 | 画像読取装置 |
-
1984
- 1984-06-05 JP JP59115066A patent/JPS60259063A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60259063A (ja) | 1985-12-21 |
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| JPH0213509B2 (ja) |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |