JPH0214073B2 - - Google Patents

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JPH0214073B2
JPH0214073B2 JP56170798A JP17079881A JPH0214073B2 JP H0214073 B2 JPH0214073 B2 JP H0214073B2 JP 56170798 A JP56170798 A JP 56170798A JP 17079881 A JP17079881 A JP 17079881A JP H0214073 B2 JPH0214073 B2 JP H0214073B2
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JP
Japan
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reel
circuit
random number
vertical position
value
Prior art date
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JP56170798A
Other languages
Japanese (ja)
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JPS5873383A (en
Inventor
Otomatsu Kadota
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Taito Co Ltd
Original Assignee
Taito Co Ltd
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Publication date
Application filed by Taito Co Ltd filed Critical Taito Co Ltd
Priority to JP56170798A priority Critical patent/JPS5873383A/en
Publication of JPS5873383A publication Critical patent/JPS5873383A/en
Publication of JPH0214073B2 publication Critical patent/JPH0214073B2/ja
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Description

【発明の詳細な説明】[Detailed description of the invention]

本発明は電子式スロツトマシンに関する。 この電子式スロツトマシンは、陰極線管上にス
ロツトマシンのリールを表示し、所定のコイン又
はメダルが投入された後、レバーが引かれると、
このリールが回転する状態を表示し、次いで順次
リールの回転を止め、所定のペイライン上に整列
したキヤラクタの組み合わせに応じて所定のコイ
ン又はメダルを払い出すものであり、最近では古
くから親しまれていた機械式のスロツトマシンに
代つて広く普及しているものである。 然しながら、公知の電子式スロツトマシンは、
大容量高速のメモリと演算回路を用いており、そ
のため高価であつた。 本発明は叙上の観点に立つてなされたものであ
り、その目的とするところは、極めて小容量で安
価な回路要素から成る電子式スロツトマシンを提
供することにある。 以下図面により本発明の詳細を説明する。 図面は本発明にかかる電子式スロツトマシンの
一実施例を示すブロツク図であり、図中1は陰極
線管式デイスプレイ装置、2は補助デイスプレイ
装置、3はリール表示回路、4はコイン領収装
置、5はレバー装置、6は当り判定回路、7は褒
賞装置である。 而して、リール表示装置3は、CPU8、クロ
ツクパルス発振器9、三個の垂直ポジシヨンレジ
スタ10,11及び12、加算回路13、リール
パターンレジスタ14、キヤラクタメモリ15、
パラレルシリアル変換器16、電子銃制御信号発
生回路17,18,19及び乱数タイマ20から
成り、乱数タイマ20は、リフレツシユカウンタ
21、二乗回路22、バツフアレジスタ23、加
算器24及びプリセツトカウンタ25から成る。 また、当り判定回路6は当りROM26と比較
回路27とから成る。 リール表示回路3の出力により、デイスプレイ
装置1の画面には第1ないし第3のリール1a,
1b,1cが示されているが、図示されている状
態はゲームが行なわれていない待機状態であり、
各リールに表示されているキヤラクタはセブンの
みである。 本実施例において第1ないし第5のペイライン
1d,1e,1f,1g,1hが設けられてお
り、画面にはこれらのペイラインとそれに対応す
る倍率が表示されている。 第1のペイライン1dは中央の水平ライン、第
2及び第3のペイライン1e,1fは上方及び下
方の水平ライン、第4のペイライン1gは左上か
ら右下への斜めライン、第5のペイライン1hは
左下から右上への斜めラインであり、倍率は第1
ないし第4のペイラインは200、第5のペイライ
ンが3000となつている。 プレイヤがコインを投入し、一回のゲームで賭
るコイン数を指定すると、その数に応じて第1の
ペイラインから順次ペイラインが設定され、ハイ
ライト表示される。 また、補助デイスプレイ装置には各ペイライン
上に止つたキヤラクタの当りの組み合わせと倍率
その他のルールを表示するものである。 各リールには、例えばオレンジ、プラム、バ
ー、チエリー、ベル、セブン等のキヤラクタが適
宜に配分され一定の序列で並べられている。その
組合わせは例へば下表の如くである。
The present invention relates to electronic slot machines. This electronic slot machine displays the slot machine reels on a cathode ray tube, and when a predetermined coin or medal is inserted and a lever is pulled,
This system displays the state in which the reels are rotating, then stops the reels one after another, and pays out predetermined coins or medals according to the combination of characters lined up on a predetermined payline. It is widely used as an alternative to mechanical slot machines. However, known electronic slot machines
It used large-capacity, high-speed memory and arithmetic circuits, and was therefore expensive. The present invention has been made in view of the above, and its object is to provide an electronic slot machine comprising extremely small capacity and inexpensive circuit elements. The details of the present invention will be explained below with reference to the drawings. The drawing is a block diagram showing one embodiment of the electronic slot machine according to the present invention, and in the drawing, 1 is a cathode ray tube type display device, 2 is an auxiliary display device, 3 is a reel display circuit, 4 is a coin receiving device, and 5 is a A lever device, 6 a hit determination circuit, and 7 a reward device. The reel display device 3 includes a CPU 8, a clock pulse oscillator 9, three vertical position registers 10, 11 and 12, an adder circuit 13, a reel pattern register 14, a character memory 15,
It consists of a parallel-to-serial converter 16, electron gun control signal generation circuits 17, 18, 19, and a random number timer 20. The random number timer 20 includes a refresh counter 21, a squaring circuit 22, a buffer register 23, an adder 24, and a preset counter. Consists of 25. Further, the winning determination circuit 6 includes a winning ROM 26 and a comparison circuit 27. By the output of the reel display circuit 3, the first to third reels 1a,
1b and 1c are shown, but the state shown is a standby state where no game is being played.
Seven is the only character displayed on each reel. In this embodiment, first to fifth paylines 1d, 1e, 1f, 1g, and 1h are provided, and these paylines and their corresponding magnifications are displayed on the screen. The first payline 1d is a central horizontal line, the second and third paylines 1e and 1f are upper and lower horizontal lines, the fourth payline 1g is a diagonal line from the upper left to the lower right, and the fifth payline 1h is a horizontal line from the upper left to the lower right. It is a diagonal line from the bottom left to the top right, and the magnification is the first
The fourth payline is 200, and the fifth payline is 3000. When the player inserts coins and specifies the number of coins to bet in one game, paylines are sequentially set from the first payline according to the number and are highlighted. In addition, the auxiliary display device displays the winning combinations of characters that land on each payline, the multipliers, and other rules. On each reel, characters such as orange, plum, bar, cheery, bell, and seven are appropriately distributed and arranged in a certain order. For example, the combinations are as shown in the table below.

【表】【table】

【表】 以下、リール表示回路3の作用について説明す
る。 キヤラクタメモリ15には使用するすべてのパ
ターンのキヤラクタデータが記録されている。 ここでパターンとはリール上に表わされる図形
であり、本実施例では前述のオレンジ、プラム、
バー、チエリー、ベル及びセブンの図形を指すも
のとし、キヤラクタデータとは、これらの図形を
表示するためキヤラクタメモリ15に記録された
データであり、このデータを読み出すと、それぞ
れ対応する図形を現出させるため必要なビデオ信
号が得られるものである。 リールパターンレジスタ14には、三個のリー
ル1a,1b,1c上にそれぞれ表示すべきパタ
ーンを指定するデータが入力する。前掲の表に示
した如く、リールの一回転に相当するパターンの
序列はあらかじめプログラムされているが、その
なかから順次輪番的に選ばれる1リール当り4パ
ターン分のデータのみがこのレジスタにストアさ
れる。 画像が静止しているときは、画面には1リール
当り3つのパターンのみが表われ、最上位の1パ
ターンはスクリーン外となつていて(又は適宜の
マスクをして)見えないようになつているが、レ
バー装置5のレバーが引かれ、リールの回転が始
まり、画像が下方に移動し始めると、最上位でス
クリーン外にあつたパターンも下方から順次スク
リーン内に入り、見えるようになる。 一方、最下位にあつたパターンがスクリーンか
ら消えると、リールパターンレジスタ14はシフ
トされ、同時に新たな最上位のパターンデータを
受入れる。 このように、リールパターンレジスタ14は、
キヤラクタメモリ15から読み出すべきキヤラク
タデータを指定し、各リール上に所定の順序でキ
ヤラクタを排列、表示させるものである。 垂直ポジシヨンレジスタ10,11,12はそ
れぞれリール1a,1b,1cに対応して設けら
れるもので、リール画像を回転させるため設けら
れるものである。 これらの垂直ポジシヨンレジスタには、例えば
各パターンが走査線32本分の高さを与えられてい
るものとすると、32の範囲で周期的に変化する数
値が与えられる。さらに具体的に説明すると、例
えば、始めに64をセツトし、これを所望の速度で
減数し、これが32となつたら64に戻し、以下同様
に変化させるものである。 これら3個のレジスタは同期して駆動されるの
ではなく、別個に駆動され、その減数速度も必ず
しも同一でないが、これが停止する際は、その計
数値はいずれも32とされるものである。 而して、これらの垂直ポジシヨンレジスタ1
0,11,12の計数値は、加算回路13によ
り、CPU8から送られるスキヤン信号に加算さ
れ、そのため、スキヤン信号に応じてキヤラクタ
メモリ15から読み出されるデータは、本来のス
キヤン信号のみによつて読出されるデータとは異
なり、それぞれ対応する垂直ポジシヨンレジスタ
の計数値に対応する走査線数だけシフトされた位
置に表われることになる。 而して、このシフトはそれぞれのリール毎に行
なわれ、かつ、そのシフト量が個別に変えられる
ので、垂直ポジシヨンレジスタが作動中はリール
はそれぞれ個別に回転しているように見える。 而して、いずれか一つのリールで最下位のパタ
ーンがスクリーン外に消えると、対応する垂直ポ
ジシヨンレジスタの数値が32となり、自動的に64
に戻されるが、このときは同時に、リールパター
ンレジスタ14の対応部分がシフトされ、新しい
最上位パターンデータが入力するので、リールは
引続き回転しているように見える。 この垂直ポジシヨンレジスタ10,11,12
の作動は乱数タイマ20が作動している間持続さ
れる。 而して、この乱数タイマ20が第1回目の作動
を停止すると、第1のリール1aを制御する垂直
ポジシヨンレジスタ10のカウント速度はあらか
じめ定められたプログラムに従つて次第に減速せ
しめられ、やがて停止せしめられるが、乱数タイ
マ20は直ちに第2回目の作動を開始する。その
第2回目の作動停止時には第2のリール1bを制
御する垂直ポジシヨンレジスタ11が減速され停
止するが同時に乱数タイマ20は第三回目の作動
を開始し、その第3回目の作動停止により第3回
のリール1cを制御する垂直ポジシヨンレジスタ
12が減速、停止せしめられる。但し、上記いず
れのレジスタも停止時の記録値は32とされる。 次に乱数タイマ20について説明する。 リフレツシユカウンタ21はCPU8が一つの
命令を実行する都度1が加算される8ビツトのカ
ウンタである。 このリフレツシユカウンタ21の数値は二乗回
路22により二乗され、その中央の8ビツト分の
数値がバツフアレジスタ23に記録される。 なお、この二乗回路22とバツフアレジスタ2
3とは別個のものでなくともよく、また必ずしも
正確な二乗演算を行う必要もないので、上記と略
同等の演算が可能な他の回路でも代用し得るもの
である。 このリフレツシユカウンタ21と二乗回路22
は乱数発生回路として利用されるものである。従
つて、これらはまた他の公知の乱数発生回路で代
替され得る。 バツフアレジスタ23の数値は、場合によつて
は零又は零に近い数値となることがあるが、それ
では不都合が生じるので、加算器24により所定
の最小時限に相当する一定数を加算し、これをプ
リセツトカウンタ25にセツトする。本実施例で
は180(二進数で10110100)が加算されている。 また、このときの加算器24の出力はリフレツ
シユカウンタ21に戻される。但し、このときは
二乗回路22、は作動しない。リフレツシユカウ
ンタ21はCPU8が1つの命令を処理する都度
1づつカウントアツプする。 プリセツトカウンタ25は、CPU8から送ら
れるクロツクパルスでカウントダウンし、その計
数値が零となると出力パルスを発信する。 その出力パルスは一方においてはCPU8を介
して垂直ポジシヨンレジスタ10の作動を減速し
次第に停止させると共に、他の一方において二乗
回路22を作動させ、叙上のプロセスにより再び
新しい乱数をプリセツトカウンタ25にセツト
し、乱数タイマ20を再起動させるものである。 このとき、垂直ポジシヨンレジスタ10に与え
られる駆動パルスの周波数はあらかじめ定められ
たプログラムに従つて順次低下せしめられ、それ
が所定の限界値以下となつた後、垂直ポジシヨン
レジスタ10の計数値が32に達すると上記駆動
パルスが遮断され、垂直ポジシヨンレジスタ10
が停止する。 而して乱数タイマ20が二回目の作動を停止す
ると、上記と同様にして垂直ポジシヨンレジスタ
11が停止し、乱数タイマ20はさらに三回目の
作動を開始する。 乱数タイマ20が三回目の作動を停止すると、
このときは垂直ポジシヨンレジスタ12は前記と
同様にして作動を停止するが、乱数タイマ20は
もはや再起動しない。 而して、このときは、CPU8が、比較回路2
7を作動させ、リールパターンレジスタ14に記
録されている各リールのパターンデータのうちか
ら、賭が行なわれているペイライン上にデイスプ
レイされているパターンを示すデータを読み出さ
せ、当りROM26に記録されている当り組合わ
せと比較させ、一致を発見したときは、それに対
応する当り信号を発生させ、褒賞装置7を作動さ
せるものである。 而して、リールパターンレジスタ14は、12の
パターンデータを記録できればよく、垂直ポジシ
ヨンレジスタ10,11,12は実質上6ビツト
のレジスタでよいものであり、キヤラクタメモリ
15、当りROM26も必要最少限の容量で足り
るから、本発明によるときは安価電子式スロツト
マシンを提供できるものである。 なお、本発明の構成は叙上の実施例に限定され
るものでなく、画面に表わすリールやパターンの
数及びキヤラクタは自由選定できるものであり、
また乱数タイマ用の乱数発生回路も自由に設計変
更できるものであつて、本発明はそれらのすべて
を包摂するものである。
[Table] The operation of the reel display circuit 3 will be explained below. Character data of all patterns to be used are recorded in the character memory 15. Here, the pattern is a figure displayed on the reels, and in this example, the above-mentioned orange, plum,
Character data refers to the shapes of bar, cherry, bell, and seven, and character data is data recorded in the character memory 15 to display these shapes. When this data is read, the corresponding shapes are displayed. This allows you to obtain the video signal necessary for displaying the image. Data specifying patterns to be displayed on the three reels 1a, 1b, and 1c is input to the reel pattern register 14. As shown in the table above, the sequence of patterns corresponding to one rotation of the reel is programmed in advance, but only data for four patterns per reel, which are selected in rotation from among them, are stored in this register. Ru. When the image is static, only three patterns per reel appear on the screen, and the top one pattern is hidden from view (or by an appropriate mask). However, when the lever of the lever device 5 is pulled, the reels begin to rotate, and the image begins to move downward, the patterns that were outside the screen at the top also enter the screen sequentially from the bottom and become visible. On the other hand, when the lowest pattern disappears from the screen, the reel pattern register 14 is shifted and simultaneously accepts the new highest pattern data. In this way, the reel pattern register 14 is
Character data to be read from the character memory 15 is specified, and the characters are arranged and displayed in a predetermined order on each reel. Vertical position registers 10, 11, and 12 are provided corresponding to reels 1a, 1b, and 1c, respectively, and are provided for rotating reel images. These vertical position registers are given numerical values that periodically change within a range of 32, assuming that each pattern is given a height of 32 scanning lines, for example. To explain more specifically, for example, 64 is first set, this value is decremented at a desired speed, and when it reaches 32, it is returned to 64, and the following changes are made in the same manner. These three registers are not driven synchronously, but are driven separately, and their decrement rates are not necessarily the same, but when they stop, their count values are all set to 32. Therefore, these vertical position registers 1
The count values of 0, 11, and 12 are added to the scan signal sent from the CPU 8 by the adder circuit 13, so that the data read out from the character memory 15 in response to the scan signal is only based on the original scan signal. Unlike the read data, the data appears at a position shifted by the number of scanning lines corresponding to the count value of the corresponding vertical position register. Since this shift is performed for each reel and the amount of shift is changed individually, each reel appears to be rotating independently while the vertical position register is in operation. Therefore, when the lowest pattern on any one reel disappears off the screen, the corresponding vertical position register value becomes 32 and automatically changes to 64.
However, at this time, the corresponding portion of the reel pattern register 14 is simultaneously shifted and new top pattern data is input, so that the reels appear to continue rotating. This vertical position register 10, 11, 12
The operation continues while the random number timer 20 is operating. When the random number timer 20 stops operating for the first time, the counting speed of the vertical position register 10 that controls the first reel 1a is gradually decelerated according to a predetermined program, and then stops. However, the random number timer 20 immediately starts its second operation. When the second reel 1b is stopped, the vertical position register 11 that controls the second reel 1b is decelerated and stopped, but at the same time the random number timer 20 starts the third operation. The vertical position register 12 that controls the three reels 1c is decelerated and stopped. However, the recorded value of any of the above registers when stopped is 32. Next, the random number timer 20 will be explained. The refresh counter 21 is an 8-bit counter that is incremented by 1 each time the CPU 8 executes one instruction. The value of this refresh counter 21 is squared by a squaring circuit 22, and the central 8-bit value is recorded in a buffer register 23. Note that this squaring circuit 22 and buffer register 2
It is not necessary to use a separate circuit from 3, and it is not necessary to perform accurate squaring calculations, so other circuits that can perform substantially the same calculations as those described above can be used instead. This refresh counter 21 and square circuit 22
is used as a random number generation circuit. Therefore, these may also be replaced with other known random number generation circuits. The value in the buffer register 23 may be zero or a value close to zero in some cases, but since this may cause problems, an adder 24 adds a constant number corresponding to a predetermined minimum time limit. is set in the preset counter 25. In this embodiment, 180 (10110100 in binary) is added. Further, the output of the adder 24 at this time is returned to the refresh counter 21. However, at this time, the squaring circuit 22 does not operate. The refresh counter 21 counts up by 1 each time the CPU 8 processes one instruction. The preset counter 25 counts down with a clock pulse sent from the CPU 8, and when the count reaches zero, it emits an output pulse. The output pulse, on the one hand, decelerates and gradually stops the operation of the vertical position register 10 via the CPU 8, and on the other hand activates the squaring circuit 22, which again generates a new random number into the preset counter 25 by the process described above. , and restarts the random number timer 20. At this time, the frequency of the drive pulse applied to the vertical position register 10 is sequentially lowered according to a predetermined program, and after the frequency falls below a predetermined limit value, the count value of the vertical position register 10 is 32, the drive pulse is cut off and the vertical position register 10
stops. When the random number timer 20 stops operating for the second time, the vertical position register 11 stops in the same manner as described above, and the random number timer 20 starts operating for the third time. When the random number timer 20 stops operating for the third time,
At this time, the vertical position register 12 stops operating in the same manner as before, but the random number timer 20 no longer restarts. Therefore, at this time, the CPU 8 uses the comparator circuit 2.
7 to read out the data indicating the pattern displayed on the payline on which the bet is being made from among the pattern data of each reel recorded in the reel pattern register 14, and read the data indicating the pattern displayed on the payline on which the bet is being made, When a match is found, a corresponding winning signal is generated and the reward device 7 is activated. Therefore, the reel pattern register 14 only needs to be able to record 12 pattern data, and the vertical position registers 10, 11, and 12 can be substantially 6-bit registers, and the character memory 15 and per ROM 26 are also required. Since the minimum capacity is sufficient, the present invention can provide an inexpensive electronic slot machine. Note that the configuration of the present invention is not limited to the embodiments described above, and the number and characters of reels and patterns displayed on the screen can be freely selected.
Furthermore, the design of the random number generation circuit for the random number timer can be freely changed, and the present invention encompasses all of them.

【図面の簡単な説明】[Brief explanation of drawings]

図面は本発明にかかる電子式スロツトマシンの
一実施例を示すブロツクダイヤグラムである。 1……陰極線管式デイスプレイ装置、2……補
助デイスプレイ装置、3……リール表示回路、4
……コイン領収装置、5……レバー装置、6……
当り判定回路、7……褒賞装置、10,11,1
2……垂直ポジシヨンレジスタ、13……加算回
路、14……リールパターンレジスタ、15……
キヤラクタメモリ、20……乱数タイマ。
The drawing is a block diagram showing one embodiment of an electronic slot machine according to the present invention. 1... Cathode ray tube display device, 2... Auxiliary display device, 3... Reel display circuit, 4
... Coin receipt device, 5 ... Lever device, 6 ...
Hit determination circuit, 7... Reward device, 10, 11, 1
2... Vertical position register, 13... Addition circuit, 14... Reel pattern register, 15...
Character memory, 20...Random number timer.

Claims (1)

【特許請求の範囲】 1 陰極線管と、それぞれ多数のキヤラクタを順
次エンドレスに連結して成る複数の画像リールの
画像の一部を互いに平行に排列し、かつ各画像リ
ールの一つのキヤラクタの画像を所定のゲーム線
上に一列に整列させて表示するため必要なビデオ
信号を発生すると共に、プレイヤの操作に応動し
てリールが回転して見えるよう上記陰極線管面上
のリール画像を各リール毎に個別に一定方向に移
動、循環させ、かつ、順次その移動速度を減少さ
せ、各リール毎にランダムに選んだ一つのキヤラ
クタの画像を上記ペイライン上に停止させるため
必要なビデオ信号を発生するリール表示回路と、
上記ゲーム線上に整列したキヤラクタの組合せに
対応しあらかじめ定められた当り及び外れ信号を
発生する当り判別回路と、上記当り判別回路が当
り信号を発したときはその当り信号に応動して所
定の褒賞を与える褒賞装置とから成る電子式スロ
ツトマシンにおいて、 そのリール表示回路が下記(a)項ないし(e)項記載
の構成要素を具備する上記の電子式スロツトマシ
ン。 (a) あらかじめ定められたプログラムに従つて、
各リール上に表示すべきパターンを指定するデ
ータが順次入力し、現に表示されるパターンの
データを保持するリールパターンレジスタ。 (b) 用いられるすべてのパターンのキヤラクタデ
ータが記録されたキヤラクタメモリ。 (c) 各リールに対応して設けられ、それぞれ与え
られる計数値が、二つの限界値の一方から他方
に所望の速度で変更され、上記他方の限界値に
達したときはもとの一方の限界値に戻され、以
下同様にしてその計数値が循環的に変えられる
垂直ポジシヨンレジスタ。 (d) 垂直スキヤン信号に、上記垂直ポジシヨンレ
ジスタの記録値を加算する加算回路。 (e) 乱数発生回路と、その乱数発生回路が発生し
た乱数に一定値を加える加算回路と、その加算
回路の出力値がセツトされ、所定のクロツクパ
ルスにより駆動されるプリセツトカウンタとか
ら成り、上記垂直ポジシヨンレジスタの作動時
間を制御する乱数タイマ。
[Scope of Claims] 1. A cathode ray tube and a plurality of image reels each consisting of a plurality of characters connected in sequence in an endless manner. Parts of the images are arranged parallel to each other, and the image of one character on each image reel is arranged in parallel with each other. In addition to generating the necessary video signals to display the reels aligned in a line on a predetermined game line, the reel images on the cathode ray tube surface are individually displayed for each reel so that the reels appear to rotate in response to player operations. a reel display circuit that generates a video signal necessary to move and circulate in a certain direction, sequentially reduce the moving speed, and stop an image of one randomly selected character on each reel on the payline. and,
A win determination circuit that generates predetermined win and loss signals corresponding to the combination of characters arranged on the game line, and when the win determination circuit generates a win signal, a predetermined reward is given in response to the win signal. an electronic slot machine comprising a reward device for giving a prize, the reel display circuit of which comprises the components described in paragraphs (a) to (e) below. (a) in accordance with a predetermined program;
A reel pattern register that sequentially inputs data specifying the pattern to be displayed on each reel and holds the data of the pattern currently displayed. (b) Character memory in which character data of all patterns used are recorded. (c) When the count value provided corresponding to each reel and given to each reel is changed from one of the two limit values to the other at the desired speed, and when the other limit value is reached, the count value is changed to the original one. A vertical position register which is returned to a limit value and whose count value is changed cyclically in the same way. (d) An addition circuit that adds the recorded value of the vertical position register to the vertical scan signal. (e) Consisting of a random number generation circuit, an addition circuit that adds a fixed value to the random number generated by the random number generation circuit, and a preset counter to which the output value of the addition circuit is set and driven by a predetermined clock pulse, A random number timer that controls the activation time of the vertical position register.
JP56170798A 1981-10-27 1981-10-27 Reel display of electronic throttle machine Granted JPS5873383A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56170798A JPS5873383A (en) 1981-10-27 1981-10-27 Reel display of electronic throttle machine

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP56170798A JPS5873383A (en) 1981-10-27 1981-10-27 Reel display of electronic throttle machine

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Publication Number Publication Date
JPS5873383A JPS5873383A (en) 1983-05-02
JPH0214073B2 true JPH0214073B2 (en) 1990-04-06

Family

ID=15911543

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JP56170798A Granted JPS5873383A (en) 1981-10-27 1981-10-27 Reel display of electronic throttle machine

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