JPH0216049B2 - - Google Patents
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- JPH0216049B2 JPH0216049B2 JP56041082A JP4108281A JPH0216049B2 JP H0216049 B2 JPH0216049 B2 JP H0216049B2 JP 56041082 A JP56041082 A JP 56041082A JP 4108281 A JP4108281 A JP 4108281A JP H0216049 B2 JPH0216049 B2 JP H0216049B2
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- Japan
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- channel
- pin
- operation switches
- light emitting
- transistor
- Prior art date
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J1/00—Details of adjusting, driving, indicating, or mechanical control arrangements for resonant circuits in general
- H03J1/02—Indicating arrangements
- H03J1/04—Indicating arrangements with optical indicating means
- H03J1/045—Indication of the tuning band, the bandwidth, tone control, the channel number, the frequency, or the like
- H03J1/047—Indication of the tuning band, the bandwidth, tone control, the channel number, the frequency, or the like using electronic means, e.g. LED's
- H03J1/048—Indication of the tuning band, the bandwidth, tone control, the channel number, the frequency, or the like using electronic means, e.g. LED's with digital indication
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- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Description
【発明の詳細な説明】
本発明はテレビジヨン受像機やビデオテープレ
コーダ等の選局回路に関するものである。
コーダ等の選局回路に関するものである。
最近の選局回路は選局用ICとその外付け回路
とにより構成されているのが普通であり、前記外
付け回路としてはチヤンネル表示機能も含む。
とにより構成されているのが普通であり、前記外
付け回路としてはチヤンネル表示機能も含む。
第１図は従来の斯種選局回路を示しており、１
はNEC社製の選局用IC（品番μPC1363C）であり、
１番ピンから11番ピン及び19番ピンから24
番ピンまでのチヤンネル設定用出力端子ピンを
有しているが、ここでは20番ピン〜23番ピン〓〓
は他の外付け端子の19番ピンと共に抵抗R13を
介して12Vの電源ライン２に接続して不使用状態
としている。前記各端子ピンとチヤンネルK1〜
〜K16との対応関係は図示のようにとつている
が、このうち、K13〜K16は上述の通り不使用と
なる。ピン〜及びは各チヤンネルの操作ス
イツチS1〜S12とチヤンネル表示用発光ダイオー
ドD21〜D32との接続点にそれぞれ結合されるが、
図ではピンについてのみ接続状態を示し
ていて他は省略している。IC１の18番ピンは
IC１を駆動するトランジスタQ4のエミツタと平
滑コンデンサC2との接続点に結合され、17番ピ
ンは発振回路の時定数、従つて発振周波数（例
えば2KHz）を決定する抵抗R14とコンデンサC4
に接続されている。チヤンネルシフトをチヤンネ
ルの低いところから高い方へ行なわせるための16
番ピンと、チヤンネルシフトをチヤンネルの高
いところから低い方へ行なわせるための15番ピン
は12V電源ライン２とアース間に接続された抵
抗R15とコンデンサC3の接続点に結合され一定電
位に保持されることにより不使用状態におかれて
いる。14番ピンはIC１の電源入力端子であり、
前記12Vの電源ライン２に接続されている。13番
ピンはチヤンネル切換え時にローレベルとなる
端子であつて、ここではチヤンネル切換え時にチ
ヤンネル表示用発光ダイオードD21〜D32の点灯
を消すように用いている。即ち、13番ピンを抵
抗R9のコールド側に接続すると共に、抵抗R8と
R9の接続点にベースが結合されたPNPトランジ
スタQ3、及び前記トランジスタQ3のコレクタ負
荷抵抗R7に生じる電圧を抵抗R6を介して受ける
NPNトランジスタQ2をオンせしめることによ
り、イ点をアースレベルに落し、それによつて発
光ダイオードD21〜D32を全てオフ状態になす。
発光ダイオードD21〜D32と直列に入つているダ
イオードD41〜D52は逆耐圧用であり、D61〜D72
は逆流防止用ダイオード、VR1〜VR12はチユー
ニング電圧設定ボリウム、SW1〜SW12はバンド
切換え用スイツチ、BL，BH，BUはバンド切換え
用電圧を出力する端子で、その出力は端子BL，
BH，BUを通してチユーナ（図示せず）に印加さ
れる。D81，D92は逆流防止ダイオードである。
Q1はチユーニング電圧出力トランジスタであり、
チユーニング電圧はエミツタ抵抗R2から電流制
御抵抗R3を通してチユーニング電圧出力端子３
に導出される。この端子３はチユーナのチユーニ
ング電圧供給端子（図示せず）と結合される。４
は32V電源ライン５に32Vの直流電圧を与える端
子、６は12V電源ライン２に12Vの直流電圧を与
える端子、R4，C1はノイズ除去フイルタを形成
する抵抗及びコンデンサ、R1は電流制限抵抗で
ある。
はNEC社製の選局用IC（品番μPC1363C）であり、
１番ピンから11番ピン及び19番ピンから24
番ピンまでのチヤンネル設定用出力端子ピンを
有しているが、ここでは20番ピン〜23番ピン〓〓
は他の外付け端子の19番ピンと共に抵抗R13を
介して12Vの電源ライン２に接続して不使用状態
としている。前記各端子ピンとチヤンネルK1〜
〜K16との対応関係は図示のようにとつている
が、このうち、K13〜K16は上述の通り不使用と
なる。ピン〜及びは各チヤンネルの操作ス
イツチS1〜S12とチヤンネル表示用発光ダイオー
ドD21〜D32との接続点にそれぞれ結合されるが、
図ではピンについてのみ接続状態を示し
ていて他は省略している。IC１の18番ピンは
IC１を駆動するトランジスタQ4のエミツタと平
滑コンデンサC2との接続点に結合され、17番ピ
ンは発振回路の時定数、従つて発振周波数（例
えば2KHz）を決定する抵抗R14とコンデンサC4
に接続されている。チヤンネルシフトをチヤンネ
ルの低いところから高い方へ行なわせるための16
番ピンと、チヤンネルシフトをチヤンネルの高
いところから低い方へ行なわせるための15番ピン
は12V電源ライン２とアース間に接続された抵
抗R15とコンデンサC3の接続点に結合され一定電
位に保持されることにより不使用状態におかれて
いる。14番ピンはIC１の電源入力端子であり、
前記12Vの電源ライン２に接続されている。13番
ピンはチヤンネル切換え時にローレベルとなる
端子であつて、ここではチヤンネル切換え時にチ
ヤンネル表示用発光ダイオードD21〜D32の点灯
を消すように用いている。即ち、13番ピンを抵
抗R9のコールド側に接続すると共に、抵抗R8と
R9の接続点にベースが結合されたPNPトランジ
スタQ3、及び前記トランジスタQ3のコレクタ負
荷抵抗R7に生じる電圧を抵抗R6を介して受ける
NPNトランジスタQ2をオンせしめることによ
り、イ点をアースレベルに落し、それによつて発
光ダイオードD21〜D32を全てオフ状態になす。
発光ダイオードD21〜D32と直列に入つているダ
イオードD41〜D52は逆耐圧用であり、D61〜D72
は逆流防止用ダイオード、VR1〜VR12はチユー
ニング電圧設定ボリウム、SW1〜SW12はバンド
切換え用スイツチ、BL，BH，BUはバンド切換え
用電圧を出力する端子で、その出力は端子BL，
BH，BUを通してチユーナ（図示せず）に印加さ
れる。D81，D92は逆流防止ダイオードである。
Q1はチユーニング電圧出力トランジスタであり、
チユーニング電圧はエミツタ抵抗R2から電流制
御抵抗R3を通してチユーニング電圧出力端子３
に導出される。この端子３はチユーナのチユーニ
ング電圧供給端子（図示せず）と結合される。４
は32V電源ライン５に32Vの直流電圧を与える端
子、６は12V電源ライン２に12Vの直流電圧を与
える端子、R4，C1はノイズ除去フイルタを形成
する抵抗及びコンデンサ、R1は電流制限抵抗で
ある。
次に、この従来回路の動作を説明する。今、１
チヤンネルを選局するべく操作スイツチS1をオン
すると32V電源ライン５→抵抗R4→ボリウムVR1
→操作スイツチS1→抵抗R12→抵抗R11→アース
の経路で電流が流れてIC駆動トランジスタ１の
ベースバイアスが与えられて該トランジスタQ4
がオンしIC１の18第ピンがハイレベルになる
のでIC１内のシフトパルス発生用発振回路が発
振を始めると共に13番ピンがローレベルとな
る。前記シフトパルスの発生によりIC１の出力
端子ピンのローレベル状態が順次歩進して11番ピ
ンがローレベルになると前記発振が停止し、11
番ピンのローレベル状態が確保される。例えば
１チヤンネルに切換える前の選局状態が９チヤン
ネル受信状態であつたとすると、３番ピンのロ
ーレベル状態は２番ピン→１番ピン→24番ピ
ン→11番ピンへと順次歩進し、11番ピンを
ローレベルにすると、このローレベルは操作スイ
ツチS1を通して駆動トランジスタQ4のベース電
位に印加されるので該駆動トランジスタQ4がオ
フとなつて18番ピンはオフになり、これに伴な
いIC１の発振が停止し前記ローレベルの歩進は
11番ピンで停止する。このチヤンネル切換えの
間、換言すれば前記発振が行なわれている間、13
番ピンはローレベルであるから、トランジスタ
Q3，Q2がオンし、イ点がアースされるので発光
ダイオードD21〜D32は全て消灯状態におかれる。
11番ピンのローレベル時はダイオードD61がオ
ンしてボリウムVR1で設定された電圧が出力トラ
ンジスタQ1を介してチユーニング電圧出力端子
３に現われる。同時にダイオードD81の導通によ
り、バンド切換えスイツチSW1により選ばれてい
るハイバンド出力端子BHにバンド切換え用信号
が生じる。一方チヤンネル表示についてはダイオ
ードD41及び発光ダイオードD21が導通して発光
ダイオードD21が点灯状態〔尚、トランジスタ
Q3，Q2はオフ状態になつていてイ点はハイレベ
ルに復帰している〕になり１チヤンネルの選局表
示がなされる。
チヤンネルを選局するべく操作スイツチS1をオン
すると32V電源ライン５→抵抗R4→ボリウムVR1
→操作スイツチS1→抵抗R12→抵抗R11→アース
の経路で電流が流れてIC駆動トランジスタ１の
ベースバイアスが与えられて該トランジスタQ4
がオンしIC１の18第ピンがハイレベルになる
のでIC１内のシフトパルス発生用発振回路が発
振を始めると共に13番ピンがローレベルとな
る。前記シフトパルスの発生によりIC１の出力
端子ピンのローレベル状態が順次歩進して11番ピ
ンがローレベルになると前記発振が停止し、11
番ピンのローレベル状態が確保される。例えば
１チヤンネルに切換える前の選局状態が９チヤン
ネル受信状態であつたとすると、３番ピンのロ
ーレベル状態は２番ピン→１番ピン→24番ピ
ン→11番ピンへと順次歩進し、11番ピンを
ローレベルにすると、このローレベルは操作スイ
ツチS1を通して駆動トランジスタQ4のベース電
位に印加されるので該駆動トランジスタQ4がオ
フとなつて18番ピンはオフになり、これに伴な
いIC１の発振が停止し前記ローレベルの歩進は
11番ピンで停止する。このチヤンネル切換えの
間、換言すれば前記発振が行なわれている間、13
番ピンはローレベルであるから、トランジスタ
Q3，Q2がオンし、イ点がアースされるので発光
ダイオードD21〜D32は全て消灯状態におかれる。
11番ピンのローレベル時はダイオードD61がオ
ンしてボリウムVR1で設定された電圧が出力トラ
ンジスタQ1を介してチユーニング電圧出力端子
３に現われる。同時にダイオードD81の導通によ
り、バンド切換えスイツチSW1により選ばれてい
るハイバンド出力端子BHにバンド切換え用信号
が生じる。一方チヤンネル表示についてはダイオ
ードD41及び発光ダイオードD21が導通して発光
ダイオードD21が点灯状態〔尚、トランジスタ
Q3，Q2はオフ状態になつていてイ点はハイレベ
ルに復帰している〕になり１チヤンネルの選局表
示がなされる。
ところで操作スイツチはタツチプレートで形成
されて全チヤンネル分が比較的密に揃列されてい
る場合が多いので同時に複数個のタツチプレート
に触れることがありうるが、このように複数個の
操作スイツチを同時に操作した場合、第１図の従
来例ではその複数のチヤンネルの表示系に電流が
流れ損失となる。
されて全チヤンネル分が比較的密に揃列されてい
る場合が多いので同時に複数個のタツチプレート
に触れることがありうるが、このように複数個の
操作スイツチを同時に操作した場合、第１図の従
来例ではその複数のチヤンネルの表示系に電流が
流れ損失となる。
第２図は前記従来回路において１チヤンネルと
２チヤンネルの操作スイツチS1，S2を同時に操作
した場合を示しており、操作当初は32V電源ライ
ン５からボリウムVR1，VR2及び操作スイツチ
S1，S2を通して抵抗R12，R11に電流が流れて駆
動トランジスタQ4がオンし、IC１のチヤンネル
シフトが11番ピンに至ると11番ピンでシフト
が停止し12V電源ライン２のイ点も電圧復帰する
が操作スイツチS1，S2は操作継続されているから
発光ダイオードD21から11番ピンに流れ込む１
チヤンネル表示電流だけでなく、発光ダイオード
D22から操作スイツチS2，S1を経由して11番ピン
に流れ込む２チヤンネル表示電流も流れてしま
うのである（勿論、この２チヤンネル表示電流は
操作スイツチの操作解除に伴なつて流れなくな
る。） 本発明は複数の操作手段を同時に操作した場合
におけるチヤンネル表示系の電流を制限するよう
に工夫した選局回路を提案するものである。
２チヤンネルの操作スイツチS1，S2を同時に操作
した場合を示しており、操作当初は32V電源ライ
ン５からボリウムVR1，VR2及び操作スイツチ
S1，S2を通して抵抗R12，R11に電流が流れて駆
動トランジスタQ4がオンし、IC１のチヤンネル
シフトが11番ピンに至ると11番ピンでシフト
が停止し12V電源ライン２のイ点も電圧復帰する
が操作スイツチS1，S2は操作継続されているから
発光ダイオードD21から11番ピンに流れ込む１
チヤンネル表示電流だけでなく、発光ダイオード
D22から操作スイツチS2，S1を経由して11番ピン
に流れ込む２チヤンネル表示電流も流れてしま
うのである（勿論、この２チヤンネル表示電流は
操作スイツチの操作解除に伴なつて流れなくな
る。） 本発明は複数の操作手段を同時に操作した場合
におけるチヤンネル表示系の電流を制限するよう
に工夫した選局回路を提案するものである。
つまり、本発明は、一端に第１の電源電圧が印
加されたチヤンネル表示用発光素子D21〜D32に
直列にチヤンネル操作スイツチS1〜S12を接続し、
この直列回路を各チヤンネルごとに設け、 駆動端子KINに制御信号が入力されると各チ
ヤンネルに対応する複数の出力端子K1〜K12を順
次アースレベルとする選局用IC１を備え、 前記各チヤンネルごとに設けられた前記複数の
チヤンネル発光素子D21〜D32と前記複数のチヤ
ンネル操作スイツチS1〜S12との間の複数の接続
中点を前記対応する選局用IC１のの出力端子K1
〜K12に接続し、 前記複数の接続中点に第２の電源電圧を複数の
抵抗R4，VR1〜VR12を介して夫々供給し、 前記複数のチヤンネル操作スイツチS1〜S12の
他端を前記駆動端子KINを駆動するための１個
の駆動用トランジスタQ4の制御電極に接続し、 前記チヤンネル操作スイツチS1〜S12の操作に
より制御信号を作成し前記駆動用トランジスタ
Q4の制御電圧に入力して、前記選局用IC１を動
作せしめ、 操作したチヤンネル操作スイツチS1〜S12に対
応する前記出力端子K1〜K13をアースレベルとす
ることにより前記駆動用トランジスタQ4への制
御信号の入力を停止せしめると共に、対応する前
記チヤンネル表示用発光素子D21〜D32を発光せ
しめる選局回路に於いて、 前記複数の接続中点と前記制御電極間に、 前記複数のチヤンネル操作スイツチS1〜S12に
直列に複数の電流制限抵抗R21〜R32を設けると
共に、前記制御電極の入力側にコンデンサC5を
挿入したことを特徴とする。
加されたチヤンネル表示用発光素子D21〜D32に
直列にチヤンネル操作スイツチS1〜S12を接続し、
この直列回路を各チヤンネルごとに設け、 駆動端子KINに制御信号が入力されると各チ
ヤンネルに対応する複数の出力端子K1〜K12を順
次アースレベルとする選局用IC１を備え、 前記各チヤンネルごとに設けられた前記複数の
チヤンネル発光素子D21〜D32と前記複数のチヤ
ンネル操作スイツチS1〜S12との間の複数の接続
中点を前記対応する選局用IC１のの出力端子K1
〜K12に接続し、 前記複数の接続中点に第２の電源電圧を複数の
抵抗R4，VR1〜VR12を介して夫々供給し、 前記複数のチヤンネル操作スイツチS1〜S12の
他端を前記駆動端子KINを駆動するための１個
の駆動用トランジスタQ4の制御電極に接続し、 前記チヤンネル操作スイツチS1〜S12の操作に
より制御信号を作成し前記駆動用トランジスタ
Q4の制御電圧に入力して、前記選局用IC１を動
作せしめ、 操作したチヤンネル操作スイツチS1〜S12に対
応する前記出力端子K1〜K13をアースレベルとす
ることにより前記駆動用トランジスタQ4への制
御信号の入力を停止せしめると共に、対応する前
記チヤンネル表示用発光素子D21〜D32を発光せ
しめる選局回路に於いて、 前記複数の接続中点と前記制御電極間に、 前記複数のチヤンネル操作スイツチS1〜S12に
直列に複数の電流制限抵抗R21〜R32を設けると
共に、前記制御電極の入力側にコンデンサC5を
挿入したことを特徴とする。
以下に図面に示した実施例に従つて説明する。
第３図において第２図と同一部分には同一の記
号を付して説明を省略する。本発明では発光ダイ
オードD21〜D32と直列に電流制限抵抗R21〜R32
を設けると共に前記操作スイツチS1〜S12と制御
電極との間にコンデンサC5を設けているが、そ
の動作を３チヤンネル分のみ取り出して示す第４
図で説明すると、まず電流制限抵抗R21，R22，
R23を設けているので操作スイツチS1，S2を同時
に操作した瞬間にトランジスタQ4を作動させる
ように32V電源ライン５から流れる電流が制限さ
れると共に、IC１の11番ピンのローレベル設
定後、発光ダイオードD22側から操作スイツチ
S2，S1を通して11番ピンに流れ込む電流は抵抗
R22，R21によつて制限され実質的に消灯状態と
することができる。その際、32V電源ライン５か
らボリウムVR2、操作スイツチS2，S1を通して流
れる電流も同様に制限される。このように電流制
限抵抗を設けた場合には選局状態が次のチヤンネ
ルに移る虞れがあり１チヤンネルのチヤンネル表
示も消えてしまうので、これを阻止するためコン
デンサC5を設けている。即ち、もしコンデンサ
C5が無いとすると、第２チヤンネルの表示系か
ら電流制限抵抗R21を通つて11番ピンに流れる
電流によつてロ点の電位が上昇し駆動トランジス
タQ4がオンしてしまうからである。このような
蓋然性は、２つの操作スイツチだけでなく、３個
の操作スイツチを同時に操作した場合に一層顕著
である。前記駆動トランジスタQ4がオンになる
とIC１の18番ピンがハイレベルとなつてIC１
内の発振が開始すると共に13番ピンがローレベ
ルになつてトランジスタQ3，Q2がオンになり、
一たん選局された１チヤンネルの表示用発光ダイ
オードD21も消える。且つ、一たん選局された１
チヤンネルの設定状態〔11番ピンのローレベル
状態〕も動いて次の２チヤンネル移つてしまう
が、このような不所望な事態はコンデンサC5が
２チヤンネルの表示系からの電流に基づくロ点の
電圧上昇に対しトランジスタQ4のベースを影響
されないように働き、従つて駆動トランジスタ
Q4がオンしないことにより阻止されるのである。
尚、第４図で抵抗R0を点線で示す如く挿入して
もよい。
号を付して説明を省略する。本発明では発光ダイ
オードD21〜D32と直列に電流制限抵抗R21〜R32
を設けると共に前記操作スイツチS1〜S12と制御
電極との間にコンデンサC5を設けているが、そ
の動作を３チヤンネル分のみ取り出して示す第４
図で説明すると、まず電流制限抵抗R21，R22，
R23を設けているので操作スイツチS1，S2を同時
に操作した瞬間にトランジスタQ4を作動させる
ように32V電源ライン５から流れる電流が制限さ
れると共に、IC１の11番ピンのローレベル設
定後、発光ダイオードD22側から操作スイツチ
S2，S1を通して11番ピンに流れ込む電流は抵抗
R22，R21によつて制限され実質的に消灯状態と
することができる。その際、32V電源ライン５か
らボリウムVR2、操作スイツチS2，S1を通して流
れる電流も同様に制限される。このように電流制
限抵抗を設けた場合には選局状態が次のチヤンネ
ルに移る虞れがあり１チヤンネルのチヤンネル表
示も消えてしまうので、これを阻止するためコン
デンサC5を設けている。即ち、もしコンデンサ
C5が無いとすると、第２チヤンネルの表示系か
ら電流制限抵抗R21を通つて11番ピンに流れる
電流によつてロ点の電位が上昇し駆動トランジス
タQ4がオンしてしまうからである。このような
蓋然性は、２つの操作スイツチだけでなく、３個
の操作スイツチを同時に操作した場合に一層顕著
である。前記駆動トランジスタQ4がオンになる
とIC１の18番ピンがハイレベルとなつてIC１
内の発振が開始すると共に13番ピンがローレベ
ルになつてトランジスタQ3，Q2がオンになり、
一たん選局された１チヤンネルの表示用発光ダイ
オードD21も消える。且つ、一たん選局された１
チヤンネルの設定状態〔11番ピンのローレベル
状態〕も動いて次の２チヤンネル移つてしまう
が、このような不所望な事態はコンデンサC5が
２チヤンネルの表示系からの電流に基づくロ点の
電圧上昇に対しトランジスタQ4のベースを影響
されないように働き、従つて駆動トランジスタ
Q4がオンしないことにより阻止されるのである。
尚、第４図で抵抗R0を点線で示す如く挿入して
もよい。
以上の如く、複数の操作スイツチを同時に操作
した場合には、今まで受信されていたチヤンネル
から近いチヤンネル（チヤンネルシフトの進行方
向において近いチヤンネル）が受信設定されると
共にそのチヤンネル表示用発光ダイオードのみが
点灯し、前記操作状態がしばらく継続しても当該
設定されたチヤンネルの表示が消えることなく、
且つ次のチヤンネルに向けてICのチヤンネルシ
フトが動くことがない。叙上の通り本発明によれ
ば複数の操作手段を同時に操作しても不必要なチ
ヤンネルの表示電流は好適に制限できるという効
果があり極めて有効である。
した場合には、今まで受信されていたチヤンネル
から近いチヤンネル（チヤンネルシフトの進行方
向において近いチヤンネル）が受信設定されると
共にそのチヤンネル表示用発光ダイオードのみが
点灯し、前記操作状態がしばらく継続しても当該
設定されたチヤンネルの表示が消えることなく、
且つ次のチヤンネルに向けてICのチヤンネルシ
フトが動くことがない。叙上の通り本発明によれ
ば複数の操作手段を同時に操作しても不必要なチ
ヤンネルの表示電流は好適に制限できるという効
果があり極めて有効である。
第１図は従来の選局回路を示す回路図であり、
第２図はその要部回路図である。第３図は本発明
を実施した選局回路の回路図であり、第４図はそ
の要部の回路図である。 １…選局用IC、S1〜S12…操作スイツチ、D21〜
D32…発効ダイオード、R21〜R32…電流制限抵
抗、Q4…駆動トランジスタ、C5…コンデンサ、
〜，…ICの出力端子ピン。
第２図はその要部回路図である。第３図は本発明
を実施した選局回路の回路図であり、第４図はそ
の要部の回路図である。 １…選局用IC、S1〜S12…操作スイツチ、D21〜
D32…発効ダイオード、R21〜R32…電流制限抵
抗、Q4…駆動トランジスタ、C5…コンデンサ、
〜，…ICの出力端子ピン。
Claims (1)
- 【特許請求の範囲】 １ 一端に第１の電源電圧が印加されたチヤンネ
ル表示用発光素子D21〜D32に直列にチヤンネル
操作スイツチS1〜S12を接続し、この直列回路を
各チヤンネルごとに設け、 駆動端子KINに制御信号が入力されると各チ
ヤンネルに対応する複数の出力端子K1〜K12を順
次アースレベルとする選局用IC１を備え、 前記各チヤンネルごとに設けられた前記複数の
チヤンネル発光素子D21〜D32と前記複数のチヤ
ンネル操作スイツチS1〜S12との間の複数の接続
中点を前記対応する選局用IC１の複数の出力端
子K1〜K12に接続し、 前記複数の接続中点に第２の電源電圧を複数の
抵抗R4，VR1〜VR12を介して夫々供給し、 前記複数のチヤンネル操作スイツチS1〜S12の
他端を前記駆動端子KINを駆動するための１個
の駆動用トランジスタQ4の制御電極に接続し、 前記チヤンネル操作スイツチS1〜S12の操作に
より制御信号を作成し前記駆動用トランジスタ
Q4の制御電圧に入力して、前記選局用IC１を動
作せしめ、 操作したチヤンネル操作スイツチS1〜S12に対
応する前記出力端子K1〜K13をアースレベルとす
ることにより前記駆動用トランジスタQ4への制
御信号の入力を停止せしめると共に、対応する前
記チヤンネル表示用発光素子D21〜D32を発光せ
しめる選局回路に於いて、 前記複数の接続中点と前記制御電極間に、前記
複数のチヤンネル操作スイツチS1〜S12に直列に
複数の電流制限抵抗（R21〜R32）を設けると共
に、前記制御電極の入力側にコンデンサC5を挿
入したことを特徴とする選局回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4108281A JPS57154928A (en) | 1981-03-19 | 1981-03-19 | Channel selecting circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4108281A JPS57154928A (en) | 1981-03-19 | 1981-03-19 | Channel selecting circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57154928A JPS57154928A (en) | 1982-09-24 |
| JPH0216049B2 true JPH0216049B2 (ja) | 1990-04-16 |
Family
ID=12598536
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4108281A Granted JPS57154928A (en) | 1981-03-19 | 1981-03-19 | Channel selecting circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57154928A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0570117U (ja) * | 1992-02-25 | 1993-09-21 | 大阪瓦斯株式会社 | 長手体の挿入／排出用シール装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6141310Y2 (ja) * | 1979-09-28 | 1986-11-25 |
-
1981
- 1981-03-19 JP JP4108281A patent/JPS57154928A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0570117U (ja) * | 1992-02-25 | 1993-09-21 | 大阪瓦斯株式会社 | 長手体の挿入／排出用シール装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57154928A (en) | 1982-09-24 |
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