JPH02252070A - 画線付加装置 - Google Patents
画線付加装置Info
- Publication number
- JPH02252070A JPH02252070A JP7293189A JP7293189A JPH02252070A JP H02252070 A JPH02252070 A JP H02252070A JP 7293189 A JP7293189 A JP 7293189A JP 7293189 A JP7293189 A JP 7293189A JP H02252070 A JPH02252070 A JP H02252070A
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- Japan
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- lines
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、画線付加装置に関し、特に、線画を扱う記録
装置において実際の線画の幅を変更する装置に関するも
のである。
装置において実際の線画の幅を変更する装置に関するも
のである。
従来の技術
新聞や雑誌を印刷する場合には、ファクシミリからのフ
ィルム出力をそのまま印刷で使用することが多い、その
際に、ファクシミリからの出力画像のうちの最小画素に
おいてインクののりが完全でない為に、実際の線画の幅
より細く印刷されることがある。そこで、この不具合を
補う為に、電気的に１画素以上の画素を付加する装置が
使用されている。また、単に、−律に線画を太くしたり
細くしたりする場合にも使用されている。
ィルム出力をそのまま印刷で使用することが多い、その
際に、ファクシミリからの出力画像のうちの最小画素に
おいてインクののりが完全でない為に、実際の線画の幅
より細く印刷されることがある。そこで、この不具合を
補う為に、電気的に１画素以上の画素を付加する装置が
使用されている。また、単に、−律に線画を太くしたり
細くしたりする場合にも使用されている。
第２図はこの種の従来技術を示すブロック図である。第
２図において、２１は参照領域出力回路、２２は画線付
加判定回路（ＲＯＭ）をそれぞれ示している。
２図において、２１は参照領域出力回路、２２は画線付
加判定回路（ＲＯＭ）をそれぞれ示している。
発明が解決しようとする課題
第２図に示す回路のように、従来のＲＯＭによる画線付
加の判定のみでは、副走査方向に１ドット、太めたり細
めたりすることしかできず、２ドツト以上については処
理することができないという欠点があった。また、上述
の１ドツト単位の付加では太すぎる場合もあり、その半
分の量を付加する要求に対応できないという欠点があっ
た。
加の判定のみでは、副走査方向に１ドット、太めたり細
めたりすることしかできず、２ドツト以上については処
理することができないという欠点があった。また、上述
の１ドツト単位の付加では太すぎる場合もあり、その半
分の量を付加する要求に対応できないという欠点があっ
た。
本発明は従来の上記実情に鑑みてなされたものであり、
従って本発明の目的は、従来の技術に内在する上記欠点
を解消することを可能とした新規な画線付加装置を提供
することにある。
従って本発明の目的は、従来の技術に内在する上記欠点
を解消することを可能とした新規な画線付加装置を提供
することにある。
課題を解決するための手段
上記目的を達成する為に、本発明に係る画線付加装置は
、読み取り装置からのイメージデータあるいはコンピュ
ータによって作成されたイメージデータに画線を付加す
る装置において、副走査方向に対して参照する領域を出
力する参照領域出力手段と、該参照領域が所定のパター
ンに当てはまるかを判定する画線付加判定手段と、該画
線付加判定手段による判定出力のうち副走査方向に２ド
ツト以上の画線付加を行うか行わないかの判別信号を格
納する判別信号格納手段と、該判別信号格納データによ
って前記画線付加判定出力を変換するか否かを選択する
画線付加結果出力選択手段と、１画素データの読み出し
回数を識別する読出識別信号出力手段とを備えて構成さ
れる。
、読み取り装置からのイメージデータあるいはコンピュ
ータによって作成されたイメージデータに画線を付加す
る装置において、副走査方向に対して参照する領域を出
力する参照領域出力手段と、該参照領域が所定のパター
ンに当てはまるかを判定する画線付加判定手段と、該画
線付加判定手段による判定出力のうち副走査方向に２ド
ツト以上の画線付加を行うか行わないかの判別信号を格
納する判別信号格納手段と、該判別信号格納データによ
って前記画線付加判定出力を変換するか否かを選択する
画線付加結果出力選択手段と、１画素データの読み出し
回数を識別する読出識別信号出力手段とを備えて構成さ
れる。
実施例
本発明を説明するにあたり、第３図のように主走査１ド
ツト、副走査シラインの参照領域について説明していく
、もちろん、他のライン数やドツト数でも同様な方法で
実現することができる。また、画線の変換は、説明の便
宜上１ドツトを１１７２ドツトに、または１ドツトを２
１７２ドツトにすることにする。もちろん、他の変更も
同様な方法で実現することができる。ここで言う１１７
２ドツトとは、画データ１ドツトに対して、２倍の解像
度で３回記録することを意味する。そしてまた画素の変
換は、説明の便宜上点側とする。もちろん、白側も同様
な方法で実現することができる０図中の＊印はある時間
での参照領域中の注目画素を表し、＠印はその参照領域
での画線付加の結果を反映させて出力する画素を表して
いる。
ツト、副走査シラインの参照領域について説明していく
、もちろん、他のライン数やドツト数でも同様な方法で
実現することができる。また、画線の変換は、説明の便
宜上１ドツトを１１７２ドツトに、または１ドツトを２
１７２ドツトにすることにする。もちろん、他の変更も
同様な方法で実現することができる。ここで言う１１７
２ドツトとは、画データ１ドツトに対して、２倍の解像
度で３回記録することを意味する。そしてまた画素の変
換は、説明の便宜上点側とする。もちろん、白側も同様
な方法で実現することができる０図中の＊印はある時間
での参照領域中の注目画素を表し、＠印はその参照領域
での画線付加の結果を反映させて出力する画素を表して
いる。
第１図は本発明の一実施例を示すブロック構成図である
。
。
第１図を参照するに、端子１０１からは、２値のシリア
ルデータが入力され、このシリアルデータは参照領域出
力回路１１に入力される。前記参照領域出力回路１１で
は、入力されたデータを１ライン単位に格納し、５ライ
ン分のデータが格納されたところで、５ライン分の各ラ
インから１ドツトずつ順次読み出しを開始する。その際
、入力データの２倍のスピードで２ライン同じデータを
出力する（第３図中のＡ・・１ライン目、Ｂ・・２ライ
ン目合計２ライン）。
ルデータが入力され、このシリアルデータは参照領域出
力回路１１に入力される。前記参照領域出力回路１１で
は、入力されたデータを１ライン単位に格納し、５ライ
ン分のデータが格納されたところで、５ライン分の各ラ
インから１ドツトずつ順次読み出しを開始する。その際
、入力データの２倍のスピードで２ライン同じデータを
出力する（第３図中のＡ・・１ライン目、Ｂ・・２ライ
ン目合計２ライン）。
前記参照領域出力回路１１から出力されたデータは、画
線付加判定回路１２に入力されて次にあげる処理が行わ
れる０判定そのものは画線付加判定回路１２内のＲＯＭ
によって行われる。そのとき、第３図のＡ側、Ｂ側を交
互に判定する。
線付加判定回路１２に入力されて次にあげる処理が行わ
れる０判定そのものは画線付加判定回路１２内のＲＯＭ
によって行われる。そのとき、第３図のＡ側、Ｂ側を交
互に判定する。
■、１ドツトを１１７２ドツトに変換する場合（第４図
参照） 第４図（ａ）の−ようなパターンが本画線付加判定回路
１２に入力された場合には第４図（ｂ）のような１／２
ドツトの付加が行われる（Ａ側のみに付加される）（＠
印の画素が変換される）。
参照） 第４図（ａ）の−ようなパターンが本画線付加判定回路
１２に入力された場合には第４図（ｂ）のような１／２
ドツトの付加が行われる（Ａ側のみに付加される）（＠
印の画素が変換される）。
■、１ドツトを２１７２ドツトに変換する場合（第５図
（ａ） 、（ｂ）参照）。
（ａ） 、（ｂ）参照）。
次の２系統の出力がある。
ａ、第５図（ａ）のようなパターンが本画線付加判定回
路１２に入力された場合には第５図（ｂ）のような１ド
ツトの付加が行われる。
路１２に入力された場合には第５図（ｂ）のような１ド
ツトの付加が行われる。
ｂ、上記ａ項のパターンが判定されたか否かの判別信号
を主走査方向にドツト単位に出力する。
を主走査方向にドツト単位に出力する。
次に、前記画線付加判定回路１２からの２系統の出力の
うち、画線付加判別結果については画線付加結果出力選
択回路１４に入力される。また、判別信号については判
別信号格納回路１３に入力される。
うち、画線付加判別結果については画線付加結果出力選
択回路１４に入力される。また、判別信号については判
別信号格納回路１３に入力される。
前記判別信号格納回路１３では、前記画線付加判定回路
１２からの判別信号データを格納し、１ライン単位に遅
延する。そして、第５図（Ｃ）のように、データが１ラ
イン進んだときに画線付加結果出力選択回路１４で前記
判別信号格納回路１３の判別信号データにより、２１７
２ドツト目の付加を行うことができる。端子１０２から
は、第３図〜第５図の＠印の位置のデータがＡ→Ｂ−Ａ
→Ｂ・・の順に交互に出力される。
１２からの判別信号データを格納し、１ライン単位に遅
延する。そして、第５図（Ｃ）のように、データが１ラ
イン進んだときに画線付加結果出力選択回路１４で前記
判別信号格納回路１３の判別信号データにより、２１７
２ドツト目の付加を行うことができる。端子１０２から
は、第３図〜第５図の＠印の位置のデータがＡ→Ｂ−Ａ
→Ｂ・・の順に交互に出力される。
読出識別信号出力回路１５では、参照領域出力回路１１
からの読み出しのラインデータに対し、Ａ＝“旧ｇｈ″
Ｂ＝“Ｌｏｗ”というように、そのラインデータに同
期した識別信号を出力している。この信号は、参照領域
出力回路１１で書き込みのゲート信号として、画線付加
判定回路１２で１１７２ドツト付加のときＡ側でのみ判
定できるようにする識別信号として、画線付加結果出力
選択回路１４では２１／２ドツト付加するときにＡ側で
のみ判定できるようにする識別信号として各々使用され
る。
からの読み出しのラインデータに対し、Ａ＝“旧ｇｈ″
Ｂ＝“Ｌｏｗ”というように、そのラインデータに同
期した識別信号を出力している。この信号は、参照領域
出力回路１１で書き込みのゲート信号として、画線付加
判定回路１２で１１７２ドツト付加のときＡ側でのみ判
定できるようにする識別信号として、画線付加結果出力
選択回路１４では２１／２ドツト付加するときにＡ側で
のみ判定できるようにする識別信号として各々使用され
る。
第６図は参照領域出力回路１１の具体的ブロック構成図
である。
である。
第６図を参照するに、端子６０１からは１ライン間欠の
く読み出しラインに対して１ラインおき）２値のシリア
ルデータが入力され、１ライン遅延素子６１に入力され
る。前記１ライン遅延素子６１から出力されたデータは
、一方はそのまま端子６０２へ出力され、他方は１ライ
ン遅延素子６２に入力される。同様に、端子６０４〜６
０６へ出力され、１ライン遅延素子６１〜６４へ入力さ
れる。このようにして、１ラインデータをライン単位に
遅延してシライン分のデータを出力させる。書き込み１
ラインに対して、読み出しは同一データを２ライン送出
するので、書き込み信号は読み出し２ラインのうちの初
めの１ラインにのみ与える。
く読み出しラインに対して１ラインおき）２値のシリア
ルデータが入力され、１ライン遅延素子６１に入力され
る。前記１ライン遅延素子６１から出力されたデータは
、一方はそのまま端子６０２へ出力され、他方は１ライ
ン遅延素子６２に入力される。同様に、端子６０４〜６
０６へ出力され、１ライン遅延素子６１〜６４へ入力さ
れる。このようにして、１ラインデータをライン単位に
遅延してシライン分のデータを出力させる。書き込み１
ラインに対して、読み出しは同一データを２ライン送出
するので、書き込み信号は読み出し２ラインのうちの初
めの１ラインにのみ与える。
第７図は画線付加結果出力選択回路１４のブロック構成
図である。
図である。
第７図を参照するに、本回路は、前記判別信号格納回路
１３からの判別データにより、前記画線付加判定回路１
２からのデータをそのまま出力させるか、または黒画素
を白画素に、白画素を黒画素に変換して出力させるかの
処理を行っている。たとえば、前記判別信号格納回路１
３からの判別データを、画線の付加を行う場合、に“Ｌ
ｏｗ”レベル、画線の付加を行わない場合に“旧ｇｈ”
レベルとし、前記画線付加判定回路１２からのデータを
、黒画素の場合に“旧ｇｈ”レベル、白画素の場合に“
Ｌｏｗレベルとしたときに、第１表のような出力が得ら
れる。第１表において表内は画素レベルである。
１３からの判別データにより、前記画線付加判定回路１
２からのデータをそのまま出力させるか、または黒画素
を白画素に、白画素を黒画素に変換して出力させるかの
処理を行っている。たとえば、前記判別信号格納回路１
３からの判別データを、画線の付加を行う場合、に“Ｌ
ｏｗ”レベル、画線の付加を行わない場合に“旧ｇｈ”
レベルとし、前記画線付加判定回路１２からのデータを
、黒画素の場合に“旧ｇｈ”レベル、白画素の場合に“
Ｌｏｗレベルとしたときに、第１表のような出力が得ら
れる。第１表において表内は画素レベルである。
また、２１７２ドツトに変換する場合の１７２ドツト付
加に対しては、読出識別信号出力回路１５から出力され
る識別信号によって（参照領域出力回路１１から出力さ
れるラインデータがＡ側であるかＢ側であるかの信号）
Ａ側にのみ１／２を付加している。
加に対しては、読出識別信号出力回路１５から出力され
る識別信号によって（参照領域出力回路１１から出力さ
れるラインデータがＡ側であるかＢ側であるかの信号）
Ａ側にのみ１／２を付加している。
第１表
発明の詳細
な説明したように、本発明によれば、画線付加判定回路
１２からの判別信号を１ライン遅延素子に格納しておく
方法、参照領域出力回路１１で２ライン同一のデータを
出力し、その識別信号を使用する方法により、２ドツト
以上の付加処理のみならず、１７２ドツトの付加処理に
ついても簡単に行うことができる。
１２からの判別信号を１ライン遅延素子に格納しておく
方法、参照領域出力回路１１で２ライン同一のデータを
出力し、その識別信号を使用する方法により、２ドツト
以上の付加処理のみならず、１７２ドツトの付加処理に
ついても簡単に行うことができる。
第１図は本発明の一実施例を示すブロック構成図、第２
図は従来の画線付加技術の回路例を示すブロック図、第
３図は本発明を説明する為の参照領域の定義を示す図、
第４図（ａ） 、（ｂ）は１ドツトを１ ｌ／２ドツト
に変換する場合の説明図、第５図（ａ）〜（ｃ）は１ド
ツトを２１７２ドツトに変換する場合の説明図、第６図
は参照領域出力回路の例を示すブロック構成図、第７図
は画線付加結果出力選択回路の具体例を示すブロック構
成図である。 １１．２１・・・参照声域出力回路、１２．２２・・・
画線付加判定回路（ＲＯＭ ） 、１３・・・判別信号
格納回路、１４・・・画線付加結果出力選択回路、６１
．６２，６３．６４．６５・・・１ライン遅延素子、 ７１・・・ＥＸ Ｒ ゲート、 ７２・・・ＡＮＤ ゲート
図は従来の画線付加技術の回路例を示すブロック図、第
３図は本発明を説明する為の参照領域の定義を示す図、
第４図（ａ） 、（ｂ）は１ドツトを１ ｌ／２ドツト
に変換する場合の説明図、第５図（ａ）〜（ｃ）は１ド
ツトを２１７２ドツトに変換する場合の説明図、第６図
は参照領域出力回路の例を示すブロック構成図、第７図
は画線付加結果出力選択回路の具体例を示すブロック構
成図である。 １１．２１・・・参照声域出力回路、１２．２２・・・
画線付加判定回路（ＲＯＭ ） 、１３・・・判別信号
格納回路、１４・・・画線付加結果出力選択回路、６１
．６２，６３．６４．６５・・・１ライン遅延素子、 ７１・・・ＥＸ Ｒ ゲート、 ７２・・・ＡＮＤ ゲート
Claims (1)
- 読み取り装置からのイメージデータあるいはコンピュー
タによって作成されたイメージデータに画線を付加する
装置において、副走査方向に対して参照する領域を出力
する参照領域出力手段と、該参照領域が所定のパターン
に当てはまるかを判定する画線付加判定手段と、該画線
付加判定手段の判定出力のうち副走査方向に２ドット以
上の画線付加を行うか行わないかの判定信号を格納する
判別信号格納手段と、該判別信号格納データによって前
記画線付加判定出力を変換するか否かを選択する画線付
加結果出力選択手段と、１画素データの読み出し回数を
識別する読出識別信号出力手段とを備えたことを特徴と
する画線付加装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7293189A JPH02252070A (ja) | 1989-03-24 | 1989-03-24 | 画線付加装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7293189A JPH02252070A (ja) | 1989-03-24 | 1989-03-24 | 画線付加装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02252070A true JPH02252070A (ja) | 1990-10-09 |
Family
ID=13503603
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7293189A Pending JPH02252070A (ja) | 1989-03-24 | 1989-03-24 | 画線付加装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02252070A (ja) |
-
1989
- 1989-03-24 JP JP7293189A patent/JPH02252070A/ja active Pending
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