JPH0227661Y2 - - Google Patents
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- Publication number
- JPH0227661Y2 JPH0227661Y2 JP2846782U JP2846782U JPH0227661Y2 JP H0227661 Y2 JPH0227661 Y2 JP H0227661Y2 JP 2846782 U JP2846782 U JP 2846782U JP 2846782 U JP2846782 U JP 2846782U JP H0227661 Y2 JPH0227661 Y2 JP H0227661Y2
- Authority
- JP
- Japan
- Prior art keywords
- counter
- output
- circuit
- signal
- preset
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- 238000005070 sampling Methods 0.000 claims description 18
- 238000010586 diagram Methods 0.000 description 10
- 230000003111 delayed effect Effects 0.000 description 2
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Digital Computer Display Output (AREA)
Description
【考案の詳細な説明】
この考案は、TV信号で再生されている画像を
ハードコピーとしてプリントする場合のＨ−ブラ
ンキング（水平方向のブランキング）回路に関す
るものである。
ハードコピーとしてプリントする場合のＨ−ブラ
ンキング（水平方向のブランキング）回路に関す
るものである。
TV信号による画面（静止画）を感熱ヘツドな
どによつてプリントする場合、通常第１図に示す
ように垂直方向にラインＡ，Ｂで示すように走査
し画面の濃淡をサンプリング回路によつて検出
し、検出した画素信号を１ラインのサーマルヘツ
ドに供給してプリントを行つている。
どによつてプリントする場合、通常第１図に示す
ように垂直方向にラインＡ，Ｂで示すように走査
し画面の濃淡をサンプリング回路によつて検出
し、検出した画素信号を１ラインのサーマルヘツ
ドに供給してプリントを行つている。
このようなサンプリング動作はTVのビデオ信
号で考察すると、第２図に示すようにビデオ信号
の１水平期間（1H，2H，……lH）毎にA1，A2
……AlB1，B2……Bl点でビデオ信号をサンプル
することになる。
号で考察すると、第２図に示すようにビデオ信号
の１水平期間（1H，2H，……lH）毎にA1，A2
……AlB1，B2……Bl点でビデオ信号をサンプル
することになる。
しかしながら、TV信号にはもともと水平ブラ
ンキング期間が存在するため、ビデオ信号の水平
同期信号の始めから順次サンプリング・パルスに
よつてビデオ信号のレベルを検出し、これをサー
マルヘツドに供給すると、第１図に示すようにこ
の水平ブランキング期間が斜線を施した黒わくで
プリントされるので、ハードコピーとしては好ま
しくない。
ンキング期間が存在するため、ビデオ信号の水平
同期信号の始めから順次サンプリング・パルスに
よつてビデオ信号のレベルを検出し、これをサー
マルヘツドに供給すると、第１図に示すようにこ
の水平ブランキング期間が斜線を施した黒わくで
プリントされるので、ハードコピーとしては好ま
しくない。
そこで、水平同期信号のあとの数サンプルポイ
ントはサンプリング回路にサンプルパルスを供給
せず、サンプリング動作を停止させて水平ブラン
キング期間を除去することが考えられる。
ントはサンプリング回路にサンプルパルスを供給
せず、サンプリング動作を停止させて水平ブラン
キング期間を除去することが考えられる。
第３図はかかる動作を行わせる１つの回路ブロ
ツクを示したもので、１、および２はサンプルク
ロツク源９のパルスをカウントする第１、および
第２のプリセツトカウンタ（以下Ｐ−カウンタと
いう）、３は前記第１のＰ−カウンタ１のプリセ
ツト値を与えるために垂直同期パルスをカウント
している第３のカウンタ、４は前記第２のＰ−カ
ウンタ２にプリセツト値（ｎ）を与えるためのデ
ジツトスイツチ、５，および６は端子CLKにパ
ルスが入るごとにＤ端子の信号（Ｈレベルにクラ
ンプされている）を出力し、端子CLRの信号で
クリアされるデレードフリツプフロツプ回路（以
下Ｄ−Ｆ／Ｆという）、７，および８はアンドゲ
ート、９はサンプルクロツク源である。
ツクを示したもので、１、および２はサンプルク
ロツク源９のパルスをカウントする第１、および
第２のプリセツトカウンタ（以下Ｐ−カウンタと
いう）、３は前記第１のＰ−カウンタ１のプリセ
ツト値を与えるために垂直同期パルスをカウント
している第３のカウンタ、４は前記第２のＰ−カ
ウンタ２にプリセツト値（ｎ）を与えるためのデ
ジツトスイツチ、５，および６は端子CLKにパ
ルスが入るごとにＤ端子の信号（Ｈレベルにクラ
ンプされている）を出力し、端子CLRの信号で
クリアされるデレードフリツプフロツプ回路（以
下Ｄ−Ｆ／Ｆという）、７，および８はアンドゲ
ート、９はサンプルクロツク源である。
この回路を第４図の波形図を参照して説明する
と、水平同期信号Ｄの第１番目のパルスP1が
入ると、Ｄ−Ｆ／Ｆ５の出力Q0はＨレベルとな
るとともに、Ｄ−Ｆ／Ｆ６はクリアされてその出
力ＱがＬレベル，がＨレベルとなる。また、第
１，および第２のＰ−カウンタ１、および２はロ
ードされてプリセツト値をとり込む。Ｄ−Ｆ／Ｆ
５，および６の出力信号によつて、サンプルクロ
ツク源９に一方の入力端子が接続されているアン
ドゲート７は閉じてその出力はＬとなり、アンド
ゲート８は開いてその出力にサンプルクロツク源
９のパルスPSが出力される。
と、水平同期信号Ｄの第１番目のパルスP1が
入ると、Ｄ−Ｆ／Ｆ５の出力Q0はＨレベルとな
るとともに、Ｄ−Ｆ／Ｆ６はクリアされてその出
力ＱがＬレベル，がＨレベルとなる。また、第
１，および第２のＰ−カウンタ１、および２はロ
ードされてプリセツト値をとり込む。Ｄ−Ｆ／Ｆ
５，および６の出力信号によつて、サンプルクロ
ツク源９に一方の入力端子が接続されているアン
ドゲート７は閉じてその出力はＬとなり、アンド
ゲート８は開いてその出力にサンプルクロツク源
９のパルスPSが出力される。
そのため、第２のＰ−カウンタ２はパルスPSをカ
ウントすることになるが、このカウント値がデジ
ツトスイツチ４でセツトされている値ｎとなると
キヤリが出力され、Ｄ−Ｆ／Ｆ６のＱ出力をＨ，
Ｑ出力をＬに反転する。
ウントすることになるが、このカウント値がデジ
ツトスイツチ４でセツトされている値ｎとなると
キヤリが出力され、Ｄ−Ｆ／Ｆ６のＱ出力をＨ，
Ｑ出力をＬに反転する。
この反転出力によつてアンドゲート８は閉じ、
第２のＰ−カウンタ２は計数を停止するとともに
アンドゲート７が開くことになるので、今後はサ
ンプルクロツク源９のパルスPSは第１のＰ−カウ
ンタ１で計数されることになる。
第２のＰ−カウンタ２は計数を停止するとともに
アンドゲート７が開くことになるので、今後はサ
ンプルクロツク源９のパルスPSは第１のＰ−カウ
ンタ１で計数されることになる。
第１のＰ−カウンタ１の計数値がプリセツトさ
れている第３のカウンタ３の計数値Ｎとなると、
カウントアツプを示すボロー出力が発生し、Ｄ−
Ｆ／Ｆ５をクリアし、その出力Q0をＬレベルに
反転する。そして、この点で図示しないサンプリ
ングホールド回路を動作させる。
れている第３のカウンタ３の計数値Ｎとなると、
カウントアツプを示すボロー出力が発生し、Ｄ−
Ｆ／Ｆ５をクリアし、その出力Q0をＬレベルに
反転する。そして、この点で図示しないサンプリ
ングホールド回路を動作させる。
次に、第２番目の水平同期信号HDのパルスP2
が入ると、再びＤ−Ｆ／Ｆ５の出力Q0はＨレベ
ルに、Ｄ−Ｆ／Ｆ６のＱ出力はクリアされてＬレ
ベルに反転しアンドゲート７が閉じ、アンドゲー
ト８が開き、第１および第２のＰ−カウンタ１，
２がロードされて最初の状態にもどつて、再びパ
ルスPSの計数を始める。したがつて、今、デジツ
トスイツチ４のプリセツト値をｎ、第３をカウン
タ３の計数値をＮとすると、Ｄ−Ｆ／Ｆ５の出力
はｎ＋Ｎ個サンプルクロツク源９のパルスPSを計
数した時点でＬレベルとなり、この時点で、図示
しないサンプリングホールド回路を動作させる。
が入ると、再びＤ−Ｆ／Ｆ５の出力Q0はＨレベ
ルに、Ｄ−Ｆ／Ｆ６のＱ出力はクリアされてＬレ
ベルに反転しアンドゲート７が閉じ、アンドゲー
ト８が開き、第１および第２のＰ−カウンタ１，
２がロードされて最初の状態にもどつて、再びパ
ルスPSの計数を始める。したがつて、今、デジツ
トスイツチ４のプリセツト値をｎ、第３をカウン
タ３の計数値をＮとすると、Ｄ−Ｆ／Ｆ５の出力
はｎ＋Ｎ個サンプルクロツク源９のパルスPSを計
数した時点でＬレベルとなり、この時点で、図示
しないサンプリングホールド回路を動作させる。
第３のカウンタ３は垂直同期パルスVDを計数
するようにしてあるので、計数値Ｎはプリントの
開始時点を０とし、１つの垂直同期信号VDを計
数するごとに、つまり、１ラインのサンプリング
を終了する毎に１つずつ増加する。したがつて、
この回路を使用すると最初のｎ計数期間はサンプ
リング回路が動作せず、以後、ｎ＋１でι回，ｎ
＋２でι回，ｎ＋Ｎでι回と、TV画面の垂直方
向、つまり、第１図のＡ，Ｂ方向のサンプル動作
を行わせることができる。
するようにしてあるので、計数値Ｎはプリントの
開始時点を０とし、１つの垂直同期信号VDを計
数するごとに、つまり、１ラインのサンプリング
を終了する毎に１つずつ増加する。したがつて、
この回路を使用すると最初のｎ計数期間はサンプ
リング回路が動作せず、以後、ｎ＋１でι回，ｎ
＋２でι回，ｎ＋Ｎでι回と、TV画面の垂直方
向、つまり、第１図のＡ，Ｂ方向のサンプル動作
を行わせることができる。
しかしながら、第３図の回路例では、サンプル
クロツク源９のパルスPSをゲートしているためク
ロツク周波数が高くなつた場合、またはクロツク
にジツタなどがあると動作が不安定になり、回路
も複雑であるという欠点がある。
クロツク源９のパルスPSをゲートしているためク
ロツク周波数が高くなつた場合、またはクロツク
にジツタなどがあると動作が不安定になり、回路
も複雑であるという欠点がある。
この考案は、かかる欠点を除去するためになさ
れたもので、ゲート回路を省略し回路の簡素化を
計つたものである。
れたもので、ゲート回路を省略し回路の簡素化を
計つたものである。
以下、この考案のＨ−ブランキング回路につい
て第５図のブロツク図および第６図の波形図で説
明する。
て第５図のブロツク図および第６図の波形図で説
明する。
第５図において、１１は水平同期信号HDによ
つてロードされ、サンプルクロツク源１４のパル
スPSをカウントする第１のＰ−カウンタ、１２
は、デジツトスイツチ１３によつてプリセツトさ
れ、垂直同期パルスVDまたは、プラテンの回転
送りパルスPVを計数している第２のＰ−カウン
タ、１５はＤ−Ｆ／Ｆである。なお、１６はデコ
ーダである。
つてロードされ、サンプルクロツク源１４のパル
スPSをカウントする第１のＰ−カウンタ、１２
は、デジツトスイツチ１３によつてプリセツトさ
れ、垂直同期パルスVDまたは、プラテンの回転
送りパルスPVを計数している第２のＰ−カウン
タ、１５はＤ−Ｆ／Ｆである。なお、１６はデコ
ーダである。
この回路は、Ｄ−Ｆ／Ｆ１５のＱ出力がＬ，
出力がＨとなつている状態でプリント信号を待つ
ている。スタートパルスが入ると、第２のＰ−カ
ウンタ１２にはデジツトスイツチ１３のプリセツ
ト値ｎがロードされる。次に水平同期信号HDの
第１番目のパルスP1が入ると、Ｄ−Ｆ／Ｆ１５
のＱ出力がＨ、出力がＬとなり、第１のＰ−カ
ウンタ１１はイネーブル端子ENがＬレベルとな
り、計数を開始するとともに第２のＰ−カウンタ
１２の計数値ｎ、すなわちデジツトスイツチ１３
の設定値ｎがロードされる。
出力がＨとなつている状態でプリント信号を待つ
ている。スタートパルスが入ると、第２のＰ−カ
ウンタ１２にはデジツトスイツチ１３のプリセツ
ト値ｎがロードされる。次に水平同期信号HDの
第１番目のパルスP1が入ると、Ｄ−Ｆ／Ｆ１５
のＱ出力がＨ、出力がＬとなり、第１のＰ−カ
ウンタ１１はイネーブル端子ENがＬレベルとな
り、計数を開始するとともに第２のＰ−カウンタ
１２の計数値ｎ、すなわちデジツトスイツチ１３
の設定値ｎがロードされる。
第１のＰ−カウンタ１１がサンプルクロツク源
１４のパルスPSをｎ個計数するとボロー出力PSが
出力され、Ｄ−Ｆ／Ｆ１５がクリアされる。その
ためＤ−Ｆ／Ｆ１５のＱ出力がＬとなり、サンプ
リングホールド回路（図示せず）がサンプル動作
を行う。また、Ｄ−Ｆ／Ｆ１５の出力がＨにな
ることによつて第１のＰ−カウンタ１１の動作が
停止する。
１４のパルスPSをｎ個計数するとボロー出力PSが
出力され、Ｄ−Ｆ／Ｆ１５がクリアされる。その
ためＤ−Ｆ／Ｆ１５のＱ出力がＬとなり、サンプ
リングホールド回路（図示せず）がサンプル動作
を行う。また、Ｄ−Ｆ／Ｆ１５の出力がＨにな
ることによつて第１のＰ−カウンタ１１の動作が
停止する。
次に、第２番目の水平同期信号HDのパルスP2
が入力されると、再び最初の状態にもどり、第１
のＰ−カウンタ１１が同様な動作によつてサンプ
ルクロツク源１４のパルスPSをｎ個計数し、Ｄ−
Ｆ／Ｆ１５のＱ出力がＬとなつたときサンプリン
グホールド回路を駆動する。かくして、画面の垂
直方向でｌ回のサンプルが終了すると垂直同期パ
ルス、またはプラテンの回転パルスPVが出力さ
れ、第２のＰ−カウンタ１２の計数値がｎ＋１と
なる。
が入力されると、再び最初の状態にもどり、第１
のＰ−カウンタ１１が同様な動作によつてサンプ
ルクロツク源１４のパルスPSをｎ個計数し、Ｄ−
Ｆ／Ｆ１５のＱ出力がＬとなつたときサンプリン
グホールド回路を駆動する。かくして、画面の垂
直方向でｌ回のサンプルが終了すると垂直同期パ
ルス、またはプラテンの回転パルスPVが出力さ
れ、第２のＰ−カウンタ１２の計数値がｎ＋１と
なる。
したがつて、そのあとは水平同期信号HDのパ
ルスP1〜Plが入るごとにｎ＋１が第１のＰ−カウ
ンタ１１にプリセツトされるので、前述したと同
様にＤ−Ｆ／Ｆ１５のＱ出力はクロツクパルス源
１４のパルスPSをｎ＋１計数後にＬレベルとな
り、サンプリングホールド回路にサンプル動作を
行わせる。以後、ｎ＋２，ｎ＋３，……，ｎ＋Ｎ
まで第２のＰ−カウンタ１２が計数するとTV画
面がＮ＋ι個の点でサンプルされたことになる。
そして、このときデコーダ１６の出力によつてサ
ンプル終了パルスが発生し、全ての回路をリセツ
トする。Ｈ−ブランキング期間はデジツトスイツ
チ１３のｎによつて決定され、任意に設定でき
る。
ルスP1〜Plが入るごとにｎ＋１が第１のＰ−カウ
ンタ１１にプリセツトされるので、前述したと同
様にＤ−Ｆ／Ｆ１５のＱ出力はクロツクパルス源
１４のパルスPSをｎ＋１計数後にＬレベルとな
り、サンプリングホールド回路にサンプル動作を
行わせる。以後、ｎ＋２，ｎ＋３，……，ｎ＋Ｎ
まで第２のＰ−カウンタ１２が計数するとTV画
面がＮ＋ι個の点でサンプルされたことになる。
そして、このときデコーダ１６の出力によつてサ
ンプル終了パルスが発生し、全ての回路をリセツ
トする。Ｈ−ブランキング期間はデジツトスイツ
チ１３のｎによつて決定され、任意に設定でき
る。
なお、サンプルクロツク源１４をサンプリング
周期に設定すると共に水平同期信号HDによつて
同期し、その出力パルスPSをＤ−Ｆ／Ｆ１５のＱ
出力がＬになつた時点で１個だけ通過させるゲー
ト回路を設けて図示していないサンプリング回路
に供給するようにしてもよい。
周期に設定すると共に水平同期信号HDによつて
同期し、その出力パルスPSをＤ−Ｆ／Ｆ１５のＱ
出力がＬになつた時点で１個だけ通過させるゲー
ト回路を設けて図示していないサンプリング回路
に供給するようにしてもよい。
また、Ｐ−カウンタ１１はダウンカウンタを使
用しているが、アツプカウンタとすることもでき
る。
用しているが、アツプカウンタとすることもでき
る。
さらに、Ｄ−Ｆ／Ｆ１５もセツト・リセツトタ
イプのフリツプフロツプを使用することができ、
この考案の要旨を変更しない範囲で他の回路ブロ
ツクについても設計変更できることはいうまでも
ない。
イプのフリツプフロツプを使用することができ、
この考案の要旨を変更しない範囲で他の回路ブロ
ツクについても設計変更できることはいうまでも
ない。
以上説明したように、この考案のＨ−ブランキ
ング回路はカウンタ２個と、Ｄ−Ｆ／Ｆおよびデ
ジツトスイツチによつて構成され、回路が簡単で
あるとともに、その動作が安定になるという利点
を有する。
ング回路はカウンタ２個と、Ｄ−Ｆ／Ｆおよびデ
ジツトスイツチによつて構成され、回路が簡単で
あるとともに、その動作が安定になるという利点
を有する。
第１図，第２図はTV画面をサンプリングする
ときの説明図で、第１図はコピー画面図、第２図
はビデオ信号波形図を示す。第３図はＨ−ブラン
キングを行うための従来の回路ブロツク図、第４
図は第３図の主要波形図、第５図はこの考案のＨ
−ブランキング回路を行うための回路ブロツク
図、第６図は第５図を説明するための波形図であ
る。 図中、１１は第１のプリセツトカウンタ、１２
は第２のプリセツトカウンタ、１３はデジツトス
イツチ、１４はサンプルクロツク源、１５はデレ
ードフリツプフロツプ回路を示す。
ときの説明図で、第１図はコピー画面図、第２図
はビデオ信号波形図を示す。第３図はＨ−ブラン
キングを行うための従来の回路ブロツク図、第４
図は第３図の主要波形図、第５図はこの考案のＨ
−ブランキング回路を行うための回路ブロツク
図、第６図は第５図を説明するための波形図であ
る。 図中、１１は第１のプリセツトカウンタ、１２
は第２のプリセツトカウンタ、１３はデジツトス
イツチ、１４はサンプルクロツク源、１５はデレ
ードフリツプフロツプ回路を示す。
Claims (1)
- Ｈ−ブランキング期間に対応する初期値が入力
されるデジツトスイツチと、該デジツトスイツチ
の計数値がプリセツトされ後、垂直同期信号のタ
イミングで前期計数値が増加するように動作する
第２のプリセツトカウンタと、水平同期信号のタ
イミングで前記第２のプリセツトカウンタの計数
値がロードされ、サンプリング周期のクロツク信
号を計数している第１のプリセツトカウンタと、
前記水平同期信号によつて前記第１のプリセツト
カウンタを計数状態に制御し、前記第１のプリセ
ツトカウンタのボロー出力により前記計数状態を
解除する制御信号を出力するフリツプフロツプ回
路を備え、前期フリツプフロツプ回路の出力タイ
ミングによつてTV信号を垂直方向に走査するこ
とを特徴とするプリンタにおけるＨ−ブランキン
グ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2846782U JPS58132475U (ja) | 1982-03-02 | 1982-03-02 | プリンタにおけるｈ−ブランキング回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2846782U JPS58132475U (ja) | 1982-03-02 | 1982-03-02 | プリンタにおけるｈ−ブランキング回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58132475U JPS58132475U (ja) | 1983-09-07 |
| JPH0227661Y2 true JPH0227661Y2 (ja) | 1990-07-25 |
Family
ID=30040314
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2846782U Granted JPS58132475U (ja) | 1982-03-02 | 1982-03-02 | プリンタにおけるｈ−ブランキング回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58132475U (ja) |
-
1982
- 1982-03-02 JP JP2846782U patent/JPS58132475U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58132475U (ja) | 1983-09-07 |
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