JPH0229357A - プリンタのインターフェース - Google Patents
プリンタのインターフェースInfo
- Publication number
- JPH0229357A JPH0229357A JP63179928A JP17992888A JPH0229357A JP H0229357 A JPH0229357 A JP H0229357A JP 63179928 A JP63179928 A JP 63179928A JP 17992888 A JP17992888 A JP 17992888A JP H0229357 A JPH0229357 A JP H0229357A
- Authority
- JP
- Japan
- Prior art keywords
- data
- cpu
- circuit
- switching
- buffer ram
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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- 238000001514 detection method Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 4
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Landscapes
- Color, Gradation (AREA)
- Accessory Devices And Overall Control Thereof (AREA)
- Dot-Matrix Printers And Others (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は階調表現可能な画像プリンタのインターフェー
ス回路の高速化に間する。
ス回路の高速化に間する。
セントロニクス等のパラレルインターフェースにおいて
、画像データを転送するコマンドによりＣＰＵはインタ
ーフェースの信号をハードウェアでデータ受信回路へ切
換え、アドレスカウンタで、特定の画素数のデータを受
取った後に、通常のソフトウェアとＣＰＵによりコマン
ドが受信状態にもどるようにしたものである。この様に
して画像データの受信を高速にする。
、画像データを転送するコマンドによりＣＰＵはインタ
ーフェースの信号をハードウェアでデータ受信回路へ切
換え、アドレスカウンタで、特定の画素数のデータを受
取った後に、通常のソフトウェアとＣＰＵによりコマン
ドが受信状態にもどるようにしたものである。この様に
して画像データの受信を高速にする。
プリンタのインターフェースとしては、セントロニクス
が最も一般的であり、はとんどのコンピュータが、この
パラレルインターフェースを持つている、又、計測器等
で使われる双方向性のＧＰＩＢインターフェースをプリ
ンタに用いたも゛のもあるが、１ドツトに１バイトのデ
ータが必要な１２ドツト／ｌ１１１の画像プリンタでは
Ａ３．１画面に４０メガバイトのデータ転送が必要であ
る。
が最も一般的であり、はとんどのコンピュータが、この
パラレルインターフェースを持つている、又、計測器等
で使われる双方向性のＧＰＩＢインターフェースをプリ
ンタに用いたも゛のもあるが、１ドツトに１バイトのデ
ータが必要な１２ドツト／ｌ１１１の画像プリンタでは
Ａ３．１画面に４０メガバイトのデータ転送が必要であ
る。
ところが、セントロニクスやＣＰＮＢ等のインターフェ
ースは、受は取ったデータをＣＰＵがソフトウェアの命
令に従って、データであるかプリンタを制御する命令（
コマンド）であるかを判断し、データの場合はメモリに
収める事を行う、この為、ハードウェアにくらべはるか
に遅いＣＰＵの速度等に依存する。第２図は、ソフトウ
ェアによりプリンタのＣＰＵがデータを受信している時
のタイミングを示すものであり、ホストコンピュータ側
のデータとストローク信号によりＣＰＵに割込（Ｐ）を
発生し、処理する。さらに、プリンタはヘッドや、モー
タの制御も行っており、その為のタイマー割込（Ｈ）や
（Ｍ＞が発生し、その処理も行っている。これらの処理
中ＣＰＵはホストコンピュータに対してビイズイ信号を
出力しており、その間は、ホストコンピュータはデータ
を送る事ができない、この様に、待ち時間とＣＰＵの処
理時間がある為、データ転送が遅くなり、１ドツト当り
１画素＋１バイトのデータを送るのに大変時間がかかる
という問題がある。さらに、データを受信しながらプリ
ントする場合には、プリント動作にデータ転送が間に合
わず、間欠的な印字動作となり送りむらを生じるという
問題があった。
ースは、受は取ったデータをＣＰＵがソフトウェアの命
令に従って、データであるかプリンタを制御する命令（
コマンド）であるかを判断し、データの場合はメモリに
収める事を行う、この為、ハードウェアにくらべはるか
に遅いＣＰＵの速度等に依存する。第２図は、ソフトウ
ェアによりプリンタのＣＰＵがデータを受信している時
のタイミングを示すものであり、ホストコンピュータ側
のデータとストローク信号によりＣＰＵに割込（Ｐ）を
発生し、処理する。さらに、プリンタはヘッドや、モー
タの制御も行っており、その為のタイマー割込（Ｈ）や
（Ｍ＞が発生し、その処理も行っている。これらの処理
中ＣＰＵはホストコンピュータに対してビイズイ信号を
出力しており、その間は、ホストコンピュータはデータ
を送る事ができない、この様に、待ち時間とＣＰＵの処
理時間がある為、データ転送が遅くなり、１ドツト当り
１画素＋１バイトのデータを送るのに大変時間がかかる
という問題がある。さらに、データを受信しながらプリ
ントする場合には、プリント動作にデータ転送が間に合
わず、間欠的な印字動作となり送りむらを生じるという
問題があった。
パラレルインターフェースで、パラレルＩ／Ｏ用ＩＣと
プリントデータを記憶するバッファＲＡＭ、、？″のバ
ッフｒ Ｒ，Ａ Ｍにアドレスを出力するアドレスカウ
ンタ、ストローブ信号とビズィ信号を切換える切換回路
を備える。ホストコンピュータが制御コマンドを出力し
ている時は、パラレルＩ／／Ｏ用ＩＣを介してＣＰＵに
コマンドを入力する。
プリントデータを記憶するバッファＲＡＭ、、？″のバ
ッフｒ Ｒ，Ａ Ｍにアドレスを出力するアドレスカウ
ンタ、ストローブ信号とビズィ信号を切換える切換回路
を備える。ホストコンピュータが制御コマンドを出力し
ている時は、パラレルＩ／／Ｏ用ＩＣを介してＣＰＵに
コマンドを入力する。
画像プリントのコマンドを受けるとＣＰＵは切換回路を
ヒットシ特定の数の画像データを受取り終ると、切換回
路は自動的にリセットし、ＣＰＵへのコマンド入力状態
となる。切換回路が作動中は、ホストコンピュータのス
トローブ信号をクロックとして、ハードウェアのみで画
素データを読込む。
ヒットシ特定の数の画像データを受取り終ると、切換回
路は自動的にリセットし、ＣＰＵへのコマンド入力状態
となる。切換回路が作動中は、ホストコンピュータのス
トローブ信号をクロックとして、ハードウェアのみで画
素データを読込む。
この様にすると画素データの転送速度はＴＴＬ等の論理
ＩＣの動作速度中５０Ｍバイト／秒までの動作が可能と
なる２ 〔実施例〕 第１図は本発明の原理を示すブロック図である。
ＩＣの動作速度中５０Ｍバイト／秒までの動作が可能と
なる２ 〔実施例〕 第１図は本発明の原理を示すブロック図である。
セントロニクスインターフェースのコネクタ１から切換
回路２から入力するホストコンピュータの信号は制御コ
マンド受信状態ではパラレルＩ／Ｏ用ＩＣ３とデータバ
ス４を介してＣＰＵ５に入力する。受信したコマンドが
画像データのプリントである時はＣＰＵ５は、ｌ／Ｏ６
を介して切換回路２をセットする。切換回路２はスイッ
チの状態を図示と反対の下側へ接続する。この切換中は
、ホストコンピュータに対しビズィを出力している。
回路２から入力するホストコンピュータの信号は制御コ
マンド受信状態ではパラレルＩ／Ｏ用ＩＣ３とデータバ
ス４を介してＣＰＵ５に入力する。受信したコマンドが
画像データのプリントである時はＣＰＵ５は、ｌ／Ｏ６
を介して切換回路２をセットする。切換回路２はスイッ
チの状態を図示と反対の下側へ接続する。この切換中は
、ホストコンピュータに対しビズィを出力している。
切換えが終了するとビズィが解除されホストコンピュー
タがデータ転送を開始する。ホストコンピュータからの
ストローブ信号はアンドレスカウンタ７をカウントアツ
プしながらバッファＲＡＭ ８にコネクタ１から入力し
たデータを書込んでいく。
タがデータ転送を開始する。ホストコンピュータからの
ストローブ信号はアンドレスカウンタ７をカウントアツ
プしながらバッファＲＡＭ ８にコネクタ１から入力し
たデータを書込んでいく。
アドレスカランタフの出力つまりバッファＲＡＭに書込
んだデータ数が、あらかじめ定めた特定の値、たとえば
、１ライン分等のデータ数に等しくなった時、検出回路
９が１．切換回路２をリセットする。すると切換回路２
のスイッチは図示の状態にもどるが、もどるまでの間は
ホストコンピュータにビズィを出力してデータ等の送信
を保留させる。バッファＲＡＭ８からのデータ転送はス
イッチ／Ｏを図示と反対の向きに切り換え、ヘッドデー
タ転送回路１１のメモリへ、ヘッドデータ転送回路のク
ロックに同期して高速ＤＭＡ転送する。
んだデータ数が、あらかじめ定めた特定の値、たとえば
、１ライン分等のデータ数に等しくなった時、検出回路
９が１．切換回路２をリセットする。すると切換回路２
のスイッチは図示の状態にもどるが、もどるまでの間は
ホストコンピュータにビズィを出力してデータ等の送信
を保留させる。バッファＲＡＭ８からのデータ転送はス
イッチ／Ｏを図示と反対の向きに切り換え、ヘッドデー
タ転送回路１１のメモリへ、ヘッドデータ転送回路のク
ロックに同期して高速ＤＭＡ転送する。
この転送はＣＰＵ５のデータバス４を専有しない為、転
送中もＣＰ ｔＪは必要な処理を継続可能である。尚、
ヘッドデータ転送回路１１は内部のメモリのデータに従
い、階調数に応じたシリアルデータを作成しサーマルヘ
ッドへ転送し、プリントする。
送中もＣＰ ｔＪは必要な処理を継続可能である。尚、
ヘッドデータ転送回路１１は内部のメモリのデータに従
い、階調数に応じたシリアルデータを作成しサーマルヘ
ッドへ転送し、プリントする。
第３図は、切換回路２が作動中にコネクタ１からバッフ
ァＲＡＭ８ヘデータ転送する様子を示すものである。第
２図のソフトウェアによるデータ転送と異り、高速にデ
ータが転送できる様子を示している。ここで、データの
受信はＴＴＬ等の動作用周波数＝５０メガバイト／秒の
転送が可能であり、一方、ホストコンピュータは高速Ｃ
ＰＵを用いてもソフトウェアを使って送信する場合には
、数メガバイト７秒であるので、ビズィ信号は解除した
状態に固定していても、確実にデータ転送ができる。
ァＲＡＭ８ヘデータ転送する様子を示すものである。第
２図のソフトウェアによるデータ転送と異り、高速にデ
ータが転送できる様子を示している。ここで、データの
受信はＴＴＬ等の動作用周波数＝５０メガバイト／秒の
転送が可能であり、一方、ホストコンピュータは高速Ｃ
ＰＵを用いてもソフトウェアを使って送信する場合には
、数メガバイト７秒であるので、ビズィ信号は解除した
状態に固定していても、確実にデータ転送ができる。
尚、バッファＲＡＭ８のアドレスとデータに３ステート
バツフアを介してＣＰＵのアドレスとデータのバスに接
続する事により、ＣＰＵ５からバッファＲＡＭ８に直接
データを書込んだり、読出したりできる様になる。その
場合も本発明に含まれる。又、バッファＲＡＭ８のデー
タ入出力部にはコネクタ１及びヘッドデータ転送回路１
１に対してそれぞれ３ステートバツフア等のバス切換手
段が内蔵されており、バヅフｙＲＡＭ８のリード／ライ
ト制御に合せてバス切換を行う。
バツフアを介してＣＰＵのアドレスとデータのバスに接
続する事により、ＣＰＵ５からバッファＲＡＭ８に直接
データを書込んだり、読出したりできる様になる。その
場合も本発明に含まれる。又、バッファＲＡＭ８のデー
タ入出力部にはコネクタ１及びヘッドデータ転送回路１
１に対してそれぞれ３ステートバツフア等のバス切換手
段が内蔵されており、バヅフｙＲＡＭ８のリード／ライ
ト制御に合せてバス切換を行う。
本発明によれば、次の効果を有する。
０画像データの転送時はソフトウェアを介さずにバー・
ドウエアのみでデータを超高速転送ができる。
ドウエアのみでデータを超高速転送ができる。
■データ転送しながらプリントするプリンタでは、デー
タ転送が間に合わない為のプリント中に起きるプリント
の瞬時停止がなくなり、送りむら等の画質劣化がなくな
る。
タ転送が間に合わない為のプリント中に起きるプリント
の瞬時停止がなくなり、送りむら等の画質劣化がなくな
る。
０１９７５時間を速くできる。
■セントロニクスはほとんどのパソコンに付いており、
本発明をセントロニクスに用いると極めて汎用性が高く
なり、ホストコンピュータの機種を問わずに使える。
本発明をセントロニクスに用いると極めて汎用性が高く
なり、ホストコンピュータの機種を問わずに使える。
第１図は本発明の原理を示すブロック図であり、第２図
はソフトウェアによりプリンタのＣＰＵがデータを受信
している時のタイミング図であり、第３図は本発明のデ
ータ転送のタイミング図である。 コネクタ 切換回路 パラレルＩ／Ｏ用ＩＣ データバス ＣＰＵ アドレスカウンタ バッファＲＡＭ 検出回路 スイッチ ヘッドデータ転送回路 以上 出願人 セイコー電子工業株式会社
はソフトウェアによりプリンタのＣＰＵがデータを受信
している時のタイミング図であり、第３図は本発明のデ
ータ転送のタイミング図である。 コネクタ 切換回路 パラレルＩ／Ｏ用ＩＣ データバス ＣＰＵ アドレスカウンタ バッファＲＡＭ 検出回路 スイッチ ヘッドデータ転送回路 以上 出願人 セイコー電子工業株式会社
Claims (1)
- パラレルデータを扱うインターフェースを介してホスト
コンピュータから１画素づつの階調データを受信してプ
リントする画像プリンタにおいて、中央処理装置（以下
ＣＰＵと呼ぶ）と、該ＣＰＵからアクセス可能なパラレ
ルＩ／Ｏ用ＩＣと、プリントデータを記憶するバッファ
ＲＡＭと、前記インターフェースのデータ読込要求を入
力する信号（以下ストローブ信号とよぶ）及び、プリン
タ側のビズィ状態を出力する信号の流れを切換える切換
手段と、前記ストローブ信号を計数するアドレスカウン
タと、該アドレスカウンタの特定値を検出する検出回路
とを備え、前記切換手段がＣＰＵおよび前記検出回路か
ら制御され、又、インターフェースのパラレルデータが
、前記パラレルＩ／Ｏ用ＩＣと前記バッッファＲＡＭに
直接又はバッファ等の回路を介して接続されている事を
特徴とするプリンタのインターフェース。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63179928A JPH0229357A (ja) | 1988-07-19 | 1988-07-19 | プリンタのインターフェース |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63179928A JPH0229357A (ja) | 1988-07-19 | 1988-07-19 | プリンタのインターフェース |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0229357A true JPH0229357A (ja) | 1990-01-31 |
Family
ID=16074378
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63179928A Pending JPH0229357A (ja) | 1988-07-19 | 1988-07-19 | プリンタのインターフェース |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0229357A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5530792A (en) * | 1990-05-10 | 1996-06-25 | Canon Kabushiki Kaisha | Data processing apparatus utilizing CPU |
| US11894851B2 (en) | 2017-12-22 | 2024-02-06 | Sony Semiconductor Solutions Corporation | Signal generation apparatus for time-of-flight camera with suppressed cyclic error |
-
1988
- 1988-07-19 JP JP63179928A patent/JPH0229357A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5530792A (en) * | 1990-05-10 | 1996-06-25 | Canon Kabushiki Kaisha | Data processing apparatus utilizing CPU |
| US11894851B2 (en) | 2017-12-22 | 2024-02-06 | Sony Semiconductor Solutions Corporation | Signal generation apparatus for time-of-flight camera with suppressed cyclic error |
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