JPH02294686A - 駆動装置及び液晶装置 - Google Patents
駆動装置及び液晶装置Info
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- JPH02294686A JPH02294686A JP11691289A JP11691289A JPH02294686A JP H02294686 A JPH02294686 A JP H02294686A JP 11691289 A JP11691289 A JP 11691289A JP 11691289 A JP11691289 A JP 11691289A JP H02294686 A JPH02294686 A JP H02294686A
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- 239000011159 matrix material Substances 0.000 claims abstract description 12
- 238000006243 chemical reaction Methods 0.000 abstract description 6
- 230000003213 activating effect Effects 0.000 abstract description 2
- 239000008186 active pharmaceutical agent Substances 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
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- 239000010409 thin film Substances 0.000 description 1
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- Liquid Crystal Display Device Control (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は液晶アクティブマトリクス・パネルを駆動する
ための液晶駆動装置に関し、特にディジタル化された映
像データに基き、パネルを駆動するものに関する。
ための液晶駆動装置に関し、特にディジタル化された映
像データに基き、パネルを駆動するものに関する。
ＴＰＴ （薄膜トランジスタ）等をスイッチング素子と
するアクティブマトリクス・パネルを駆動する液晶駆動
装置においては、映像信号はアナログ値であって、その
電圧値を液晶駆動電圧として伝播させ、パネルに印加す
るものが一般的であった。ところで画像表示部を必要と
する機器としては、例えばコンピュータ等の情報機器が
ある。これらの機器では、内部信号はほぼディジタル化
して処理されており、先の液晶アクティブマトリクス・
パネルにて画像表示を行なおうとすると、ディジタル映
像データを必ずＤ／Ａ変換してアナログ信号へ置換する
必要がある。これらの処理をする回路は構成が複雑、消
費電流が大きいといった問題点を有する。そこでディジ
タル映像データをＤ／Ａ変換することなしに構成された
液晶駆動装置について、特開昭６３−１６１４９５に開
示されている。同開示例では、液晶駆動装置内のデータ
側ドライバに、値の異なる２Ｎ本（ディジタル映像デー
タがＮビットの場合）の電源ラインを入力し、各画素の
映像データの重みに対応する電源ラインを選択し、デー
タ側駆動信号として、データ電極に出力する装置例を示
している。
するアクティブマトリクス・パネルを駆動する液晶駆動
装置においては、映像信号はアナログ値であって、その
電圧値を液晶駆動電圧として伝播させ、パネルに印加す
るものが一般的であった。ところで画像表示部を必要と
する機器としては、例えばコンピュータ等の情報機器が
ある。これらの機器では、内部信号はほぼディジタル化
して処理されており、先の液晶アクティブマトリクス・
パネルにて画像表示を行なおうとすると、ディジタル映
像データを必ずＤ／Ａ変換してアナログ信号へ置換する
必要がある。これらの処理をする回路は構成が複雑、消
費電流が大きいといった問題点を有する。そこでディジ
タル映像データをＤ／Ａ変換することなしに構成された
液晶駆動装置について、特開昭６３−１６１４９５に開
示されている。同開示例では、液晶駆動装置内のデータ
側ドライバに、値の異なる２Ｎ本（ディジタル映像デー
タがＮビットの場合）の電源ラインを入力し、各画素の
映像データの重みに対応する電源ラインを選択し、デー
タ側駆動信号として、データ電極に出力する装置例を示
している。
ところが先の開示例では以下の課題がある。通常、パネ
ルのドライバはモノリシックＩＣ化されるが、２Ｎ本の
電源ラインが必要なこと（この電源ラインはドライバＩ
Ｃ内の全液晶パネル駆動出力端子と関係するためＩＣ全
体に配線される。）、電源ラインを選択するマルチブレ
クサ回路の規模が大きいことにより、ＩＣサイズが大き
くなり単価の上昇につながる。
ルのドライバはモノリシックＩＣ化されるが、２Ｎ本の
電源ラインが必要なこと（この電源ラインはドライバＩ
Ｃ内の全液晶パネル駆動出力端子と関係するためＩＣ全
体に配線される。）、電源ラインを選択するマルチブレ
クサ回路の規模が大きいことにより、ＩＣサイズが大き
くなり単価の上昇につながる。
本発明では、Ｄ／Ａ変換せずにディジタル映像データで
液晶アクティブマトリクス・パネルを表示可能であり、
回路規模（ドライバＩＣ内の配線量を含む）の小さな液
晶駆動装置を提供することを目的とする。
液晶アクティブマトリクス・パネルを表示可能であり、
回路規模（ドライバＩＣ内の配線量を含む）の小さな液
晶駆動装置を提供することを目的とする。
前記目的を達成するために本発明の液晶駆動装置は
（１）ａ）走査電極とデータ電極との交点に、スイッチ
ング素子と液晶とからなる画素が形成されてなるアクテ
ィブマトリクス・パネルにて、ディジタル化された画像
データに基き画像を表示する液晶駆動装置において、 ｂ）少なくとも、前記ディジタル化された画像データの
各桁に対応し、電流値の異なる複数の定電流源と Ｃ）前記ディジタル化された画像データの各桁の論理値
に基き、前記複数の定電流源の動作を制御する手段とを
備え、 ｄ）前記複数の定電流源の共通出力により、前記データ
電極を駆動することを特徴とする。
ング素子と液晶とからなる画素が形成されてなるアクテ
ィブマトリクス・パネルにて、ディジタル化された画像
データに基き画像を表示する液晶駆動装置において、 ｂ）少なくとも、前記ディジタル化された画像データの
各桁に対応し、電流値の異なる複数の定電流源と Ｃ）前記ディジタル化された画像データの各桁の論理値
に基き、前記複数の定電流源の動作を制御する手段とを
備え、 ｄ）前記複数の定電流源の共通出力により、前記データ
電極を駆動することを特徴とする。
（２）ａ）前記複数の定電流源は、各々、電流を吸いこ
む第一の状態と、電流をはき出す第二の状態とを有し、 ｂ）各々の状態は、前記アクティブマトリクス・パネル
の交流駆動期間の１７２の期間に同期して、交互に選択
されることを特徴とする。
む第一の状態と、電流をはき出す第二の状態とを有し、 ｂ）各々の状態は、前記アクティブマトリクス・パネル
の交流駆動期間の１７２の期間に同期して、交互に選択
されることを特徴とする。
以下本発明の一構成例を図面に基き説明する。
第１、図は本発明による液晶駆動装置の構成図である。
１０１は走査電極（Ｙｎはその内の一つ）に走査側駆動
信号を出力する走査側ドライバである。
信号を出力する走査側ドライバである。
内部はシフトレジスタ構成となっており、ＹＣＬをシフ
トクロック信号、ＹＳＴをシフト開始信号としている。
トクロック信号、ＹＳＴをシフト開始信号としている。
ＹＣＬ，ＹＳＴ及び以後説明する各種信号はタイミング
・コントローラ（図示せず）より出力されており、後述
するタイムチャート内にタイミングで示されている。
・コントローラ（図示せず）より出力されており、後述
するタイムチャート内にタイミングで示されている。
１０２はデータ側ドライバであり、以下の構成を有して
いる。
いる。
１０３は第１ラインメモリである。第１ラインメモリ１
０３は、４ビット（Ｍ１０〜Ｍ１３）／ワードのメモリ
がＫワード（Ｋは液晶パネル１２０の水平方向画素数に
対応）あるラインメモリである。各ワードはそれぞれの
対応するビット同士が直列的に接続されたシフトレジス
タ構成となっている。ディジタル映像データＤＯ〜Ｄ３
はＭ１０〜Ｍ１３に対応している。第１ラインメモリ１
０３では、ＸＳＴをシフトレジスタの開始信号とし、シ
フトクロックＸＣＬにより順次映像データＤ１０〜Ｄ１
３をＭＩＯ〜Ｍ１３に取りこむ。
０３は、４ビット（Ｍ１０〜Ｍ１３）／ワードのメモリ
がＫワード（Ｋは液晶パネル１２０の水平方向画素数に
対応）あるラインメモリである。各ワードはそれぞれの
対応するビット同士が直列的に接続されたシフトレジス
タ構成となっている。ディジタル映像データＤＯ〜Ｄ３
はＭ１０〜Ｍ１３に対応している。第１ラインメモリ１
０３では、ＸＳＴをシフトレジスタの開始信号とし、シ
フトクロックＸＣＬにより順次映像データＤ１０〜Ｄ１
３をＭＩＯ〜Ｍ１３に取りこむ。
１０４は第２ラインメモリであって、第１ラインメモリ
１０３と同じく、４ビット（Ｍ２０〜Ｍ２３）／ワード
のメモリがＫワードあるラインメモリである。Ｍ２０
〜Ｍ２３はＭＩＯ 〜Ｍ１３に対応しており、ＬＰ信号
によって、第１ラインメモリ１０３の内容が第２ライン
メモリ１０４の対応するワードへ転送される。
１０３と同じく、４ビット（Ｍ２０〜Ｍ２３）／ワード
のメモリがＫワードあるラインメモリである。Ｍ２０
〜Ｍ２３はＭＩＯ 〜Ｍ１３に対応しており、ＬＰ信号
によって、第１ラインメモリ１０３の内容が第２ライン
メモリ１０４の対応するワードへ転送される。
１０５は液晶駆動回路であって、液晶バネル１２６の水
平方向画素数に対応して、Ｋ個の同一ブロックよりなり
、そのブロック内の構成を破線内に示す。
平方向画素数に対応して、Ｋ個の同一ブロックよりなり
、そのブロック内の構成を破線内に示す。
１０７はＡＮＤゲート、ＮＡＮＤゲートよりなるセレク
タであって、各ゲートの第１の入力端子には第２ライン
メモリのＭ２０〜Ｍ２３の出力が接続されている。ＡＮ
ＤＳＮＡＮＤの各ゲートの第２の入力端子には、液晶パ
ネル交流反転信号ＦＲとその反転信号ＦＲ（インバータ
１０６にてＦＲの逆相がとられる。）が接続されている
。各ゲートの出力はＭＯＳ−ＦＥＴＩＩＯ、１１７のゲ
ート入力端子に接続されている。
タであって、各ゲートの第１の入力端子には第２ライン
メモリのＭ２０〜Ｍ２３の出力が接続されている。ＡＮ
ＤＳＮＡＮＤの各ゲートの第２の入力端子には、液晶パ
ネル交流反転信号ＦＲとその反転信号ＦＲ（インバータ
１０６にてＦＲの逆相がとられる。）が接続されている
。各ゲートの出力はＭＯＳ−ＦＥＴＩＩＯ、１１７のゲ
ート入力端子に接続されている。
１０８、１１５、１１６、１１９、１２１、１２３はＰ
チャネルＭＯＳ−Ｆ ＥＴ （Ｔｐ ） 、１ ０９、
１１７、１１８、１２０、１２２、１２４、１２５はＮ
チャネルＭＯＳφＦＥＴ（ＴＮ）である。Ｔｐｌ０８は
ゲートとドレインが共通接続されていて、電源ＶＢとの
間に抵抗１１０がある。
チャネルＭＯＳ−Ｆ ＥＴ （Ｔｐ ） 、１ ０９、
１１７、１１８、１２０、１２２、１２４、１２５はＮ
チャネルＭＯＳφＦＥＴ（ＴＮ）である。Ｔｐｌ０８は
ゲートとドレインが共通接続されていて、電源ＶＢとの
間に抵抗１１０がある。
また同共通接続端子はＴＰ１１５、１１９、１２１、１
２３の各ゲート端子とも接続されており、さらにＴｐｌ
０８のソース端子は電源ＶＡと接続されている。したが
ってＴＰ１０８、抵抗１１０、Ｔｐ１１５、１１９、１
２１、１２３はヤレントミラ−回路を構成している。各
トランジスタ素子の製造条件は同一として、各トランジ
スタのサイズをＴｐｌ０８に対し、Ｔｐｌｌ５は等しく
、ＴＰ１１９は２倍に、Ｔｐｌ２１は４倍に、ＴＰ１２
３は８倍に設定する。ヤレントミラー回路動作時には、
ＴＰ１０８を流れる電流をＩＡとすれば、Ｔｐｌｌ５〜
１２３の各トランジスタを通して、ＩＡ，２ＩＡ，４１
Ａ，８１Ａの大きさの電流が、後述するデータ電極Ｘｍ
へ流れ出す。
２３の各ゲート端子とも接続されており、さらにＴｐｌ
０８のソース端子は電源ＶＡと接続されている。したが
ってＴＰ１０８、抵抗１１０、Ｔｐ１１５、１１９、１
２１、１２３はヤレントミラ−回路を構成している。各
トランジスタ素子の製造条件は同一として、各トランジ
スタのサイズをＴｐｌ０８に対し、Ｔｐｌｌ５は等しく
、ＴＰ１１９は２倍に、Ｔｐｌ２１は４倍に、ＴＰ１２
３は８倍に設定する。ヤレントミラー回路動作時には、
ＴＰ１０８を流れる電流をＩＡとすれば、Ｔｐｌｌ５〜
１２３の各トランジスタを通して、ＩＡ，２ＩＡ，４１
Ａ，８１Ａの大きさの電流が、後述するデータ電極Ｘｍ
へ流れ出す。
ＴＮ１０９、抵抗１１１、ＴＮ１１８、１２０、１２２
、１２４もヤレントミラー回路を構成している。ＴＮ１
０９に対して、各トランジスタのサイズを、ＴＮ１１８
は等しく、ＴＮ１２０は２倍に、ＴＮ１２２は４倍に、
Ｔｓｌ２４は８倍に設定する。製造条件を同一とすれば
、ヤレントミラ−回路動作時には、ＴＮ１０９を流れる
電流を■Ｂとすると、ＴＮ１１８〜１２４の各トランジ
スタを通して、ＩＢ、２１Ｂ，４１Ｂ、８１Ｂの大きさ
の電流が、データ電極Ｘｍがら吸いこまれる。
、１２４もヤレントミラー回路を構成している。ＴＮ１
０９に対して、各トランジスタのサイズを、ＴＮ１１８
は等しく、ＴＮ１２０は２倍に、ＴＮ１２２は４倍に、
Ｔｓｌ２４は８倍に設定する。製造条件を同一とすれば
、ヤレントミラ−回路動作時には、ＴＮ１０９を流れる
電流を■Ｂとすると、ＴＮ１１８〜１２４の各トランジ
スタを通して、ＩＢ、２１Ｂ，４１Ｂ、８１Ｂの大きさ
の電流が、データ電極Ｘｍがら吸いこまれる。
各ヤレントミラ−回路はＴｐｌｌ６、もしくはＴＮ１１
７によりデータ電極Ｘｍと接続されている。
７によりデータ電極Ｘｍと接続されている。
Ｔｐｌｌ６、ＴＮｌｌ７の動作は前述のように、セレク
タ１０７で制御される。すなわちＮＡＮＤ出力がｒＬＪ
ではＴＰ１１６がＯＮＬ、ＡＮＤ出力がｒＨＪではＴＮ
１１７がＯＮする。
タ１０７で制御される。すなわちＮＡＮＤ出力がｒＬＪ
ではＴＰ１１６がＯＮＬ、ＡＮＤ出力がｒＨＪではＴＮ
１１７がＯＮする。
さらにデータ電極ＸｍはＭＯＳ−ＦＥＴ１２５のドレイ
ン端子にも接続されている。１２５のゲート端子には信
号ＤＳが人力され、ソース端子は第３の電源ＶＣに接続
されている。信号ＤＳ−ｒＨＪでは、データ電極Ｘｍは
電源ＶＣと短絡される。
ン端子にも接続されている。１２５のゲート端子には信
号ＤＳが人力され、ソース端子は第３の電源ＶＣに接続
されている。信号ＤＳ−ｒＨＪでは、データ電極Ｘｍは
電源ＶＣと短絡される。
１２６は液晶アクティブマトリクス・パネルであって、
複数の画素よりなる。１２７はデータ電極Ｘｍと走査電
極Ｙｎとの交点にある画素で、例えばスイッチング素子
としてＴＰＴ１２８を用いている。ＴＰＴ１２ｇはゲー
ト端子を走査電極Ｙｎに、ソース端子をデータ電極Ｘｍ
に接続されていて、ドレイン端子には液晶素子１２９に
接続されている。液晶素子１２９のもう一方は固定電位
ＶＣＯＭに接続されている。
複数の画素よりなる。１２７はデータ電極Ｘｍと走査電
極Ｙｎとの交点にある画素で、例えばスイッチング素子
としてＴＰＴ１２８を用いている。ＴＰＴ１２ｇはゲー
ト端子を走査電極Ｙｎに、ソース端子をデータ電極Ｘｍ
に接続されていて、ドレイン端子には液晶素子１２９に
接続されている。液晶素子１２９のもう一方は固定電位
ＶＣＯＭに接続されている。
第１図の液晶駆動装置の動作を、第２図、第３図のタイ
ムチャートにより説明する。
ムチャートにより説明する。
第２図において、ＸＳＴ−ｒＨＪにより、第１図１０３
の第１ラインメモリは、映像データＤＯ〜Ｄ３の取りこ
みを開始する。（ＸＳＴの周期はＴＨである。）画素（
Ｘｍ，Ｙｎ）のデータは、ＸＳＴから数えてｍ個目のＸ
ＣＬでＭ１０〜Ｍ１３に取りこまれる。第２図のように
、ＭＩＯ〜Ｍ１３には最初６−（０、１、１、０）のデ
ータが格納されており、次にＡ一（１、０、１、０）、
？一（１、１、１、０）が順次取りこまれる。第２ライ
ンメモリ１０４のＭ２０〜Ｍ２３には、ＬＰ信号立上り
時のＭＩＯ〜Ｍ１３のデータが取りこまれる。（ＬＰの
周期もＴＨである。）第３図に示すように、走査側ドラ
イバ１０１では、ＹＳＴ− ｒＨＪにより、ＹＣＬに同
期して、順次Ｙ１、Ｙ２、・・・Ｙｎ、・・・の走査側
駆動信号を発生する。いまＦＲ− ｒＬＪ中でのＹｎ−
ｒＨＪを考える。この時、第２ラインメモリ１０４中の
Ｍ２０〜Ｍ２３に格納されているデータはｒＡＪ一（１
、０、１、０）である。ＦＲ− ｒＬＪであるので、セ
レクタ１０７ではＮＡＮＤゲートが能動状態である。デ
ータｒＡＪ − （１、０、１、０）に対応して、液晶
駆動回路１０５ではＴｐｌｌ９、１２３によるヤレント
ミラー回路が能動状態となる。したがって、この時デー
タ電極Ｘｍに流れ出す電流は ２ＩＡ＋８ＩＡ−１０１Ａ である。
の第１ラインメモリは、映像データＤＯ〜Ｄ３の取りこ
みを開始する。（ＸＳＴの周期はＴＨである。）画素（
Ｘｍ，Ｙｎ）のデータは、ＸＳＴから数えてｍ個目のＸ
ＣＬでＭ１０〜Ｍ１３に取りこまれる。第２図のように
、ＭＩＯ〜Ｍ１３には最初６−（０、１、１、０）のデ
ータが格納されており、次にＡ一（１、０、１、０）、
？一（１、１、１、０）が順次取りこまれる。第２ライ
ンメモリ１０４のＭ２０〜Ｍ２３には、ＬＰ信号立上り
時のＭＩＯ〜Ｍ１３のデータが取りこまれる。（ＬＰの
周期もＴＨである。）第３図に示すように、走査側ドラ
イバ１０１では、ＹＳＴ− ｒＨＪにより、ＹＣＬに同
期して、順次Ｙ１、Ｙ２、・・・Ｙｎ、・・・の走査側
駆動信号を発生する。いまＦＲ− ｒＬＪ中でのＹｎ−
ｒＨＪを考える。この時、第２ラインメモリ１０４中の
Ｍ２０〜Ｍ２３に格納されているデータはｒＡＪ一（１
、０、１、０）である。ＦＲ− ｒＬＪであるので、セ
レクタ１０７ではＮＡＮＤゲートが能動状態である。デ
ータｒＡＪ − （１、０、１、０）に対応して、液晶
駆動回路１０５ではＴｐｌｌ９、１２３によるヤレント
ミラー回路が能動状態となる。したがって、この時デー
タ電極Ｘｍに流れ出す電流は ２ＩＡ＋８ＩＡ−１０１Ａ である。
一選択期間Ｔ■の前縁に信号ＤＳ（パルス幅ＴＤ）があ
り、ＤＳ−ｒＨＪの時にデータ電極Ｘｍは電源ＶＣに固
定化される。残りのＴＨ−ＴＤの期間、データ電極Ｘｍ
は電流１０ＩＡで充電してゆく。最終電圧■は浮遊容量
をＣとすると、し である。
り、ＤＳ−ｒＨＪの時にデータ電極Ｘｍは電源ＶＣに固
定化される。残りのＴＨ−ＴＤの期間、データ電極Ｘｍ
は電流１０ＩＡで充電してゆく。最終電圧■は浮遊容量
をＣとすると、し である。
Ｙｎ−ｒＨＪではトランジスタ１２８がＯＮＬているの
で、液晶１２９では■の電圧が印加され、Ｙｎ＝ ｒＬ
Ｊとなった非選択期間においても、図の斜線部に示した
ように、印加電圧が保持される。
で、液晶１２９では■の電圧が印加され、Ｙｎ＝ ｒＬ
Ｊとなった非選択期間においても、図の斜線部に示した
ように、印加電圧が保持される。
ＦＲ−ｒＨＪでは、セレクタ１０７のＡＮＤゲートが能
動状態である。Ｍ２０〜Ｍ２３の格納データがｒＡＪ
− （１、０、１、０）では、ＴＮ１２０、１２４によ
るヤレントミラ−回路が能動状態となる。したがって、
この時データ電極Ｘｍからの流入電流は ２１Ｂ＋８１Ｂ−１０ＩＢ である。したがって、選択期間での最終電圧■′は し である。
動状態である。Ｍ２０〜Ｍ２３の格納データがｒＡＪ
− （１、０、１、０）では、ＴＮ１２０、１２４によ
るヤレントミラ−回路が能動状態となる。したがって、
この時データ電極Ｘｍからの流入電流は ２１Ｂ＋８１Ｂ−１０ＩＢ である。したがって、選択期間での最終電圧■′は し である。
同様に、Ｍ２０〜Ｍ２３の格納データがｒＥＪ一（１、
１、１、０）の場合の、選択期間の最終電圧は となる。
１、１、０）の場合の、選択期間の最終電圧は となる。
このように映像データの値によって、液晶への印加電圧
が変化される。
が変化される。
（発明の効果〕
以上のように本発明によれば、ディジタル化された映像
データの各桁に対応した大きさを持つ定電流源を備え、
映像データの値により、その定電流源を能動化して、デ
ータ電極を駆動することにより、Ｄ／Ａ変換を必要とせ
ずに液晶アクティブマトリクス・パネルを駆動できる。
データの各桁に対応した大きさを持つ定電流源を備え、
映像データの値により、その定電流源を能動化して、デ
ータ電極を駆動することにより、Ｄ／Ａ変換を必要とせ
ずに液晶アクティブマトリクス・パネルを駆動できる。
またｔＣ化に適した回路構成となっている。
この液晶駆動装置は、スイッチング素子としてＭＩＭ等
の２端子素子が用いられた液晶アクティブマトリクス・
パネルに適用でき、応用範囲が広い。
の２端子素子が用いられた液晶アクティブマトリクス・
パネルに適用でき、応用範囲が広い。
第１図は本発明による液晶駆動装置の回路構成図。
第２図は第１図各部のタイムチャート（１）。
第３図は第１図各部のタイムチャート（２）。
出願人 セイコーエプソン株式会社
Claims (2)
- （１）ａ）走査電極とデータ電極との交点に、スイッチ
ング素子と液晶とからなる画素が形成されてなるアクテ
ィブマトリクス・パネルにて、ディジタル化された画像
データに基き画像を表示する液晶駆動装置において、 ｂ）少なくとも、前記ディジタル化された画像データの
各桁に対応し、電流値の異なる複数の定電流源と ｃ）前記ディジタル化された画像データの各桁の論理値
に基き、前記複数の定電流源の動作を制御する手段とを
備え、 ｄ）前記複数の定電流源の共通出力により、前記データ
電極を駆動することを特徴とする液晶駆動装置。 - （２）ａ）前記複数の定電流源は、各々、電流を吸いこ
む第一の状態と、電流をはき出す第二の状態とを有し、 ｂ）各々の状態は、前記アクティブマトリクス・パネル
の交流駆動期間の１／２の期間に同期して、交互に選択
されることを特徴とする請求項１記載の液晶駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11691289A JP2876619B2 (ja) | 1989-05-10 | 1989-05-10 | 駆動装置及び液晶装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11691289A JP2876619B2 (ja) | 1989-05-10 | 1989-05-10 | 駆動装置及び液晶装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02294686A true JPH02294686A (ja) | 1990-12-05 |
| JP2876619B2 JP2876619B2 (ja) | 1999-03-31 |
Family
ID=14698730
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11691289A Expired - Lifetime JP2876619B2 (ja) | 1989-05-10 | 1989-05-10 | 駆動装置及び液晶装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2876619B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000122608A (ja) * | 1998-10-13 | 2000-04-28 | Seiko Epson Corp | 表示装置及び電子機器 |
-
1989
- 1989-05-10 JP JP11691289A patent/JP2876619B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000122608A (ja) * | 1998-10-13 | 2000-04-28 | Seiko Epson Corp | 表示装置及び電子機器 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2876619B2 (ja) | 1999-03-31 |
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