JPH0230184A - Mis型半導体集積回路装置 - Google Patents
Mis型半導体集積回路装置Info
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- JPH0230184A JPH0230184A JP18089388A JP18089388A JPH0230184A JP H0230184 A JPH0230184 A JP H0230184A JP 18089388 A JP18089388 A JP 18089388A JP 18089388 A JP18089388 A JP 18089388A JP H0230184 A JPH0230184 A JP H0230184A
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- Japan
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- polycrystalline silicon
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- point metal
- mis
- integrated circuit
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- Pending
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Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は高融点金属配線をゲート電極として用いるMI
S型半導体集積回路装置に関し、高融点金属配線の配線
jli造に関する。
S型半導体集積回路装置に関し、高融点金属配線の配線
jli造に関する。
MIS型半導体集積回路装置はLSIからVL31/\
と進歩し、集積度でメガビット、微細化レベルでサブミ
クロン時代に突入した。さらに、高集積化、高速化、高
信頼性化への要求はとどまるところを知らない。これら
の要求に応えるため、回路技術、プロセス技術の分野で
精力的な開発が進められている。プロセス面で注目され
る技術の一つに、VLS Iの進歩に伴い適用が期待さ
れている高融点金属配線技術がある。
と進歩し、集積度でメガビット、微細化レベルでサブミ
クロン時代に突入した。さらに、高集積化、高速化、高
信頼性化への要求はとどまるところを知らない。これら
の要求に応えるため、回路技術、プロセス技術の分野で
精力的な開発が進められている。プロセス面で注目され
る技術の一つに、VLS Iの進歩に伴い適用が期待さ
れている高融点金属配線技術がある。
高融点金属をゲート等の配線に適用する場合、いくつか
の構造がある。高融点金属膜の単層か、多結晶シリコン
を下にしいた重ね構造等、色々考えられている。しかし
、Stゲートプロセスと互換性をもたせ、rij広く使
用されていくには幾多の問題かあり、巾広い実用にいた
っていない。
の構造がある。高融点金属膜の単層か、多結晶シリコン
を下にしいた重ね構造等、色々考えられている。しかし
、Stゲートプロセスと互換性をもたせ、rij広く使
用されていくには幾多の問題かあり、巾広い実用にいた
っていない。
第2図(a)〜(C)、第3図(a)〜(c)に断面略
図を示し、以下に従来方法について説明する。
図を示し、以下に従来方法について説明する。
第2図(a)に示すように、N型St単結晶基板21上
にLOCO3酸化M22、ゲート酸化膜23を形成する
。第2図(b)に示すように、高融点金属配線24を形
成した後、イオン打込みによってP+拡散層25を形成
する。第2図(C)に示すように、眉間絶縁膜26を形
成した後、ホトエツチングによりコンタクトホールの穴
あけをおこなう、その後、AL配線27を形成する。
にLOCO3酸化M22、ゲート酸化膜23を形成する
。第2図(b)に示すように、高融点金属配線24を形
成した後、イオン打込みによってP+拡散層25を形成
する。第2図(C)に示すように、眉間絶縁膜26を形
成した後、ホトエツチングによりコンタクトホールの穴
あけをおこなう、その後、AL配線27を形成する。
以上の構造だと、高融点金属配線を形成した後のレジス
ト膜や有機溶剤からの汚れに弱く、スレッショールド電
圧の変動や不安定性をきたすのと同時に、酸などの薬品
処理に弱くおかされやすい。
ト膜や有機溶剤からの汚れに弱く、スレッショールド電
圧の変動や不安定性をきたすのと同時に、酸などの薬品
処理に弱くおかされやすい。
又、熱処理中の雰囲気中に酸素や水分があるとおかされ
やすく不安定である。
やすく不安定である。
第3図(a)に示すように、N型Si単結晶基板31上
にLOCO3酸化11I32及びゲート酸化膜33を形
成する。第3図(b)に示すように、N+ドープされた
多結晶シリコン層34を形成した後高融点金属配線層3
5を形成し、ホトエツチングによって配線を形成する。
にLOCO3酸化11I32及びゲート酸化膜33を形
成する。第3図(b)に示すように、N+ドープされた
多結晶シリコン層34を形成した後高融点金属配線層3
5を形成し、ホトエツチングによって配線を形成する。
その後、イオン打込みによってP+拡散層36を形成す
る。
る。
第3図(C)に示すように、層間絶縁膜37を形成した
後、ホトエツチングによりコンタクトホールの穴あけを
おこなう、その後、AL配線38を形成する。
後、ホトエツチングによりコンタクトホールの穴あけを
おこなう、その後、AL配線38を形成する。
以上の構造だと高融点金属配線層とゲート酸化膜の間に
N型多結晶シリコン層が入っているので、高融点金属配
線層を形成した後のレジスト膜や有機溶剤からの汚れに
は多少強くなるが完全ではないのと同時に、酸などの薬
品処理に弱く、又、熱処理中の雰囲気中に酸素や水分が
あるとおかされやすく不安定である。
N型多結晶シリコン層が入っているので、高融点金属配
線層を形成した後のレジスト膜や有機溶剤からの汚れに
は多少強くなるが完全ではないのと同時に、酸などの薬
品処理に弱く、又、熱処理中の雰囲気中に酸素や水分が
あるとおかされやすく不安定である。
本発明は、高融点金属をゲート電極や配線に用いても、
レジスト膜や有機溶剤等からの汚れに強く、スレッシコ
ールド電圧の変動が少なく、安定した値を得るのと同時
に、酸などの薬品に強く、又、熱処理中の雰囲気の中の
酸素や水分におかされないように強固なものにするのが
目的である。
レジスト膜や有機溶剤等からの汚れに強く、スレッシコ
ールド電圧の変動が少なく、安定した値を得るのと同時
に、酸などの薬品に強く、又、熱処理中の雰囲気の中の
酸素や水分におかされないように強固なものにするのが
目的である。
本発明は、上記問題を解決するために高融点金属を極や
配線の上面と両側面に多結晶シリコンを被着し、高融点
金属層を安定な多結晶シリコンでおおい、さらに必要で
あれば多結晶シリコンを酸化して熱酸化膜でおおう方法
である。
配線の上面と両側面に多結晶シリコンを被着し、高融点
金属層を安定な多結晶シリコンでおおい、さらに必要で
あれば多結晶シリコンを酸化して熱酸化膜でおおう方法
である。
第1図(a)〜(d)に断面略図を示し、以下に本発明
の方法について説明する。
の方法について説明する。
第1図(a>に示すように、N型St単結晶基板1上に
LOGO3酸化膜2及びゲート酸化膜3を形成する。そ
の上に、第1の多結晶シリコン層4を形成した後N+ド
ープをおこなう、その後高融点金属層5及び第2の多結
晶シリコン層6を形成する。
LOGO3酸化膜2及びゲート酸化膜3を形成する。そ
の上に、第1の多結晶シリコン層4を形成した後N+ド
ープをおこなう、その後高融点金属層5及び第2の多結
晶シリコン層6を形成する。
第1図(b)に示すように、第2の多結晶シリコン層6
、高融点金属層5及び第1の多結晶シリコン層4の一部
を残してホトエツチングし配線層を形成する。その上に
、第3の多結晶シリコン層7を形成する。第1図(c)
に示すように、第3の多結晶シリコン層7を異方性エツ
チングでエツチングし配線層の側面に高融点金属層5を
おおうように残す、その後、熱酸化によって多結晶シリ
コンの表面を酸化して、熱酸化膜8を形成する。
、高融点金属層5及び第1の多結晶シリコン層4の一部
を残してホトエツチングし配線層を形成する。その上に
、第3の多結晶シリコン層7を形成する。第1図(c)
に示すように、第3の多結晶シリコン層7を異方性エツ
チングでエツチングし配線層の側面に高融点金属層5を
おおうように残す、その後、熱酸化によって多結晶シリ
コンの表面を酸化して、熱酸化膜8を形成する。
その後、イオン打込み拡散によってP″拡fliJI9
を形成する。
を形成する。
第1図(d)に示すように、PSG膜10を形成した後
、N2アニールをおこない、コンタクトホールの穴あけ
のホトエツチングをおこなった後、AL配線11を形成
する。
、N2アニールをおこない、コンタクトホールの穴あけ
のホトエツチングをおこなった後、AL配線11を形成
する。
本発明の上記のような方法によると、高融点金属をゲー
ト電極や配線に用いても、安定な多結晶シリコン層とそ
の熱酸化膜で高融点金属の電極や配線をおおっているの
で、レジス1〜膜や有機溶剤等からの汚れに強く、スレ
ッショールド電圧の変動がなく安定した値を得るのと同
時に、酸などの薬品におかされない、又、熱処理中の雰
囲気の中に酸素や水分かあっても表面に安定なS i
O2膜ができていて、おかされる事もない。
ト電極や配線に用いても、安定な多結晶シリコン層とそ
の熱酸化膜で高融点金属の電極や配線をおおっているの
で、レジス1〜膜や有機溶剤等からの汚れに強く、スレ
ッショールド電圧の変動がなく安定した値を得るのと同
時に、酸などの薬品におかされない、又、熱処理中の雰
囲気の中に酸素や水分かあっても表面に安定なS i
O2膜ができていて、おかされる事もない。
本発明の例では1高融点金属層の下にN型の多結晶シリ
コン層を用いた例を示したが、P型でも良く、又、 多結晶シリコン層がなくても良い。
コン層を用いた例を示したが、P型でも良く、又、 多結晶シリコン層がなくても良い。
第1図(a)〜第1図(d)
は本発明の一方法
であって製造工程順の断面略図である。
第2図(a)〜第2図(C)
第3図(a)
第3図(c)
は従来の方法による断面略図である。
以
上
Claims (2)
- (1)高融点金属配線をゲート電極として用いるMIS
型半導体集積回路装置において、該高融点金属配線の両
側面と上面のすくなくとも一部を多結晶シリコンでおお
った構造を特徴とするMIS型半導体集積回路装置。 - (2)該多結晶シリコンの表面を該多結晶シリコンの熱
酸化膜で被覆した事を特徴とする請求項1記載のMIS
型半導体集積回路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18089388A JPH0230184A (ja) | 1988-07-19 | 1988-07-19 | Mis型半導体集積回路装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18089388A JPH0230184A (ja) | 1988-07-19 | 1988-07-19 | Mis型半導体集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0230184A true JPH0230184A (ja) | 1990-01-31 |
Family
ID=16091168
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18089388A Pending JPH0230184A (ja) | 1988-07-19 | 1988-07-19 | Mis型半導体集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0230184A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH054522U (ja) * | 1991-06-27 | 1993-01-22 | 三洋電機株式会社 | Mos型fetのゲート構造 |
-
1988
- 1988-07-19 JP JP18089388A patent/JPH0230184A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH054522U (ja) * | 1991-06-27 | 1993-01-22 | 三洋電機株式会社 | Mos型fetのゲート構造 |
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