JPH0230524B2 - - Google Patents
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- Publication number
- JPH0230524B2 JPH0230524B2 JP56117324A JP11732481A JPH0230524B2 JP H0230524 B2 JPH0230524 B2 JP H0230524B2 JP 56117324 A JP56117324 A JP 56117324A JP 11732481 A JP11732481 A JP 11732481A JP H0230524 B2 JPH0230524 B2 JP H0230524B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- key input
- input
- key
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Input From Keyboards Or The Like (AREA)
Description
【発明の詳細な説明】
本発明は、制御回路を具備した集積回路におけ
るキー入力回路に関する。
るキー入力回路に関する。
従来、キー入力を検出する場合、常時あるい
は、所定のサンプリングによつて、キー入力変化
を検出していた。しかし、常時あるいは所定のサ
ンプリングによつてキー入力変化を検出する方法
では、キー入力回路の動作している時間の割合が
大きく、それだけ消費電力が大きくなり、低消費
電力化をめざす集積回路においては、障害となつ
ていた。また、キー入力には、チヤツタ防止機構
を設け、不安定なキー入力は、無効とする制御回
路が必要であるが、このチヤツター防止制御回路
が比較的大きな構成を必要とし、チツプ面積の増
大がコスト上昇を招く集積回路においては、障害
となつていた。
は、所定のサンプリングによつて、キー入力変化
を検出していた。しかし、常時あるいは所定のサ
ンプリングによつてキー入力変化を検出する方法
では、キー入力回路の動作している時間の割合が
大きく、それだけ消費電力が大きくなり、低消費
電力化をめざす集積回路においては、障害となつ
ていた。また、キー入力には、チヤツタ防止機構
を設け、不安定なキー入力は、無効とする制御回
路が必要であるが、このチヤツター防止制御回路
が比較的大きな構成を必要とし、チツプ面積の増
大がコスト上昇を招く集積回路においては、障害
となつていた。
本発明は、この様な欠点を無くすために、キー
入力に係る回路動作時間を短縮し、かつ、チヤツ
ター防止制御を専用の入力回路で行なわず、キー
入力変化直後だけ、汎用レジスタ等で実行可能と
し、集積回路における、低消費電力化、チツプ面
積の減少を計ることを目的とする。
入力に係る回路動作時間を短縮し、かつ、チヤツ
ター防止制御を専用の入力回路で行なわず、キー
入力変化直後だけ、汎用レジスタ等で実行可能と
し、集積回路における、低消費電力化、チツプ面
積の減少を計ることを目的とする。
以下、本発明の実施例を図面を参照しながら説
明する。
明する。
第１図は、本発明の構成要件を示すブロツク図
である。SW１〜SW３等のKey入力群よりの信
号を選択微分回路１０により検出し、１０の出力
信号で、フリツプフロツプ２０をセツトし、２０
の出力信号ａ、サンプリングクロツク発生回路３
０を許可し、３０の出力信号bv、キー入力判定
回路４０を動作させ、所定の判定動作の後、２０
をリセツトする信号ｃを出力し、１０によつて意
味づけられた入力変化の後の所定期間のみをキー
入力検出を行なう。10ブロツク中の１１は、キー
SW１のpositive going edgeとnegative going
edgeの両方を検出し、１２はキーSW２の
positive going edeのみ、１３はキーSW３の
negative going edgeのみを検出し、１４は、１
１，１２，１３の出力信号の論理和をとつてい
る。40ブロツク中の４１は、カウンタ回路で、所
定のサンプリングクロツクを計数後、キヤリー信
号ｃを発生するカウンタ、４２はSW１，SW２，
SW３の入力端の信号をそのまま、サンプリング
クロツクｂによつてストロープする、Ｄフリツプ
フロツプ回路、４３は、４２の出力を入力とする
Ｄフリツプフロツプ回路、４４は、４２と４３の
出力を比較し一致を判定する回路、信号ｄは、一
致した場合、所定のレベルとなる信号であり、ｅ
はｃとｄのAND信号である。
である。SW１〜SW３等のKey入力群よりの信
号を選択微分回路１０により検出し、１０の出力
信号で、フリツプフロツプ２０をセツトし、２０
の出力信号ａ、サンプリングクロツク発生回路３
０を許可し、３０の出力信号bv、キー入力判定
回路４０を動作させ、所定の判定動作の後、２０
をリセツトする信号ｃを出力し、１０によつて意
味づけられた入力変化の後の所定期間のみをキー
入力検出を行なう。10ブロツク中の１１は、キー
SW１のpositive going edgeとnegative going
edgeの両方を検出し、１２はキーSW２の
positive going edeのみ、１３はキーSW３の
negative going edgeのみを検出し、１４は、１
１，１２，１３の出力信号の論理和をとつてい
る。40ブロツク中の４１は、カウンタ回路で、所
定のサンプリングクロツクを計数後、キヤリー信
号ｃを発生するカウンタ、４２はSW１，SW２，
SW３の入力端の信号をそのまま、サンプリング
クロツクｂによつてストロープする、Ｄフリツプ
フロツプ回路、４３は、４２の出力を入力とする
Ｄフリツプフロツプ回路、４４は、４２と４３の
出力を比較し一致を判定する回路、信号ｄは、一
致した場合、所定のレベルとなる信号であり、ｅ
はｃとｄのAND信号である。
第２図は、第１図の構成における、各部信号の
タイミングの１例を示す図である。SW２が与え
られると、第２図のタイムシーケンスが発生し、
ｄに一致信号、ｌにその判定期間を除く信号が得
られる。ここで、サンプリングクロツクｂの周期
を、キー入力系のチヤタリングに対応した適当な
値に設定する事により、チヤツタリング防止機能
を持つたキー入力検出を行ない、検出時点t1にお
ける４２あるいは４３の並列出力を、キー入力群
の入力データとして、次段のキー入力識別処理
に回すことが可能となる。
タイミングの１例を示す図である。SW２が与え
られると、第２図のタイムシーケンスが発生し、
ｄに一致信号、ｌにその判定期間を除く信号が得
られる。ここで、サンプリングクロツクｂの周期
を、キー入力系のチヤタリングに対応した適当な
値に設定する事により、チヤツタリング防止機能
を持つたキー入力検出を行ない、検出時点t1にお
ける４２あるいは４３の並列出力を、キー入力群
の入力データとして、次段のキー入力識別処理
に回すことが可能となる。
キー入力群の識別処理は、マイクロコンピユ
ータによるソフト処理等の任意の方法で実現可能
である。
ータによるソフト処理等の任意の方法で実現可能
である。
第１図における、40ブロツクの機能を、ｂ信号
を、マイクロコンピユータの割込入力端子に与え
ることによつて、SW１，SW２，SW３のキー入
力検出をマイクロコンピユータのソフト処理によ
つて、キー入力群として検出し、機能の識別処
理の前処理として、実現することも出来る。
を、マイクロコンピユータの割込入力端子に与え
ることによつて、SW１，SW２，SW３のキー入
力検出をマイクロコンピユータのソフト処理によ
つて、キー入力群として検出し、機能の識別処
理の前処理として、実現することも出来る。
また、第１図における、10ブロツクの微分回路
を、第２図中に示される信号ｂのサンプル周期よ
り短い所定の周期で、SW１，SW２，SW３信号
をサンプルした、元信号と１周期遅延の微分をと
る回路で実現することも出来る。以上の様に、本
発明により、意味のある入力変化の後の所定期間
のみ、キー識別処理することを可能とし、かつキ
ー群の入力群の入力があつた事を、一括処理する
ため、個々のキー入力毎に、チヤタリング防止回
路等の処理を必要とせず、キー検出機能を備えた
集積回路において、動作処理時間の低減による低
消費電力化、又、個々のチヤツタリング防止回路
を持たないため、少ないハードウエアで実現出来
る事、等の効果がある。特に、マイクロコンピユ
ータ制御回路を具備した、集積回路において、そ
の効果が著しい。
を、第２図中に示される信号ｂのサンプル周期よ
り短い所定の周期で、SW１，SW２，SW３信号
をサンプルした、元信号と１周期遅延の微分をと
る回路で実現することも出来る。以上の様に、本
発明により、意味のある入力変化の後の所定期間
のみ、キー識別処理することを可能とし、かつキ
ー群の入力群の入力があつた事を、一括処理する
ため、個々のキー入力毎に、チヤタリング防止回
路等の処理を必要とせず、キー検出機能を備えた
集積回路において、動作処理時間の低減による低
消費電力化、又、個々のチヤツタリング防止回路
を持たないため、少ないハードウエアで実現出来
る事、等の効果がある。特に、マイクロコンピユ
ータ制御回路を具備した、集積回路において、そ
の効果が著しい。
第１図は、本発明の１実施例で、ブロツク10，
20，30，40は、本発明の構成要件を示す。 １０……選択微分回路、２０……フリツプフロ
ツプ回路、３０……サンプリングクロツク発生回
路、４０……キー入力判定回路 第２図は、第１図における、各部信号のタイム
シーケンスを表わす、タイミングチヤート図であ
る。
20，30，40は、本発明の構成要件を示す。 １０……選択微分回路、２０……フリツプフロ
ツプ回路、３０……サンプリングクロツク発生回
路、４０……キー入力判定回路 第２図は、第１図における、各部信号のタイム
シーケンスを表わす、タイミングチヤート図であ
る。
Claims (1)
- １ キー入力群の入力レベルの変化のうち所定の
入力レベル変化を選択する選択微分回路と、該選
択微分回路の出力信号によつてセツトされるフリ
ツプフロツプ回路と、該フリツプフロツプ回路が
セツトされているときに所定数のサンプリングク
ロツクを発生するサンプリングクロツク発生回路
と、該所定数のサンプリングクロツクによつてサ
ンプリングされた前記キー入力群の入力信号の値
の一致を判定するキー入力判定回路とを備え、該
キー入力判定回路により一致が判定されたときに
サンプリングされていた前記キー入力群の入力信
号を入力データとすることを特徴とするキー入力
検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56117324A JPS5818734A (ja) | 1981-07-27 | 1981-07-27 | キー入力検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56117324A JPS5818734A (ja) | 1981-07-27 | 1981-07-27 | キー入力検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5818734A JPS5818734A (ja) | 1983-02-03 |
| JPH0230524B2 true JPH0230524B2 (ja) | 1990-07-06 |
Family
ID=14708917
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56117324A Granted JPS5818734A (ja) | 1981-07-27 | 1981-07-27 | キー入力検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5818734A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61116734A (ja) * | 1984-11-12 | 1986-06-04 | Mitsubishi Electric Corp | カラ−陰極線管用鋼板部品の黒化被膜形成方法 |
| JPS61172330U (ja) * | 1985-04-16 | 1986-10-25 | ||
| JP2599489B2 (ja) * | 1990-07-09 | 1997-04-09 | 三菱電機株式会社 | 金属の酸化膜形成法および金属の酸化膜形成炉 |
-
1981
- 1981-07-27 JP JP56117324A patent/JPS5818734A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5818734A (ja) | 1983-02-03 |
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