JPH02307117A - 記憶制御装置 - Google Patents
記憶制御装置Info
- Publication number
- JPH02307117A JPH02307117A JP1129109A JP12910989A JPH02307117A JP H02307117 A JPH02307117 A JP H02307117A JP 1129109 A JP1129109 A JP 1129109A JP 12910989 A JP12910989 A JP 12910989A JP H02307117 A JPH02307117 A JP H02307117A
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- 238000001514 detection method Methods 0.000 claims description 10
- 238000010586 diagram Methods 0.000 description 3
- 239000000470 constituent Substances 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は記憶制御装置に関する。
従来、記録媒体上の物理レコード内の一部のデータを更
新することを可能にした記憶制御装置は存在していた。
新することを可能にした記憶制御装置は存在していた。
しかしながら、従来の記憶制御装置においては物理レコ
ードの読取り時に更新すべき論理レコード内においてデ
ータ誤りが発生すると、誤りを訂正しなければ物理レコ
ード内の一部のデータを更新することができないという
欠点があった。
ードの読取り時に更新すべき論理レコード内においてデ
ータ誤りが発生すると、誤りを訂正しなければ物理レコ
ード内の一部のデータを更新することができないという
欠点があった。
本発明は、記録媒体から読取ったデータを一時的に記憶
回路に格納し、誤り位置検出回路で誤りの位置を検出し
、誤りが更新すべき論理レコード内に存在するときはチ
ャネルアダプタ回路により記憶回路内のデータの一部を
チャネルから転送されたデータで更新した後に再び記憶
回路内のデータを記録媒体に書戻すことにより上記欠点
を解決し、更新すべき論理レコード内に読取り誤りが検
出された場合誤りを訂正することなく物理レコード内の
一部のデータを更新することができるようにした装置を
提供するものである。
回路に格納し、誤り位置検出回路で誤りの位置を検出し
、誤りが更新すべき論理レコード内に存在するときはチ
ャネルアダプタ回路により記憶回路内のデータの一部を
チャネルから転送されたデータで更新した後に再び記憶
回路内のデータを記録媒体に書戻すことにより上記欠点
を解決し、更新すべき論理レコード内に読取り誤りが検
出された場合誤りを訂正することなく物理レコード内の
一部のデータを更新することができるようにした装置を
提供するものである。
すなわち本発明は、記録媒体から読取ったデータを一時
的に記憶する記憶回路と、記録媒体とから読取り時に記
憶回路内に格納されているデータの更新すべき論理レコ
ード内に誤りが含まれているか否かを判定するための誤
り位置検出回路と、記憶回路内のデータの一部をチャネ
ルから転送されたデータで更新するチャネルアダプタ回
路とを含み、更新された記憶回路内のデータを再び記録
媒体上に書戻すことにより記録媒体上の更新すべき論理
レコード内にデータ誤りを含む物理レコードの一部のデ
ータを更新することを特徴とする。
的に記憶する記憶回路と、記録媒体とから読取り時に記
憶回路内に格納されているデータの更新すべき論理レコ
ード内に誤りが含まれているか否かを判定するための誤
り位置検出回路と、記憶回路内のデータの一部をチャネ
ルから転送されたデータで更新するチャネルアダプタ回
路とを含み、更新された記憶回路内のデータを再び記録
媒体上に書戻すことにより記録媒体上の更新すべき論理
レコード内にデータ誤りを含む物理レコードの一部のデ
ータを更新することを特徴とする。
次に、本発明の実施例について図面を参照して説明する
。
。
第１図は、本発明の一実施例をブロック的に示した回路
図である。第１図を参照すると、本発明の記憶制御装置
は、マイクロプログラム制御回路１０、記録媒体より読
取ったデータ又はチャネルから転送されたデータを一時
的に格納する記憶回路３０．チャネルとの間でデータ転
送を行ない該記憶回路３０にデータを取込むチャネルア
ダプタ回路２０．記録媒体（デバイス）との間でデータ
転送を行ない前記記憶回路３０にデータを取込み、かつ
記憶回路３０内のデータを取出しデバイスに転送するデ
バイスアダプタ回路５０．記録媒体からデータ読取り時
にデータ誤りがあることを検出し、誤り位置情報を作成
する誤り位置検出回路４０から構成される。
図である。第１図を参照すると、本発明の記憶制御装置
は、マイクロプログラム制御回路１０、記録媒体より読
取ったデータ又はチャネルから転送されたデータを一時
的に格納する記憶回路３０．チャネルとの間でデータ転
送を行ない該記憶回路３０にデータを取込むチャネルア
ダプタ回路２０．記録媒体（デバイス）との間でデータ
転送を行ない前記記憶回路３０にデータを取込み、かつ
記憶回路３０内のデータを取出しデバイスに転送するデ
バイスアダプタ回路５０．記録媒体からデータ読取り時
にデータ誤りがあることを検出し、誤り位置情報を作成
する誤り位置検出回路４０から構成される。
次に上記実施例の構成要素の作用及び動作について具体
的に説明する。複数個の論理レコードから構成される１
つの物理レコードに対して１つの誤り検出訂正コードが
付加されて記録されている物理レコード内の一部の論理
レコードを更新するコマンドを受取ると、マイクロプロ
グラム制御回路１０はコマンドにより指定された物理レ
コードを記録媒体から読取るマイクロ命令を実行し、信
号線１５０を通してデバイスアダプタ回路５０を起動し
、デバイスコマンドを送出する。デバイスアダプタ回路
５０は受取ったデバイスコマンドを信号線５００を通し
てデバイスに対して出し、デバイスから転送されてきた
データを信号線３５０を通して記憶回路３０に格納し、
同時に信号線４５０を通して誤り位置検出回路４０に送
る。
的に説明する。複数個の論理レコードから構成される１
つの物理レコードに対して１つの誤り検出訂正コードが
付加されて記録されている物理レコード内の一部の論理
レコードを更新するコマンドを受取ると、マイクロプロ
グラム制御回路１０はコマンドにより指定された物理レ
コードを記録媒体から読取るマイクロ命令を実行し、信
号線１５０を通してデバイスアダプタ回路５０を起動し
、デバイスコマンドを送出する。デバイスアダプタ回路
５０は受取ったデバイスコマンドを信号線５００を通し
てデバイスに対して出し、デバイスから転送されてきた
データを信号線３５０を通して記憶回路３０に格納し、
同時に信号線４５０を通して誤り位置検出回路４０に送
る。
誤り位置検出回路４０は記録媒体から読取ったデータに
誤りがあることを検出すると、信号線１４０を通してマ
イクロプログラム制御回路１０に通知すると共に誤り位
置情報を作成する。マイクロプログラム制御回路１０は
誤り位置検出回路４０でデータ誤りが検出されたことを
知ると信号線１４０を通して誤り位置検出回路４０から
誤り位置情報を受取り、コマンドより指定された更新す
べき論理レコード内に誤りがあるか否かを判定し、更新
すべき論理レコード内に誤りがある場合には、記憶回路
３０内のデータを更新するためのマイクロ命令を実行し
、信号線１２０を通してチャネルアダプタ回路２０を起
動する。チャネルアダプタ回路２０はチャネルから更新
すべきデータを受取り信号線２３０を通して記憶回路３
０内のデータの更新すべき論理レコード部を更新する。
誤りがあることを検出すると、信号線１４０を通してマ
イクロプログラム制御回路１０に通知すると共に誤り位
置情報を作成する。マイクロプログラム制御回路１０は
誤り位置検出回路４０でデータ誤りが検出されたことを
知ると信号線１４０を通して誤り位置検出回路４０から
誤り位置情報を受取り、コマンドより指定された更新す
べき論理レコード内に誤りがあるか否かを判定し、更新
すべき論理レコード内に誤りがある場合には、記憶回路
３０内のデータを更新するためのマイクロ命令を実行し
、信号線１２０を通してチャネルアダプタ回路２０を起
動する。チャネルアダプタ回路２０はチャネルから更新
すべきデータを受取り信号線２３０を通して記憶回路３
０内のデータの更新すべき論理レコード部を更新する。
データ更新が終了するとマイクロプログラム制御回路ｌ
Ｏは再び記録媒体上に書戻すマイクロ命令を実行し、信
号線１５０を通してデバイスアダプタ回路５０を起動し
デバイスコマンドを送る。デバイスアダプタ回路５０は
受取ったデバイスコマンドを信号線５００を通してデバ
イスに送り、信号線３５０を通して記憶回路３０から前
記更新したデータを読出し、信号線５００を通してデバ
イスに送り記録媒体上に書戻すことにより読取り時にデ
ータ誤りが発生したとき更新する論理レコード内にデー
タ誤りがある場合、物理レコード内の一部の論理レコー
ドの更新が可能となる。
Ｏは再び記録媒体上に書戻すマイクロ命令を実行し、信
号線１５０を通してデバイスアダプタ回路５０を起動し
デバイスコマンドを送る。デバイスアダプタ回路５０は
受取ったデバイスコマンドを信号線５００を通してデバ
イスに送り、信号線３５０を通して記憶回路３０から前
記更新したデータを読出し、信号線５００を通してデバ
イスに送り記録媒体上に書戻すことにより読取り時にデ
ータ誤りが発生したとき更新する論理レコード内にデー
タ誤りがある場合、物理レコード内の一部の論理レコー
ドの更新が可能となる。
第２図の実施例は、データ読取り時に誤りが検出される
と訂正情報を作成する誤り訂正回路６０を第１図、の回
路に付加したものである。誤り訂正回路６０を付加する
ことにより更新すべき論理しコード外に誤りが存在する
とき、訂正可能なデータ誤りの場合には、誤りを訂正し
た後で更新すべき論理レコード部を更新し、記録媒体上
に書戻すことにより更新する論理レコード外でも訂正可
能なデータ誤りが発生した場合、物理レコード内の一部
の論理レコードの更新が可能となる。
と訂正情報を作成する誤り訂正回路６０を第１図、の回
路に付加したものである。誤り訂正回路６０を付加する
ことにより更新すべき論理しコード外に誤りが存在する
とき、訂正可能なデータ誤りの場合には、誤りを訂正し
た後で更新すべき論理レコード部を更新し、記録媒体上
に書戻すことにより更新する論理レコード外でも訂正可
能なデータ誤りが発生した場合、物理レコード内の一部
の論理レコードの更新が可能となる。
本発明は以上説明したように、更新すべき論理レコード
内に誤りがあるか否かを判定し、記憶回路内で更新する
ように構成することにより記録媒体からデータ読取り時
に更新すべき論理レコード内にデータ誤りが発生したと
き誤りを訂正することなく更新できるという効果がある
。
内に誤りがあるか否かを判定し、記憶回路内で更新する
ように構成することにより記録媒体からデータ読取り時
に更新すべき論理レコード内にデータ誤りが発生したと
き誤りを訂正することなく更新できるという効果がある
。
第１図は本発明の一実施例をブロック的に示した回路図
、第２図は本発明の他の実施例を示す回路図である。 １０・・・・・・マイクルプログラム制御回路、２０・
・・・・・チャネルアダプタ回路、３０・・・・・・記
憶回路、４０・・・・・・誤り位置検出回路、５０・・
・・・・デバイスアダプタ回路、６０・・・・・・語り
訂正回路。
、第２図は本発明の他の実施例を示す回路図である。 １０・・・・・・マイクルプログラム制御回路、２０・
・・・・・チャネルアダプタ回路、３０・・・・・・記
憶回路、４０・・・・・・誤り位置検出回路、５０・・
・・・・デバイスアダプタ回路、６０・・・・・・語り
訂正回路。
Claims (1)
- 記録媒体から読取ったデータを一時的に記憶する記憶回
路と、記録媒体から読取り時に該記憶回路内に格納され
ているデータの更新すべき論理レコード内に誤りが含ま
れているか否かを判定するための誤り位置検出回路と、
前記記憶回路内のデータの一部をチャネルから転送され
たデータで更新するチャネルアダプタ回路とを含み、更
新された前記記憶回路内のデータを再び記録媒体上に書
き戻すことにより記録媒体上の更新すべき論理レコード
内にデータ誤りを含む物理レコードの一部のデータを更
新することを特徴とする記憶制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1129109A JPH0833803B2 (ja) | 1989-05-22 | 1989-05-22 | 記憶制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1129109A JPH0833803B2 (ja) | 1989-05-22 | 1989-05-22 | 記憶制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02307117A true JPH02307117A (ja) | 1990-12-20 |
| JPH0833803B2 JPH0833803B2 (ja) | 1996-03-29 |
Family
ID=15001288
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1129109A Expired - Lifetime JPH0833803B2 (ja) | 1989-05-22 | 1989-05-22 | 記憶制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0833803B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6727306B2 (en) | 2000-12-15 | 2004-04-27 | Wellman, Inc. | Polymer resins having reduced frictional properties |
| US6903154B2 (en) | 2001-03-30 | 2005-06-07 | Eastman Chemical Company | Polyesters and polyester containers having a reduced coefficient of friction and improved clarity |
-
1989
- 1989-05-22 JP JP1129109A patent/JPH0833803B2/ja not_active Expired - Lifetime
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6727306B2 (en) | 2000-12-15 | 2004-04-27 | Wellman, Inc. | Polymer resins having reduced frictional properties |
| US6903154B2 (en) | 2001-03-30 | 2005-06-07 | Eastman Chemical Company | Polyesters and polyester containers having a reduced coefficient of friction and improved clarity |
| US7399802B2 (en) | 2001-03-30 | 2008-07-15 | Eastman Chemical Company | Polyesters and polyester containers having a reduced coefficient of friction and improved clarity |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0833803B2 (ja) | 1996-03-29 |
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Legal Events
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| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080329 Year of fee payment: 12 |
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Free format text: PAYMENT UNTIL: 20090329 Year of fee payment: 13 |
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