JPH0239181U - - Google Patents

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JPH0239181U
JPH0239181U JP11770888U JP11770888U JPH0239181U JP H0239181 U JPH0239181 U JP H0239181U JP 11770888 U JP11770888 U JP 11770888U JP 11770888 U JP11770888 U JP 11770888U JP H0239181 U JPH0239181 U JP H0239181U
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gate circuit
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signal
gate
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  • Test And Diagnosis Of Digital Computers (AREA)

Description

【図面の簡単な説明】
第１図は本考案に係わるアドレススキヤン用ラ
ツチ回路の原理および実施例構成を説明するため
の図、第２図は、ＬＳＩ内部の要部構成図、第３
図は従来のアドレススキヤン用ラツチ回路の構成
図、第４図は、アドレススキヤン用ラツチ回路の
動作を説明するための信号波形図、第５図はアド
レススキヤン用ラツチ回路を行列状に配設した図
である。 ５ａ〜５ｃ：ＯＲゲート、５ｄ：ＡＮＤゲート
、６ａ：ＯＲゲート、６ｂ：ＮＯＲゲート、９ａ
：ＯＲゲート、９ｂ：ＡＮＤゲート。

Claims (1)

  1. 【実用新案登録請求の範囲】 セツト信号を一方の入力端子に受ける第１のＯ
    Ｒゲート回路９ａと、前記第１のＯＲゲート回路
    ９ａの出力信号を一方の入力端子に受けるＡＮＤ
    ゲート回路９ｂとを設け、 前記ＡＮＤゲート回路９ｂの出力信号を前記第
    １のＯＲゲート回路９ａの他方の入力端子に入力
    せしめるとともに、 スキヤンイン信号およびＸ，Ｙアドレス信号を
    受ける第２のＯＲゲート回路１０ａと、前記Ｘ，
    Ｙアドレス信号および前記ＡＮＤゲート回路９ｂ
    の出力信号を受けるＮＯＲゲート回路１０ｂとを
    設け、 前記第２のＯＲゲート回路１０ａの出力信号を
    、前記ＡＮＤゲート回路９ｂの他方の入力端子へ
    入力せしめることを特徴とするアドレススキヤン
    用ラツチ回路。
JP11770888U 1988-09-07 1988-09-07 アドレススキャン用ラッチ回路 Expired - Lifetime JPH0714925Y2 (ja)

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JP11770888U JPH0714925Y2 (ja) 1988-09-07 1988-09-07 アドレススキャン用ラッチ回路

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JPH0239181U true JPH0239181U (ja) 1990-03-15
JPH0714925Y2 JPH0714925Y2 (ja) 1995-04-10

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ID=31361402

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JPH0714925Y2 (ja) 1995-04-10

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