JPH0240599Y2 - - Google Patents
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- Publication number
- JPH0240599Y2 JPH0240599Y2 JP1982173382U JP17338282U JPH0240599Y2 JP H0240599 Y2 JPH0240599 Y2 JP H0240599Y2 JP 1982173382 U JP1982173382 U JP 1982173382U JP 17338282 U JP17338282 U JP 17338282U JP H0240599 Y2 JPH0240599 Y2 JP H0240599Y2
- Authority
- JP
- Japan
- Prior art keywords
- recording
- flip
- flop circuit
- signal
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Management Or Editing Of Information On Record Carriers (AREA)
- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
Description
【考案の詳細な説明】
本考案は、曲間に無信号部分を自動的に設ける
曲間無信号録音制御回路に関し、特に曲間無信号
録音の進行中にその動作を解除して、そく録音の
開始が行なえる曲間無信号録音制御回路に関する
ものである。
曲間無信号録音制御回路に関し、特に曲間無信号
録音の進行中にその動作を解除して、そく録音の
開始が行なえる曲間無信号録音制御回路に関する
ものである。
曲間無信号録音制御回路は、テープレコーダの
録音時にその曲間部に予め定められた一定時間に
わたつて無信号部分を記録するためのものであ
り、再生時にこの無信号部分を検出することによ
つて曲間検出が容易に行なえるものである。
録音時にその曲間部に予め定められた一定時間に
わたつて無信号部分を記録するためのものであ
り、再生時にこの無信号部分を検出することによ
つて曲間検出が容易に行なえるものである。
この場合、従来一般に用いられている曲間無信
号録音制御回路は、録音中の曲の終了時にオート
エデイタスイツチを一瞬オンすると、自動的に無
信号録音が一定時間行なわれた後に自動的に停止
またはポーズ状態となるものである。
号録音制御回路は、録音中の曲の終了時にオート
エデイタスイツチを一瞬オンすると、自動的に無
信号録音が一定時間行なわれた後に自動的に停止
またはポーズ状態となるものである。
しかしながら、上記構成による曲間無信号録音
制御回路は、曲間無信号録音が開始されると、そ
の途中においてはかかる動作の解除は停止または
ポーズ動作にセツトしない限り行なうことができ
ない。この結果、例えばFM放送の録音時等のよ
うに、曲間無信号録音の途中において急拠録音を
行なう場合には、停止またはポーズにセツトする
ことにより曲間無信号録音を解除した後に録音セ
ツトを行なう必要があり、その操作が２重になつ
て操作が繁雑なものとなつてしまう問題を有して
いる。
制御回路は、曲間無信号録音が開始されると、そ
の途中においてはかかる動作の解除は停止または
ポーズ動作にセツトしない限り行なうことができ
ない。この結果、例えばFM放送の録音時等のよ
うに、曲間無信号録音の途中において急拠録音を
行なう場合には、停止またはポーズにセツトする
ことにより曲間無信号録音を解除した後に録音セ
ツトを行なう必要があり、その操作が２重になつ
て操作が繁雑なものとなつてしまう問題を有して
いる。
この考案の目的は、曲間無信号録音中において
も、録音操作によつて直接録音が行なえる曲間無
信号録音制御回路を提供することである。
も、録音操作によつて直接録音が行なえる曲間無
信号録音制御回路を提供することである。
以下、図面を用いてこの考案による曲間無信号
録音制御回路を詳細に説明する。
録音制御回路を詳細に説明する。
図はこの考案による曲間無信号制御回路の一実
施例を示す回路図である。同図においてS1はプル
アツプ抵抗R1を介して電源Vccとアース間に接続
されたエデイタスイツチ、S2はプルアツプ抵抗
R2を介して電源Vccとアース間に接続された録音
スイツチ、FF1は録音スイツチS2の出力によつて
セツトされるフリツプフロツプ回路であつて、図
示しない停止スイツチから供給されるリセツト入
力信号Ａによりリセツトされる。G1はエデイタ
スイツチS1の出力とフリツプフロツプ回路FF1の
リセツト出力とを入力とするナンドゲート、
FF2はナンドゲートG1の出力によりセツトされる
フリツプフロツプ回路、Ｔはフリツプフロツプ回
路FF2のセツト出力によつてトリガされ、予め定
められた曲間無信号期間としての時間ｔを計時す
るタイマ、G2は録音スイツチS2の出力とフリツ
プフロツプ回路FF2のリセツト出力を入力とす
るアンドゲート、G3はタイマＴの出力とアンド
ゲートG2の出力を入力として、その出力によつ
てフリツプフロツプ回路FF2をリセツトするノア
ゲート、Ｂはテープレコーダであつて、フリツプ
フロツプ回路FF1のセツト出力ＱとタイマＴの出
力によつて制御される入力部Ｘと、フリツプフロ
ツプ回路FF2のセツト出力Ｑとフリツプフロツプ
回路FF1のセツト出力Ｑによつて制御される録音
信号系Ｙとによつて構成されている。そして、こ
の場合における入力部Ｘは電子制御によつて駆動
されるものである。
施例を示す回路図である。同図においてS1はプル
アツプ抵抗R1を介して電源Vccとアース間に接続
されたエデイタスイツチ、S2はプルアツプ抵抗
R2を介して電源Vccとアース間に接続された録音
スイツチ、FF1は録音スイツチS2の出力によつて
セツトされるフリツプフロツプ回路であつて、図
示しない停止スイツチから供給されるリセツト入
力信号Ａによりリセツトされる。G1はエデイタ
スイツチS1の出力とフリツプフロツプ回路FF1の
リセツト出力とを入力とするナンドゲート、
FF2はナンドゲートG1の出力によりセツトされる
フリツプフロツプ回路、Ｔはフリツプフロツプ回
路FF2のセツト出力によつてトリガされ、予め定
められた曲間無信号期間としての時間ｔを計時す
るタイマ、G2は録音スイツチS2の出力とフリツ
プフロツプ回路FF2のリセツト出力を入力とす
るアンドゲート、G3はタイマＴの出力とアンド
ゲートG2の出力を入力として、その出力によつ
てフリツプフロツプ回路FF2をリセツトするノア
ゲート、Ｂはテープレコーダであつて、フリツプ
フロツプ回路FF1のセツト出力ＱとタイマＴの出
力によつて制御される入力部Ｘと、フリツプフロ
ツプ回路FF2のセツト出力Ｑとフリツプフロツプ
回路FF1のセツト出力Ｑによつて制御される録音
信号系Ｙとによつて構成されている。そして、こ
の場合における入力部Ｘは電子制御によつて駆動
されるものである。
このように構成された回路において、まず録音
スイツチS2が操作されてオンすると、その出力が
“Ｌ”となつてフリツプフロツプ回路FF1がセツ
トされる。フリツプフロツプ回路FF1がセツトさ
れると、そのセツト出力Ｑによつて入力部Ｘおよ
び録音信号系Ｙが制御されてテープレコーダＢが
録音モードにセツトされる。
スイツチS2が操作されてオンすると、その出力が
“Ｌ”となつてフリツプフロツプ回路FF1がセツ
トされる。フリツプフロツプ回路FF1がセツトさ
れると、そのセツト出力Ｑによつて入力部Ｘおよ
び録音信号系Ｙが制御されてテープレコーダＢが
録音モードにセツトされる。
この状態で目的とする曲の録音が行なわれ、曲
の終了に応じてエデイタスイツチS1が閉じられる
と、フリツプフロツプ回路FF1のリセツト出力
は“Ｌ”であるために、ナンドゲートG1の出力
によつてフリツプフロツプ回路FF2がセツトされ
る。このようにしてフリツプフロツプ回路FF2が
セツトされると、そのセツト出力Ｑによつて録音
信号系Ｙが制御されて録音信号に対するミユート
がかけられて無信号録音が行なわれると共に、タ
イマＴがトリガされて無信号録音期間としての時
間ｔの計時を開始する。そして、タイマＴが時間
ｔの計時を終了して出力を発生すると、入力部Ｘ
がポーズモードにセツトされると共に、フリツプ
フロツプ回路FF2がリセツトされて録音信号系Ｙ
に対するミユート制御が解除される。従つて、テ
ープレコーダＢは全体として録音ポーズモードと
なる。
の終了に応じてエデイタスイツチS1が閉じられる
と、フリツプフロツプ回路FF1のリセツト出力
は“Ｌ”であるために、ナンドゲートG1の出力
によつてフリツプフロツプ回路FF2がセツトされ
る。このようにしてフリツプフロツプ回路FF2が
セツトされると、そのセツト出力Ｑによつて録音
信号系Ｙが制御されて録音信号に対するミユート
がかけられて無信号録音が行なわれると共に、タ
イマＴがトリガされて無信号録音期間としての時
間ｔの計時を開始する。そして、タイマＴが時間
ｔの計時を終了して出力を発生すると、入力部Ｘ
がポーズモードにセツトされると共に、フリツプ
フロツプ回路FF2がリセツトされて録音信号系Ｙ
に対するミユート制御が解除される。従つて、テ
ープレコーダＢは全体として録音ポーズモードと
なる。
次に、曲間無信号録音中、つまり、フリツプフ
ロツプ回路FF1，FF2のセツト時に急拠録音の必
要に伴つて録音スイツチS2が一瞬閉じられると、
アンドゲートG2の両入力が共に“Ｌ”となり、
これに伴つて出力が“Ｈ”となる。アンドゲート
G2の入力が“Ｈ”になると、ノアゲートG3の出
力が“Ｌ”となつてフリツプフロツプ回路FF2が
リセツトされる。この結果、フリツプフロツプ回
路FF2のセツト出力Ｑが“Ｌ”に反転するため
に、録音信号系Ｙのミユート制御が解除されて直
接録音がそく実行されることになる。従つてこの
場合においては、曲間無信号録音の期間中おいて
も、録音スイツチS2のみを操作する１動作を実行
するのみで、曲間無信号録音が解除されて直接録
音がそく実行されることになり、その操作が従来
に比較して大幅に簡略化されることになる。
ロツプ回路FF1，FF2のセツト時に急拠録音の必
要に伴つて録音スイツチS2が一瞬閉じられると、
アンドゲートG2の両入力が共に“Ｌ”となり、
これに伴つて出力が“Ｈ”となる。アンドゲート
G2の入力が“Ｈ”になると、ノアゲートG3の出
力が“Ｌ”となつてフリツプフロツプ回路FF2が
リセツトされる。この結果、フリツプフロツプ回
路FF2のセツト出力Ｑが“Ｌ”に反転するため
に、録音信号系Ｙのミユート制御が解除されて直
接録音がそく実行されることになる。従つてこの
場合においては、曲間無信号録音の期間中おいて
も、録音スイツチS2のみを操作する１動作を実行
するのみで、曲間無信号録音が解除されて直接録
音がそく実行されることになり、その操作が従来
に比較して大幅に簡略化されることになる。
なお、タイマＴはフリツプフロツプ回路FF2の
セツト出力Ｑが“Ｌ”に反転することによりその
計時動作を停止してリセツトされるために、その
出力は発生されない。
セツト出力Ｑが“Ｌ”に反転することによりその
計時動作を停止してリセツトされるために、その
出力は発生されない。
以上説明したように、この考案による曲間無信
号録音制御回路によれば、曲間無信号録音の期間
中においても、録音スイツチを一瞬操作するのみ
で急拠録音がそく実行されることなり、その操作
が従来に比較して大幅に簡略化される優れた効果
を有する。
号録音制御回路によれば、曲間無信号録音の期間
中においても、録音スイツチを一瞬操作するのみ
で急拠録音がそく実行されることなり、その操作
が従来に比較して大幅に簡略化される優れた効果
を有する。
図はこの考案による曲間無信号録音制御回路の
一実施例を示す回路図である。 S1……エデイタスイツチ、S2……録音スイツ
チ、G1……ナンドゲート、G2……アンドゲート、
G3……ノアゲート、FF1，FF2……フリツプフロ
ツプ回路、Ｔ……タイマ、Ｂ……テープレコー
ダ。
一実施例を示す回路図である。 S1……エデイタスイツチ、S2……録音スイツ
チ、G1……ナンドゲート、G2……アンドゲート、
G3……ノアゲート、FF1，FF2……フリツプフロ
ツプ回路、Ｔ……タイマ、Ｂ……テープレコー
ダ。
Claims (1)
- エデイタスイツチと、録音スイツチを備える曲
間無信号録音制御回路において、録音スイツチの
出力によりセツトされてテープレコーダを録音モ
ードにセツトする第１フリツプフロツプ回路と、
この第１フリツプフロツプ回路のセツト期間にエ
デイタスイツチが操作された時のみセツトされて
録音信号をミユート制御する第２フリツプフロツ
プ回路と、この第２フリツプフロツプ回路のセツ
ト出力により動作を開始して曲間無信号録音期間
を計時すると出力を発生してテープレコーダを録
音ポーズにセツトすると共に前記第２フリツプフ
ロツプ回路をリセツトするタイマと、前記第２フ
リツプフロツプ回路のセツト期間に前記録音スイ
ツチが操作されたことを検出して前記第２フリツ
プフロツプ回路をリセツトする第２ゲート回路と
を備えた曲間無信号録音制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17338282U JPS5978541U (ja) | 1982-11-15 | 1982-11-15 | 曲間無信号録音制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17338282U JPS5978541U (ja) | 1982-11-15 | 1982-11-15 | 曲間無信号録音制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5978541U JPS5978541U (ja) | 1984-05-28 |
| JPH0240599Y2 true JPH0240599Y2 (ja) | 1990-10-30 |
Family
ID=30377719
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17338282U Granted JPS5978541U (ja) | 1982-11-15 | 1982-11-15 | 曲間無信号録音制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5978541U (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5792449A (en) * | 1980-11-27 | 1982-06-09 | Akai Electric Co Ltd | Tape recorder |
-
1982
- 1982-11-15 JP JP17338282U patent/JPS5978541U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5978541U (ja) | 1984-05-28 |
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