JPH0242744A - チップ選別方法 - Google Patents
チップ選別方法Info
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- JPH0242744A JPH0242744A JP63193840A JP19384088A JPH0242744A JP H0242744 A JPH0242744 A JP H0242744A JP 63193840 A JP63193840 A JP 63193840A JP 19384088 A JP19384088 A JP 19384088A JP H0242744 A JPH0242744 A JP H0242744A
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- Japan
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- wafer
- sheet
- chip
- medium layer
- scribed
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- Pending
Links
- 239000010410 layer Substances 0.000 claims abstract description 8
- 239000012790 adhesive layer Substances 0.000 claims abstract description 4
- 230000002950 deficient Effects 0.000 claims description 6
- 238000005259 measurement Methods 0.000 claims description 4
- 238000000034 method Methods 0.000 abstract description 21
- 238000011179 visual inspection Methods 0.000 abstract 1
- 235000012431 wafers Nutrition 0.000 description 16
- 230000000694 effects Effects 0.000 description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 238000001259 photo etching Methods 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
Landscapes
- Testing Electric Properties And Detecting Electric Faults (AREA)
- Sorting Of Articles (AREA)
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
- Dicing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はチップ選別方法に関する。
次に従来のチップ選別方法について図面を参照して詳細
に説明する。
に説明する。
第2図は従来のチップ選別方法の一例を示すフローチャ
ートである。
ートである。
第2図に示すチップ選別方法は、
(A)拡散、ホトエツチング等の工程を経たウェハ内の
素子の各特性をプローバ等で個々に測定する測定工程(
Sll)、 (B)不良素子にスクラッチマーキング(またはインク
マーキング、磁性インクマーキング)をつけて良否を分
類する分類工程(S12)、(C)ウェハをスクライビ
ングするスクライビング工程(S13)、 (D)ウェハを粘着剤を片面に有するプ°ラスチック製
のシートに張付ける張付工程(S14)、(E)ウェハ
をチップ化するブレーキング工程(S15)、 (F)シートを拡張し前記ウェハのブレーキング部分に
間隔を設けるシート拡張工程(S16)、(G)良品チ
ップを判別してパッケージの所定の位置に搭載するダイ
マウント工程(S17)、とを含んで構成される。
素子の各特性をプローバ等で個々に測定する測定工程(
Sll)、 (B)不良素子にスクラッチマーキング(またはインク
マーキング、磁性インクマーキング)をつけて良否を分
類する分類工程(S12)、(C)ウェハをスクライビ
ングするスクライビング工程(S13)、 (D)ウェハを粘着剤を片面に有するプ°ラスチック製
のシートに張付ける張付工程(S14)、(E)ウェハ
をチップ化するブレーキング工程(S15)、 (F)シートを拡張し前記ウェハのブレーキング部分に
間隔を設けるシート拡張工程(S16)、(G)良品チ
ップを判別してパッケージの所定の位置に搭載するダイ
マウント工程(S17)、とを含んで構成される。
第3図は第2図に示すブレーキング工程S15終了後の
チップの形状を示す断面図である。
チップの形状を示す断面図である。
シート20に張付いているチップ31〜34は、シリコ
ン結晶の性質上、ある角度を持ってブレーキングされる
ので、真上に持上げてダイマウントできない。そこでチ
ップ31〜34に間隔を設は真上に持上げてダイマウン
トできるようにするため、シート20を拡張するシート
拡張工程S16が必要になる。
ン結晶の性質上、ある角度を持ってブレーキングされる
ので、真上に持上げてダイマウントできない。そこでチ
ップ31〜34に間隔を設は真上に持上げてダイマウン
トできるようにするため、シート20を拡張するシート
拡張工程S16が必要になる。
シート拡張工程S16を実施すると各チップの相対位置
は不定になるため、ダイマウント工程S17ではマウン
トせんとするチップの位置をを画像認識装置を用いて調
べなければならない。
は不定になるため、ダイマウント工程S17ではマウン
トせんとするチップの位置をを画像認識装置を用いて調
べなければならない。
画像認識装置は搭載せんとするチップの良否をも調べ、
良品チップのみをマウントするために利用されるが、認
識率が低い場合はダイマウント工程S17以前に、不良
チップを人間が目視で排除しておかなけれはならない。
良品チップのみをマウントするために利用されるが、認
識率が低い場合はダイマウント工程S17以前に、不良
チップを人間が目視で排除しておかなけれはならない。
上述した従来のチップ選別方法は、ダイマウント工程前
に良品チップとその位置を機械的に移動する光学系を用
いて調べ、不良チップ認識率が低い場合は人間が目視で
排除しておかなけれはならないので、選別時間が長くな
るという欠点があった。
に良品チップとその位置を機械的に移動する光学系を用
いて調べ、不良チップ認識率が低い場合は人間が目視で
排除しておかなけれはならないので、選別時間が長くな
るという欠点があった。
本発明のチップ選別方法は、
(A)表面に粘着剤層を、裏面に磁性媒体層を有するシ
ートの前記表面にウェハを張付けるシート張付工程、 (B)前記ウェハ内の各素子の各特性をプローバ等で個
々に測定する測定工程 (C)前記各素子の裏面に位置する前記磁性媒体層に前
記測定結果を記憶させる分類工程、(D)前記ウェハを
スクライビングするスクライビング工程、 (R)スクライビングされたウェハをブレーキングする
ブレーキング工程、 (F)前記シートを拡張し前記ウェハのブレーキング部
分に間隔を設けるシート拡張工程、(G)前記磁気情報
にもとづいて良品チップを判別してパッケージの所定の
位置に搭載するダイマウント工程、 とを含んで構成される。
ートの前記表面にウェハを張付けるシート張付工程、 (B)前記ウェハ内の各素子の各特性をプローバ等で個
々に測定する測定工程 (C)前記各素子の裏面に位置する前記磁性媒体層に前
記測定結果を記憶させる分類工程、(D)前記ウェハを
スクライビングするスクライビング工程、 (R)スクライビングされたウェハをブレーキングする
ブレーキング工程、 (F)前記シートを拡張し前記ウェハのブレーキング部
分に間隔を設けるシート拡張工程、(G)前記磁気情報
にもとづいて良品チップを判別してパッケージの所定の
位置に搭載するダイマウント工程、 とを含んで構成される。
次に、本発明の実施例について図面を参照して説明する
。
。
第1図は本発明の一実施例を示すフローチャートである
。
。
工程S1
表面に粘着剤層を、裏面に磁性媒体層を有するシートの
前記表面にウェハを張付ける。
前記表面にウェハを張付ける。
工程S2
前記ウェハ内の各素子の各特性をプローバ等で個々に測
定する。
定する。
工程S3
前記各素子の裏面に位置する前記磁性媒体層に前記測定
結果を記憶させる。
結果を記憶させる。
工程S4
前記ウェハをスクライビングする。
工程S5
スクライビングされたウェハをブレーキングする。
工程S6
前記シートを拡張し前記ウェハのブレーキング部分に間
隔を設ける。
隔を設ける。
工程S7
前記磁気情報にもとづいて良品チップを判別してパッケ
ージの所定の位置に搭載する。
ージの所定の位置に搭載する。
工程S6において、シートはウェハのブレーキング部分
が主として拡張され、チップに粘着している部分のシー
トはチップに保護されて殆んど拡張しないから、磁気情
報は破壊されない。
が主として拡張され、チップに粘着している部分のシー
トはチップに保護されて殆んど拡張しないから、磁気情
報は破壊されない。
本発明のチップ選別方法は、選別時間が短縮できるとい
う効果がある。
う効果がある。
勇7
第1図は本発明の一実施例を示すフローチャート、第2
図は従来の一例を示すフローチャート、第3図は第2図
に示すブレーキング工程終了後のチップの形状を示す断
面図である。 20・・・・・・シート、31〜34・・・・・・チッ
プ。 代理人 弁理士 内 原 晋
図は従来の一例を示すフローチャート、第3図は第2図
に示すブレーキング工程終了後のチップの形状を示す断
面図である。 20・・・・・・シート、31〜34・・・・・・チッ
プ。 代理人 弁理士 内 原 晋
Claims (1)
- 【特許請求の範囲】 (A)表面に粘着剤層を、裏面に磁性媒体層を有するシ
ートの前記表面にウェハを張付けるシート張付工程、 (B)前記ウェハ内の各素子の各特性をプローバ等で個
々に測定する測定工程 (C)前記各素子の裏面に位置する前記磁性媒体層に前
記測定結果を磁気情報として記憶させる分類工程、 (D)前記ウェハをスクライビングするスクライビング
工程、 (E)スクライビングされたウェハをブレーキングする
ブレーキング工程、 (F)前記シートを拡張し前記ウェハのブレーキング部
分に間隔を設けるシート拡張工程、 (G)前記磁気情報にもとづいて良品チップを判別して
パッケージの所定の位置に搭載するダイマウント工程、 とを含むことを特徴とするチップ選別方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63193840A JPH0242744A (ja) | 1988-08-02 | 1988-08-02 | チップ選別方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63193840A JPH0242744A (ja) | 1988-08-02 | 1988-08-02 | チップ選別方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0242744A true JPH0242744A (ja) | 1990-02-13 |
Family
ID=16314612
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63193840A Pending JPH0242744A (ja) | 1988-08-02 | 1988-08-02 | チップ選別方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0242744A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04174529A (ja) * | 1990-11-07 | 1992-06-22 | Nec Corp | ウェハーマーキング装置 |
| CN116809429A (zh) * | 2023-07-12 | 2023-09-29 | 无锡奥特维科技股份有限公司 | 一种硅片收料装置及硅片分选系统 |
-
1988
- 1988-08-02 JP JP63193840A patent/JPH0242744A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04174529A (ja) * | 1990-11-07 | 1992-06-22 | Nec Corp | ウェハーマーキング装置 |
| CN116809429A (zh) * | 2023-07-12 | 2023-09-29 | 无锡奥特维科技股份有限公司 | 一种硅片收料装置及硅片分选系统 |
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