JPH0258794B2 - - Google Patents

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JPH0258794B2
JPH0258794B2 JP56068889A JP6888981A JPH0258794B2 JP H0258794 B2 JPH0258794 B2 JP H0258794B2 JP 56068889 A JP56068889 A JP 56068889A JP 6888981 A JP6888981 A JP 6888981A JP H0258794 B2 JPH0258794 B2 JP H0258794B2
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Description

【発明の詳細な説明】 本発明はセラミツク配線板に関する。特に、そ
の導体材料組成を改良したセラミツク配線板に関
する。
この種のもの、例えば、Al2O3(酸化アルミニ
ウム)を主成分としたセラミツクグリーンシート
にW(タングステン),Mo(モリブデン)などの
高融点金属粉で配線を形成し、その後焼結して成
るセラミツク配線板は、従来より半導体パツケー
ジ等に広く用いられている。一方近年、パツケー
ジレベルでの高集積化要求が強く、これを達成す
るため、上記のようなセラミツク板における多層
配線化が強く望まれて来ている。しかしかかる多
層セラミツク板は、焼結の際セラミツク部と配線
部との熱膨張特性の差により両者間にき裂などが
発生するという技術的難点を有するため、信頼性
に欠けることがあり、結局製造歩留りも低く、そ
のため高価格となつているのが現状である。
すなわち、一般に多層セラミツク配線板は第1
図に示すような断面構造であつて、Al2O3を主成
分とするセラミツク部1と、W,Moなど高融点
金属によるスル―ホール部2および配線パターン
部3とより構成される。従来このような多層セラ
ミツク配線板の製造は下記の如き方法により行わ
れている。まず、融解を容易ならしめるべく
Al2O3粉末に、1300℃〜1500℃で溶融する低融フ
ラツクス材(例えばSiO2―MgO―Al2O3系ガラ
ス又はカオリナイト,ドロマイトなど、又はこれ
らの混合物など)の粉末を融剤として混合する。
その後ブチラール,ポリビニルアルコール等の有
機バインダと、トリクロルエチレン,アルコール
類等の有機溶剤を混入させてスラリ状とする。こ
のスラリから、ドクターブレード法のキヤストマ
シンにより、所望の厚さのセラミツクグリーンシ
ートを製造する。このグリーンシートの所望の位
置に、ドリル又はパンチによりスル―ホールとす
る穴を形成する。
別途、W,Mo又はこれらの混合金属粉にエチ
ルセルロース又はニトロセルロースなどの有機バ
インダと、α―テルピネオール,n―ブチルカル
ビトールアセテートなどの高沸点有機溶剤を混合
して、導体ペーストを形成しておく。このペース
トを用いて、上記した穴明け後のグリーンシート
に、スルホールを形成する導体充填と、各配線層
に該当する配線パターン部形成とをスクリーン印
刷法にて行う。このようにして配線パターン部形
成スルホール充填を行つたグリーンシートを所望
の数だけ位置合わせして重ね合わせ、これをグリ
ーンシート内の有機バイダが軟化する温度以上
(通常80℃〜150℃)で加圧し、一体化する。
上記で得られたものを1550℃〜1600℃の温度
下、還元雰囲気にて焼結する。その後表面に露出
した導体パターンにNi又はNi―Auなどのめつき
処理を施すことにより防食性を与えるとともに個
別部品の接続を容易にして、多層セラミツク配線
板が完成するのである。
ところがこのような従来技術にあつては、配線
板を構成するAl2O3系セラミツクスとW,Mo等
の高融点金属とは、焼結時における温度上昇に伴
うその収縮曲線は第2図に示す如く両者で全く異
なつている。すなわち、Al2O3系セラミツクス
は、第2図中に符号で示す曲線のとおり、混入
された低融フラツクスの溶融温度から液相焼結に
よる急激な収縮を生じ、1550℃〜1600℃で飽和す
るのが通常であるが、他方のW,Mo粉は同じく
符号で示すようにその時点では全く焼結せず、
収縮もセラミツクスに比して極度に小さい。よつ
て、この両者を一体化したセラミツク配線板の焼
結においては、WやMoより成る配線パターン部
3の方は一般に10〜20μmと薄いために周辺のセ
ラミツク部1からの溶融フラツクスの浸透により
該セラミツク部と同様の液相焼結が生じ、第2図
の符号のAl2O3+フラツクスの収縮曲線に乗つ
た充分な焼結現象が起こるものの、現状の加工技
術ではスルホール部2はその径が通常200μm以
上と大きいため、内部までの充分なフラツクス浸
透はなされず、従つてセラミツク部1に比して充
分な焼結が起こらず、収縮も小さくなる。このた
め、従来技術では焼結後スルホール2近辺に大き
な歪が残留し、基板の割れを生じたり、極度の反
りを生じたりして歩留りが悪くなる。又スルホー
ル部の導体が充分ち密化しないため、ここの吸水
率が大きくなつて、後工程のめつき時にスルホー
ル内にめつき液が残留して、スルホールを腐食す
るなどの問題を生じている。
このように、Al2O3系セラミツクスと、W,
Moなどの高融点金属の複合体である配線板にお
いては、焼結工程時にこの異なる両材料を同一の
収縮率で焼結させることが重要であるにも拘ら
ず、従来技術では上記のようにこの問題が解決さ
れておらず、瑕疵のある配線板が生産されること
があり、よつてその信頼性が低くなり、又歩留り
が低下する結果高価格となつていたのである。
本発明は、上記した従来技術の欠点を解消し
て、高信頼度であつて性能が良く、生産歩留りも
良好で価格低減に資することができるセラミツク
多層配線板を提供することを目的とする。
この目的を達成するため、本発明においては、
導体部を形成する材料として少なくともそのスル
ホール充填部に用いるものは、高融点金属にセラ
ミツク部に混入したのと同様(同一組成)なフラ
ツクス材を3.5〜75Vo%を混入したものとす
る。
この構成により、スルホール充填部周辺での歪
の残留を除去し、その吸水率も小さくて製品の信
頼性が高く、生産も高歩留りであるセラミツク多
層配線板を得ることができるものである。
又、本発明の一態様に従えば、充填部以外の配
線部にも上記のような高融点金属にスラツクス材
を添加したものを用いて、同様の効果を得ること
ができる。
以下、具体的な実施例を挙げてこれを説明する
ことにより、本発明についてさらに詳述する。
第1実施例: Al2O390wt%、タルク6wt%、クレイ4wt%の
セラミツク混合物に、ブチラール,トリクロルエ
チレンを混入しスラリ状とした後キヤステイング
して、0.3mmtのグリーンシートを得、これに0.25
mm〓,0.5mmPitchのスルホールをパンチにより形成
した。このグリーンシートに前記した従来と同じ
工程によりセラミツク多層基板を作成した。但
し、配線パターン形成には、平均粒径2μm〓のW
粉末に、エチルセルロースをn―ブチルカルビト
ールアセテートに溶解したビヒクルを混入して作
成した導体ペーストを用いたが、スルホール充填
用には、2μm〓W粉末に上記セラミツク部の
Al2O3に混入したのと同じ組成のフラツクスを混
入したものを使用した。つまりこのスルホール充
填用には、Wに対して60wt%タルク及び40wt%
クレイの混合物からなるフラツクスを0.5wt%
(3.5Vo%)混合し、さらに上記配線パターン
用と同様にペースト化して、これを材料としたの
である。(タルク対クレイの組成割合は、セラミ
ツクス部におけると同様重量比で3:2となつて
いる)。このようにして形成したセラミツク多層
基板を焼結して、製品を得た。得られた製品に0
℃〜100℃の熱衝撃試験を行つたところ、従来法
によるセラミツク多層基板(スルホール充填にも
配線パターンと同一ペースト使用のもの)の場合
10〜15%の割れが発生したいたのに対し、本製品
は割れが0.01%以下ときわめて良好な結果が得ら
れた。さらに本製品の吸水率を測定したところ、
従来基板が0.2%程度であつたものが、本製品は
測定限界(0.001%)以下であつた。すなわち本
実施例で得られたセラミツク配線板は、従来のも
のに比べて格段顕著な効果を有しており、信頼性
も高く、生産歩留りもきわめて良好なものであ
る。なお、本実施例においてはフラツクスを
0.5wt%(3.5Vo%)にしている。その理由は、
3.5Vo%以下では添加量が微量なため、導体材
料(ペースト)製造時のバラツキが大きく安定し
た効果が得られないからである。
第2実施例: 第1実施例では、配線パターン形成用には従来
と同じ組成物を用いたが、本例では配線パターン
形成・スルホール充填とも、Wに60wt%タルク
及び40wt%クレイの混合物からなるフラツクス
を0.5wt%(3.5Vo%)混合した同一のペース
トを使用した。すなわち、セラミツクス部に混入
したフラツクス材と同組成のフラツクス材を混入
したものを、導体部分すべての形成に用いたもの
である。その他は第1実施例と同じである。この
場合も第1の実施例と同様な好結果が得られた。
第3実施例: 第1実施例と同様なグリーンシートを用いた。
このグリーンシートに、平均粒径3μm〓のMo粉末
に60wt%タルク及び40wt%クレイの混合物から
なるフラツクスを1wt%(3.5Vo%)混入して
第1実施例と同様なビヒクルでペースト化した材
料を用い、スルホール部を形成した。この場合
も、前記と同様な好結果が得られた。また、スル
ホール部と配線パターン部との双方をその材料で
形成した場合も、同様な結果が得られた。
第4実施例: 第3実施例の3μm〓Mo粉のかわりに、2μm〓の
W粉と、3μm〓Mo粉との混合物を使用した。この
場合も同様な結果が得られた。
第5実施例: 第1実施例,第2実施例において、金属粉に混
入するフラツクス材の量を、75Vo%になるま
で増加させた。この時も同等の効果が得られた。
第6実施例: 同様に、第3実施例において金属粉に混入する
フラツクス材の量を75wt%にまで増加させて配
線板を形成した。この時も同等の効果が得られ
た。
上記実施例において金属粉に混入するフラツク
ス材の量を75wt%にした理由は、それ以上では
抵抗値が大きく実用的配線として使用困難になる
からである。
以上が本発明の実施例を、いくつか述べたもの
である。なお、上記実施例において、第1実施例
〜第4実施例に示したフラツクス分添加量以下を
用いた場合にも、熱衝撃強度および吸水率の改善
は認められたが、その効果は、前記した程顕著で
はなかつた。また、第5実施例,第6実施例以上
に添加した場合は、やはり熱衝撃強度,吸水率に
つき同様に顕著な効果が認められたが、導体部の
固有抵抗値が急増し、実用上問題があつた。
以上述べたように、本発明によればスルホール
部にはセラミツク部に混入したのと同様なフラツ
クス材を混入して形成したので、セラミツク部と
導体部特にそのスルホール部との焼結収縮率差を
解消できるので、生産の歩留りが良くて価格低減
も図れ得、かつ吸水率の小さな高信頼度セラミツ
ク配線板を提供できるものである。
なお当然のことであるが、本発明は上記した実
施例にのみ限定されるものではない。
【図面の簡単な説明】
第1図は一般のセラミツク多層配線基板を示す
部分断面図である。第2図は従来技術を説明する
ための、セラミツク部および導体部を加熱した時
の焼結収縮曲線である。 1…セラミツク部、2…スルホール部、3…配
線パターン部。

Claims (1)

  1. 【特許請求の範囲】 1 セラミツク部と、該セラミツク部に設けられ
    た配線パターン部及びスル―ホール部とを備える
    とともにセラミツク部はフラツクス材を混入して
    成るものであるセラミツク配線板において、前記
    スル―ホール部にはセラミツク部に混入したのと
    同様なフラツクス材を3.5〜75Vo%混入して形
    成したことを特徴とするセラミツク配線板。 2 前記配線パターン部にも、セラミツク部に混
    入したのと同様なフラツクス材を3.5〜75Vo%
    混入して形成したことを特徴とする特許請求の範
    囲第1項に記載のセラミツク配線板。
JP56068889A 1981-05-09 1981-05-09 Ceramic circuit board Granted JPS57184296A (en)

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