JPH0265294U - - Google Patents

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JPH0265294U
JPH0265294U JP14460788U JP14460788U JPH0265294U JP H0265294 U JPH0265294 U JP H0265294U JP 14460788 U JP14460788 U JP 14460788U JP 14460788 U JP14460788 U JP 14460788U JP H0265294 U JPH0265294 U JP H0265294U
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JP
Japan
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delay circuit
sense amplifiers
group
activation signal
bit lines
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JP14460788U
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Description

【図面の簡単な説明】
第1図、第3図は、それぞれ本考案の実施例を
示すブロツク図、第2図、第4図は、本考案の実
施例の動作説明図である。 105,308……遅延回路活性化信号発生回
路、106,309……第1遅延回路、107,
310……第2遅延回路、108……アドレスバ
ツフア、110,312……第1センスアンプ列
、111,313……第2センスアンプ列、11
2,314……第1メモリセルアレイ、113,
315……第2メモリセルアレイ、306……行
アドレスバツフア、307……列アドレスバツフ
ア。

Claims (1)

    【実用新案登録請求の範囲】
  1. 行列状に配列されたメモリセルと、該メモリセ
    ルが接続された複数のビツト線と、ビツト線に接
    続された複数のセンスアンプとを具備するダイナ
    ミツク型半導体記憶装置において、前記複数のセ
    ンスアンプは複数の群に分けられ、分けられたセ
    ンスアンプの各群には遅延回路活性化信号を受け
    て当該群のセンスアンプの活性化を所定時間遅延
    させることのできる遅延回路が設けられ、該遅延
    回路には、アドレス情報を受けて選択されていな
    いメモリセルが属する群のセンスアンプに付設さ
    れた遅延回路には遅延回路活性化信号を送出する
    遅延回路活性化信号発生回路が接続されているこ
    とを特徴とするダイナミツク型半導体記憶装置。
JP14460788U 1988-11-05 1988-11-05 Pending JPH0265294U (ja)

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JP14460788U JPH0265294U (ja) 1988-11-05 1988-11-05

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JP14460788U JPH0265294U (ja) 1988-11-05 1988-11-05

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JPH0265294U true JPH0265294U (ja) 1990-05-16

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ID=31412462

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JP14460788U Pending JPH0265294U (ja) 1988-11-05 1988-11-05

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