JPH0268526U - - Google Patents

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JPH0268526U
JPH0268526U JP14884588U JP14884588U JPH0268526U JP H0268526 U JPH0268526 U JP H0268526U JP 14884588 U JP14884588 U JP 14884588U JP 14884588 U JP14884588 U JP 14884588U JP H0268526 U JPH0268526 U JP H0268526U
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JP
Japan
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transistor
channel type
transistors
buffer circuit
voltage
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JP14884588U
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【図面の簡単な説明】
第1図は本考案を実施した出力バツフア回路を
示す回路図であり、第2図はその動作を従来例と
比較して示す特性図である。第3図は従来例の回
路図である。 1……電源電圧ライン、2……インバータ、Q
1……第1トランジスタ、Q2……第2トランジ
スタ、Q3……第3トランジスタ、Vi……入力
電圧、Vo……出力電圧。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電源電圧点と基準電位点との間にPチヤンネル
    型の第1トランジスタとNチヤンネル型の第2ト
    ランジスタをCMOS接続し、これらのトランジ
    スタに共通の入力電圧を印加すると共に第1、第
    2トランジスタの接続中点から出力を取り出すよ
    うにした出力バツフア回路において、前記第1ト
    ランジスタと並列にNチヤンネル型の第3トラン
    ジスタを接続し、前記入力電圧をインバータを介
    して前記第3トランジスタに印加するようにした
    ことを特徴とする出力バツフア回路。
JP14884588U 1988-11-14 1988-11-14 Pending JPH0268526U (ja)

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JP14884588U JPH0268526U (ja) 1988-11-14 1988-11-14

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JP14884588U JPH0268526U (ja) 1988-11-14 1988-11-14

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JPH0268526U true JPH0268526U (ja) 1990-05-24

Family

ID=31420534

Family Applications (1)

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JP14884588U Pending JPH0268526U (ja) 1988-11-14 1988-11-14

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6085623A (ja) * 1983-10-17 1985-05-15 Hitachi Ltd Cmos集積回路装置

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6085623A (ja) * 1983-10-17 1985-05-15 Hitachi Ltd Cmos集積回路装置

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