JPH0270242U - - Google Patents
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- Publication number
- JPH0270242U JPH0270242U JP14915488U JP14915488U JPH0270242U JP H0270242 U JPH0270242 U JP H0270242U JP 14915488 U JP14915488 U JP 14915488U JP 14915488 U JP14915488 U JP 14915488U JP H0270242 U JPH0270242 U JP H0270242U
- Authority
- JP
- Japan
- Prior art keywords
- expected value
- input
- microcomputer
- comparing
- interrupt
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
- 238000000605 extraction Methods 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
- Microcomputers (AREA)
Description
第１図は本考案の一実施例のマイクロコンピユ
ータのブロツク図である。 １……入力ポート、２……入力ラツチ、３……
期待値ラツチ、４……比較ゲート、５……割込み
発生信号、６……割込み制御回路、７……内部バ
ス、８……期待値取出しゲート、９……割込み信
号、１０……入力データ読み込み信号、１１……
入力データクリア信号、１２……期待値読み込み
信号。
ータのブロツク図である。 １……入力ポート、２……入力ラツチ、３……
期待値ラツチ、４……比較ゲート、５……割込み
発生信号、６……割込み制御回路、７……内部バ
ス、８……期待値取出しゲート、９……割込み信
号、１０……入力データ読み込み信号、１１……
入力データクリア信号、１２……期待値読み込み
信号。
Claims (1)
- 入力ポートを有するマイクロコンピユータにお
いて、入力されるべき期待値を保持する手段と、
ある一定時間毎に前記期待値とその時々の入力デ
ータ値とを比較する手段と、前記比較する手段に
おいて比較した結果一致していない場合に割り込
みを発生させる手段とを備えたことを特徴とする
マイクロコンピユータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14915488U JPH0270242U (ja) | 1988-11-15 | 1988-11-15 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14915488U JPH0270242U (ja) | 1988-11-15 | 1988-11-15 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0270242U true JPH0270242U (ja) | 1990-05-29 |
Family
ID=31421125
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14915488U Pending JPH0270242U (ja) | 1988-11-15 | 1988-11-15 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0270242U (ja) |
-
1988
- 1988-11-15 JP JP14915488U patent/JPH0270242U/ja active Pending
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