JPH027259B2 - - Google Patents
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- Publication number
- JPH027259B2 JPH027259B2 JP57026114A JP2611482A JPH027259B2 JP H027259 B2 JPH027259 B2 JP H027259B2 JP 57026114 A JP57026114 A JP 57026114A JP 2611482 A JP2611482 A JP 2611482A JP H027259 B2 JPH027259 B2 JP H027259B2
- Authority
- JP
- Japan
- Prior art keywords
- power supply
- input
- battery backup
- backup power
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Stand-By Power Supply Arrangements (AREA)
- Direct Current Feeding And Distribution (AREA)
Description
【発明の詳細な説明】
本発明は、入力が停止してもバツテリにより電
力供給を可能とするバツテリバツクアツプ電源装
置とバツテリバツクアツプ機能を有しない非バツ
テリバツクアツプ電源装置を有する電源装置に係
り、特に同一系統の負荷に電力を供給する電源装
置に関する。
力供給を可能とするバツテリバツクアツプ電源装
置とバツテリバツクアツプ機能を有しない非バツ
テリバツクアツプ電源装置を有する電源装置に係
り、特に同一系統の負荷に電力を供給する電源装
置に関する。
第１図は非バツテリバツクアツプ電源装置のみ
を備えたシステムのブロツク図で、非バツテリバ
ツクアツプ電源装置３は出力電圧４を第２図の様
に負荷系統６に出力する。
を備えたシステムのブロツク図で、非バツテリバ
ツクアツプ電源装置３は出力電圧４を第２図の様
に負荷系統６に出力する。
このようなシステムでは、入力１が停止すると
負荷系統６が動作停止するため、負荷系統６内の
負荷７，８等のうち、電子計算機システムにおけ
る揮発性ICメモリの様な、動作停止によりシス
テムに重大な被害をおよぼす負荷８がある場合に
は問題である。
負荷系統６が動作停止するため、負荷系統６内の
負荷７，８等のうち、電子計算機システムにおけ
る揮発性ICメモリの様な、動作停止によりシス
テムに重大な被害をおよぼす負荷８がある場合に
は問題である。
そこで第３図に示す様に、入力停止時のバツク
アツプを行うためのバツテリバツクアツプ電源装
置９を設け、該バツテリバツクアツプ電源装置９
の出力１４を出力供給停止不可の負荷８に接続し
て、負荷８に対する出力供給停止を保護する方式
があつた。第４図の期間Ｔはこのバツテリによる
バツクアツプ出力期間である。なおこの方式は、
バツテリバツクアツプ電源９の入力１１を直接商
用電源から得ているが、これは非バツテリバツク
アツプ電源からバツテリ充電を行う方法ではその
負担が大きくなつて不都合な場合に用いられ、最
近のシステム規模の大型化に伴つて多用されてい
るものである。
アツプを行うためのバツテリバツクアツプ電源装
置９を設け、該バツテリバツクアツプ電源装置９
の出力１４を出力供給停止不可の負荷８に接続し
て、負荷８に対する出力供給停止を保護する方式
があつた。第４図の期間Ｔはこのバツテリによる
バツクアツプ出力期間である。なおこの方式は、
バツテリバツクアツプ電源９の入力１１を直接商
用電源から得ているが、これは非バツテリバツク
アツプ電源からバツテリ充電を行う方法ではその
負担が大きくなつて不都合な場合に用いられ、最
近のシステム規模の大型化に伴つて多用されてい
るものである。
しかしながら第３図の方式の場合、第４図の様
り入力１１が入力１より後で投入された場合や、
入力１１が投入されなかつた場合、出力４が立上
り負荷７が動作開始した時点で、バツテリバツク
アツプ電源装置９の出力１４が出力されていない
ため、負荷系統６から見れば電源供給不完全とな
り、誤動作する。
り入力１１が入力１より後で投入された場合や、
入力１１が投入されなかつた場合、出力４が立上
り負荷７が動作開始した時点で、バツテリバツク
アツプ電源装置９の出力１４が出力されていない
ため、負荷系統６から見れば電源供給不完全とな
り、誤動作する。
このため、入力系統を一本化し、開閉スイツチ
２，１２を１本化して入力投入のタイミングを揃
え、投入忘れを防ぐことも一つの方法として考え
られるが、バツテリバツクアツプ電源装置９の独
立性を好慮すれば、各々の電源装置に開閉スイツ
チを設ける必要があり、又各々の電源装置の起動
遅れ特性のバラツキを考えれば、必ずしも良い手
段ではない。
２，１２を１本化して入力投入のタイミングを揃
え、投入忘れを防ぐことも一つの方法として考え
られるが、バツテリバツクアツプ電源装置９の独
立性を好慮すれば、各々の電源装置に開閉スイツ
チを設ける必要があり、又各々の電源装置の起動
遅れ特性のバラツキを考えれば、必ずしも良い手
段ではない。
本発明の目的は、上述した従来技術の欠点をな
くし、バツテリバツクアツプ電源装置及び非バツ
テリバツクアツプ電源装置の各々の入力のいかな
るタイミングに於いても、負荷系統から見れば必
らずバツテリバツクアツプ電源９の出力１４が確
立した後に非バツテリバツクアツプ電源の出力４
が出力される様にした電源装置を提供するにあ
る。
くし、バツテリバツクアツプ電源装置及び非バツ
テリバツクアツプ電源装置の各々の入力のいかな
るタイミングに於いても、負荷系統から見れば必
らずバツテリバツクアツプ電源９の出力１４が確
立した後に非バツテリバツクアツプ電源の出力４
が出力される様にした電源装置を提供するにあ
る。
本発明の装置は、バツテリバツクアツプ電源装
置に入力が供給された事を検知し、該検知信号に
よりバツテリバツクアツプ電源装置自体の出力の
起動を行なうとともに、上記検知信号によつて非
バツテリバツクアツプ電源装置に出力電圧の起動
を行わしめるようにしたことを特徴とするもので
ある。
置に入力が供給された事を検知し、該検知信号に
よりバツテリバツクアツプ電源装置自体の出力の
起動を行なうとともに、上記検知信号によつて非
バツテリバツクアツプ電源装置に出力電圧の起動
を行わしめるようにしたことを特徴とするもので
ある。
以下、本発明を第５図の実施例によつて詳しく
説明する。第５図に於て、非バツテリバツクアツ
プ電源装置３０は、入力検出回路３１にて発生さ
れた入力検出信号３２と、バツテリバツクアツプ
電源装置９０より発生された、本発明の特徴とす
る制御信号３３とのアンド条件をアンド回路３４
でとり、この条件成立時にタイミングコントロー
ル回路３５から起動命令信号３６が出力され、出
力発生回路３７が起動されて出力４も出力される
様な構成となつている。
説明する。第５図に於て、非バツテリバツクアツ
プ電源装置３０は、入力検出回路３１にて発生さ
れた入力検出信号３２と、バツテリバツクアツプ
電源装置９０より発生された、本発明の特徴とす
る制御信号３３とのアンド条件をアンド回路３４
でとり、この条件成立時にタイミングコントロー
ル回路３５から起動命令信号３６が出力され、出
力発生回路３７が起動されて出力４も出力される
様な構成となつている。
一方、バツテリバツクアツプ電源装置９の入力
１１が投入されると、入力検出回路９１がその入
力電圧を検出し、これによつて起動タイミング回
路９５が働き、バツテリバツクアツプ電圧発生回
路９６が起動するとともに、バツテリバツクアツ
プ電源装置９から制御信号３３が出力される。こ
の制御信号３３は非バツテリバツクアツプ電源装
置３に入力され、上述したように入力１が投入さ
れている場合に非バツテリバツクアツプ電源３も
起動され、両電源３，９の出力は協調して動作開
始に至る。
１１が投入されると、入力検出回路９１がその入
力電圧を検出し、これによつて起動タイミング回
路９５が働き、バツテリバツクアツプ電圧発生回
路９６が起動するとともに、バツテリバツクアツ
プ電源装置９から制御信号３３が出力される。こ
の制御信号３３は非バツテリバツクアツプ電源装
置３に入力され、上述したように入力１が投入さ
れている場合に非バツテリバツクアツプ電源３も
起動され、両電源３，９の出力は協調して動作開
始に至る。
次にバツテリバツクアツプ電源装置９の入力１
１が停止すると、入力検出回路９１が停電を検出
し、これによつて制御信号３３が停止し、非バツ
テリバツクアツプ電源３は出力４を停止する。ま
た、バツテリバツクアツプ電源装置９の出力発生
回路９６の入力は、入力１１が停止したためバツ
テリ９８からの電力をバツテリ充放電回路９２、
入力切替回路９７を介してとり込み、これを出力
１４として負荷側へ供給する。
１が停止すると、入力検出回路９１が停電を検出
し、これによつて制御信号３３が停止し、非バツ
テリバツクアツプ電源３は出力４を停止する。ま
た、バツテリバツクアツプ電源装置９の出力発生
回路９６の入力は、入力１１が停止したためバツ
テリ９８からの電力をバツテリ充放電回路９２、
入力切替回路９７を介してとり込み、これを出力
１４として負荷側へ供給する。
更にバツテリ９８が放電してその電圧が低下し
た時には、バツテリ電圧検出回路９３がこれを検
出し、停止コントロール回路９４が動作して出力
発生回路９６を停止させる。
た時には、バツテリ電圧検出回路９３がこれを検
出し、停止コントロール回路９４が動作して出力
発生回路９６を停止させる。
以上の動作から明らかなように、本発明によれ
ば、バツテリバツクアツプ電源装置と非バツテリ
バツクアツプ電源装置との入力投入順序を考慮せ
ずに入力の投入をできるため、システムのテス
ト、保守に効果的であり、又入力誤操作によるシ
ステムの誤動作を防止できる。更に、入力開閉ス
イツチを一本化する必要がないため、バツテリバ
ツクアツプ電源装置の単体装置としての独立性を
確保できるため、単体でのテスト保守も容易であ
る。
ば、バツテリバツクアツプ電源装置と非バツテリ
バツクアツプ電源装置との入力投入順序を考慮せ
ずに入力の投入をできるため、システムのテス
ト、保守に効果的であり、又入力誤操作によるシ
ステムの誤動作を防止できる。更に、入力開閉ス
イツチを一本化する必要がないため、バツテリバ
ツクアツプ電源装置の単体装置としての独立性を
確保できるため、単体でのテスト保守も容易であ
る。
第１図はバツテリバツクアツプ電源装置のない
場合の負荷系統図、第２図は第１図の系統図の動
作タイミングチヤート、第３図は従来のバツテリ
バツクアツプ電源装置をもつ電源装置を接続した
場合の負荷系統図、第４図は第３図の系統図の動
作タイミングチヤート、第５図は本発明の一実施
例を示す図、第６図は第５図の動作タイミングチ
ヤートである。 １，１１……入力、３……非バツテリバツクア
ツプ電源装置、４……出力、６……負荷系統、７
……負荷、８……負荷、９……バツテリバツクア
ツプ電源装置、１４……出力、３１……入力検出
回路、３２……入力検出信号、３３……制御信
号、３４……アンド回路、３５……起動回路、９
１……入力検出回路、９５……起動回路、９６…
…出力発生回路、９８……バツテリ。
場合の負荷系統図、第２図は第１図の系統図の動
作タイミングチヤート、第３図は従来のバツテリ
バツクアツプ電源装置をもつ電源装置を接続した
場合の負荷系統図、第４図は第３図の系統図の動
作タイミングチヤート、第５図は本発明の一実施
例を示す図、第６図は第５図の動作タイミングチ
ヤートである。 １，１１……入力、３……非バツテリバツクア
ツプ電源装置、４……出力、６……負荷系統、７
……負荷、８……負荷、９……バツテリバツクア
ツプ電源装置、１４……出力、３１……入力検出
回路、３２……入力検出信号、３３……制御信
号、３４……アンド回路、３５……起動回路、９
１……入力検出回路、９５……起動回路、９６…
…出力発生回路、９８……バツテリ。
Claims (1)
- １ 入力の有無を検出する検出手段をそれぞれ有
し、当該検出手段により入力有を検出した時に同
一系統の負荷に電力供給を開始するようになつて
いる非バツテリバツクアツプ電源装置およびバツ
テリバツクアツプ電源装置を有するものにおい
て、該非バツテリバツクアツプ電源装置は、該バ
ツテリバツクアツプ電源装置で電力供給を開始し
たことを条件に自装置からの電力供給を開始する
ようにしたことを特徴とする電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57026114A JPS58144533A (ja) | 1982-02-22 | 1982-02-22 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57026114A JPS58144533A (ja) | 1982-02-22 | 1982-02-22 | 電源装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58144533A JPS58144533A (ja) | 1983-08-27 |
| JPH027259B2 true JPH027259B2 (ja) | 1990-02-16 |
Family
ID=12184550
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57026114A Granted JPS58144533A (ja) | 1982-02-22 | 1982-02-22 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58144533A (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5930287B2 (ja) * | 1978-11-24 | 1984-07-26 | 株式会社東芝 | 記憶装置 |
-
1982
- 1982-02-22 JP JP57026114A patent/JPS58144533A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58144533A (ja) | 1983-08-27 |
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