JPH0278250A - 半導体パッケージの封止枠の装着方法 - Google Patents
半導体パッケージの封止枠の装着方法Info
- Publication number
- JPH0278250A JPH0278250A JP23061088A JP23061088A JPH0278250A JP H0278250 A JPH0278250 A JP H0278250A JP 23061088 A JP23061088 A JP 23061088A JP 23061088 A JP23061088 A JP 23061088A JP H0278250 A JPH0278250 A JP H0278250A
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- Japan
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- sealing frame
- sealing
- printed wiring
- frame
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- 239000011295 pitch Substances 0.000 claims 4
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Landscapes
- Structure Of Printed Boards (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
本発明はPGAのような半導体パッケージの封止枠の装
着方法に関する。
着方法に関する。
従来にあっては、封止枠用材を枠形状に切断加工して封
止枠6を形成し、この封止枠6に接着剤層2を設けて各
封止枠6を位置決めプレート10にセットし、パッケー
ジ本体となる複数のプリント配線板が配列形成された基
板5に各封止枠6を各プリント配線板4に対応させて接
着させることにより装着されている。
止枠6を形成し、この封止枠6に接着剤層2を設けて各
封止枠6を位置決めプレート10にセットし、パッケー
ジ本体となる複数のプリント配線板が配列形成された基
板5に各封止枠6を各プリント配線板4に対応させて接
着させることにより装着されている。
【発明が解決しようとする課fil
従来の方法にあっては、封止枠6が単体であるため、逐
一位置決めプレー)1(Hこセットしなければならない
など基本的に封止枠6を一個毎基板5のプリント配線板
に装着しなければならなく、従って、大量生産には適し
ていないという問題があった。 本発明は上記事情に鑑みて為されたものであり、その目
的とするところは、複数の封止枠を一度に装着でき、し
かも、装着位置のばらつきも少ない半導体パッケージの
封止枠の装着方法を提供することにある。 【課題を解決するための手段] 本発明の半導体パッケージの封止枠の装着方法における
第1の手段は、封止枠用材1の片面に所定ピッチで接着
剤を枠状に塗布し、封止枠用材1の枠状の接着剤層2の
内側をくり抜くと共に接着剤12の外周に凹溝3を設け
、封止枠用材1をプリント配線板4が所定のピッチで配
列形成された基板5に枠状の接着剤N2と各プリント配
線板4とを対応させて接合し、この後、凹溝3にで封止
枠用材1を切断し封止枠6を形成することにより基板5
の各プリント配線板4に封止枠6を装着し、次いで基板
1を各プリント配線板4毎に切断することを特徴とする
ものであり、第2の手段は、封止枠用材1の片面に所定
ピッチで接着剤を枠状に塗布すると共に他面に接着シー
ト7を貼着し、封止枠用材1を枠状の接着剤M2の内周
と外周に沿って切断して接着シート7上に所定の枠形状
の複数の封止枠6を形成し、この後、複数の封止枠6を
接着剤N2にて接着シート7を介して一体的にプリント
配線板4が所定のピッチで配列形成された基板5に各封
止枠6と各プリント配線板4とを対応させて接合し、次
いで、接着シート7を剥がすと共に基板5を各プリント
配線@4毎に切断することを特徴とするものであり、こ
の構成により上記課題が解決されたものである。 [作用] 本発明の第1の手段にあっては、封止枠用材1をプリン
ト配線板4が所定のピッチで配列形成された基板に枠状
の接着剤層2と各プリント配線板4とを対応させて接合
し、この後、凹溝3にて封止枠用材1を切断し封止枠6
を形成することにより基@1の各プリント配線板4に封
止枠6を装着し、次いで基板1を各プリント配線板4毎
に切断するので、又、第2の手段にあっては、接着シー
ト7上に所定の枠形状の複数の封止枠6を形成し、この
後、複数の封止枠6を接着剤層2にて接着シート7を介
して一体的にプリント配線板4が所定のピッチで配列形
成された基板5に各封止枠6と各プリント配線板4とを
対応させて接合し、次いで、接着シート7を剥がすと共
に基板5を各プリント配線板4毎に切断するので、複数
の封止枠6の装着が一度にでき、しかも、装着位置のば
らつきも少なくなるものである。 以下、本発明を添付の図面に基づいて説明する。 第1図及び第2図は本発明の一実施例を示しでおり、ま
ず封止枠用材1の片面に所定ピッチで接着剤を枠状に塗
布する(第1図(a))。 次に、この封止枠用材1の枠状の接着剤層2の内側をく
り抜くと共に接着剤層2の外周に凹溝3を貫通させない
ように設ける(第1図(b)(C))。 この後、封止枠用材1をプリント配線板4が所定のピッ
チで配列形成された基板5に枠状の接着剤層2と各プリ
ント配線板4とを対応させて接合する(第1図(d))
。 次に、カッター9により凹溝3にて封止枠用材1を切断
し封止枠6を形成することtこより基板1の各プリント
配線板4に封止枠6を装着させる(第1図(f))。 次いで、基板5を各プリント配線板4毎に切断する(第
2図)。 尚、プリント配線板40半導体装用四部8に半導体を実
装し、プリント配線板4の各導体パターンとボンディン
グさせて電気的に接続し、封止枠6内に封止樹脂を充填
させて封止することにより半導体パッケージを製造する
。 P143図及び第4図は本発明の他の実施例を示してお
り、まず上記実施例と同様に封止枠用材1の片面に所定
ピッチで接着剤を枠状に塗布する(、fIfJ3図(a
))。 この封止枠用材1の他面には接着シート7を貼着した後
、封止枠用材1を枠状の接着剤/12の内周と外周に沿
って切断して接着シート7上に所定の枠形状の複数の封
止枠6を形成する(第3図(b)(C))。 次に、複数の封止枠6を接着剤層2にて接着シート7を
介して一体的にプリント配線板4が所定のピッチで配列
形成された基板5に各封止枠6と各プリント配線板4と
を対応させて接合し、次いで、接着シート7を剥がす(
第3図(C))。 次に、基板5を各プリント配線板4毎に切断する(!@
4図)。 【発明の効果】 本発明のPIIJlの手段にあっては、封止枠用材をプ
リント配線板が所定のピッチで配列形成された基板に枠
状のIIi着剤層と各プリント配線板とを対応させて接
合し、この後、凹溝にて封止枠用材を切断し封止枠を形
成することにより基板の各プリント配線板に封止枠を装
着し、次いで基板を各プリント配線板毎に切断するので
、又、第2の手段にあっては、接着シート上に所定の枠
形状の複数″の封止枠を形成し、この後、複数の封止枠
を接着剤層にて接着シートを介して一体的にプリント配
線板が所定のピッチで配列形成された基板に各封止枠と
各プリント配線板とを対応させて接合し、次いで、接着
シートを剥がすと共に基板を各プリント配線板毎に切断
するので、複数の封止枠の装着が一度にでき、しかも、
装着位置のばらつきも少なくなるものである。
一位置決めプレー)1(Hこセットしなければならない
など基本的に封止枠6を一個毎基板5のプリント配線板
に装着しなければならなく、従って、大量生産には適し
ていないという問題があった。 本発明は上記事情に鑑みて為されたものであり、その目
的とするところは、複数の封止枠を一度に装着でき、し
かも、装着位置のばらつきも少ない半導体パッケージの
封止枠の装着方法を提供することにある。 【課題を解決するための手段] 本発明の半導体パッケージの封止枠の装着方法における
第1の手段は、封止枠用材1の片面に所定ピッチで接着
剤を枠状に塗布し、封止枠用材1の枠状の接着剤層2の
内側をくり抜くと共に接着剤12の外周に凹溝3を設け
、封止枠用材1をプリント配線板4が所定のピッチで配
列形成された基板5に枠状の接着剤N2と各プリント配
線板4とを対応させて接合し、この後、凹溝3にで封止
枠用材1を切断し封止枠6を形成することにより基板5
の各プリント配線板4に封止枠6を装着し、次いで基板
1を各プリント配線板4毎に切断することを特徴とする
ものであり、第2の手段は、封止枠用材1の片面に所定
ピッチで接着剤を枠状に塗布すると共に他面に接着シー
ト7を貼着し、封止枠用材1を枠状の接着剤M2の内周
と外周に沿って切断して接着シート7上に所定の枠形状
の複数の封止枠6を形成し、この後、複数の封止枠6を
接着剤N2にて接着シート7を介して一体的にプリント
配線板4が所定のピッチで配列形成された基板5に各封
止枠6と各プリント配線板4とを対応させて接合し、次
いで、接着シート7を剥がすと共に基板5を各プリント
配線@4毎に切断することを特徴とするものであり、こ
の構成により上記課題が解決されたものである。 [作用] 本発明の第1の手段にあっては、封止枠用材1をプリン
ト配線板4が所定のピッチで配列形成された基板に枠状
の接着剤層2と各プリント配線板4とを対応させて接合
し、この後、凹溝3にて封止枠用材1を切断し封止枠6
を形成することにより基@1の各プリント配線板4に封
止枠6を装着し、次いで基板1を各プリント配線板4毎
に切断するので、又、第2の手段にあっては、接着シー
ト7上に所定の枠形状の複数の封止枠6を形成し、この
後、複数の封止枠6を接着剤層2にて接着シート7を介
して一体的にプリント配線板4が所定のピッチで配列形
成された基板5に各封止枠6と各プリント配線板4とを
対応させて接合し、次いで、接着シート7を剥がすと共
に基板5を各プリント配線板4毎に切断するので、複数
の封止枠6の装着が一度にでき、しかも、装着位置のば
らつきも少なくなるものである。 以下、本発明を添付の図面に基づいて説明する。 第1図及び第2図は本発明の一実施例を示しでおり、ま
ず封止枠用材1の片面に所定ピッチで接着剤を枠状に塗
布する(第1図(a))。 次に、この封止枠用材1の枠状の接着剤層2の内側をく
り抜くと共に接着剤層2の外周に凹溝3を貫通させない
ように設ける(第1図(b)(C))。 この後、封止枠用材1をプリント配線板4が所定のピッ
チで配列形成された基板5に枠状の接着剤層2と各プリ
ント配線板4とを対応させて接合する(第1図(d))
。 次に、カッター9により凹溝3にて封止枠用材1を切断
し封止枠6を形成することtこより基板1の各プリント
配線板4に封止枠6を装着させる(第1図(f))。 次いで、基板5を各プリント配線板4毎に切断する(第
2図)。 尚、プリント配線板40半導体装用四部8に半導体を実
装し、プリント配線板4の各導体パターンとボンディン
グさせて電気的に接続し、封止枠6内に封止樹脂を充填
させて封止することにより半導体パッケージを製造する
。 P143図及び第4図は本発明の他の実施例を示してお
り、まず上記実施例と同様に封止枠用材1の片面に所定
ピッチで接着剤を枠状に塗布する(、fIfJ3図(a
))。 この封止枠用材1の他面には接着シート7を貼着した後
、封止枠用材1を枠状の接着剤/12の内周と外周に沿
って切断して接着シート7上に所定の枠形状の複数の封
止枠6を形成する(第3図(b)(C))。 次に、複数の封止枠6を接着剤層2にて接着シート7を
介して一体的にプリント配線板4が所定のピッチで配列
形成された基板5に各封止枠6と各プリント配線板4と
を対応させて接合し、次いで、接着シート7を剥がす(
第3図(C))。 次に、基板5を各プリント配線板4毎に切断する(!@
4図)。 【発明の効果】 本発明のPIIJlの手段にあっては、封止枠用材をプ
リント配線板が所定のピッチで配列形成された基板に枠
状のIIi着剤層と各プリント配線板とを対応させて接
合し、この後、凹溝にて封止枠用材を切断し封止枠を形
成することにより基板の各プリント配線板に封止枠を装
着し、次いで基板を各プリント配線板毎に切断するので
、又、第2の手段にあっては、接着シート上に所定の枠
形状の複数″の封止枠を形成し、この後、複数の封止枠
を接着剤層にて接着シートを介して一体的にプリント配
線板が所定のピッチで配列形成された基板に各封止枠と
各プリント配線板とを対応させて接合し、次いで、接着
シートを剥がすと共に基板を各プリント配線板毎に切断
するので、複数の封止枠の装着が一度にでき、しかも、
装着位置のばらつきも少なくなるものである。
mi図は本発明の一実施例の各工程を示す説明図、m2
図は同上により封止枠が装着されたプリント配線板を示
す平面図、第3図は本発明の他の実施例の各工程を示す
説明図、第4図は同上により封止枠が装着されたプリン
ト配線板を示す平面図、第5図は従来例の各工程を示す
説明図であって、1は封止枠用材、2は接着剤層、3は
凹溝、4はプリント配線板、5は基板、6は封止枠、7
は接着シートである。 −〜(イ)寸−〇 4ス− 第3図 (a) 第4図 第5図
図は同上により封止枠が装着されたプリント配線板を示
す平面図、第3図は本発明の他の実施例の各工程を示す
説明図、第4図は同上により封止枠が装着されたプリン
ト配線板を示す平面図、第5図は従来例の各工程を示す
説明図であって、1は封止枠用材、2は接着剤層、3は
凹溝、4はプリント配線板、5は基板、6は封止枠、7
は接着シートである。 −〜(イ)寸−〇 4ス− 第3図 (a) 第4図 第5図
Claims (2)
- (1)封止枠用材の片面に所定ピッチで接着剤を枠状に
塗布し、封止枠用材の枠状の接着剤層の内側をくり抜く
と共に接着剤層の外周に凹溝を設け、封止枠用材をプリ
ント配線板が所定のピッチで配列形成された基板に枠状
の接着剤層と各プリント配線板とを対応させて接合し、
この後、凹溝にて封止枠用材を切断し封止枠を形成する
ことにより基板の各プリント配線板に封止枠を装着し、
次いで基板を各プリント配線板毎に切断することを特徴
とする半導体パッケージの封止枠の装着方法。 - (2)封止枠用材の片面に所定ピッチで接着剤を枠状に
塗布すると共に他面に接着シートを貼着し、封止枠用材
を枠状の接着剤層の内周と外周に沿って切断して接着シ
ート上に所定の枠形状の複数の封止枠を形成し、この後
、複数の封止枠を接着剤層にて接着シートを介して一体
的にプリント配線板が所定のピッチで配列形成された基
板に各封止枠と各プリント配線板とを対応させて接合し
、次いで、接着シートを剥がすと共に基板を各プリント
配線板毎に切断することを特徴とする半導体パッケージ
の封止枠の装着方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63230610A JPH0793391B2 (ja) | 1988-09-14 | 1988-09-14 | 半導体パッケージの封止枠の装着方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63230610A JPH0793391B2 (ja) | 1988-09-14 | 1988-09-14 | 半導体パッケージの封止枠の装着方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0278250A true JPH0278250A (ja) | 1990-03-19 |
| JPH0793391B2 JPH0793391B2 (ja) | 1995-10-09 |
Family
ID=16910458
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63230610A Expired - Lifetime JPH0793391B2 (ja) | 1988-09-14 | 1988-09-14 | 半導体パッケージの封止枠の装着方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0793391B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5125153A (en) * | 1989-11-09 | 1992-06-30 | Oerlikon-Contraves Ag | Method of making a hybrid electronic array |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57138149A (en) * | 1981-02-20 | 1982-08-26 | Shindo Denshi Kogyo Kk | Mounting method for chip |
-
1988
- 1988-09-14 JP JP63230610A patent/JPH0793391B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57138149A (en) * | 1981-02-20 | 1982-08-26 | Shindo Denshi Kogyo Kk | Mounting method for chip |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5125153A (en) * | 1989-11-09 | 1992-06-30 | Oerlikon-Contraves Ag | Method of making a hybrid electronic array |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0793391B2 (ja) | 1995-10-09 |
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