JPH0282171A - 電源の相順判別方法 - Google Patents
電源の相順判別方法Info
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- JPH0282171A JPH0282171A JP63233717A JP23371788A JPH0282171A JP H0282171 A JPH0282171 A JP H0282171A JP 63233717 A JP63233717 A JP 63233717A JP 23371788 A JP23371788 A JP 23371788A JP H0282171 A JPH0282171 A JP H0282171A
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- Japan
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- power supply
- pulse
- phase sequence
- voltage
- phase
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- Supply And Distribution Of Alternating Current (AREA)
- Control Of Voltage And Current In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔１既 要〕
計算機システムの電源制御システムにおける電源の相順
判別方法に関し、 計算機システムにおける電源のＡＣ入力系の誤配°線に
よる装置冷却用ファンの逆回転を防止することを目的と
し、 外部電源から複数相のＡＣ入力を受電する電源部と、前
記電源部から相順データを受取り、相順を判別し外部に
判別結果を送出するマイクロプロセッサを有する電源制
御部により構成される電源制御システムにおいて、外部
電源を投入した時、電源部のＡＣ入力電圧が規定電圧を
越えるまでは規定電圧以下であることを外部装置に通知
し、電源部のＡＣ入力端子が規定電圧前後の不安定な状
態であっても、規定電圧以下であるとして外部装置に通
知し、電源部のＡＣ入力電圧が規定電圧を確実に越えて
から初めて相順判別を行い、判別結果を外部に送出する
ように構成する。
判別方法に関し、 計算機システムにおける電源のＡＣ入力系の誤配°線に
よる装置冷却用ファンの逆回転を防止することを目的と
し、 外部電源から複数相のＡＣ入力を受電する電源部と、前
記電源部から相順データを受取り、相順を判別し外部に
判別結果を送出するマイクロプロセッサを有する電源制
御部により構成される電源制御システムにおいて、外部
電源を投入した時、電源部のＡＣ入力電圧が規定電圧を
越えるまでは規定電圧以下であることを外部装置に通知
し、電源部のＡＣ入力端子が規定電圧前後の不安定な状
態であっても、規定電圧以下であるとして外部装置に通
知し、電源部のＡＣ入力電圧が規定電圧を確実に越えて
から初めて相順判別を行い、判別結果を外部に送出する
ように構成する。
計算機システムの電源制御システムにおける電源の相順
判別方法に関し、特に、ＡＣ電源の入力系の誤配線によ
る装置冷却用ファンの逆回転を防止するための相順判別
方法に関する。
判別方法に関し、特に、ＡＣ電源の入力系の誤配線によ
る装置冷却用ファンの逆回転を防止するための相順判別
方法に関する。
一般に、計算機システムには装置冷却用にファンが設け
られているが、ＡＣ電源用のファンであるためＡＣ入力
系の誤配線をした場合、ファンが逆回転し装置が冷却さ
れずＣＰＵ等発熱量の多い部分を破損してしまうことが
ある。このため、ＡＣ入力を監視することが要求されて
いる。
られているが、ＡＣ電源用のファンであるためＡＣ入力
系の誤配線をした場合、ファンが逆回転し装置が冷却さ
れずＣＰＵ等発熱量の多い部分を破損してしまうことが
ある。このため、ＡＣ入力を監視することが要求されて
いる。
第６図は、−船釣な計算機システムの電源装置の概略構
成における相順検出のブロック構成図である。ｌは外部
電源、ｌａは商用ＡＣ電圧を歪みの少ない安定した交流
電圧に変換する整流器インバータ部、２は電源部、３は
電源制御部、４は外部表示装置、５は装置冷却用のＡＣ
ファンである。
成における相順検出のブロック構成図である。ｌは外部
電源、ｌａは商用ＡＣ電圧を歪みの少ない安定した交流
電圧に変換する整流器インバータ部、２は電源部、３は
電源制御部、４は外部表示装置、５は装置冷却用のＡＣ
ファンである。
外部電源ｌから複数相のＡＣ電圧が入力され、電源部２
には入力されたＡＣ′ｒＬ圧と規定電圧と比較するコン
パレータＣＭＰおよび交流電圧を高圧直流電圧に変換す
る整流部２ａ、高圧直流電圧を歪みの少ない安定した低
圧直流電圧に変換する電圧変換部２ｂが設けられ、電源
制御部３には相順データＰＤを取り込むメモリＲＡＭと
、相順検出処理を後述するフローに従って行うマイクロ
プロセッサＭＰＵが設けられる。
には入力されたＡＣ′ｒＬ圧と規定電圧と比較するコン
パレータＣＭＰおよび交流電圧を高圧直流電圧に変換す
る整流部２ａ、高圧直流電圧を歪みの少ない安定した低
圧直流電圧に変換する電圧変換部２ｂが設けられ、電源
制御部３には相順データＰＤを取り込むメモリＲＡＭと
、相順検出処理を後述するフローに従って行うマイクロ
プロセッサＭＰＵが設けられる。
第７図は従来方法による相順検出処理フローチャートで
ある。先ず、相順データを２０ｍ５ｅｃ分メモリに取り
込み、ＩＶＡＩ（Ｒ−３相聞）のデータを先頭から最後
まで検索する。検索の結果ＩＶＡＩのパルスがあるか否
か判断し、あるならばＩＶＡ２ （Ｓ−Ｔ相間）をＩＶ
ＡＩのパルスの立ち下がりから最後まで検索する。
ある。先ず、相順データを２０ｍ５ｅｃ分メモリに取り
込み、ＩＶＡＩ（Ｒ−３相聞）のデータを先頭から最後
まで検索する。検索の結果ＩＶＡＩのパルスがあるか否
か判断し、あるならばＩＶＡ２ （Ｓ−Ｔ相間）をＩＶ
ＡＩのパルスの立ち下がりから最後まで検索する。
同様に、検索の結果ＩＶＡ２のパルスがあるか否か判断
し、次に、ＩＶＡ３（Ｔ−Ｒ相間）のデータをＩＶＡＩ
（７）パルスの立ち下がりから最後まで検索し、ＩＶＡ
３のパルスがあるか否か判断する。あるならば、［ＶＡ
３のパルスがＩＶＡ２のパルスと同時か又は遅いかを判
断し、同時か又は遅いならぼりトライを５回行った後、
相順異常の表示をする。
し、次に、ＩＶＡ３（Ｔ−Ｒ相間）のデータをＩＶＡＩ
（７）パルスの立ち下がりから最後まで検索し、ＩＶＡ
３のパルスがあるか否か判断する。あるならば、［ＶＡ
３のパルスがＩＶＡ２のパルスと同時か又は遅いかを判
断し、同時か又は遅いならぼりトライを５回行った後、
相順異常の表示をする。
このように、従来方法では、電源制御部３のファームウ
ェアが相順判別を開始するまでに、電源部２のＡＣ入力
電圧が規定電圧以上になるという前堤に従って作られて
いるため、外部電源１の出力電圧の立上がり状態に関係
なく相順判別を行っている。この場合、電源制御部３の
ファームウェアが相順判別を開始した時点で電源部２の
ＡＣ入力端子が規定電圧を越えていない場合は相順異常
であると判別している。
ェアが相順判別を開始するまでに、電源部２のＡＣ入力
電圧が規定電圧以上になるという前堤に従って作られて
いるため、外部電源１の出力電圧の立上がり状態に関係
なく相順判別を行っている。この場合、電源制御部３の
ファームウェアが相順判別を開始した時点で電源部２の
ＡＣ入力端子が規定電圧を越えていない場合は相順異常
であると判別している。
従来の問題点として、電源制御部３にＡＣ電圧を供給す
る外部電源１は出力電圧の立上がりが緩やかなため、Ａ
Ｃ人力系が正常に配線されていても電源制御部３が相順
判別を開始した時点で、電源部２のＡＣ入力電圧が規定
電圧を越えない場合は、ＡＣ入力系の配線が正常であっ
ても相順異常であると判別していた。
る外部電源１は出力電圧の立上がりが緩やかなため、Ａ
Ｃ人力系が正常に配線されていても電源制御部３が相順
判別を開始した時点で、電源部２のＡＣ入力電圧が規定
電圧を越えない場合は、ＡＣ入力系の配線が正常であっ
ても相順異常であると判別していた。
また、電源部２のＡＣ入力電圧が規定電圧前後で不安定
な状態になり、１ｍ５ｅｃ前後のパルスが電源制御部３
に送られた場合、メモリに取り込んだ相順データをすべ
て検索する方法のため、誤判別してしまう可能性もあっ
た。
な状態になり、１ｍ５ｅｃ前後のパルスが電源制御部３
に送られた場合、メモリに取り込んだ相順データをすべ
て検索する方法のため、誤判別してしまう可能性もあっ
た。
本発明の目的は、外部電源１の出力電圧の立上がりがど
のような場合にも対応でき、誤動作を生じないで相順判
別を行うことができる方法を提供することにある。
のような場合にも対応でき、誤動作を生じないで相順判
別を行うことができる方法を提供することにある。
〔課題を解決するための手段及び作用〕本発明は、外部
電源１から複数相のＡＣ入力を受電する電源部２と、前
記電源部２から相順データを受取り、相順を判別し外部
に判別結果を送出するマイクロプロセッサを有する電源
制御部３により構成される電源制御システムにおいて、
外部電源ｌを投入した時、電源部２のＡＣ入力電圧が規
定電圧を越えるまでは規定電圧以下であることを外部装
置に通知し、電源部２のＡＣ入力電圧が規定電圧前後の
不安定な状態であっても、規定電圧以下であるとして外
部装置に通知し、電源部２のＡＣ入力電圧が規定電圧を
確実に越えてから初めて相順判別を行い、判別結果を外
部装置に送出することを特徴とする。
電源１から複数相のＡＣ入力を受電する電源部２と、前
記電源部２から相順データを受取り、相順を判別し外部
に判別結果を送出するマイクロプロセッサを有する電源
制御部３により構成される電源制御システムにおいて、
外部電源ｌを投入した時、電源部２のＡＣ入力電圧が規
定電圧を越えるまでは規定電圧以下であることを外部装
置に通知し、電源部２のＡＣ入力電圧が規定電圧前後の
不安定な状態であっても、規定電圧以下であるとして外
部装置に通知し、電源部２のＡＣ入力電圧が規定電圧を
確実に越えてから初めて相順判別を行い、判別結果を外
部装置に送出することを特徴とする。
第１図は本発明による一実施例相順検出処理フローチャ
ートである。電源部１のＡＣ入力端子は５０１１ｚ／６
０１１ｚの場合である。先ず、電源投入後立ち上がるま
での時間として、０．５ｓｅｃ経過するのを待ち（１）
、その後相順データ（ＰＤ）を２０ｍ５ｅｃ分メモリ（
Ｉ？ＡＭ）に取り込む（２）。次に、ＩＶＡｌ＋７）チ
ータラ先頭から１０ｍ５ｅｃ分検索しく３） 、ＩＶＡ
ｌのパルスがあるか否か判断する（４）。パルスがある
か否かはパルスの立ち下がりで判断する。ある場合には
ＩＶＡ２のデータを１νＡ１のパルスの立ち下がりから
８ｍ５ｅｃ分検索しく５） 、Ｉｔ／Ａ２のパルスがあ
るか否か判断する（６）。
ートである。電源部１のＡＣ入力端子は５０１１ｚ／６
０１１ｚの場合である。先ず、電源投入後立ち上がるま
での時間として、０．５ｓｅｃ経過するのを待ち（１）
、その後相順データ（ＰＤ）を２０ｍ５ｅｃ分メモリ（
Ｉ？ＡＭ）に取り込む（２）。次に、ＩＶＡｌ＋７）チ
ータラ先頭から１０ｍ５ｅｃ分検索しく３） 、ＩＶＡ
ｌのパルスがあるか否か判断する（４）。パルスがある
か否かはパルスの立ち下がりで判断する。ある場合には
ＩＶＡ２のデータを１νＡ１のパルスの立ち下がりから
８ｍ５ｅｃ分検索しく５） 、Ｉｔ／Ａ２のパルスがあ
るか否か判断する（６）。
次に、ＩＶＡ３のデータをＩＶＡＩのパルスの立ち下が
りから８ｍ５ｅｃ分検索しく７） 、ｒＶＡ３のパルス
があるか否か判断する（８）。この段階で、ステップ（
４）。
りから８ｍ５ｅｃ分検索しく７） 、ｒＶＡ３のパルス
があるか否か判断する（８）。この段階で、ステップ（
４）。
（６） 、 （８）でパルスがない場合には欠相の表示
をする（９）。ステップ（８）においてＩＶＡ３のパル
スがある場合には、ＩＶＡ３のパルスがＩＶ＾２のパル
スと同時か又は遅いか否かを判断する（ｌＯ）。同時か
又は遅い場合には相順異常の回数をカウントしく１１）
、ルーチンを５回繰り返した後（１２）、相順異常の回
数が３回以上であるか否かを判断しく１３）、３回以上
であれば相順異常の表示をする（１４）。
をする（９）。ステップ（８）においてＩＶＡ３のパル
スがある場合には、ＩＶＡ３のパルスがＩＶ＾２のパル
スと同時か又は遅いか否かを判断する（ｌＯ）。同時か
又は遅い場合には相順異常の回数をカウントしく１１）
、ルーチンを５回繰り返した後（１２）、相順異常の回
数が３回以上であるか否かを判断しく１３）、３回以上
であれば相順異常の表示をする（１４）。
このように、ステップ（３） 、 （５） 、 （７）
において、パルスが検出されなかった場合には電源部２
のＡＣ入力電圧が規定電圧を越えていないとみなして規
定電圧以下であることをパネルに表示し最初に戻り処理
を繰り返す、これにより前述の問題点の前半は解消され
る。
において、パルスが検出されなかった場合には電源部２
のＡＣ入力電圧が規定電圧を越えていないとみなして規
定電圧以下であることをパネルに表示し最初に戻り処理
を繰り返す、これにより前述の問題点の前半は解消され
る。
一方、ステップ（３）でＩＶＡＩのパルスを検索する範
囲はメモリの先頭からＡＣ入力波形の半周期弁（１０ｍ
ｓｅｃ）だけ行い、ステップ（５）ではＩ ＶＡ２のパ
ルスを検索する範囲はＩＶＡＩのパルスのあったメモリ
アドレスからＡＣ入力波形の半周期弁（８ａ＋５ｅｃ）
だけ行い、ステップ（７）ではＩＶＡ３のパルスを検索
する範囲はＩＶＡＩのパルスのあったメモリアドレスか
らＡＣ入力波形の半周期弁（８ｍｓｅｃ）だけ行うので
、これにより第５図の場合のように１ｍ５ｅｃ以下のパ
ルスｐ２が検出できなかった場合でも次のパルスｐ４を
検出しないので前述の問題点の後半は解消される。
囲はメモリの先頭からＡＣ入力波形の半周期弁（１０ｍ
ｓｅｃ）だけ行い、ステップ（５）ではＩ ＶＡ２のパ
ルスを検索する範囲はＩＶＡＩのパルスのあったメモリ
アドレスからＡＣ入力波形の半周期弁（８ａ＋５ｅｃ）
だけ行い、ステップ（７）ではＩＶＡ３のパルスを検索
する範囲はＩＶＡＩのパルスのあったメモリアドレスか
らＡＣ入力波形の半周期弁（８ｍｓｅｃ）だけ行うので
、これにより第５図の場合のように１ｍ５ｅｃ以下のパ
ルスｐ２が検出できなかった場合でも次のパルスｐ４を
検出しないので前述の問題点の後半は解消される。
第１図の各ステップをさらに詳細に説明する。
ステップ（２）では、まず、相順データを格納しておく
領域の先頭番地を設定する。次に相順データを５０μ３
１３Ｃ毎にサンプリングし、相順データを格納する領域
の番地を１づつ増やしながら、２０ｍ５ｅｃ分の相順デ
ータをメモリに記録する。
領域の先頭番地を設定する。次に相順データを５０μ３
１３Ｃ毎にサンプリングし、相順データを格納する領域
の番地を１づつ増やしながら、２０ｍ５ｅｃ分の相順デ
ータをメモリに記録する。
ステップ（３）では、相間データが格納しである領域の
先頭番地を設定し、トＳ相チエツク用情報をセットし、
相データ検索用定数を１０ｍ５ｅｃにセットし、さらに
、Ｒ−５相順データが１１１ Ｇ ＩＩからＬＯＷに切
り換わるところを調べる。
先頭番地を設定し、トＳ相チエツク用情報をセットし、
相データ検索用定数を１０ｍ５ｅｃにセットし、さらに
、Ｒ−５相順データが１１１ Ｇ ＩＩからＬＯＷに切
り換わるところを調べる。
ステップ（４）では、Ｒ−Ｓ相順データがＩＩＩＧＨか
らＬＯ−に切り換わるところがなかったときＩＶＡＩエ
ラーコードをセットして分岐する。
らＬＯ−に切り換わるところがなかったときＩＶＡＩエ
ラーコードをセットして分岐する。
ステップ（５）では、Ｒ−Ｓ相順データがＩＩＩＧＨが
らＬＯ−に切り換わるところのアドレスを保存し、Ｔ−
５相チエツク用情報をセットし、相データ検索用定数を
３ｍ５ｅｃにし、そして、Ｔ−Ｒ相順データが１１１Ｇ
１１からＬＯ−に切り換わるところを調べる。
らＬＯ−に切り換わるところのアドレスを保存し、Ｔ−
５相チエツク用情報をセットし、相データ検索用定数を
３ｍ５ｅｃにし、そして、Ｔ−Ｒ相順データが１１１Ｇ
１１からＬＯ−に切り換わるところを調べる。
ステップ（６）では、Ｔ−Ｒ相順データがＨＩＧＨがら
ＬＯＷに切り換わるところがなかったとき、ＩＶＡ３エ
ラーコードをセットして分岐する。
ＬＯＷに切り換わるところがなかったとき、ＩＶＡ３エ
ラーコードをセットして分岐する。
ステップ（７）では、Ｔ−Ｒ相順データがＨＩＧＨから
ＬＯＷに切り換わるところのアドレスを保存し、Ｒ−５
相順データがＩＩＩＧＨからＬＯＷに切り換わるところ
のアドレスを取り出し、Ｓ−Ｔ相チエツク用情報をセッ
トし、相データ検索用定数を８ｍ５ｅｃにセットし、そ
して、Ｓ−Ｔ相順データが旧Ｇ１１がらＬＯＷに切り換
わるところを調べる。
ＬＯＷに切り換わるところのアドレスを保存し、Ｒ−５
相順データがＩＩＩＧＨからＬＯＷに切り換わるところ
のアドレスを取り出し、Ｓ−Ｔ相チエツク用情報をセッ
トし、相データ検索用定数を８ｍ５ｅｃにセットし、そ
して、Ｓ−Ｔ相順データが旧Ｇ１１がらＬＯＷに切り換
わるところを調べる。
ステップ（８）では、Ｓ−Ｔ相順データがＩＩＴＧ）ｌ
がらＬＯＷに切り換わるところがなかったとき、ＩＶＡ
２エラーコードをセットして分岐する。
がらＬＯＷに切り換わるところがなかったとき、ＩＶＡ
２エラーコードをセットして分岐する。
ステップ（９）では、外部表示装置に欠相を示す表示を
行い、繰り返しカウンタをリセットし、相順異常データ
ありのカウンタをクリアする。
行い、繰り返しカウンタをリセットし、相順異常データ
ありのカウンタをクリアする。
ステップ（１０）では、Ｓ−Ｔ相順データが旧Ｇｌｌか
らＬＯ−に切り換わるところのアドレスがＴ−Ｒ相順デ
ータがＩＩ Ｉ Ｇ ＋１からＬＯＷに切り換わるとこ
ろのアドレスより大きいかどうか判断する。
らＬＯ−に切り換わるところのアドレスがＴ−Ｒ相順デ
ータがＩＩ Ｉ Ｇ ＋１からＬＯＷに切り換わるとこ
ろのアドレスより大きいかどうか判断する。
ステップ（１１）では、相順異常データありのカウンタ
を１増やす。
を１増やす。
ステップ（１２）では、本ルーチンを５回繰り返したか
どうか判断する。
どうか判断する。
ステップ（１３）では、相順異常データは３回未満かど
うか判断する。
うか判断する。
ステップ（１４）では、相順異常のアラームフラグをセ
ントし、外部表示装置に相順異常を示す表示を行う。
ントし、外部表示装置に相順異常を示す表示を行う。
第２図は第１図フローチャートのサブルーチンである。
サブルーチンの前半はＩＩＩＧＩＩが１ｍ５ｅｃ続いた
か否かチエツクするルーチンであり、後半はＬＯＷが１
ｍ５ｅｃ ｋＡいたか否かチエツクするルーチンである
。このルーチンは第１図のＲ−３，Ｔ−Ｒ，Ｓ−Ｔ等の
相間データがＨＩＧｌｌからＬＯ−に切り換わるところ
を調べるステップである。
か否かチエツクするルーチンであり、後半はＬＯＷが１
ｍ５ｅｃ ｋＡいたか否かチエツクするルーチンである
。このルーチンは第１図のＲ−３，Ｔ−Ｒ，Ｓ−Ｔ等の
相間データがＨＩＧｌｌからＬＯ−に切り換わるところ
を調べるステップである。
前半のステップでは、まず、パルスの立下がりがあった
フラグをクリアし、パルスチエツク用の１ｍ５ｅｃタイ
マをリセットし、相データ検索用カウンタをリセットす
る。次に、チエツクする相データはｌｌＩＣ１１か否か
確認し、１ｍ５ｅｃタイマは０”か否かを判断し、パル
スチエツク用のｌ ｍ５ｅｃタイマをリセットし、相デ
ータ検索用のカウンタをリセットする。次に、相データ
のチエツクはすべて終了しているか否かを判断する。
フラグをクリアし、パルスチエツク用の１ｍ５ｅｃタイ
マをリセットし、相データ検索用カウンタをリセットす
る。次に、チエツクする相データはｌｌＩＣ１１か否か
確認し、１ｍ５ｅｃタイマは０”か否かを判断し、パル
スチエツク用のｌ ｍ５ｅｃタイマをリセットし、相デ
ータ検索用のカウンタをリセットする。次に、相データ
のチエツクはすべて終了しているか否かを判断する。
後半のステップでは、まず、チエツクする相データはＬ
Ｏ−であるか否か判断し、パルスチエ’７り用の１ｍ５
ｅｃタイマは“０″か否か判断する。そして、パルスの
立下がりがあったフラグをセットし、相データのチエツ
クはすべて終了したか否か判断する。
Ｏ−であるか否か判断し、パルスチエ’７り用の１ｍ５
ｅｃタイマは“０″か否か判断する。そして、パルスの
立下がりがあったフラグをセットし、相データのチエツ
クはすべて終了したか否か判断する。
第３図は、ＡＣ入力電圧と相順データの関係を示すグラ
フである。電源部２のＡＣ入力電圧が規定電圧Ｖｒｅｆ
、例えば、＾Ｃ１５０ν±２ｖ、を越えるとＬＯ−レベ
ルのパルスが電源部２から送られてくる。
フである。電源部２のＡＣ入力電圧が規定電圧Ｖｒｅｆ
、例えば、＾Ｃ１５０ν±２ｖ、を越えるとＬＯ−レベ
ルのパルスが電源部２から送られてくる。
相順データの振幅は論理レベルとして５ｖである。
また、電源制御部のファームウェアでは相順データのパ
ルス幅の時間としてＬｌ及びｔ２が１ａ＋ｓｅｃ以上継
続するとパルスありと判断する。
ルス幅の時間としてＬｌ及びｔ２が１ａ＋ｓｅｃ以上継
続するとパルスありと判断する。
第４図は、正常入力の場合の相順データである。
ここでＲ，Ｓ、Ｔは３相の各配線を示し、各相間のＲ−
Ｓ相間のデータをＩＶＡＩ、 Ｓ−Ｔ相間をＩＶＡ２、
Ｔ−Ｒ相間をＩＶＡ３とする。電源部２では全波整流を
行っており、パルスがＰＩ、Ｐ３．Ｐ２の順番ならばＡ
Ｃ入力系は正常に各相に配線されていると判別できる。
Ｓ相間のデータをＩＶＡＩ、 Ｓ−Ｔ相間をＩＶＡ２、
Ｔ−Ｒ相間をＩＶＡ３とする。電源部２では全波整流を
行っており、パルスがＰＩ、Ｐ３．Ｐ２の順番ならばＡ
Ｃ入力系は正常に各相に配線されていると判別できる。
第５図は相順異常の場合の相順データである。
パルスがＰＩ、Ｐ２．Ｐ３の順番にあり、ＡＣ入力系は
誤配線されていると判別されるが、入力端子が低下して
パルスＰ２の幅が１ｍ５ｅｃ未満である場合、電源制御
部３のファームウェアでは検出できず、パルスＰｉ、Ｐ
３．Ｐ４の順番にみえ、ＡＣ入力系は正常に配線されて
いると誤判別してしまうことになる。
誤配線されていると判別されるが、入力端子が低下して
パルスＰ２の幅が１ｍ５ｅｃ未満である場合、電源制御
部３のファームウェアでは検出できず、パルスＰｉ、Ｐ
３．Ｐ４の順番にみえ、ＡＣ入力系は正常に配線されて
いると誤判別してしまうことになる。
以上説明したように、本発明によれば、外部電源を投入
してから電源部のＡＣ入力電圧が規定電圧を越えるまで
か、又は規定電圧前後で不安定な状態にある場合は規定
電圧以下であることを外部に通知し、電源部のＡＣ入力
電圧が規定電圧を確実に越えてから相順判別を行い判別
結果を外部に送出するため、外部電源の立上がりがどの
ような場合にも対応でき、誤動作を生じない相順判別を
行うことができる。
してから電源部のＡＣ入力電圧が規定電圧を越えるまで
か、又は規定電圧前後で不安定な状態にある場合は規定
電圧以下であることを外部に通知し、電源部のＡＣ入力
電圧が規定電圧を確実に越えてから相順判別を行い判別
結果を外部に送出するため、外部電源の立上がりがどの
ような場合にも対応でき、誤動作を生じない相順判別を
行うことができる。
第１図は、本発明の一実施例相順検出処理のフローチャ
ート、 第２図は、第１図ステップ（３） 、 （５） 、 （
７）のサブルーチン、 第３図は、ＡＣ入力端子と相順データの関係を説明する
グラフ、 第４図は、正常入力の場合の相順データ、第５図は、相
順異常の場合の相順データ、第６図は、電源装置におけ
る相順検出ブロック構成図、及び 第７図は、従来方法の相順検出処理フローチャトである
。 （符号の説明） ■・・・外部電源、 ２・・・電源部、 ３・・・電源制御部、 ４・・・外部表示装置、 ５・・・装置冷却用ファン ＣＭＰ・・・コンパレータ、 ＲＡＭ・・・メモリ、 ？ｌＰｔ１・・・マイクロプロセッサ、ＰＤ・・・相順
データ。
ート、 第２図は、第１図ステップ（３） 、 （５） 、 （
７）のサブルーチン、 第３図は、ＡＣ入力端子と相順データの関係を説明する
グラフ、 第４図は、正常入力の場合の相順データ、第５図は、相
順異常の場合の相順データ、第６図は、電源装置におけ
る相順検出ブロック構成図、及び 第７図は、従来方法の相順検出処理フローチャトである
。 （符号の説明） ■・・・外部電源、 ２・・・電源部、 ３・・・電源制御部、 ４・・・外部表示装置、 ５・・・装置冷却用ファン ＣＭＰ・・・コンパレータ、 ＲＡＭ・・・メモリ、 ？ｌＰｔ１・・・マイクロプロセッサ、ＰＤ・・・相順
データ。
Claims (1)
- 【特許請求の範囲】 １、外部電源から複数相のＡＣ入力を受電する電源部と
、前記電源部から相順データを受取り、相順を判別し外
部に判別結果を送出するマイクロプロセッサを有する電
源制御部により構成される電源制御システムにおいて、 外部電源を投入した時、電源部のＡＣ入力電圧が規定電
圧を越えるまでは規定電圧以下であることを外部装置に
通知し、 電源部のＡＣ入力電圧が規定電圧前後の不安定な状態で
あっても、規定電圧以下であるとして外部装置に通知し
、 電源部のＡＣ入力電圧が規定電圧を確実に越えてから初
めて相順判別を行い、判別結果を外部装置に送出する、 ことを特徴とする電源の相順判別方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63233717A JP2584843B2 (ja) | 1988-09-20 | 1988-09-20 | 電源の相順判別方法 |
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| JP63233717A JP2584843B2 (ja) | 1988-09-20 | 1988-09-20 | 電源の相順判別方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0282171A true JPH0282171A (ja) | 1990-03-22 |
| JP2584843B2 JP2584843B2 (ja) | 1997-02-26 |
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ID=16959454
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63233717A Expired - Fee Related JP2584843B2 (ja) | 1988-09-20 | 1988-09-20 | 電源の相順判別方法 |
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| Country | Link |
|---|---|
| JP (1) | JP2584843B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0899575A3 (en) * | 1997-08-27 | 1999-08-18 | Ensto Sekko Oy | A method and device for measuring the phase sequence and rotational direction of a three-phase system |
| JP2009244217A (ja) * | 2008-03-31 | 2009-10-22 | Hitachi Ltd | 圧縮機の制御装置および電動モータの制御装置 |
| JP2011053108A (ja) * | 2009-09-02 | 2011-03-17 | Kyoritsu Keiki Co Ltd | 逆相欠相検出器 |
-
1988
- 1988-09-20 JP JP63233717A patent/JP2584843B2/ja not_active Expired - Fee Related
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0899575A3 (en) * | 1997-08-27 | 1999-08-18 | Ensto Sekko Oy | A method and device for measuring the phase sequence and rotational direction of a three-phase system |
| JP2009244217A (ja) * | 2008-03-31 | 2009-10-22 | Hitachi Ltd | 圧縮機の制御装置および電動モータの制御装置 |
| JP2011053108A (ja) * | 2009-09-02 | 2011-03-17 | Kyoritsu Keiki Co Ltd | 逆相欠相検出器 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2584843B2 (ja) | 1997-02-26 |
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