JPH0287968A - Ｄｃ−ｄｃコンバータ - Google Patents
Ｄｃ−ｄｃコンバータInfo
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- JPH0287968A JPH0287968A JP23916088A JP23916088A JPH0287968A JP H0287968 A JPH0287968 A JP H0287968A JP 23916088 A JP23916088 A JP 23916088A JP 23916088 A JP23916088 A JP 23916088A JP H0287968 A JPH0287968 A JP H0287968A
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- Japan
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- voltage
- transformer
- circuit
- converter
- resonant capacitor
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- 239000003990 capacitor Substances 0.000 claims abstract description 12
- 238000009499 grossing Methods 0.000 claims description 3
- 238000004804 winding Methods 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 15
- 238000001514 detection method Methods 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 2
- 101100203839 Caenorhabditis elegans dvc-1 gene Proteins 0.000 description 1
- 101000852966 Rattus norvegicus Interleukin-1 receptor-like 1 Proteins 0.000 description 1
- 238000007792 addition Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000037430 deletion Effects 0.000 description 1
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- 230000005496 eutectics Effects 0.000 description 1
- 230000009466 transformation Effects 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はＤＣ−ＤＣＣコンバータ特に共振型に関するも
のである。
のである。
従来、この種の共振型コンバータにおいて、共振条件を
満足しないなどにより主スイッチ素子のターンオン時に
ゼロ電圧スイッチングができないときに一定時間模、強
制的に主スイッチ素子をターンオンさせていた。このた
め、ターンオン時のスイッチング損失が大きく、又、ス
パイクパルスを発生ブるなどの欠点があった。更に、図
面により詳）ホする。第１図は従来の共振型ＤＣ−ＤＣ
コンバータの一例を示す回路図であって、Ｔｒｌは主ス
イッチ素子、Ｔ１は変圧器、Ｃ１は共振用コンデンサ、
Ｄｌはダンパーダイオード、Ｄ２は整流用ダイオード、
Ｃ２は平滑用コンデンサであり、■は入力ｍａ、ｖｏは
出力電圧、ＶＣｌは共振用コンデンサＣ１の両端電圧、
１ｘは変圧器Ｔ１の１次電流、ＩＯは出力？！流を示す
。又、Ａは出力検出誤差幅器、Ｂは主スイッチ素子Ｔｒ
１の駆動回路である。
満足しないなどにより主スイッチ素子のターンオン時に
ゼロ電圧スイッチングができないときに一定時間模、強
制的に主スイッチ素子をターンオンさせていた。このた
め、ターンオン時のスイッチング損失が大きく、又、ス
パイクパルスを発生ブるなどの欠点があった。更に、図
面により詳）ホする。第１図は従来の共振型ＤＣ−ＤＣ
コンバータの一例を示す回路図であって、Ｔｒｌは主ス
イッチ素子、Ｔ１は変圧器、Ｃ１は共振用コンデンサ、
Ｄｌはダンパーダイオード、Ｄ２は整流用ダイオード、
Ｃ２は平滑用コンデンサであり、■は入力ｍａ、ｖｏは
出力電圧、ＶＣｌは共振用コンデンサＣ１の両端電圧、
１ｘは変圧器Ｔ１の１次電流、ＩＯは出力？！流を示す
。又、Ａは出力検出誤差幅器、Ｂは主スイッチ素子Ｔｒ
１の駆動回路である。
第１図においては八により出力電圧■０を検出し、それ
に対応したＢからの駆動信号により主スイッチ素子Ｔｒ
１のオン期間を制ｍする。オフ期間については［３から
の駆動信号により共振回路の条件に見合った一定値に保
たれる。
に対応したＢからの駆動信号により主スイッチ素子Ｔｒ
１のオン期間を制ｍする。オフ期間については［３から
の駆動信号により共振回路の条件に見合った一定値に保
たれる。
第２図は共振条件を満たした場合の波形図を示し、（ａ
）は共振用コンデンサＣ１の両端電圧の波形図であり、
（ｂ）は変圧器Ｔ１の１次電流ｌｘの波形図である。
）は共振用コンデンサＣ１の両端電圧の波形図であり、
（ｂ）は変圧器Ｔ１の１次電流ｌｘの波形図である。
図において、Ｎは変圧ｆｉＴ１の１次・２次巻線比、ｌ
ｎは変圧！１１ＴＩの内部インダクタンスと共振コンデ
ンサＣ１によって決まる回路定数である。
ｎは変圧！１１ＴＩの内部インダクタンスと共振コンデ
ンサＣ１によって決まる回路定数である。
時点１０で主スイッチ素子７ｒ＋をターンオンさせ、出
力に見合ったオン期間侵、ｔｌでＴｒｌをターンオフさ
せる。ｖＣｌはｔｌから増加しはじめ、Ｖｉ十Ｎ−Ｖｏ
を軸として振幅１０・７ｎの正弦波状の波形となる。こ
の場合、 Ｖｉ ＋Ｎ・Ｖｏ ＜ｔｏ ・Ｚｎ （＋）の
条件が成り立てばＶｃｌはＣ２の時点でゼロ電圧に達す
る。時点ｔ２〜ｔ３において、■×はダンパーダイオー
ドＤ１を流れるので、この間で、主スイッチ素子Ｔｒ１
をターンオンさせればスイッチング損失を最小にできる
。
力に見合ったオン期間侵、ｔｌでＴｒｌをターンオフさ
せる。ｖＣｌはｔｌから増加しはじめ、Ｖｉ十Ｎ−Ｖｏ
を軸として振幅１０・７ｎの正弦波状の波形となる。こ
の場合、 Ｖｉ ＋Ｎ・Ｖｏ ＜ｔｏ ・Ｚｎ （＋）の
条件が成り立てばＶｃｌはＣ２の時点でゼロ電圧に達す
る。時点ｔ２〜ｔ３において、■×はダンパーダイオー
ドＤ１を流れるので、この間で、主スイッチ素子Ｔｒ１
をターンオンさせればスイッチング損失を最小にできる
。
しかしながら、第１図の回路で出力電流１０が減少しす
ると、前記（１）式を満足しないようになり、ｖＣｌの
共振波形は零クロスしなくなる。
ると、前記（１）式を満足しないようになり、ｖＣｌの
共振波形は零クロスしなくなる。
第３図は共振条件を満たさない場合、叩ら、主スイッチ
素子のオフ期間におけるＣ１の両端電圧ＶＣ１が零に達
しない場合の波形図であり（ａ）はＣ１の両端電圧の波
形図、（ｂ）はｌｘの波形図である。
素子のオフ期間におけるＣ１の両端電圧ＶＣ１が零に達
しない場合の波形図であり（ａ）はＣ１の両端電圧の波
形図、（ｂ）はｌｘの波形図である。
第１図の従来回路においては駆動回路図Ｂの信号により
、オフ期間を共振回路の条件に見合って一定値に保って
いるのみであるから、次点ｔ４や、Ｃ６で、Ｔｒｉをタ
ーンオンする可能性が高く、その場合、スイッチング損
失は極めて大となり、スパイクパルス発生等の欠点を生
ずる。
、オフ期間を共振回路の条件に見合って一定値に保って
いるのみであるから、次点ｔ４や、Ｃ６で、Ｔｒｉをタ
ーンオンする可能性が高く、その場合、スイッチング損
失は極めて大となり、スパイクパルス発生等の欠点を生
ずる。
本発明は前記せる従来の共振型ＤＣ−ＤＣコンバータの
欠点を解消し、簡単な回路構成、高効率、低ノイズのＤ
Ｃ−ＤＣコンバータを得ることを目的とする。
欠点を解消し、簡単な回路構成、高効率、低ノイズのＤ
Ｃ−ＤＣコンバータを得ることを目的とする。
第４図は本発明の実施例を示す回路図であり、第１図と
同一符号は同一部分を示す。
同一符号は同一部分を示す。
ＣＴＩは変圧器■１の１次電流検出器、Ｃは電流−電圧
交換回路、ＯはＣの電圧判別回路である。
交換回路、ＯはＣの電圧判別回路である。
本発明はＶｃｌの極小値を直接的に検出せず、Ｖｃｌが
極／ｈ値ヲトルｔ５１．：おいてｄＶｃ１／ ｄｔ＝
Ｏテアルから、ｌｘ ＝Ｏとなることに着目し、ＩＸ
−０の検出に対応して、主スイッチ素子をターンオンす
るものである。即ち、！×を１次電流検出器ＣＴ１によ
り検出し、電流−電圧交換回路Ｃで電圧値に変換し、電
圧判別回路りにより、１ｘ−０であることを判別して駆
動回路Ｂからの駆動信号により主スイッチ素子をターン
オンさせる。従って、ｖＣｌの極小値でかつｌｘ −０
におけるスイッチングとなり、損失を著しく減少できる
。第４図では電流−電圧変換回路Ｃと電圧判別回路を２
部分に区分して図示したが、機能的説明上のための区分
であり、具体的回路構成上は一体に形成したちよい。
極／ｈ値ヲトルｔ５１．：おいてｄＶｃ１／ ｄｔ＝
Ｏテアルから、ｌｘ ＝Ｏとなることに着目し、ＩＸ
−０の検出に対応して、主スイッチ素子をターンオンす
るものである。即ち、！×を１次電流検出器ＣＴ１によ
り検出し、電流−電圧交換回路Ｃで電圧値に変換し、電
圧判別回路りにより、１ｘ−０であることを判別して駆
動回路Ｂからの駆動信号により主スイッチ素子をターン
オンさせる。従って、ｖＣｌの極小値でかつｌｘ −０
におけるスイッチングとなり、損失を著しく減少できる
。第４図では電流−電圧変換回路Ｃと電圧判別回路を２
部分に区分して図示したが、機能的説明上のための区分
であり、具体的回路構成上は一体に形成したちよい。
ＩＸの検出、変換、判別において誤差等により１ｘ−０
から若干のズレを生ずること本発明の範囲に包含される
ことは当然である。又、第４図の回路図において、部分
的な変更、付加、除去等があっても本発明の要旨の範囲
で本願に含まれるものである。
から若干のズレを生ずること本発明の範囲に包含される
ことは当然である。又、第４図の回路図において、部分
的な変更、付加、除去等があっても本発明の要旨の範囲
で本願に含まれるものである。
例えば、Ｃ［１は電流検出Ｃ１能をｂてばよく、シャン
ト、抵抗等で買き換え可能である。又、共振回路の構成
にＪ３いても、変圧器Ｔ１内部インダクタンスの他に直
列インダクタンスを付加してもよい。
ト、抵抗等で買き換え可能である。又、共振回路の構成
にＪ３いても、変圧器Ｔ１内部インダクタンスの他に直
列インダクタンスを付加してもよい。
以上のごとく、本発明により、簡単な回路構成で、スイ
ッチング損失を最小とし、更に、低ノイズになし１ｑる
共振型ＤＣ−ＤＣコンバータを提供でき、各産業用の直
流ｍ源等に利用して効果大なるものである。
ッチング損失を最小とし、更に、低ノイズになし１ｑる
共振型ＤＣ−ＤＣコンバータを提供でき、各産業用の直
流ｍ源等に利用して効果大なるものである。
第１図は従来のＤＣ−ＤＣコンバータの一例を示す回路
図、第２図（ａ）（ｂ）は共振条件を満たした時の波形
図、第３図（ａ）（ｂ）は共振条件を満たさない時の波
形図、第４図は本発明の実施例を示す回路図であり、Ｔ
ｒｌは主スイッチ素子、Ｔ１は変圧器、Ｃ１は共融用コ
ンデンサ、Ｄｌはダンパーダイオード、Ｄ２は整流用ダ
イオード、Ｃ２は平滑用コンデンサ、Ｖｉは入力電圧、
ｖ０は出力電圧、ｖＣｌはＣ１の両端電圧、ＩＸはＴ１
の１次電流、ＩＯは出力電流、Ａは出力検出誤差増幅器
、ＢはＴｒ＋の駆動回路、ＣＴ＋は丁１の１次電流検出
器、Ｃは電流−電圧交換回路、Ｄは電圧判別回路である
。
図、第２図（ａ）（ｂ）は共振条件を満たした時の波形
図、第３図（ａ）（ｂ）は共振条件を満たさない時の波
形図、第４図は本発明の実施例を示す回路図であり、Ｔ
ｒｌは主スイッチ素子、Ｔ１は変圧器、Ｃ１は共融用コ
ンデンサ、Ｄｌはダンパーダイオード、Ｄ２は整流用ダ
イオード、Ｃ２は平滑用コンデンサ、Ｖｉは入力電圧、
ｖ０は出力電圧、ｖＣｌはＣ１の両端電圧、ＩＸはＴ１
の１次電流、ＩＯは出力電流、Ａは出力検出誤差増幅器
、ＢはＴｒ＋の駆動回路、ＣＴ＋は丁１の１次電流検出
器、Ｃは電流−電圧交換回路、Ｄは電圧判別回路である
。
Claims (1)
- 直流電源、変圧器の一次巻線、及び主スイッチ素子を直
列に接続し、該変圧器の１次巻線と共振回路を構成する
共振用コンデンサを接続するとともに、該変圧器の出力
を整流し、平滑するＤＣ−ＤＣコンバータにおいて、共
振条件を満たさないで、共振用コンデンサの両端電圧が
零に達しない、場合、変圧器の１次電流の零クロス点を
検出することにより、該両端電圧の極小点を判別して、
主スイッチ素子をターンオンするようにしたことを特徴
とするＤＣ−ＤＣコンバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23916088A JP2681378B2 (ja) | 1988-09-24 | 1988-09-24 | Ｄｃ−ｄｃコンバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23916088A JP2681378B2 (ja) | 1988-09-24 | 1988-09-24 | Ｄｃ−ｄｃコンバータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0287968A true JPH0287968A (ja) | 1990-03-28 |
| JP2681378B2 JP2681378B2 (ja) | 1997-11-26 |
Family
ID=17040629
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23916088A Expired - Fee Related JP2681378B2 (ja) | 1988-09-24 | 1988-09-24 | Ｄｃ−ｄｃコンバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2681378B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE112006000074T5 (de) | 2005-09-15 | 2008-11-20 | Mitsubishi Denki K.K. | Elektrische Drahterodier-Bearbeitungsvorrichtung und elektrisches Drahterodier-Bearbeitungsverfahren |
-
1988
- 1988-09-24 JP JP23916088A patent/JP2681378B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE112006000074T5 (de) | 2005-09-15 | 2008-11-20 | Mitsubishi Denki K.K. | Elektrische Drahterodier-Bearbeitungsvorrichtung und elektrisches Drahterodier-Bearbeitungsverfahren |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2681378B2 (ja) | 1997-11-26 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20070808 Year of fee payment: 10 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080808 Year of fee payment: 11 |
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| LAPS | Cancellation because of no payment of annual fees |