JPH03105045A - エンジンのノッキング制御方法 - Google Patents
エンジンのノッキング制御方法Info
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- JPH03105045A JPH03105045A JP23962689A JP23962689A JPH03105045A JP H03105045 A JPH03105045 A JP H03105045A JP 23962689 A JP23962689 A JP 23962689A JP 23962689 A JP23962689 A JP 23962689A JP H03105045 A JPH03105045 A JP H03105045A
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- Japan
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- port
- output
- cpu
- knocking
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- Electrical Control Of Ignition Timing (AREA)
- Combined Controls Of Internal Combustion Engines (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（概 要〕
エンジンのノッキングを検出してフィードバック制御す
るノッキング制御方法に関し、ノック信号をＣＰＵに入
力するゲート回路の故障や、該ゲート同路を制御する該
ＣＰＵのポート故障に起因してノッキングが発生しない
ようにすることを目的とし、 エンジンのノッキングを検出するノックセンサと、該セ
ンサの出力をノッキング制御用のＣＰＵに人力するゲー
ト同路と、該ゲート回路を制御するポート、該ポートの
状態を変更する出力レジスタ、該ポートの状態を検出す
るポート状態レジスタを有する前記ＣＰＵとを備え、該
ＣＰＵは該ポートの状態変更タイ壽ング直後に該出力レ
ジスタとポート状態レジスタの内容を比較し、一致して
いれば正常モードの処理を行い、不一致のときは故障モ
ードの処理を行うよう構成する。
るノッキング制御方法に関し、ノック信号をＣＰＵに入
力するゲート回路の故障や、該ゲート同路を制御する該
ＣＰＵのポート故障に起因してノッキングが発生しない
ようにすることを目的とし、 エンジンのノッキングを検出するノックセンサと、該セ
ンサの出力をノッキング制御用のＣＰＵに人力するゲー
ト同路と、該ゲート回路を制御するポート、該ポートの
状態を変更する出力レジスタ、該ポートの状態を検出す
るポート状態レジスタを有する前記ＣＰＵとを備え、該
ＣＰＵは該ポートの状態変更タイ壽ング直後に該出力レ
ジスタとポート状態レジスタの内容を比較し、一致して
いれば正常モードの処理を行い、不一致のときは故障モ
ードの処理を行うよう構成する。
本発明は、エンジンのノッキングを検出してフィードハ
ック制御するノッキング制御方法に関する。
ック制御するノッキング制御方法に関する。
エンジンの発生トルクは点火タイミングを上死点（ＴＤ
Ｃ）より進角側に移すことで増大するが、点火進角を大
きくし過ぎるとノッキングが発生し易くなる。ノック制
御システム（ＫＣＳ）はノッキングが発生した場合に点
火タイミングを遅角側に戻したり、燃料噴射量を増加さ
せる等してノッキングが継続しないようにしてエンジン
を保護する。このシステムの有効性は、ノッキングを検
出するノックセンサから該センサの信号を処理するＣＰ
Ｕまでの系全体が正常に機能している場合に限られるの
で、各部の故障検出機能を同時に備えることが望まれる
。
Ｃ）より進角側に移すことで増大するが、点火進角を大
きくし過ぎるとノッキングが発生し易くなる。ノック制
御システム（ＫＣＳ）はノッキングが発生した場合に点
火タイミングを遅角側に戻したり、燃料噴射量を増加さ
せる等してノッキングが継続しないようにしてエンジン
を保護する。このシステムの有効性は、ノッキングを検
出するノックセンサから該センサの信号を処理するＣＰ
Ｕまでの系全体が正常に機能している場合に限られるの
で、各部の故障検出機能を同時に備えることが望まれる
。
［従来の技術］
第４図は燃料噴射制御方弐のエンジンシステムの実例を
示している。図中、ｌはエンジンで、その付近にスパー
クプラグ２とインジエクタ３が配置される。このエンジ
ンｌの吸気系から排気系にかけて吸気温センサ４、スロ
ットルポジションセンサ５、バキュームセンサ６、クラ
ンク角センサ７、水温センサ８、０２センサ９、排気温
センサｌＯ等が配置される。
示している。図中、ｌはエンジンで、その付近にスパー
クプラグ２とインジエクタ３が配置される。このエンジ
ンｌの吸気系から排気系にかけて吸気温センサ４、スロ
ットルポジションセンサ５、バキュームセンサ６、クラ
ンク角センサ７、水温センサ８、０２センサ９、排気温
センサｌＯ等が配置される。
ＩＩはスパークプラグ２の点火制御とインジェクタ３の
噴射制御等を行うエンジン・コントロール・コンピュー
タで、その入力には−ヒ述したセンサ４〜１０の他に車
速センサｌ２、ニュートラル・スタート・スイッチ（Ａ
／Ｔ車の場合）１３、エアコン（Ａ／Ｃ）１ ４、スタ
ータ１５、バッテリ１６、ノックセンサ５１等がある。
噴射制御等を行うエンジン・コントロール・コンピュー
タで、その入力には−ヒ述したセンサ４〜１０の他に車
速センサｌ２、ニュートラル・スタート・スイッチ（Ａ
／Ｔ車の場合）１３、エアコン（Ａ／Ｃ）１ ４、スタ
ータ１５、バッテリ１６、ノックセンサ５１等がある。
このコンピュータ１１はイグナイタ１７を通してスパー
クブラグ２を制御する。この他に排気温か異常に上昇し
たら排気温警告ランプ１８を点灯し、またアイドル回転
数を安定させるために、スロットルＩ９を迂回するアイ
ドル回転数制御用バルブ２０の開度を制御する。燃料ボ
ンプ２１を駆動するためにサーキット・オープニング・
リレー２２に通電するのも制御内容の１つである。
クブラグ２を制御する。この他に排気温か異常に上昇し
たら排気温警告ランプ１８を点灯し、またアイドル回転
数を安定させるために、スロットルＩ９を迂回するアイ
ドル回転数制御用バルブ２０の開度を制御する。燃料ボ
ンプ２１を駆動するためにサーキット・オープニング・
リレー２２に通電するのも制御内容の１つである。
第５図は第４図の燃料噴射制御系をブロック化して示し
たものである。コンピュータＬ １はＣＰＵ３Ｉを中心
にアナログ入力用のインタフェース３２とデジタル人力
用のインタフェース３３を備え、インタフェース３２で
取り込んだ信号はＡ／Ｄコンバータ３４でデジタル化し
てＣＰＵ３ １に入力する。
たものである。コンピュータＬ １はＣＰＵ３Ｉを中心
にアナログ入力用のインタフェース３２とデジタル人力
用のインタフェース３３を備え、インタフェース３２で
取り込んだ信号はＡ／Ｄコンバータ３４でデジタル化し
てＣＰＵ３ １に入力する。
ＣＰＵ３ １はメモリ３５を備え、定電圧電源３６で動
作する。３７は排気温センサｌＯの出力から排気温か異
常値に上昇したか否かを検出する回路、３８は該異常値
に達したとき排気温ランプｌ８を点灯させる駆動回路、
３９はインジエクタ３、リレー２２、バルブ２０、イグ
ナイタ１７を制御する各信号の出力インタフェースであ
る。インジェクタ３の数は気箇数に対応し、６気筒では
＃ｌ〜＃６の６本である。
作する。３７は排気温センサｌＯの出力から排気温か異
常値に上昇したか否かを検出する回路、３８は該異常値
に達したとき排気温ランプｌ８を点灯させる駆動回路、
３９はインジエクタ３、リレー２２、バルブ２０、イグ
ナイタ１７を制御する各信号の出力インタフェースであ
る。インジェクタ３の数は気箇数に対応し、６気筒では
＃ｌ〜＃６の６本である。
ＫＣＳはノックセンサ５１を用いて構戒される。
第６図はそのノッキング信号処理回路の一例を示してい
る。図中、５２はノックセンサ５１の出方からノンク固
有の周波数帯域（例えば７ＫＨｚの基本波またはその高
調波）を通過させるバンドパスフィルタ（ＢＰＦ）、５
３はオン／オフ制御されるゲート同路、５４はゲート回
路５３の出力波数をカウントするパルスカウント回路ま
たは該出力の最大振幅を保持するピークホールド回路、
５５は該回路５４の出力をデジタル値に変換するＡ／Ｄ
コンバータ、５６はＡ／Ｄコンバータ５５の出力を取込
むＣＰＵである。このＡ／Ｄコンバータ５５とＣＰＵ５
６は第５図のＡ／Ｄコンバータ３４とＣＰＵ３ １を
兼用できる。
る。図中、５２はノックセンサ５１の出方からノンク固
有の周波数帯域（例えば７ＫＨｚの基本波またはその高
調波）を通過させるバンドパスフィルタ（ＢＰＦ）、５
３はオン／オフ制御されるゲート同路、５４はゲート回
路５３の出力波数をカウントするパルスカウント回路ま
たは該出力の最大振幅を保持するピークホールド回路、
５５は該回路５４の出力をデジタル値に変換するＡ／Ｄ
コンバータ、５６はＡ／Ｄコンバータ５５の出力を取込
むＣＰＵである。このＡ／Ｄコンバータ５５とＣＰＵ５
６は第５図のＡ／Ｄコンバータ３４とＣＰＵ３ １を
兼用できる。
第７図は第６図の各部信号波形図である。ノックセンサ
５１の出−力はノック信号の他に点火ノイズやインテー
クおよびエキゾーストの各バルブノイズ等を含む。この
種のノイズはＢＰＦ５２を通遇してしまうため、ゲート
回路５３で時間的に除去する必要がある。一般にノック
信号は七死点（ＴＤＣ）付近で発生するため、ＴＤＣを
基準にゲート制御すればノック信号だけを抽出できる。
５１の出−力はノック信号の他に点火ノイズやインテー
クおよびエキゾーストの各バルブノイズ等を含む。この
種のノイズはＢＰＦ５２を通遇してしまうため、ゲート
回路５３で時間的に除去する必要がある。一般にノック
信号は七死点（ＴＤＣ）付近で発生するため、ＴＤＣを
基準にゲート制御すればノック信号だけを抽出できる。
また点火時期を基準にゲート制御を行う方法もあり、こ
れらは特開昭５４−１４１１８０号公報や特開昭５３［
４２０１｛号公報に紹介されている。この種のゲート制
御は時間またはクランク角を用いて行う。
れらは特開昭５４−１４１１８０号公報や特開昭５３［
４２０１｛号公報に紹介されている。この種のゲート制
御は時間またはクランク角を用いて行う。
ところで、ノックセンサ５１の出力レヘルが一定値以下
であるとノッキングなしと判定するシステムでは、ノッ
クセンサ５１自体が故障するとノッキングに関し正常と
誤判定する弱点がある。
であるとノッキングなしと判定するシステムでは、ノッ
クセンサ５１自体が故障するとノッキングに関し正常と
誤判定する弱点がある。
第８図はこの点を改善する方式で、（ａ）はシステム構
戒図、（ｂ）はフローチャートである。このシステムで
はＢＰＦ５２の出力をフエイルアンブ５７にも入力し、
その出力をＡ／Ｄコンバータ５５でデジタル値に変換し
てＣＰＵ５ ６で監視する。つまり、ＣＰＵ５６は（ｂ
）の処理を例えば６４ｍｓ毎に行い、先スステップ３３
１でフエイルアンプ５７の出力をＡ／Ｄ変換した値を読
込む。次いでステン７”Ｓ３２で（Ｃ）のようなフエイ
ルレヘルマップをサーチし、そのときのエンジン回転数
に応じたフエイルレベルを読出す。そして、ステップＳ
３３でフヱイルアンプ５７の出力のＡ／Ｄ値とサーチさ
れたフェイルレベルを比較し、Ａ／Ｄ値が大きければ正
常、小さければ異常（センサｌｔＪｉ線）と判断する。
戒図、（ｂ）はフローチャートである。このシステムで
はＢＰＦ５２の出力をフエイルアンブ５７にも入力し、
その出力をＡ／Ｄコンバータ５５でデジタル値に変換し
てＣＰＵ５ ６で監視する。つまり、ＣＰＵ５６は（ｂ
）の処理を例えば６４ｍｓ毎に行い、先スステップ３３
１でフエイルアンプ５７の出力をＡ／Ｄ変換した値を読
込む。次いでステン７”Ｓ３２で（Ｃ）のようなフエイ
ルレヘルマップをサーチし、そのときのエンジン回転数
に応じたフエイルレベルを読出す。そして、ステップＳ
３３でフヱイルアンプ５７の出力のＡ／Ｄ値とサーチさ
れたフェイルレベルを比較し、Ａ／Ｄ値が大きければ正
常、小さければ異常（センサｌｔＪｉ線）と判断する。
センサ異常と判定されたときはノックが発生しているに
も拘わらずピークホールド同路５４の出力は正常レベル
であるため、これによるフィードバック制御を継続する
とノ、ツキングが多発する。そこでこの制御を中断し、
ステップＳ３４の異常モード処理を行う。この処理は例
えば点火タイξングを進角域内で最大限遅角側に固定し
てしまう内容である。
も拘わらずピークホールド同路５４の出力は正常レベル
であるため、これによるフィードバック制御を継続する
とノ、ツキングが多発する。そこでこの制御を中断し、
ステップＳ３４の異常モード処理を行う。この処理は例
えば点火タイξングを進角域内で最大限遅角側に固定し
てしまう内容である。
第９図はこの説明図である。前述したように点火進角を
増加させるとトルクは増加し、ＰＩ点で最大となる。し
かし、このＰ１点はノック領域内にあるので、フィード
バック制御ではこのＰ１点をＰ２点一Ｐ３点へと移し、
ノック領域外の最良トルクが実現できるようにする。こ
のフィードバック制御はノックセンサ５１が正常な場合
には効果的であるが、ノックセンサ５１が故障したらノ
ック領域を大きく外れる点Ｐ４に移した方がエンジン保
護の面から好ましい。第８図（ｂ）のステップＳ３４で
遅角量を最大にする点はこのＰ４である。
増加させるとトルクは増加し、ＰＩ点で最大となる。し
かし、このＰ１点はノック領域内にあるので、フィード
バック制御ではこのＰ１点をＰ２点一Ｐ３点へと移し、
ノック領域外の最良トルクが実現できるようにする。こ
のフィードバック制御はノックセンサ５１が正常な場合
には効果的であるが、ノックセンサ５１が故障したらノ
ック領域を大きく外れる点Ｐ４に移した方がエンジン保
護の面から好ましい。第８図（ｂ）のステップＳ３４で
遅角量を最大にする点はこのＰ４である。
ところで、第６図の構或で故障するのはノックセンサ５
１に限らない。例えばゲート回路５３の故障、またはＣ
ＰＵ５６のポート障害も考えられる。また、ＣＰＵ５６
のポートからゲート回路５３に至る制御線の障害も考え
られる。しかしながら、従来はこのゲート系の故障を検
出していないので、フェイルセイフとしては不完全であ
る。
１に限らない。例えばゲート回路５３の故障、またはＣ
ＰＵ５６のポート障害も考えられる。また、ＣＰＵ５６
のポートからゲート回路５３に至る制御線の障害も考え
られる。しかしながら、従来はこのゲート系の故障を検
出していないので、フェイルセイフとしては不完全であ
る。
本発明は、ＣＰＵによって自己のポートも含めたゲート
系の故障を検出できるようにするものである。
系の故障を検出できるようにするものである。
第１図は本発明の原理図で、ＣＰＵの内部構或の一部を
示したものである。図中、６ｌはフリーランカウンタ、
６２は割込みの予定時刻をセットするコンベアレジスタ
、６３は両者の一致時に割込要求信号を出す一致同路、
６４はポート出力設定用の出力（ＤＯ［ＩＴ）レジスタ
、６５は出力レジスタ６４の内容を割込要求信号発生時
に取込む出力ラッチ、６６は出力ラッチ６５の出力、従
って実際のポートの状態を取込むポート状態レジスタで
ある。
示したものである。図中、６ｌはフリーランカウンタ、
６２は割込みの予定時刻をセットするコンベアレジスタ
、６３は両者の一致時に割込要求信号を出す一致同路、
６４はポート出力設定用の出力（ＤＯ［ＩＴ）レジスタ
、６５は出力レジスタ６４の内容を割込要求信号発生時
に取込む出力ラッチ、６６は出力ラッチ６５の出力、従
って実際のポートの状態を取込むポート状態レジスタで
ある。
ＣＰＵがプログラムでコンベアレジスタ６２にゲートＯ
Ｎの予定時刻をセットし、また出力レジスタ６４に１を
セットすると、フリーランカウンタ６１がレジスタ６２
内の予定時刻になったとき、出力レジスタ６４内の１が
出力ラッチ６５に取込まれ、ゲート制御用のポートがＨ
（ハイ）になる。
Ｎの予定時刻をセットし、また出力レジスタ６４に１を
セットすると、フリーランカウンタ６１がレジスタ６２
内の予定時刻になったとき、出力レジスタ６４内の１が
出力ラッチ６５に取込まれ、ゲート制御用のポートがＨ
（ハイ）になる。
次に、レジスタ６２にゲー［）ＦＦの予定時刻をセット
し、また出力レジスタ６４に０をセットすると、フリー
ランカウンタ６ｌがレジスタ６２内の予定時刻になった
とき出力レジスタ６４内のＯが出力ラッチ６５に取込ま
れ、ゲート制御用のポートがＬ（ロー）になる。
し、また出力レジスタ６４に０をセットすると、フリー
ランカウンタ６ｌがレジスタ６２内の予定時刻になった
とき出力レジスタ６４内のＯが出力ラッチ６５に取込ま
れ、ゲート制御用のポートがＬ（ロー）になる。
ところがゲート同路側でポートをＨに引トげる故障が生
していると、出力レジスタ６４から０を出力ラッチ６５
に移してもポートはＬにならない。
していると、出力レジスタ６４から０を出力ラッチ６５
に移してもポートはＬにならない。
また、ゲート回路側でポートをＬに引込む故障が生して
いると、出力レジスタ６４から１を出力ラッチ６５に移
してもポートはＨにならない。
いると、出力レジスタ６４から１を出力ラッチ６５に移
してもポートはＨにならない。
ポート状態レジスタ６６はこのようなポートの実際のレ
ベルを取込み、ＣＰＵが出力レジスタ６４の内容とポー
トの状態を把握できるようにする。
ベルを取込み、ＣＰＵが出力レジスタ６４の内容とポー
トの状態を把握できるようにする。
この対応関係が正常であればゲート回路は正常に作動し
ているが、異常であればゲート回路は正しく作動しない
状態になっていると判断し、前述したノッキングのフィ
ードバック制御を中断して異常モード処理に移る。この
異常モード処理は例えば第８図（ｂ）のステップ３３４
で良いので、その前段の■へ移行する。
ているが、異常であればゲート回路は正しく作動しない
状態になっていると判断し、前述したノッキングのフィ
ードバック制御を中断して異常モード処理に移る。この
異常モード処理は例えば第８図（ｂ）のステップ３３４
で良いので、その前段の■へ移行する。
第２図は本発明の一実施例を示す構成図で、５１はノッ
クセンサ、５２はＢＰＦ，５３はゲート同路、５４はピ
ークホールド回路、５５はＡ／Ｄコンバータ、５６は第
１図の構威を内蔵するＣＰＵである。
クセンサ、５２はＢＰＦ，５３はゲート同路、５４はピ
ークホールド回路、５５はＡ／Ｄコンバータ、５６は第
１図の構威を内蔵するＣＰＵである。
ゲート同路５３は、ＢＰＦ５２とピークホールド回路５
４の間の信号線を強制的に接地するｎｐｎ型トランジス
タＱ，と、そのベースバイアス抵抗Ｒ１〜Ｒ３からなる
。抵抗Ｒ，〜Ｒ，は電源５■とアース間に直列に接続さ
れ、抵抗Ｒ．，Ｒｆｆの接続点がトランジスタＱ１のヘ
ースに、また抵抗Ｒ，，Ｒ．の接続点がＣＰＵ５６のゲ
ート制御用ポートに接続されている。従って、該ポート
がＨになるとトランジスタＱ１はオンしてピークホール
ド回路５４の入力を遮断し、逆に該ポートがＬになると
トランジスタＱ，はオフしてＢＰＦ５２の出力がピーク
ホールド回路５４に入力する。従って、本例ではトラン
ジスタＱ，がオフしている期間が前述したゲートＯＮの
期間になる。
４の間の信号線を強制的に接地するｎｐｎ型トランジス
タＱ，と、そのベースバイアス抵抗Ｒ１〜Ｒ３からなる
。抵抗Ｒ，〜Ｒ，は電源５■とアース間に直列に接続さ
れ、抵抗Ｒ．，Ｒｆｆの接続点がトランジスタＱ１のヘ
ースに、また抵抗Ｒ，，Ｒ．の接続点がＣＰＵ５６のゲ
ート制御用ポートに接続されている。従って、該ポート
がＨになるとトランジスタＱ１はオンしてピークホール
ド回路５４の入力を遮断し、逆に該ポートがＬになると
トランジスタＱ，はオフしてＢＰＦ５２の出力がピーク
ホールド回路５４に入力する。従って、本例ではトラン
ジスタＱ，がオフしている期間が前述したゲートＯＮの
期間になる。
第３図はＣＰＵＦ＋６による処理の説明図で、（ａ）は
ＴＤＣタイミングで起動される割込処理である。
ＴＤＣタイミングで起動される割込処理である。
この処理では先ずステップＳｌｌで１８０゜ＣＡ（ＣＡ
はクランク角）に相当する時間Ｔ１８０を１２分の１に
してｌ５゜ＣＡ分の時間Ｄを求める。
はクランク角）に相当する時間Ｔ１８０を１２分の１に
してｌ５゜ＣＡ分の時間Ｄを求める。
次いで、このＤに割込時刻つまりＴＤＣ時刻を加えた値
をゲートＯＮの予定時刻としてＣＯＭＰ （コンベアレ
ジスタ６４に相当する）にセットする。次のステップＳ
ｌ３では予定時刻でポートをＯＮにするデータｌを出力
レジスタにセットする。ステップＳｌｌ，３１２による
セットは（Ｃ）の矢印のに示すように、ＴＤＣから１５
゜ＣＡ後にゲートをＯＮにすることを意味する。尚、こ
の場合のゲートは第２図とは逆論理でＯＮ／ＯＦＦする
。
をゲートＯＮの予定時刻としてＣＯＭＰ （コンベアレ
ジスタ６４に相当する）にセットする。次のステップＳ
ｌ３では予定時刻でポートをＯＮにするデータｌを出力
レジスタにセットする。ステップＳｌｌ，３１２による
セットは（Ｃ）の矢印のに示すように、ＴＤＣから１５
゜ＣＡ後にゲートをＯＮにすることを意味する。尚、こ
の場合のゲートは第２図とは逆論理でＯＮ／ＯＦＦする
。
やがてゲートＯＮの予定時刻になると第１図の一致同路
６３が割込要求信号を出し、出力ラッチ６５に出力レジ
スタ６４の１が書込まれ、同時に（ｂ）のルーチンが起
動される。このときは出力レジスタ＝１であるので、ス
テップＳ２１からステップＳ２２へ分岐する。そして、
ポートの状態を調べＨであれば正常なので、ステップＳ
２３，Ｓ２４でゲートＯＦＦの予定時刻をセットする。
６３が割込要求信号を出し、出力ラッチ６５に出力レジ
スタ６４の１が書込まれ、同時に（ｂ）のルーチンが起
動される。このときは出力レジスタ＝１であるので、ス
テップＳ２１からステップＳ２２へ分岐する。そして、
ポートの状態を調べＨであれば正常なので、ステップＳ
２３，Ｓ２４でゲートＯＦＦの予定時刻をセットする。
本例ではゲー｝ Ｏ Ｆ ＦをＴＤＣ後９０゜ＣＡとし
ているので、ステップＳ２３で９０’ＣＡに相当する時
間Ｄ＝Ｔ １ ８ ０／２を求める。そして、ステップ
３２４でＴＤＣ割込時刻にＤを算して予定時刻を求め、
これをＣＯＭＰにセットする。これは（Ｃ）の矢印■に
相当する。次いでステップＳ２５でゲートをＯ Ｆ Ｆ
にする０を出力レジスタにセットしておく。
ているので、ステップＳ２３で９０’ＣＡに相当する時
間Ｄ＝Ｔ １ ８ ０／２を求める。そして、ステップ
３２４でＴＤＣ割込時刻にＤを算して予定時刻を求め、
これをＣＯＭＰにセットする。これは（Ｃ）の矢印■に
相当する。次いでステップＳ２５でゲートをＯ Ｆ Ｆ
にする０を出力レジスタにセットしておく。
やがてゲー１−ＯＦＦの予定時刻になると一致回路６３
から再び割込要求信号が発生し、出力レジスタ６４の０
が出力ラッチ６５に取込まれ、同時に（ｂ）のルーチン
が起動される。このときは出力レジスタが０であるので
ステップＳ２１からステップＳ２６に分岐する。ここで
ポートがＬであれば正常なので、ステップＳ２７で正常
モード処理（前述したフィードバック制′ａ）を行う。
から再び割込要求信号が発生し、出力レジスタ６４の０
が出力ラッチ６５に取込まれ、同時に（ｂ）のルーチン
が起動される。このときは出力レジスタが０であるので
ステップＳ２１からステップＳ２６に分岐する。ここで
ポートがＬであれば正常なので、ステップＳ２７で正常
モード処理（前述したフィードバック制′ａ）を行う。
これに対し、ステップＳ２２でポートがＬと判断された
とき、またはステップＳ２６でポートがＨと判定された
ときはいずれも異常なのでステップ３２８の故障モード
処理を行う。これば第８図（ｂ）で■からステップＳ３
４へ移行することと等価である。
とき、またはステップＳ２６でポートがＨと判定された
ときはいずれも異常なのでステップ３２８の故障モード
処理を行う。これば第８図（ｂ）で■からステップＳ３
４へ移行することと等価である。
第２図の例では抵抗Ｒ１が■で示すようにショートシて
いると出力レジスタに０をセットしてもポートはＨにし
かならず、また抵抗Ｒ，がオーブンになっていると出力
レジスタに１をセットしてもポートはＬにしかならない
ため、いずれも故障と検知される。この他にポートつま
り出力ラッチ６５や、ポートとゲート回路５３との間の
信号線に故障が生しているときも、出力レジスタ６４と
ポート状態レジスタ６６が別の状態になるため、ＣＰＵ
５６はこれらを含めてゲート系の故障と判定できる。
いると出力レジスタに０をセットしてもポートはＨにし
かならず、また抵抗Ｒ，がオーブンになっていると出力
レジスタに１をセットしてもポートはＬにしかならない
ため、いずれも故障と検知される。この他にポートつま
り出力ラッチ６５や、ポートとゲート回路５３との間の
信号線に故障が生しているときも、出力レジスタ６４と
ポート状態レジスタ６６が別の状態になるため、ＣＰＵ
５６はこれらを含めてゲート系の故障と判定できる。
〔発明の効果〕
以−ヒ述べたように本発明によれば、ノックセンサの出
力をゲート同路を通してＣＰＵに取込むノック制御シス
テムにおいて、該ゲート同路系の故障を検出できるよう
にしたので、ノック発生の検知不能状態での不適正な点
火制御等を未然に回避できる利点がある。
力をゲート同路を通してＣＰＵに取込むノック制御シス
テムにおいて、該ゲート同路系の故障を検出できるよう
にしたので、ノック発生の検知不能状態での不適正な点
火制御等を未然に回避できる利点がある。
第１図は本発明の原理図、
第２図は本発明の実施例を示す構或図、第３図は本発明
の処理を示す説明図、 第４図はエンジンシステムの構成図、 第５図は燃料噴射制御系のブロック図、第６図はノッキ
ング信号処理同路の構或図、第７図は第６図の各部信号
波形図、 第８図はノ・ンクセンサ故障検出方式の説明図、第９図
は点火進角とノック領域の説明図である。 ータ、５６はＣＰＵ，６１はフリーランカウンタ、６２
はコンベアレジスタ、６３は一致同路、６４は出力レジ
スタ、６５は出力ランチ、６６はポート状態レジスタで
あるう 出 願 人 富士通テン株式会社 出 願 人 トヨタ自動車株式会社
の処理を示す説明図、 第４図はエンジンシステムの構成図、 第５図は燃料噴射制御系のブロック図、第６図はノッキ
ング信号処理同路の構或図、第７図は第６図の各部信号
波形図、 第８図はノ・ンクセンサ故障検出方式の説明図、第９図
は点火進角とノック領域の説明図である。 ータ、５６はＣＰＵ，６１はフリーランカウンタ、６２
はコンベアレジスタ、６３は一致同路、６４は出力レジ
スタ、６５は出力ランチ、６６はポート状態レジスタで
あるう 出 願 人 富士通テン株式会社 出 願 人 トヨタ自動車株式会社
Claims (1)
- 【特許請求の範囲】 １、エンジンのノッキングを検出するノックセンサ（５
１）と、 該センサの出力をノッキング制御用のＣＰＵに入力する
ゲート回路（５３）と、 該ゲート回路を制御するポート、該ポートの状態を変更
する出力レジスタ、該ポートの状態を検出するポート状
態レジスタを有する前記ＣＰＵ（５６）とを備え、 該ＣＰＵは該ポートの状態変更タイミング直後に該出力
レジスタとポート状態レジスタの内容を比較し、一致し
ていれば正常モードの処理を行い、不一致のときは故障
モードの処理を行うことを特徴とするエンジンのノッキ
ング制御方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23962689A JPH03105045A (ja) | 1989-09-14 | 1989-09-14 | エンジンのノッキング制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23962689A JPH03105045A (ja) | 1989-09-14 | 1989-09-14 | エンジンのノッキング制御方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03105045A true JPH03105045A (ja) | 1991-05-01 |
Family
ID=17047521
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23962689A Pending JPH03105045A (ja) | 1989-09-14 | 1989-09-14 | エンジンのノッキング制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03105045A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015229992A (ja) * | 2014-06-06 | 2015-12-21 | 日本特殊陶業株式会社 | 点火時期制御装置 |
-
1989
- 1989-09-14 JP JP23962689A patent/JPH03105045A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015229992A (ja) * | 2014-06-06 | 2015-12-21 | 日本特殊陶業株式会社 | 点火時期制御装置 |
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