JPH03175708A - 自動利得制御回路 - Google Patents
自動利得制御回路Info
- Publication number
- JPH03175708A JPH03175708A JP31487389A JP31487389A JPH03175708A JP H03175708 A JPH03175708 A JP H03175708A JP 31487389 A JP31487389 A JP 31487389A JP 31487389 A JP31487389 A JP 31487389A JP H03175708 A JPH03175708 A JP H03175708A
- Authority
- JP
- Japan
- Prior art keywords
- control voltage
- variable gain
- gain amplifier
- period
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
信号振幅を一定レベルとして出力する自動利得制御回路
に関し、 データ読出し不能期間を短縮し、二次記憶装置のデータ
読出しを高速化することを目的とし、入力信号を整流し
て直流の制御電圧を得る整流回路と、該整流回路から供
給される制御ｌｌ電圧が大なる程ゲインを小さくして該
入力信号を増幅し出力する可変利得増幅器とを有し構成
する。
に関し、 データ読出し不能期間を短縮し、二次記憶装置のデータ
読出しを高速化することを目的とし、入力信号を整流し
て直流の制御電圧を得る整流回路と、該整流回路から供
給される制御ｌｌ電圧が大なる程ゲインを小さくして該
入力信号を増幅し出力する可変利得増幅器とを有し構成
する。
本発明は自動利得制御回路に関し、信号振幅を一定レベ
ルとして出力する自動利得制御回路に関する。
ルとして出力する自動利得制御回路に関する。
近年のコンビコータシステムの高速化に伴い、磁気ディ
スク装置等の二次記憶装置の高速化の要求が高まってい
る。磁気ディスク装置ではディスクより再生した再生信
号の振幅を自動利得制御（ＡＧＣ）回路で一定レベルと
して後段の復調回路に供給している。
スク装置等の二次記憶装置の高速化の要求が高まってい
る。磁気ディスク装置ではディスクより再生した再生信
号の振幅を自動利得制御（ＡＧＣ）回路で一定レベルと
して後段の復調回路に供給している。
従来の磁気ディスク装置に用いられるＡＧＣ回路は第４
図に示す構成であり、端子１０に入来する再生信号ＶＩ
Ｎを可変利得増幅器１１で増幅して出力信号ＶＯＩＪＴ
を端子１２より出力する。可変利得増幅器１１の出力信
号ｖ ｏｕｒは整流回路１３で整流され、ここで得られ
た制御電圧Ｖｃが可変利得増幅器１１に供給され、可変
利得増幅器１１のゲインを可変する。
図に示す構成であり、端子１０に入来する再生信号ＶＩ
Ｎを可変利得増幅器１１で増幅して出力信号ＶＯＩＪＴ
を端子１２より出力する。可変利得増幅器１１の出力信
号ｖ ｏｕｒは整流回路１３で整流され、ここで得られ
た制御電圧Ｖｃが可変利得増幅器１１に供給され、可変
利得増幅器１１のゲインを可変する。
可変利得増幅器１１ば制御電圧Ｖｃに対して第５図に示
す如くゲインを可変する。
す如くゲインを可変する。
（発明が解決しようとする課題）
従来回路では、磁気ディスク装置のリード／ライト信号
が第６図（Ａ）に示す如くロレベルとなって同図（Ｂ）
に示す再生信号ＶＩＮが入来すると、制御電圧Ｖｏは同
図（Ｃ）に示す如＜Ｏｖから徐々に立上がる。このため
出力信５ＶＯＵＴの振幅は再生信号入来からある期間Ｔ
１だけ期待値レベルより大きくなり、この期間−「１は
後段の復調回路の動作が保障されずデータ読出しをでき
なくなり、このデータ読出し不能期間Ｔ１が長いという
問題があった。
が第６図（Ａ）に示す如くロレベルとなって同図（Ｂ）
に示す再生信号ＶＩＮが入来すると、制御電圧Ｖｏは同
図（Ｃ）に示す如＜Ｏｖから徐々に立上がる。このため
出力信５ＶＯＵＴの振幅は再生信号入来からある期間Ｔ
１だけ期待値レベルより大きくなり、この期間−「１は
後段の復調回路の動作が保障されずデータ読出しをでき
なくなり、このデータ読出し不能期間Ｔ１が長いという
問題があった。
本発明は上記の点に鑑みなされたもので、データ読出し
不能期間を短縮し、二次記憶装置のデータ読出しを高速
化する自動利得制御回路を提供することを目的とする。
不能期間を短縮し、二次記憶装置のデータ読出しを高速
化する自動利得制御回路を提供することを目的とする。
第１図は本発明回路の原理図を示す。
同図中、整流回路２は、端子１より入来する入力信ｇを
整流して直流の制御電圧を得る。
整流して直流の制御電圧を得る。
可変利得増幅器３は、整流回路２から供給される制御電
圧が大なる程ゲインを小さくして入力信号を増幅し端子
４より出力する。
圧が大なる程ゲインを小さくして入力信号を増幅し端子
４より出力する。
本発明においては、入力信号を流して可変利得増幅器３
に供給しているため、入力信号の入来がなく可変利得増
幅器３のゲインが最大の状態で入力信号が入来したとき
可変利得増幅器３のゲインが飽和している期間が短かく
て済み、出力信号の振幅が短時間で一定レベルとなり、
データ読出し不能期間が短縮化され、二次記憶装置は高
速のデ−タ読出しを行なうことができる。
に供給しているため、入力信号の入来がなく可変利得増
幅器３のゲインが最大の状態で入力信号が入来したとき
可変利得増幅器３のゲインが飽和している期間が短かく
て済み、出力信号の振幅が短時間で一定レベルとなり、
データ読出し不能期間が短縮化され、二次記憶装置は高
速のデ−タ読出しを行なうことができる。
〔実施例）
第２図は本発明回路の一実施例のブロック図を示す。
同図中、磁気ディスク装簡のリード／ライト信号が第３
図（Ａ）に示す如くロレベルとなり読出しが開始される
と、ディスクヘッド２１でディスクより再生され結合コ
ンデンサ２２を通った第３図（Ｂ）に示す如き再生信号
ＶＩＮが可変利得増幅器２３及び全波整流器２４に供給
される。
図（Ａ）に示す如くロレベルとなり読出しが開始される
と、ディスクヘッド２１でディスクより再生され結合コ
ンデンサ２２を通った第３図（Ｂ）に示す如き再生信号
ＶＩＮが可変利得増幅器２３及び全波整流器２４に供給
される。
全波整流器２４は再生信号を全波整流し、その整流出力
は低域フィルタ２５に供給されて第３図（Ｃ）に示す制
御電圧Ｖｃが得られる。この制御電圧Ｖｃは可変利得増
幅器２３に供給される。
は低域フィルタ２５に供給されて第３図（Ｃ）に示す制
御電圧Ｖｃが得られる。この制御電圧Ｖｃは可変利得増
幅器２３に供給される。
可変利得増幅器２３は第５図に示す制御電圧ゲイン特性
を有し、制御電圧Ｖｃに応じたゲインで再生信号ＶＩＮ
を増幅して第３図（Ｄ）に示す出力信号ｖ ｏｕｒを得
、この出力信号ｖ ｏｕｒを端子２６より次段の復調回
路（図示せず〉に供給する。
を有し、制御電圧Ｖｃに応じたゲインで再生信号ＶＩＮ
を増幅して第３図（Ｄ）に示す出力信号ｖ ｏｕｒを得
、この出力信号ｖ ｏｕｒを端子２６より次段の復調回
路（図示せず〉に供給する。
ここで、本実施例では入来する再生信号を直接整流して
制御電圧Ｖｃを得ているため、従来の如く可変利得増幅
器出力を整流して制御電圧Ｖｃを得るものに比して再生
信号の入来後可変利得増幅器２３のゲインが最大で飽和
している期間が短がくなり、第３図（Ｄ）に示す如くデ
ータ読出し不能期間Ｔ２は従来の期間Ｔ１より大幅に短
縮化される。
制御電圧Ｖｃを得ているため、従来の如く可変利得増幅
器出力を整流して制御電圧Ｖｃを得るものに比して再生
信号の入来後可変利得増幅器２３のゲインが最大で飽和
している期間が短がくなり、第３図（Ｄ）に示す如くデ
ータ読出し不能期間Ｔ２は従来の期間Ｔ１より大幅に短
縮化される。
上述の如く、本発明の自動利得制御回路によれば、入力
信号が入来し始めてから可変利得増幅器のゲインが最大
で飽和している期間を短縮でき、データ読出し不能期間
を短縮することができ、二次記憶装置のデータ読出しを
高速化でき、実用上きわめて有用である。
信号が入来し始めてから可変利得増幅器のゲインが最大
で飽和している期間を短縮でき、データ読出し不能期間
を短縮することができ、二次記憶装置のデータ読出しを
高速化でき、実用上きわめて有用である。
第１図は本発明回路の原理図、
第２図は本発明回路の一実施例の回路図、第３図は本発
明回路の各部の４Ｂ ”ｊ波形図、第４図は従来回路の
一例の回路図、 第５図は可変利得増幅器の特性図、 第６図は従来回路の各部の信号波形図である。 図において、 ２．２３は整流回路、 ３は可変利得増幅器、 ２４は全波整流器、 ２５は低域フィルタ を示す。
明回路の各部の４Ｂ ”ｊ波形図、第４図は従来回路の
一例の回路図、 第５図は可変利得増幅器の特性図、 第６図は従来回路の各部の信号波形図である。 図において、 ２．２３は整流回路、 ３は可変利得増幅器、 ２４は全波整流器、 ２５は低域フィルタ を示す。
Claims (1)
- 【特許請求の範囲】 入力信号を整流して直流の制御電圧を得る整流回路（２
）と、 該整流回路（２）から供給される制御電圧が大なる程ゲ
インを小さくして該入力信号を増幅し出力する可変利得
増幅器（３）とを有することを特徴とする自動利得制御
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31487389A JPH03175708A (ja) | 1989-12-04 | 1989-12-04 | 自動利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31487389A JPH03175708A (ja) | 1989-12-04 | 1989-12-04 | 自動利得制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03175708A true JPH03175708A (ja) | 1991-07-30 |
Family
ID=18058646
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31487389A Pending JPH03175708A (ja) | 1989-12-04 | 1989-12-04 | 自動利得制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03175708A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6433633B1 (en) * | 1999-11-15 | 2002-08-13 | Telefonaktiebolaget L M Ericsson (Publ) | Automatic gain control system with signal presence conditioning |
-
1989
- 1989-12-04 JP JP31487389A patent/JPH03175708A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6433633B1 (en) * | 1999-11-15 | 2002-08-13 | Telefonaktiebolaget L M Ericsson (Publ) | Automatic gain control system with signal presence conditioning |
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