JPH03185605A - 記録電流駆動回路のヘッド端子電位制御方法およびその回路 - Google Patents
記録電流駆動回路のヘッド端子電位制御方法およびその回路Info
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- JPH03185605A JPH03185605A JP32371889A JP32371889A JPH03185605A JP H03185605 A JPH03185605 A JP H03185605A JP 32371889 A JP32371889 A JP 32371889A JP 32371889 A JP32371889 A JP 32371889A JP H03185605 A JPH03185605 A JP H03185605A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、磁気記録装置の記録回路にかかり、特に２端
子の記録ヘッドに立上り特性の良好な記録電流を供給す
る記録電流駆動回路に関する。
子の記録ヘッドに立上り特性の良好な記録電流を供給す
る記録電流駆動回路に関する。
従来の２端子の記録ヘッドに記録電流を供給する記録回
路には、アイ・ビー・エム、テクニカル・ディスクロー
ジャー・プリテン２３．Ｎα１１（１９８１年）第５１
６７頁から第５１６８頁（Ｉ ＢＭ、ＴＤＢ、ＶｏＱ、
２３．Ｎｉｌ １ ＾ｐｒｉｌ（１９８１）ｐｐ５１６
７−１５６８）に記載の第６図に示すような構成の回路
がある。
路には、アイ・ビー・エム、テクニカル・ディスクロー
ジャー・プリテン２３．Ｎα１１（１９８１年）第５１
６７頁から第５１６８頁（Ｉ ＢＭ、ＴＤＢ、ＶｏＱ、
２３．Ｎｉｌ １ ＾ｐｒｉｌ（１９８１）ｐｐ５１６
７−１５６８）に記載の第６図に示すような構成の回路
がある。
この記録回路は、２端子の誘導性記録ヘット２の両端に
、−組の電圧ホロワＱ３．Ｑ４の出力をそれぞれ接続す
ると共に、ヘッド２の両端に一組の電流スイッチＱｌ、
Ｑ２の出力をそれぞれ接続し、更にこの電流スイッチに
電流源Ｉｓの電流を供給する構成である。
、−組の電圧ホロワＱ３．Ｑ４の出力をそれぞれ接続す
ると共に、ヘッド２の両端に一組の電流スイッチＱｌ、
Ｑ２の出力をそれぞれ接続し、更にこの電流スイッチに
電流源Ｉｓの電流を供給する構成である。
記録ヘッド２に供給する電流Ｉｗの方向をきめる入力情
報０１〜Ｇ４に応じて、ヘッド両端に接続された電圧ホ
ロワと電流スイッチを逆位相で交互に切り替えて、交番
電流として記録ヘッドに供給する。
報０１〜Ｇ４に応じて、ヘッド両端に接続された電圧ホ
ロワと電流スイッチを逆位相で交互に切り替えて、交番
電流として記録ヘッドに供給する。
上記従来技術は、全回路構成がＮＰＮトランジスタで構
成可能であるため集積化に適するが、電流源スイッチに
用いるトランジスタの飽和の保護についてはむんら配慮
なされていない。
成可能であるため集積化に適するが、電流源スイッチに
用いるトランジスタの飽和の保護についてはむんら配慮
なされていない。
記録電流の立上り時には、記録ヘッドの誘導性分によっ
て電流流出端に大きむフライバック電圧が生じる。この
電圧はオンしている電流スイッチ１−ランジスタのＶｃ
ｅ電位を狭め、従来回路では電流スイッチトランジスタ
が飽和する。このためトランジスタのベース電流が増大
し、電流スイッチの動作余裕を劣化させ、この結果記Ｂ
電流の立上り波形が歪み、充分な高連化ができないとい
った問題があった。
て電流流出端に大きむフライバック電圧が生じる。この
電圧はオンしている電流スイッチ１−ランジスタのＶｃ
ｅ電位を狭め、従来回路では電流スイッチトランジスタ
が飽和する。このためトランジスタのベース電流が増大
し、電流スイッチの動作余裕を劣化させ、この結果記Ｂ
電流の立上り波形が歪み、充分な高連化ができないとい
った問題があった。
本発明の目的は、記８電流の立上り時に電流スイッチト
ランジスタの飽和を防止し、電流の立上り特性の良好む
記録回路を提供することにある。
ランジスタの飽和を防止し、電流の立上り特性の良好む
記録回路を提供することにある。
上記目的は、記録ヘッドの両端子に設けである記８電流
供給用の電圧ホロワの下限電位を電流スイッチのトラン
ジスタが飽和しないように設定することによって達成さ
れる。
供給用の電圧ホロワの下限電位を電流スイッチのトラン
ジスタが飽和しないように設定することによって達成さ
れる。
また、入力情報に応じて切り替わる一組の電流スイッチ
と、この電流スイッチに供給する電流源と、電流スイッ
チのそれぞれの出力端子と動作電位の上限を決める電圧
源との間に設けた一組の抵抗素子とからなる、いわゆる
差動増幅器を設けると共に、それぞれの出力端にアノー
ド端子を接続し、カソード端子を電圧ホロワの下限動作
電位を設定する電圧源に共通接続した一組のダイオード
を設けて、それぞれの出力端で電圧ホロワの動作電位を
電流スイッチのトランジスタが飽和しないように設定す
ることによって達成される。
と、この電流スイッチに供給する電流源と、電流スイッ
チのそれぞれの出力端子と動作電位の上限を決める電圧
源との間に設けた一組の抵抗素子とからなる、いわゆる
差動増幅器を設けると共に、それぞれの出力端にアノー
ド端子を接続し、カソード端子を電圧ホロワの下限動作
電位を設定する電圧源に共通接続した一組のダイオード
を設けて、それぞれの出力端で電圧ホロワの動作電位を
電流スイッチのトランジスタが飽和しないように設定す
ることによって達成される。
記録ヘッドに流れる記録電流の立上り時に発生するフラ
イバック電圧によるヘッド端子電位の降下を、同端子に
接続された動作電位が低電位の状態にある電圧ホロワで
クランプさせて、電流スイッチのトランジスタの飽和を
防止するので、電流波形を歪ませることがない。
イバック電圧によるヘッド端子電位の降下を、同端子に
接続された動作電位が低電位の状態にある電圧ホロワで
クランプさせて、電流スイッチのトランジスタの飽和を
防止するので、電流波形を歪ませることがない。
また、差動増幅器の出力をダイオードでクランプして電
圧ホロワの低電位側の電位を設定することにより、電圧
ホロワの動作電位を安定に設定することができ、立上り
特性の良好な記録電流を実現できる。
圧ホロワの低電位側の電位を設定することにより、電圧
ホロワの動作電位を安定に設定することができ、立上り
特性の良好な記録電流を実現できる。
本発明の第１の実施例を第１図、第２図を用いて説明す
る。
る。
本実施例の構成を第１図に示す。
薄膜記録ヘッドに代表されるよ−うな２端子の誘導性ヘ
ッド２の両端に、記録電流Ｉｗの方向を規定する入力情
報Ｇｌ、Ｇ２に応じて動作電位■１〜■４を切り替える
一組の電位設定回路１を介して、−組の電圧ホロワの出
力をそれぞれ接続する。
ッド２の両端に、記録電流Ｉｗの方向を規定する入力情
報Ｇｌ、Ｇ２に応じて動作電位■１〜■４を切り替える
一組の電位設定回路１を介して、−組の電圧ホロワの出
力をそれぞれ接続する。
ここで、電圧ホロワには例えばＮＰＮ トランジスタＱ
３．Ｑ４のエミッタホロワ等を用いる。同時に、記録ヘ
ッド２の両端には、電位設定回路■によってエミッタホ
ロワとは逆位相で動作し、且つ逆方向の電流を出力する
一組の電流スイッチＱｌ。
３．Ｑ４のエミッタホロワ等を用いる。同時に、記録ヘ
ッド２の両端には、電位設定回路■によってエミッタホ
ロワとは逆位相で動作し、且つ逆方向の電流を出力する
一組の電流スイッチＱｌ。
Ｑ２のコレクタ端子をそれぞれ接続し、更にこの電流ス
イッチＱｌ、Ｑ２の共通エミッタ端子に、電流源Ｉｓの
電流を供給する。
イッチＱｌ、Ｑ２の共通エミッタ端子に、電流源Ｉｓの
電流を供給する。
本実施例の動作を第２図を用いて説明する。入力情報Ｇ
ｌ、Ｇ２に応して、電流スイッチＱｌ。
ｌ、Ｇ２に応して、電流スイッチＱｌ。
Ｑｌ、及びエミッタホロワＱ３．Ｑ４が逆位相で動作す
る。例えばＴ１の時間領域を考えると、電位■↓〜■４
の設定状態から記録電流Ｉｗが正方向に設定される。こ
の時、電位設定回路１のエミッタホロワへの低電位側の
出力電位Ｖ４を、記録電流１ｗの立上り時にヘット２の
誘導成分によって最低電位まで低下した時に、エミッタ
ホロワＱ４がクランプ動作するように設定し、電流スイ
ッチのトランジスタＱ２の飽和を防止する。
る。例えばＴ１の時間領域を考えると、電位■↓〜■４
の設定状態から記録電流Ｉｗが正方向に設定される。こ
の時、電位設定回路１のエミッタホロワへの低電位側の
出力電位Ｖ４を、記録電流１ｗの立上り時にヘット２の
誘導成分によって最低電位まで低下した時に、エミッタ
ホロワＱ４がクランプ動作するように設定し、電流スイ
ッチのトランジスタＱ２の飽和を防止する。
其体的には、トランジスタの飽和マージンをＶｃｅｍ１
ｎ、電流スイッチへの出力電位Ｖ２の高電位レベルをＶ
２（Ｈ）とすると、電位設定回路のエミッタホロワへの
出力電位Ｖ４の低電位レベルＶ４（Ｌ）を、 Ｖ ４ （Ｌ）＝ Ｖ ２ （Ｈ） ＋Ｖｃｅｍｊｎ （１，１）に設定すれば電
流スイッチ用のトランジスタが飽和することはない。
ｎ、電流スイッチへの出力電位Ｖ２の高電位レベルをＶ
２（Ｈ）とすると、電位設定回路のエミッタホロワへの
出力電位Ｖ４の低電位レベルＶ４（Ｌ）を、 Ｖ ４ （Ｌ）＝ Ｖ ２ （Ｈ） ＋Ｖｃｅｍｊｎ （１，１）に設定すれば電
流スイッチ用のトランジスタが飽和することはない。
本実施例によれば、電圧設定回路のエミッタホロワへの
低電位側の出力電位Ｖ４（Ｌ）を飽和マージンに応じて
自由に設定できるので、比較的大きむヘッドの誘起電圧
を許容でき、より高速に立ち上がる記録電流が実現でき
る。
低電位側の出力電位Ｖ４（Ｌ）を飽和マージンに応じて
自由に設定できるので、比較的大きむヘッドの誘起電圧
を許容でき、より高速に立ち上がる記録電流が実現でき
る。
本発明の第２の実施例を第３図を用いて説明する。
第３図に本実施例の構成を示す、
薄膜記録ヘッドに代表されるような２端子の誘導性ヘッ
ト２の両端に、！ｉ！録電流Ｉｗの方向を規定するほぼ
ＴＴＬレベルの入力情報Ｇｌ、Ｇ２に応して動作電位を
切り替える一組の電位設定回路ｌを介して、−組の電圧
ホロワＱ３．Ｑ４の出力をそれぞれ接続する。ここで、
電位設定回路１は同図に示すように、トランジスタ２個
、ダイオード３個、及び抵抗２個とからなり、電圧ホロ
ワＱ３．Ｑ／ｌは例えばＮＰＮ ｌ−ランジスタのエミ
ッタホロワを用いる。同時に、記録ヘッド２の両端には
、前記の電位設定回路１の内部レベルＶｌ。
ト２の両端に、！ｉ！録電流Ｉｗの方向を規定するほぼ
ＴＴＬレベルの入力情報Ｇｌ、Ｇ２に応して動作電位を
切り替える一組の電位設定回路ｌを介して、−組の電圧
ホロワＱ３．Ｑ４の出力をそれぞれ接続する。ここで、
電位設定回路１は同図に示すように、トランジスタ２個
、ダイオード３個、及び抵抗２個とからなり、電圧ホロ
ワＱ３．Ｑ／ｌは例えばＮＰＮ ｌ−ランジスタのエミ
ッタホロワを用いる。同時に、記録ヘッド２の両端には
、前記の電位設定回路１の内部レベルＶｌ。
Ｖ２を人力信号とする一組の電流スイッチＱ１゜Ｑｌの
コレクタ端子をそれぞれ接続し、更にこの電流スイッチ
Ｑｌ、Ｑ２の共通エミッタ端子に電流ｇＩｓの電流を供
給する。
コレクタ端子をそれぞれ接続し、更にこの電流スイッチ
Ｑｌ、Ｑ２の共通エミッタ端子に電流ｇＩｓの電流を供
給する。
Ｔ Ｔ Ｌレベルの人力情報Ｇｌ、Ｇ２に応じて、電位
設定回路１は、電流スイッチＱｌ、Ｑ２、及び電圧ホロ
ワＱ３．Ａ４を逆位相で動作させる。
設定回路１は、電流スイッチＱｌ、Ｑ２、及び電圧ホロ
ワＱ３．Ａ４を逆位相で動作させる。
例えば入力信号Ｇ１が１ルベルであると、Ｄ５がオフし
、Ｑ５．Ｄｉ、Ｑ７がオンするので、電圧ホロワである
エミッタホロワＱ３の入力端子電位Ｖ３は低電位レベル
に設定され、同時に電流スイッチＱ１のベース端子には
、出力トランジスタＱ７のベース電位と同電位のＶ ｂ
ｅが入力される。
、Ｑ５．Ｄｉ、Ｑ７がオンするので、電圧ホロワである
エミッタホロワＱ３の入力端子電位Ｖ３は低電位レベル
に設定され、同時に電流スイッチＱ１のベース端子には
、出力トランジスタＱ７のベース電位と同電位のＶ ｂ
ｅが入力される。
他方のヘット端子に接続された電位設定回路１は。
これとは逆に、電位設定回路１の出力トランジスタＱ８
がオフするので、電圧ホロワＱ４の入力端子電位Ｖ４を
ほぼ電源電位の高電位レベルＶｃｃ２に設定し、同時に
電流スイッチＱ２のトランジスタがオフし、ベース電位
■２はほぼ接地レベルとなる。従って、この時の記８電
流Ｉｗの設定方向は負方向である。
がオフするので、電圧ホロワＱ４の入力端子電位Ｖ４を
ほぼ電源電位の高電位レベルＶｃｃ２に設定し、同時に
電流スイッチＱ２のトランジスタがオフし、ベース電位
■２はほぼ接地レベルとなる。従って、この時の記８電
流Ｉｗの設定方向は負方向である。
電流スイッチＱｌ、Ｑ２のエミッタ共通端子の電位はＱ
ｌと０２のいずれかがオン状態であり、はぼ接地レベル
である。これに対して、電位Ｖ３（Ｌ）は、 Ｖ３（Ｌ）＝２ ・Ｖｂ ｅ （１，２
）に設定されることから、電流スイッチのトランジスタ
Ｑ１のＶｃｅは、 Ｖｃｅｍ１ｎ（Ｌ）−Ｖｂｅ ＝Ｖｂ ｅ （１，３）となり、飽和
することがない。
ｌと０２のいずれかがオン状態であり、はぼ接地レベル
である。これに対して、電位Ｖ３（Ｌ）は、 Ｖ３（Ｌ）＝２ ・Ｖｂ ｅ （１，２
）に設定されることから、電流スイッチのトランジスタ
Ｑ１のＶｃｅは、 Ｖｃｅｍ１ｎ（Ｌ）−Ｖｂｅ ＝Ｖｂ ｅ （１，３）となり、飽和
することがない。
本実施例によれば、電位設定回路の電源（Ｖ ｃ ）と
電圧ホロワの高電位側を決める電源（Ｖｃｅ２）とを同
一電源とすることにより、簡単な回路で高速な立上り時
間を有する記録電流駆動回路を実現できる。尚、２個の
電源を別電源とし、電位設定回路側の電源をより低電位
の電源に設定することにより、記録回路の省電力化が図
れる。
電圧ホロワの高電位側を決める電源（Ｖｃｅ２）とを同
一電源とすることにより、簡単な回路で高速な立上り時
間を有する記録電流駆動回路を実現できる。尚、２個の
電源を別電源とし、電位設定回路側の電源をより低電位
の電源に設定することにより、記録回路の省電力化が図
れる。
本発明の第３の実施例を第４図を用いて説明する。
第４図に本実施例の構成を示す。
２端子の記録ヘッド２の記録電流Ｉｗの方向を規定する
入力情報Ｇｌ、Ｇ２に応して電位設定回路１の出力電位
Ｖ１〜Ｖ４を切り替える。ここで、−組２個の電位設定
回路１は、二組の電流スイッチＱ７〜Ｑ９とクランプ用
のダイオードＤ３゜Ｄ４，２個の電圧源ＶＳ２．ＶＳ３
とからなる。
入力情報Ｇｌ、Ｇ２に応して電位設定回路１の出力電位
Ｖ１〜Ｖ４を切り替える。ここで、−組２個の電位設定
回路１は、二組の電流スイッチＱ７〜Ｑ９とクランプ用
のダイオードＤ３゜Ｄ４，２個の電圧源ＶＳ２．ＶＳ３
とからなる。
電圧源ＶＳ２が電流スイッチＱｌ、Ｑ２の共通エミッタ
端子の電位を規定し、電圧源ＶＳ３とダイオードＤ３．
Ｄ４が電圧ホロワＱ３．Ｑ４の低電位レベルを規定する
。入力Ｇｌ、Ｇ２で、Ｑ９゜Ｑ１０からなる電流スイッ
チを駆動し、この出力を記ａ電流１ｗを駆動する一組の
電流スイッチＱｌ、Ｑ２に入力するとともに、更にもう
一組の電流スイッチＱ７．Ｑ８に接続する。この電流ス
イッチの出力を、抵抗Ｒ１，Ｒ２を介して電圧ホロワＱ
３．Ｑ４の高電位を決める電圧源Ｖｃｃ２に接続すると
ともに、アノードを電圧源ＶＳ３に接続したダイオード
Ｄ３．Ｄ４のカソードを接続し、更に電圧ホロワＱ３．
Ｑ４のベース端子を接続する。電圧ホロワＱ３．Ｑ４と
記録電流駆動用の電流スイッチＱ１．Ｑ２の出力は、各
々ヘッド端子に接続する。更にこの電流スイッチの共通
エミッタ端子に電流源Ｉｓの電流を供給すると共に、ト
ランジスタ０７〜Ｑ９からなる二組の電流スイッチに電
流源ＴｓＱ、Ｉｓｌを接続する構ｒｌｉ、である。
端子の電位を規定し、電圧源ＶＳ３とダイオードＤ３．
Ｄ４が電圧ホロワＱ３．Ｑ４の低電位レベルを規定する
。入力Ｇｌ、Ｇ２で、Ｑ９゜Ｑ１０からなる電流スイッ
チを駆動し、この出力を記ａ電流１ｗを駆動する一組の
電流スイッチＱｌ、Ｑ２に入力するとともに、更にもう
一組の電流スイッチＱ７．Ｑ８に接続する。この電流ス
イッチの出力を、抵抗Ｒ１，Ｒ２を介して電圧ホロワＱ
３．Ｑ４の高電位を決める電圧源Ｖｃｃ２に接続すると
ともに、アノードを電圧源ＶＳ３に接続したダイオード
Ｄ３．Ｄ４のカソードを接続し、更に電圧ホロワＱ３．
Ｑ４のベース端子を接続する。電圧ホロワＱ３．Ｑ４と
記録電流駆動用の電流スイッチＱ１．Ｑ２の出力は、各
々ヘッド端子に接続する。更にこの電流スイッチの共通
エミッタ端子に電流源Ｉｓの電流を供給すると共に、ト
ランジスタ０７〜Ｑ９からなる二組の電流スイッチに電
流源ＴｓＱ、Ｉｓｌを接続する構ｒｌｉ、である。
人力情報Ｇｌ、Ｇ２に応じて電位設定回路１が動作し、
記録電流の？！！流スイッチＱ１．Ｑ２、及び電圧ホロ
ワＱ３．Ｑ４が逆位相で動作し、例えば入力信号Ｇ１を
Ｌレベルとすると、電位設定回路１が電流スイッチＱ１
の入力電位■１をほぼ電圧源ＶＳ２の電位レベルに設定
する。同時に電圧ホロワＱ３の入力電位Ｖ３を、電圧−
ｔＡＶＳ３で決まる低電位となるように、電流源ＩｓＯ
と抵抗Ｒ１による電圧降下の大きさを定める。他方のヘ
ラ［・端子に接続された電圧ホロワＱ４及び電流スイッ
チＱ２は、これとは逆に電・圧ホロワＱ４の入力端子電
位Ｖ４をほぼ電源電位Ｖ ｃ ｃ ２の高電位レベルに
、電流スイッチのトランジスタＱ２のベース電位をオフ
レベルまで低下させる。従って。
記録電流の？！！流スイッチＱ１．Ｑ２、及び電圧ホロ
ワＱ３．Ｑ４が逆位相で動作し、例えば入力信号Ｇ１を
Ｌレベルとすると、電位設定回路１が電流スイッチＱ１
の入力電位■１をほぼ電圧源ＶＳ２の電位レベルに設定
する。同時に電圧ホロワＱ３の入力電位Ｖ３を、電圧−
ｔＡＶＳ３で決まる低電位となるように、電流源ＩｓＯ
と抵抗Ｒ１による電圧降下の大きさを定める。他方のヘ
ラ［・端子に接続された電圧ホロワＱ４及び電流スイッ
チＱ２は、これとは逆に電・圧ホロワＱ４の入力端子電
位Ｖ４をほぼ電源電位Ｖ ｃ ｃ ２の高電位レベルに
、電流スイッチのトランジスタＱ２のベース電位をオフ
レベルまで低下させる。従って。
記録電流Ｉｗは、負方向に設定され、この時電圧ホロワ
の低電位側の出力電位Ｖ３（Ｌ）は、電源電圧ＶＳ３か
ら、 Ｖ３（Ｌ）＝ＶＳ３−Ｖｂｅ （１，４）とな
る。また、電流スイッチのトランジスタＱ１の入力電位
レベルＶｌ（Ｈ）は、電源電圧ＶＳ２から。
の低電位側の出力電位Ｖ３（Ｌ）は、電源電圧ＶＳ３か
ら、 Ｖ３（Ｌ）＝ＶＳ３−Ｖｂｅ （１，４）とな
る。また、電流スイッチのトランジスタＱ１の入力電位
レベルＶｌ（Ｈ）は、電源電圧ＶＳ２から。
Ｖｌ（Ｈ）＝ＶＳ２ （１，５）
となり、従って記８電流スイッチ用のトランジスタＱ１
のＶｃｅは、 Ｖｃ ｅ＝Ｖ３（Ｌ）−Ｖｌ（Ｈ） ＝ＶＳ ３−ＶＳ ２−Ｖｂ ｅ （１，６）とな
り、２個の電圧源で任意にＶｃｅを設定でき。
となり、従って記８電流スイッチ用のトランジスタＱ１
のＶｃｅは、 Ｖｃ ｅ＝Ｖ３（Ｌ）−Ｖｌ（Ｈ） ＝ＶＳ ３−ＶＳ ２−Ｖｂ ｅ （１，６）とな
り、２個の電圧源で任意にＶｃｅを設定でき。
トランジスタＱ１．Ｑ２を飽和から守れる。
本実施例によれば、記録電流の電流スイッチの共通エミ
ッタ端子の電位レベルが電圧源ＶＳ２によって自由に設
定でき、且つ電圧ホロワの出力端子の高電位レベルも電
圧源Ｖ ｃ ｃ ２で設定できる。
ッタ端子の電位レベルが電圧源ＶＳ２によって自由に設
定でき、且つ電圧ホロワの出力端子の高電位レベルも電
圧源Ｖ ｃ ｃ ２で設定できる。
従って、電流スイッチの耐圧についてもこれら２電圧源
で規定でき、トランジスタの耐圧に近い値のフライバッ
ク電圧を許容できる回路が実現可能であり、記録電流の
高速化に極めて有効となる６本発明の第４の実施例を、
第５図を用いて説明する。
で規定でき、トランジスタの耐圧に近い値のフライバッ
ク電圧を許容できる回路が実現可能であり、記録電流の
高速化に極めて有効となる６本発明の第４の実施例を、
第５図を用いて説明する。
本実施例は、前記実施例を適用した例えば磁気ディスク
装置のような磁気記録装置のリードライトＩＣを示した
ものである。第５図に構成を示す。
装置のような磁気記録装置のリードライトＩＣを示した
ものである。第５図に構成を示す。
リードアンプ４とライトアンプ３からなるリードライト
回路ブロック５を４個内蔵し、それらの回路ブロック５
を選択するヘットセレクト回路７゜記録と再生状態を選
択するリードライトセレクト回路８．ヘッド２およびリ
ードライト回路ブロック５の異常状態を検出するアンセ
ーフ回路９．記Ｂ電流源回路１０からなる。
回路ブロック５を４個内蔵し、それらの回路ブロック５
を選択するヘットセレクト回路７゜記録と再生状態を選
択するリードライトセレクト回路８．ヘッド２およびリ
ードライト回路ブロック５の異常状態を検出するアンセ
ーフ回路９．記Ｂ電流源回路１０からなる。
端子ＨＳＩ、Ｈ３２でヘットが選択され、更に記録動作
がＲ／Ｗ端子で規定されると、端子ＷＤＩ。
がＲ／Ｗ端子で規定されると、端子ＷＤＩ。
ＷＤ２から入力される記録データが、選択されたライト
アンプ３を介して、ヘッド２に記録電流を供給する。
アンプ３を介して、ヘッド２に記録電流を供給する。
本実施例によれば、ライトアンプの記録電流のスイッチ
ングを高速化できるので、高速化した分だけヘッドとＩ
Ｃ間の距離を長くでき、実装が容易となる。
ングを高速化できるので、高速化した分だけヘッドとＩ
Ｃ間の距離を長くでき、実装が容易となる。
本発明によれば、記録電流の立上り時に発生しうる電流
スイッチ用トランジスタの飽和を防止でき、記録電流の
立上り特性の良好な記録電流駆動回路を提供できる。
スイッチ用トランジスタの飽和を防止でき、記録電流の
立上り特性の良好な記録電流駆動回路を提供できる。
第１図は本発明の第１の実施例の構成を示す回路図、第
２図は動作を示すタイムチャートである。 第３図は第２の実施例を示す回路図、第４図は第３の実
施例を示す回路図、第５図は第４の実施例を示す回路図
である。更に、第６図は従来構成を示す回路図である。 １・・・電位設定回路、２・・・ヘッド、Ｇｌ、Ｇ２・
・・入力情報、Ｑ１〜ＱＩＯ・・・ＮＰＮｈランジスタ
。 Ｒ１−Ｒ６−・・抵抗、Ｉ ｓ、 Ｉ ｓｏ、 Ｉ ｓ
１−電流源、Ｖｃｃ、Ｖｃｃ２．Ｖｅｅ、ＶＳ２．Ｖ
Ｓ３゜Ｖｃ・・電圧源。 １−Ｄ６ ダイオード。 猶 回 図 Ｖｒ一番 訝夏電徨 工Ｗ 記舷電曳 蔦 図 ４ （２） ■ ｙ アンセーフρ月Ｅト ｔＯｓｔ＠’Ｉｔ先！！、回路
２図は動作を示すタイムチャートである。 第３図は第２の実施例を示す回路図、第４図は第３の実
施例を示す回路図、第５図は第４の実施例を示す回路図
である。更に、第６図は従来構成を示す回路図である。 １・・・電位設定回路、２・・・ヘッド、Ｇｌ、Ｇ２・
・・入力情報、Ｑ１〜ＱＩＯ・・・ＮＰＮｈランジスタ
。 Ｒ１−Ｒ６−・・抵抗、Ｉ ｓ、 Ｉ ｓｏ、 Ｉ ｓ
１−電流源、Ｖｃｃ、Ｖｃｃ２．Ｖｅｅ、ＶＳ２．Ｖ
Ｓ３゜Ｖｃ・・電圧源。 １−Ｄ６ ダイオード。 猶 回 図 Ｖｒ一番 訝夏電徨 工Ｗ 記舷電曳 蔦 図 ４ （２） ■ ｙ アンセーフρ月Ｅト ｔＯｓｔ＠’Ｉｔ先！！、回路
Claims (1)
- １．２端子の誘導性記録ヘッドの両端に、入力情報に応
じて電位が切り替わり一方向にのみ電流出力する一組の
電圧ホロワの出力をそれぞれ接続すると共に、該ヘッド
の両端に該電圧ホロワと逆位相で動作する該電圧ホロワ
と逆方向の電流を出力する第１の一組の電流スイッチの
出力をそれぞれ接続し、該第１の電流スイッチに供給す
る第１の電流源の電流を、該入力情報に応じて交番電流
として記録ヘッドに供給する記録回路において、 該記録ヘッドに流れる記録電流の立上り時に発生する誘
起電力を、前記電圧ホロワでクランプすることを特徴と
する記録電流駆動回路のヘッド端子電位制御方法。 ２、特許請求の範囲第１項の記録電流駆動回路のヘッド
端子電位制御方法に用いるヘッド端子電位制御回路にお
いて、 前記電圧ホロワの動作電位を、入力情報に応じて切り替
わる第２の一組の電流スイッチと、該第２の電流スイッ
チに供給する第２の電流源と、該第２の電流スイッチの
それぞれの出力端子と第１の電圧源との間に設けた一組
の抵抗素子と、該それぞれの出力端にアノード端子を接
続すると共にカソード端子を第２の電圧源に共通接続し
た一組のダイオードを設けて、該ダイオードの共通カソ
ード端子に接続した第２の電圧源の電位で制御し、記録
電流の立上り時に発生する記録ヘッドの誘起電力を、前
記電圧ホロワでクランプすることを特徴とする記録電流
駆動回路のヘッド端子電位制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32371889A JPH03185605A (ja) | 1989-12-15 | 1989-12-15 | 記録電流駆動回路のヘッド端子電位制御方法およびその回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32371889A JPH03185605A (ja) | 1989-12-15 | 1989-12-15 | 記録電流駆動回路のヘッド端子電位制御方法およびその回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03185605A true JPH03185605A (ja) | 1991-08-13 |
Family
ID=18157830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32371889A Pending JPH03185605A (ja) | 1989-12-15 | 1989-12-15 | 記録電流駆動回路のヘッド端子電位制御方法およびその回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03185605A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06195616A (ja) * | 1992-10-09 | 1994-07-15 | Internatl Business Mach Corp <Ibm> | データ書込み回路 |
| JPH06236503A (ja) * | 1993-02-01 | 1994-08-23 | Seagate Technol Internatl | 書込み回路 |
-
1989
- 1989-12-15 JP JP32371889A patent/JPH03185605A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06195616A (ja) * | 1992-10-09 | 1994-07-15 | Internatl Business Mach Corp <Ibm> | データ書込み回路 |
| JPH06236503A (ja) * | 1993-02-01 | 1994-08-23 | Seagate Technol Internatl | 書込み回路 |
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