JPH03198429A - Ａ／ｄ変換器の入力レベル判定回路 - Google Patents
Ａ／ｄ変換器の入力レベル判定回路Info
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- JPH03198429A JPH03198429A JP1341448A JP34144889A JPH03198429A JP H03198429 A JPH03198429 A JP H03198429A JP 1341448 A JP1341448 A JP 1341448A JP 34144889 A JP34144889 A JP 34144889A JP H03198429 A JPH03198429 A JP H03198429A
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- JP
- Japan
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- signal
- input
- digital signal
- circuit
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- Pending
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F7/00—Methods or arrangements for processing data by operating upon the order or content of the data handled
- G06F7/38—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation
- G06F7/48—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation using non-contact-making devices, e.g. tube, solid state device; using unspecified devices
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- G—PHYSICS
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- G06F—ELECTRIC DIGITAL DATA PROCESSING
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、テレビジョン受像機などのようにＡ／Ｄ変
換器を搭載した機器におけるＡ／Ｄ変換器への入力レベ
ルを調整する場合にその入力レベルを判定するように用
いられるＡ／Ｄ変換器の入力レベル判定回路に関するも
のである。
換器を搭載した機器におけるＡ／Ｄ変換器への入力レベ
ルを調整する場合にその入力レベルを判定するように用
いられるＡ／Ｄ変換器の入力レベル判定回路に関するも
のである。
［従来の技術］
ｆＪＳ４図は従来のＡ／Ｄ変換器の人力レベル判定回路
の構成図であり、同図において、’（１）はアナログ信
号（ａ）の入力端子、（２）はその入力アナログ信号を
ディジタル信号に変換するＡ／Ｄ変換器、（３）は上記
Ａ／Ｄ変換器（２）から出力されるディジタル信号（Ｃ
）をアナログ信号に変換するＤ／Ａ変換器、（４）は変
換されたアナログ信号（ｂ）の出力端子である。
の構成図であり、同図において、’（１）はアナログ信
号（ａ）の入力端子、（２）はその入力アナログ信号を
ディジタル信号に変換するＡ／Ｄ変換器、（３）は上記
Ａ／Ｄ変換器（２）から出力されるディジタル信号（Ｃ
）をアナログ信号に変換するＤ／Ａ変換器、（４）は変
換されたアナログ信号（ｂ）の出力端子である。
つぎに、上記構成の動作について説明する。
入力端子（１）に第５図（ａ）で示されるような波形の
アナログビデオ信号を入力すると、その入力されたアナ
ログビデオ信号（ａ）はＡ／Ｄ変換器（２）によりディ
ジタル信号（ｅ）に変換される。ここで、上記Ａ／Ｄ変
換器（２）に入力ηｆ能なビデオ信号（ａ）が第５図の
（菫）を上限としくｙ）を下限とする範囲内のものであ
ると、ディジタル信号（Ｃ）は、第５図の（重）の上部
と（りの下部の斜線部が切取られた信号になる。
アナログビデオ信号を入力すると、その入力されたアナ
ログビデオ信号（ａ）はＡ／Ｄ変換器（２）によりディ
ジタル信号（ｅ）に変換される。ここで、上記Ａ／Ｄ変
換器（２）に入力ηｆ能なビデオ信号（ａ）が第５図の
（菫）を上限としくｙ）を下限とする範囲内のものであ
ると、ディジタル信号（Ｃ）は、第５図の（重）の上部
と（りの下部の斜線部が切取られた信号になる。
つぎに、その変換されたディジタル信号（Ｃ）はＤ／Ａ
変換器（３）に入力されて、第５図（ｂ）で示すような
波形のアナログ信号に変換され、出力端子（４）に出力
される。
変換器（３）に入力されて、第５図（ｂ）で示すような
波形のアナログ信号に変換され、出力端子（４）に出力
される。
ここにおいて、入力信号（ａ）と同じ波形の出力信号（
ｂ）を得るために、−上記Ａ／Ｄ変換器（２）への入力
レベルの調整をおこなう場合、Ｄ／Ａ変換器（３）の出
力信号波形をオシロスコープなどで観測しながら１人力
レベルを調整していた。
ｂ）を得るために、−上記Ａ／Ｄ変換器（２）への入力
レベルの調整をおこなう場合、Ｄ／Ａ変換器（３）の出
力信号波形をオシロスコープなどで観測しながら１人力
レベルを調整していた。
［発明が解決しようとする課題］
従来のＡ／Ｄ変換器の入力レベル判定回路は以上のよう
に構成されているので、入出力信号の波形を同一にする
ために入力信号のレベルを正確に調整する場合、Ｄ／Ａ
変換器（３）の出力信号波形をオシロスコープなどによ
り観測しながら、入力信号のレベルを調整しなければな
らず、レベル調整が複雑かつ面倒になるという問題があ
った。
に構成されているので、入出力信号の波形を同一にする
ために入力信号のレベルを正確に調整する場合、Ｄ／Ａ
変換器（３）の出力信号波形をオシロスコープなどによ
り観測しながら、入力信号のレベルを調整しなければな
らず、レベル調整が複雑かつ面倒になるという問題があ
った。
この発明は上記のような問題点を解消するためになされ
たもので、オシロスコープなどにより出力信号波形を観
測するという面倒な作業を省いて、Ａ／Ｄ変換器の入力
レベルを容易に、かつ正確に調整することができるＡ／
Ｄ変換器の入力レベル判定回路を提供することを目的と
する。
たもので、オシロスコープなどにより出力信号波形を観
測するという面倒な作業を省いて、Ａ／Ｄ変換器の入力
レベルを容易に、かつ正確に調整することができるＡ／
Ｄ変換器の入力レベル判定回路を提供することを目的と
する。
［課題を解決するための手段］
この発明に係るＡ／Ｄ変換器の入力レベル判定回路は、
Ａ／Ｄ変換器で変換されたディジタル信号の最大値およ
び最小値を検出し、その信号を反転させるとともに、そ
の反転されたディジタル信号をアナログ信号に変換して
出力するように構成したことを特徴とする。
Ａ／Ｄ変換器で変換されたディジタル信号の最大値およ
び最小値を検出し、その信号を反転させるとともに、そ
の反転されたディジタル信号をアナログ信号に変換して
出力するように構成したことを特徴とする。
［作用］
この発明によれば、入力されたアナログ信号をディジタ
ル信号に変換し、その変換されたディジタル信号の最大
値および最小値を検出することにより、出力信号をテレ
ビジョン受信機のモニタなどに画像として写し出しなが
ら、正しい画像が得られるように、Ａ／Ｄ変換器の入力
レベルを簡単に調整することができる。
ル信号に変換し、その変換されたディジタル信号の最大
値および最小値を検出することにより、出力信号をテレ
ビジョン受信機のモニタなどに画像として写し出しなが
ら、正しい画像が得られるように、Ａ／Ｄ変換器の入力
レベルを簡単に調整することができる。
［発明の実施例］
以下、この発明の一実施例を図面にもとづいて説明する
。
。
第１図はこの発明の一実施例によるＡ／Ｄ変換器の入力
レベル判定回路の構成図であり、同図において、（１）
はアナログ信号（ａ）の入力端子、（２）はその入力ア
ナログ信号をディジタル信号（Ｃ）に変換するＡ／Ｄ変
換器、（３）はＤ／Ａ変換器、（４）はＡ／Ｄ変換器（
１）で変換されたディジタル信号（Ｃ）の最大値および
最小値を求める論理回路で、ＡＮＤ回路（４１）、ＮＯ
Ｒ回路（４２）、ＯＲ回路（４３）からなる。
レベル判定回路の構成図であり、同図において、（１）
はアナログ信号（ａ）の入力端子、（２）はその入力ア
ナログ信号をディジタル信号（Ｃ）に変換するＡ／Ｄ変
換器、（３）はＤ／Ａ変換器、（４）はＡ／Ｄ変換器（
１）で変換されたディジタル信号（Ｃ）の最大値および
最小値を求める論理回路で、ＡＮＤ回路（４１）、ＮＯ
Ｒ回路（４２）、ＯＲ回路（４３）からなる。
（５）はＡ／Ｄ変換器（２）の出力を反転させる論理回
路で、複数のＸＯＲ回路（５１）からなる、（６）はモ
ニタ、（ｄ）は論理回路（４）で得られるディジタル信
号、（ｅ）は論理回路（５）で得られるディジタル信号
である。
路で、複数のＸＯＲ回路（５１）からなる、（６）はモ
ニタ、（ｄ）は論理回路（４）で得られるディジタル信
号、（ｅ）は論理回路（５）で得られるディジタル信号
である。
つぎに、上記構成の動作について説明する。
いま、入力端子（１）に第２図（ａ）に示すような波形
のアナログビデオ信号が入力されると、Ａ／Ｄ変換器（
２）の入力信号変換レベルが第２図（ａ）の（Ｋ）〜（
りの範囲内であるとき、第２図（ａ）で示す信号は（ｆ
）のところで最大となり、Ａ／Ｄ変換器（２）によって
ｒｌｌｌｌｌｌｌｌＪの８ビツトのディジタル信号（Ｃ
）に変換される。
のアナログビデオ信号が入力されると、Ａ／Ｄ変換器（
２）の入力信号変換レベルが第２図（ａ）の（Ｋ）〜（
りの範囲内であるとき、第２図（ａ）で示す信号は（ｆ
）のところで最大となり、Ａ／Ｄ変換器（２）によって
ｒｌｌｌｌｌｌｌｌＪの８ビツトのディジタル信号（Ｃ
）に変換される。
ついで、このディジタル信号（Ｃ）が論理回路（４）に
入力され、このとき、ＡＮＤ回路（４１）は第３図の真
理値表に示すようにｒｌＪが出力される方、ＮＯＲ回路
（４２）は第３図の真理値表に示すようにｒＯＪが出力
され、それぞれの出力がＯＲ回路（４３）に入力されて
、このＯＲ回路（４３）は第３図の真理値表に示すよう
に「ｌ」、のディジタル信号（ｄ）を出力する。
入力され、このとき、ＡＮＤ回路（４１）は第３図の真
理値表に示すようにｒｌＪが出力される方、ＮＯＲ回路
（４２）は第３図の真理値表に示すようにｒＯＪが出力
され、それぞれの出力がＯＲ回路（４３）に入力されて
、このＯＲ回路（４３）は第３図の真理値表に示すよう
に「ｌ」、のディジタル信号（ｄ）を出力する。
つぎに、ディジタル信号（Ｃ）とディジタル信号（ｄ）
とが論理回路（５）に入力され、ＸＯＲ回路（５１）に
おいて第３図の真理値表に示すように、ディジタル信号
が反転されｒｏｏｏｏｏｏｏｏＪの８ビツトのディジタ
ル信号Ｃｅ）が得られる。
とが論理回路（５）に入力され、ＸＯＲ回路（５１）に
おいて第３図の真理値表に示すように、ディジタル信号
が反転されｒｏｏｏｏｏｏｏｏＪの８ビツトのディジタ
ル信号Ｃｅ）が得られる。
また、第２図（ａ）で示す信号は第２図の（ｇ）のとこ
ろで最小となり、Ａ／Ｄ変換器（２）によって、ｒｏｏ
ｏｏｏｏｏｏＪの８ビツトのディジタル信号（ｃ）に変
換される。
ろで最小となり、Ａ／Ｄ変換器（２）によって、ｒｏｏ
ｏｏｏｏｏｏＪの８ビツトのディジタル信号（ｃ）に変
換される。
ついで、このディジタル信号（Ｃ）が論理回路（４）に
入力され、このとき、ＡＮＤ回路（４１）は第３図の真
理値表に示すように「Ｏ」が出力される一方、ＮＯＲ回
路（４２）は第３図の真理値表に示すようにｒｌ」が出
力され、それぞれの出力がＯＲ回路（４３）に入力され
て、このＯＲ回路（４３）は第３図の真理値表に示すよ
うにｒＱＪのディジタル信ＬＨｄ）を出力する。
入力され、このとき、ＡＮＤ回路（４１）は第３図の真
理値表に示すように「Ｏ」が出力される一方、ＮＯＲ回
路（４２）は第３図の真理値表に示すようにｒｌ」が出
力され、それぞれの出力がＯＲ回路（４３）に入力され
て、このＯＲ回路（４３）は第３図の真理値表に示すよ
うにｒＱＪのディジタル信ＬＨｄ）を出力する。
つづいて、ディジタル信号（Ｃ）とディジタル信号（ｄ
）が論理回路（５）に入力され、ＸＯＲ回路（５１）に
おいてディジタル信号が反転され。
）が論理回路（５）に入力され、ＸＯＲ回路（５１）に
おいてディジタル信号が反転され。
ｒｌｌｌｌｌｌｌｌＪの８ビツトのディジタル信”＞（
ｅ）が得られる。
ｅ）が得られる。
Ｌ記のようにして得られた第２図（ｅ）で示すようなデ
ィジタル信号がＤ／Ａ変換器（３）でアナログ信桂に変
換されて、第２図（ｂ）で示すような波形の出力信号を
モニタ（６）に人力する。
ィジタル信号がＤ／Ａ変換器（３）でアナログ信桂に変
換されて、第２図（ｂ）で示すような波形の出力信号を
モニタ（６）に人力する。
この出力信号（ｂ）は人力信号（ａ）とは全く異なり、
Ａ／Ｄ変換器（２）の入力信号レベルが適当でないと、
出力信号をテレビジ冒ン受信機などのモニタ（６）に入
力したとき、止しい画像が得られない。そこで、モニタ
（６）を見ながら、正しい画像が得られる範囲で、Ａ／
Ｄ人力信号レベルを最大とするような調整をおこなうこ
とにより、適正な調整をおこなうことができる。
Ａ／Ｄ変換器（２）の入力信号レベルが適当でないと、
出力信号をテレビジ冒ン受信機などのモニタ（６）に入
力したとき、止しい画像が得られない。そこで、モニタ
（６）を見ながら、正しい画像が得られる範囲で、Ａ／
Ｄ人力信号レベルを最大とするような調整をおこなうこ
とにより、適正な調整をおこなうことができる。
［発明の効果］
以上のように、この発明によれば、Ａ／Ｄ変換器の出力
信号の最大値および最小値を検出し、それを反転してモ
ニタなどに画像を写すことにより、Ａ／Ｄ変換器の入力
信号レベルをリアルタイムに正確に判定することができ
、その画像を見ながら、人力信号レベルを容易に、かつ
正確に調整することがで診る。
信号の最大値および最小値を検出し、それを反転してモ
ニタなどに画像を写すことにより、Ａ／Ｄ変換器の入力
信号レベルをリアルタイムに正確に判定することができ
、その画像を見ながら、人力信号レベルを容易に、かつ
正確に調整することがで診る。
第１図はこの発明の一実施例によるＡ／Ｄ変換器の入力
レベル判定回路の構成図、第２図は入出力信号の波形図
、第３図は論理回路の真理イ＾、第４図は従来のＡ／Ｄ
変換器の入力レベル判定回路の構成図、第５図は従来の
回路の人出力信号の波形図である。 （２）・・・Ａ／Ｄ変換器、（３）・・・Ｄ／Ａ変換器
、（４） 、 （５）・・・論理回路、（６）・・・モ
ニタ。 なお、図中の同一符号は同一または相当部分を示す。
レベル判定回路の構成図、第２図は入出力信号の波形図
、第３図は論理回路の真理イ＾、第４図は従来のＡ／Ｄ
変換器の入力レベル判定回路の構成図、第５図は従来の
回路の人出力信号の波形図である。 （２）・・・Ａ／Ｄ変換器、（３）・・・Ｄ／Ａ変換器
、（４） 、 （５）・・・論理回路、（６）・・・モ
ニタ。 なお、図中の同一符号は同一または相当部分を示す。
Claims (1)
- （１）入力アナログ信号をディジタル信号に変換するＡ
／Ｄ変換器と、このＡ／Ｄ変換器から出力されるディジ
タル信号の最大値および最小値を検出する論理回路と、
上記Ａ／Ｄ変換器から出力されるディジタル信号を反転
する論理回路と、その反転されたディジタル信号をアナ
ログ信号に変換するＤ／Ａ変換器とを備えたことを特徴
とするＡ／Ｄ変換器の入力レベル判定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1341448A JPH03198429A (ja) | 1989-12-26 | 1989-12-26 | Ａ／ｄ変換器の入力レベル判定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1341448A JPH03198429A (ja) | 1989-12-26 | 1989-12-26 | Ａ／ｄ変換器の入力レベル判定回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03198429A true JPH03198429A (ja) | 1991-08-29 |
Family
ID=18346159
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1341448A Pending JPH03198429A (ja) | 1989-12-26 | 1989-12-26 | Ａ／ｄ変換器の入力レベル判定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03198429A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS574838B2 (ja) * | 1975-12-23 | 1982-01-27 | ||
| JPS6159913A (ja) * | 1984-08-30 | 1986-03-27 | Shin Kobe Electric Mach Co Ltd | Ａｄ変換回路 |
-
1989
- 1989-12-26 JP JP1341448A patent/JPH03198429A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS574838B2 (ja) * | 1975-12-23 | 1982-01-27 | ||
| JPS6159913A (ja) * | 1984-08-30 | 1986-03-27 | Shin Kobe Electric Mach Co Ltd | Ａｄ変換回路 |
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