JPH0323805Y2 - - Google Patents
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- Publication number
- JPH0323805Y2 JPH0323805Y2 JP7447584U JP7447584U JPH0323805Y2 JP H0323805 Y2 JPH0323805 Y2 JP H0323805Y2 JP 7447584 U JP7447584 U JP 7447584U JP 7447584 U JP7447584 U JP 7447584U JP H0323805 Y2 JPH0323805 Y2 JP H0323805Y2
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- JP
- Japan
- Prior art keywords
- arrester
- diode
- resistance element
- surge
- discharge
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- 238000010586 diagram Methods 0.000 description 2
- 238000007599 discharging Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 230000002159 abnormal effect Effects 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 230000002285 radioactive effect Effects 0.000 description 1
Landscapes
- Emergency Protection Circuit Devices (AREA)
Description
【考案の詳細な説明】
本考案はサージ保護回路に係り、特に線路に接
続された電子機器等の被保護機器を、線路から侵
入するサージ電圧、電流から保護するための回路
等に適用し得るサージ保護回路に関するものであ
る。
続された電子機器等の被保護機器を、線路から侵
入するサージ電圧、電流から保護するための回路
等に適用し得るサージ保護回路に関するものであ
る。
一般に線路に接続された電子機器等は、線路か
ら侵入するサージ電圧、電流に対する耐サージ性
が極めて弱いので、何らかの手段により電子機器
等をサージ電圧、電流から保護する必要がある。
このため従来は例えばガス入放電管やバリスタ等
またはその組合せからなる回路を被保護機器の端
子間に接続してサージ保護回路を構成し、これに
より被保護機器をサージ電圧、電流から保護する
ようになされていた。
ら侵入するサージ電圧、電流に対する耐サージ性
が極めて弱いので、何らかの手段により電子機器
等をサージ電圧、電流から保護する必要がある。
このため従来は例えばガス入放電管やバリスタ等
またはその組合せからなる回路を被保護機器の端
子間に接続してサージ保護回路を構成し、これに
より被保護機器をサージ電圧、電流から保護する
ようになされていた。
しかしながら従来のサージ保護回路において
は、例えばガス入放電管の如きアレスタは、その
放電電流耐量が大きく、且つ放電動作中の放電電
圧を低く抑制できる利点があるが、一方において
放電動作遅れが生じたり、また一度放電すると続
流を生ずる等の欠点があつた。さらに例えばバリ
スタを使用する場合には、放電動作遅れが生じな
いという利点があるが、その電流容量が小さい等
の欠点があつた。さらにまた例えばガス入放電管
とバリスタとの組合せよりなるサージ保護回路に
おいては、ガス入放電管の続流を阻止できるが、
ガス入放電管の放電動作遅れや、バリスタの電流
容量が小さい等の欠点を解消することができなか
つた。そのため放電動作遅れがなく、電流耐量が
大きく且つ続流が生じないサージ保護回路の開発
が切に要望されていた。
は、例えばガス入放電管の如きアレスタは、その
放電電流耐量が大きく、且つ放電動作中の放電電
圧を低く抑制できる利点があるが、一方において
放電動作遅れが生じたり、また一度放電すると続
流を生ずる等の欠点があつた。さらに例えばバリ
スタを使用する場合には、放電動作遅れが生じな
いという利点があるが、その電流容量が小さい等
の欠点があつた。さらにまた例えばガス入放電管
とバリスタとの組合せよりなるサージ保護回路に
おいては、ガス入放電管の続流を阻止できるが、
ガス入放電管の放電動作遅れや、バリスタの電流
容量が小さい等の欠点を解消することができなか
つた。そのため放電動作遅れがなく、電流耐量が
大きく且つ続流が生じないサージ保護回路の開発
が切に要望されていた。
本考案は上記の事情に鑑みて提案されたもの
で、その目的とするところは、放電動作遅れがな
く、電流耐量が大きく且つ続流が生じないサージ
保護回路を提供することにある。
で、その目的とするところは、放電動作遅れがな
く、電流耐量が大きく且つ続流が生じないサージ
保護回路を提供することにある。
本考案によるサージ保護回路は、線路に接続さ
れた被保護機器の端子間に直列に接続された第１
アレスタ、ダイオードおよび第２アレスタの３素
子を含む直列回路と、前記第１アレスタと前記ダ
イオードとを含む直列回路に並列に接続された第
１抵抗素子と、前記第２アレスタと前記ダイオー
ドとを含む直列回路に並列に接続された第２抵抗
素子とを具備してなることを特徴とし、前記３素
子を含む直列回路は、平常時の線路間の電圧では
放電動作しないが、前記第１アレスタと前記第２
抵抗素子、および前記第２アレスタと前記第１抵
抗素子よりなる各直列回路の前記第１アレスタお
よび前記第２アレスタは、それぞれ平常時の線路
間の電圧で、それぞれ前記第２抵抗素子および前
記第１抵抗素子を介して微小のグロー放電動作を
行なうようにし、これにより線路間に異常電圧が
印加されたときに前記第１および第２アレスタの
放電動作遅れを防止することにより、前記従来の
欠点を解消し得るようにしたものである。
れた被保護機器の端子間に直列に接続された第１
アレスタ、ダイオードおよび第２アレスタの３素
子を含む直列回路と、前記第１アレスタと前記ダ
イオードとを含む直列回路に並列に接続された第
１抵抗素子と、前記第２アレスタと前記ダイオー
ドとを含む直列回路に並列に接続された第２抵抗
素子とを具備してなることを特徴とし、前記３素
子を含む直列回路は、平常時の線路間の電圧では
放電動作しないが、前記第１アレスタと前記第２
抵抗素子、および前記第２アレスタと前記第１抵
抗素子よりなる各直列回路の前記第１アレスタお
よび前記第２アレスタは、それぞれ平常時の線路
間の電圧で、それぞれ前記第２抵抗素子および前
記第１抵抗素子を介して微小のグロー放電動作を
行なうようにし、これにより線路間に異常電圧が
印加されたときに前記第１および第２アレスタの
放電動作遅れを防止することにより、前記従来の
欠点を解消し得るようにしたものである。
本考案の一実施例を図面に基づいて詳細に説明
する。
する。
図は本考案の一実施例の構成を示す回路図であ
る。
る。
図において、１，２は線路側端子、３，４は被
保護機器端子、５は例えばガス入放電管の如き第
１アレスタ、６は同じくガス入放電管の如き第２
アレスタ、７はダイオード、８は第１抵抗素子、
９は第２抵抗素子、１０はダイオード、１１は電
源、L1，L2は線路であり、第１アレスタ５、ダ
イオード７および第２アレスタ６の３素子を含む
直列回路が、線路L1，L2に接続された被保護機
器（図示せず）の端子３，４間に直列に接続さ
れ、この直列回路内の第１アレスタ５とダイオー
ド７とを含む直列回路に、第１抵抗素子８が並列
に接続され、また第２アレスタ６とダイオード７
とを含む直列回路に、第２抵抗素子９が並列に接
続されて、本考案によるサージ保護回路が構成さ
れている。
保護機器端子、５は例えばガス入放電管の如き第
１アレスタ、６は同じくガス入放電管の如き第２
アレスタ、７はダイオード、８は第１抵抗素子、
９は第２抵抗素子、１０はダイオード、１１は電
源、L1，L2は線路であり、第１アレスタ５、ダ
イオード７および第２アレスタ６の３素子を含む
直列回路が、線路L1，L2に接続された被保護機
器（図示せず）の端子３，４間に直列に接続さ
れ、この直列回路内の第１アレスタ５とダイオー
ド７とを含む直列回路に、第１抵抗素子８が並列
に接続され、また第２アレスタ６とダイオード７
とを含む直列回路に、第２抵抗素子９が並列に接
続されて、本考案によるサージ保護回路が構成さ
れている。
上記本考案の一実施例の作用について説明す
る。
る。
図において、第１アレスタ５、ダイオード７お
よび第２アレスタ６の３素子を含む直列回路の中
の第１アレスタ５および第２アレスタ６は、それ
ぞれ平常時の線路L1，L2間の電源１１の電圧で
は放電動作しないように、第１アレスタ５および
第２アレスタ６の和の放電開始電圧を電源１１の
電圧よりも高く設定しているので、平常時の電源
１１の電圧では第１アレスタ５および第２アレス
タ６は放電動作しない。しかしながらそれぞれ第
１アレスタ５と第２抵抗素子９との直列回路、お
よび第２アレスタ６と第１抵抗素子８との直列回
路の中の第１アレスタ５および第２アレスタ６
は、それぞれ第２抵抗素子９および第１抵抗素子
８を介して微小グロー放電動作が行なわれる。こ
の場合これらの微小グロー放電は、それぞれ第２
抵抗素子９および第１抵抗素子８を介して行なわ
れるので、電源１１の電圧を低下させるように抑
制する作用はないため、線路L1，L2の端子３，
４間に接続された被保護機器には、略電源１１の
電圧がそのまま正常に印加されることとなる。
よび第２アレスタ６の３素子を含む直列回路の中
の第１アレスタ５および第２アレスタ６は、それ
ぞれ平常時の線路L1，L2間の電源１１の電圧で
は放電動作しないように、第１アレスタ５および
第２アレスタ６の和の放電開始電圧を電源１１の
電圧よりも高く設定しているので、平常時の電源
１１の電圧では第１アレスタ５および第２アレス
タ６は放電動作しない。しかしながらそれぞれ第
１アレスタ５と第２抵抗素子９との直列回路、お
よび第２アレスタ６と第１抵抗素子８との直列回
路の中の第１アレスタ５および第２アレスタ６
は、それぞれ第２抵抗素子９および第１抵抗素子
８を介して微小グロー放電動作が行なわれる。こ
の場合これらの微小グロー放電は、それぞれ第２
抵抗素子９および第１抵抗素子８を介して行なわ
れるので、電源１１の電圧を低下させるように抑
制する作用はないため、線路L1，L2の端子３，
４間に接続された被保護機器には、略電源１１の
電圧がそのまま正常に印加されることとなる。
上記の説明を具体的な数値により説明すると、
例えば電源１１の電圧を90V、各第１アレスタ５
および第２アレスタ６の放電動作電圧をそれぞれ
60V、第１抵抗素子８および第２抵抗素子９の各
抵抗値をそれぞれ2MΩとすると、例えば線路L2
−第２抵抗素子９−第１アレスタ５−線路L1の
回路および線路L1−第１抵抗素子８−第２アレ
スタ６−線路L2の回路において、第１アレスタ
５および第２アレスタ６はそれぞれ微小のグロー
放電を行なうが、このとき第１抵抗素子８又は第
２抵抗素子９に略30V、第１アレスタ５又は第２
アレスタ６に略60Vの電圧が印加されることとな
り、電源１１の電圧90Vの電圧は抑制されること
なくそのまま被保護機器の端子３，４間に印加さ
れることになる。この場合に第１抵抗素子８又は
第２抵抗素子９を介して流れる電流が、他の回路
のアレスタに介在しないようにするためにダイオ
ード７が設けられている。
例えば電源１１の電圧を90V、各第１アレスタ５
および第２アレスタ６の放電動作電圧をそれぞれ
60V、第１抵抗素子８および第２抵抗素子９の各
抵抗値をそれぞれ2MΩとすると、例えば線路L2
−第２抵抗素子９−第１アレスタ５−線路L1の
回路および線路L1−第１抵抗素子８−第２アレ
スタ６−線路L2の回路において、第１アレスタ
５および第２アレスタ６はそれぞれ微小のグロー
放電を行なうが、このとき第１抵抗素子８又は第
２抵抗素子９に略30V、第１アレスタ５又は第２
アレスタ６に略60Vの電圧が印加されることとな
り、電源１１の電圧90Vの電圧は抑制されること
なくそのまま被保護機器の端子３，４間に印加さ
れることになる。この場合に第１抵抗素子８又は
第２抵抗素子９を介して流れる電流が、他の回路
のアレスタに介在しないようにするためにダイオ
ード７が設けられている。
次に例えば＋側の線路L2にサージ電圧が印加
されたと仮定すると、このサージ電圧が侵入する
初期段階では、第１アレスタ５および第２アレス
タ６が、それぞれ第２抵抗素子９および第１抵抗
素子８の各2MΩの抵抗値を通してそれぞれ微小
のグロー放電を行なつているので、サージ電圧が
上昇し前記各アレスタの和の電圧より高い電圧例
えば121Vに達すると、第２アレスタ６−ダイオ
ード７−第１アレスタ５の直列回路に放電電流が
流れ始めて、このサージを線路L2から線路L1に
流通させる。これにより線路L2とL1との間の電
圧上昇が制限され、端子４と３との間に接続され
た被保護機器をサージから保護することとなる。
この場合に前記の如く、第１アレスタ５および第
２アレスタ６は、常時それぞれ第２抵抗素子９お
よび第１抵抗素子８を通して、それぞれ微小のグ
ロー放電を行なつているので、線路L2とL1との
間にサージが印加されたとき、第１アレスタ５お
よび第２アレスタ６はそれぞれ放電動作遅れを生
ずることなく、直ちに放電動作してサージを吸収
することができる。これにより従来の欠点である
放電動作遅れによる被保護機器に対するサージ電
圧の印加を有効に防止することとなる。またサー
ジ印加時の放電電流は、第２アレスタ６−ダイオ
ード７−第１アレスタ５の直列回路、従つてアレ
スタ２個の直列回路に流通するので、例えばアー
ク電圧が２倍となり続流し難くなるとともに電流
耐量が大きくなる。さらにサージ印加時の放電開
始時においては、前記直列回路の２個のアレスタ
５，６は、それぞれ各抵抗素子９，８を介して並
列に接続された構成となるので、各アレスタ５，
６の特性が加算（例えば２倍）されることがない
ため、サージ電圧等に対する応答特性が良好とな
る。さらにまた各アレスタ５，６は常時各抵抗素
子９，８を介して微小のグロー放電を起している
ので、例えば従来の冷陰極放電管で用いられてい
た放電開始促進のためのRI（放射性同位元素）や
カーボン線による放電トリガー用の補助間〓等が
不要となるとともに、このグロー放電を例えば表
示ランプとして活用を図ることができる。
されたと仮定すると、このサージ電圧が侵入する
初期段階では、第１アレスタ５および第２アレス
タ６が、それぞれ第２抵抗素子９および第１抵抗
素子８の各2MΩの抵抗値を通してそれぞれ微小
のグロー放電を行なつているので、サージ電圧が
上昇し前記各アレスタの和の電圧より高い電圧例
えば121Vに達すると、第２アレスタ６−ダイオ
ード７−第１アレスタ５の直列回路に放電電流が
流れ始めて、このサージを線路L2から線路L1に
流通させる。これにより線路L2とL1との間の電
圧上昇が制限され、端子４と３との間に接続され
た被保護機器をサージから保護することとなる。
この場合に前記の如く、第１アレスタ５および第
２アレスタ６は、常時それぞれ第２抵抗素子９お
よび第１抵抗素子８を通して、それぞれ微小のグ
ロー放電を行なつているので、線路L2とL1との
間にサージが印加されたとき、第１アレスタ５お
よび第２アレスタ６はそれぞれ放電動作遅れを生
ずることなく、直ちに放電動作してサージを吸収
することができる。これにより従来の欠点である
放電動作遅れによる被保護機器に対するサージ電
圧の印加を有効に防止することとなる。またサー
ジ印加時の放電電流は、第２アレスタ６−ダイオ
ード７−第１アレスタ５の直列回路、従つてアレ
スタ２個の直列回路に流通するので、例えばアー
ク電圧が２倍となり続流し難くなるとともに電流
耐量が大きくなる。さらにサージ印加時の放電開
始時においては、前記直列回路の２個のアレスタ
５，６は、それぞれ各抵抗素子９，８を介して並
列に接続された構成となるので、各アレスタ５，
６の特性が加算（例えば２倍）されることがない
ため、サージ電圧等に対する応答特性が良好とな
る。さらにまた各アレスタ５，６は常時各抵抗素
子９，８を介して微小のグロー放電を起している
ので、例えば従来の冷陰極放電管で用いられてい
た放電開始促進のためのRI（放射性同位元素）や
カーボン線による放電トリガー用の補助間〓等が
不要となるとともに、このグロー放電を例えば表
示ランプとして活用を図ることができる。
上記本考案の一実施例においては、＋側の線路
L2にサージが侵入する場合について説明したが、
例えば−側の線路L1にサージが侵入する場合に
ついても保護を必要とする場合には、図において
ダイオード７の極性を反転させたもう１つの直列
回路を設けるが、または図に点線で示すように、
ダイオード７と逆方向の特性を有するダイオード
１０を線路L1，L2間に接続し、このダイオード
１０を介してサージを吸収させるようにすればよ
い。
L2にサージが侵入する場合について説明したが、
例えば−側の線路L1にサージが侵入する場合に
ついても保護を必要とする場合には、図において
ダイオード７の極性を反転させたもう１つの直列
回路を設けるが、または図に点線で示すように、
ダイオード７と逆方向の特性を有するダイオード
１０を線路L1，L2間に接続し、このダイオード
１０を介してサージを吸収させるようにすればよ
い。
以上により本考案によれば、２個のアレスタと
ダイオードの３素子を含む直列回路を線路間に接
続し、常時各アレスタをそれぞれ各抵抗素子を介
して微小のグロー放電を行なわせるようにするこ
とにより、線路に侵入するサージに対する放電遅
れがなく、電流耐量が大きく、且つ続流を抑制し
得るサージ保護回路が得られる優れた効果が奏せ
られるものである。
ダイオードの３素子を含む直列回路を線路間に接
続し、常時各アレスタをそれぞれ各抵抗素子を介
して微小のグロー放電を行なわせるようにするこ
とにより、線路に侵入するサージに対する放電遅
れがなく、電流耐量が大きく、且つ続流を抑制し
得るサージ保護回路が得られる優れた効果が奏せ
られるものである。
図は本考案の一実施例の構成を示す回路図であ
る。 １，２……線路側端子、３，４……被保護機器
端子、５……ガス入放電管の如き第１アレスタ、
６……ガス入放電管の如き第２アレスタ、７……
ダイオード、８……第１抵抗素子、９……第２抵
抗素子、１０……ダイオード、１１……電源、
L1，L2……線路。
る。 １，２……線路側端子、３，４……被保護機器
端子、５……ガス入放電管の如き第１アレスタ、
６……ガス入放電管の如き第２アレスタ、７……
ダイオード、８……第１抵抗素子、９……第２抵
抗素子、１０……ダイオード、１１……電源、
L1，L2……線路。
Claims (1)
- 線路に接続された被保護機器の端子間に直列に
接続された第１アレスタ、ダイオードおよび第２
アレスタの３素子を含む直列回路と、前記第１ア
レスタと前記ダイオードとを含む直列回路に並列
に接続された第１抵抗素子と、前記第２アレスタ
と前記ダイオードとを含む直列回路に並列に接続
された第２抵抗素子とを具備してなることを特徴
とするサージ保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7447584U JPS60186827U (ja) | 1984-05-23 | 1984-05-23 | サ−ジ保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7447584U JPS60186827U (ja) | 1984-05-23 | 1984-05-23 | サ−ジ保護回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60186827U JPS60186827U (ja) | 1985-12-11 |
| JPH0323805Y2 true JPH0323805Y2 (ja) | 1991-05-23 |
Family
ID=30614809
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7447584U Granted JPS60186827U (ja) | 1984-05-23 | 1984-05-23 | サ−ジ保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60186827U (ja) |
-
1984
- 1984-05-23 JP JP7447584U patent/JPS60186827U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60186827U (ja) | 1985-12-11 |
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