JPH03241176A - 半導体製造工場の建屋レイアウト構造 - Google Patents

半導体製造工場の建屋レイアウト構造

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JPH03241176A
JPH03241176A JP3467290A JP3467290A JPH03241176A JP H03241176 A JPH03241176 A JP H03241176A JP 3467290 A JP3467290 A JP 3467290A JP 3467290 A JP3467290 A JP 3467290A JP H03241176 A JPH03241176 A JP H03241176A
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semiconductor
semiconductor manufacturing
manufacturing factory
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Osamu Takahata
高畠 修
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野] この発明a半導体製造工場の!a屋クレイアウト構造関
し、特に被処理半導体ウェハに対するFA機能構造を提
供するものである。
〔従来の技術〕
第3図は従来の半導体製造工場の建屋レイアウト構造の
平面図で1図にかいて、C11)は写真製版プロセス部
、0.1は化学処理プロセス部、(Lll’を拡散プロ
セス部、圓は成膜プロセス部、@はイオン注入プロセス
部、aaは被処理半導体ウェハの各物流方向を示す。
第4図は第3図の側面工υ見た建屋レイアウト構造を示
す。図にかいて、(ロ)は半1体つエノ・プロセス部、
明はユーテイリイテイ部、CL嶋ri空t11部を示す
。次に、被処理半透体ウェハの物流について第3図を用
いて説明する。被処理半導体ウェハは半導体製造工場に
投入された後、拡散プロセス部αQから写真製版プロセ
ス部(ロ)を経て、イオン注入プロセス部@から化学処
理プロセス部(至)又は、成膜プロセス部a4から写真
製版プロセス部0又は。
拡散プロセスs叫から写真製版プロセス部Ql)を経て
成膜プロセス部α4から写真製版プロセス部(ロ)とい
う処理工Sを順次進んで行く。
従来の半導体製造工場にシいて、ウェハプロセス工程が
進むにつれて化学処理、写真製版、拡散。
敗膜、イオン注入などの各プロセス部は建屋横方向へ繰
υ返し設置されてかや、被処理半這体ウエハは後戻りを
しないようにll或される。
[発明が解決しようとするff191 従来の半導体製造工場の建屋レイアウト構造は以上の様
に1111或されていたので、建屋が横方向に大きく拡
がシ、写真製版など何回も使用されるプロセス部にDい
ては設置場所の装置の処理負荷が少なく、他の場所の装
置が負荷オーバーになってもFAK工っての半導体ウェ
ハの物流が困雌でその部分ヘウエハを送ることが不可で
あるなど半導体製造に柔軟性が無いなどの問題点があっ
た。
この発明は上記の様な問題点を解消するためになされた
もので、製造工場を小さくでさるとともに各プロセス部
を集合させ半導体製造に柔軟性を持たせることのできる
半導体製造工場の建屋レイアウトt!l得ることを目的
とする。
〔a題を解決するための手段〕
この発明に係る半導体製造工場の建屋レイアウト構造は
、建mを上面から見た場合円形もしくは5角以上の多角
形にするとともに、各半導体プロセスをパイチャートの
ごとく配置するLうにしたものである。
〔作用〕
この発明にかける半導体製造工場の建屋レイアウト構造
は、被処理半導体ウエノ・の物R,を単純化して建屋ス
ペースを小さく出来るO 〔実施例〕 以下、この発明の一実施例を図について説明する。第1
図はこの発明の一実施例である半導体製造工場のI屋の
平面図で、図にかいて、(1)は化学処理プロセス部、
(2)は写真製版プロセス部、(3)は拡散プロセス部
、(4)は成膜プロセス部、(5)はイオン注入プロセ
ス部、(6)は被処理半導体ウニ/・を各プロセス部へ
配分するFA機能部である。
第2図は第1図の半導・体製造工場の側面図で、図にか
いて、(8)は半導体ウニ/%プロセス部、(9)はユ
ーテイリイテイ部、(7)は空調部である。
被処理半導体ウニノ・が製造工場に投入され、被処理半
導体ウニノ・は化学処理プロセス部fl)から写真製版
プロセス5(2)を経て、拡散プロセス部(3)から成
膜プロセス部(4)からイオン注入プロセス5(5)で
順次処理されていくが、各プロセス部がパイチャートの
ごとく配置されている為、中央に設置されたFA機能部
(6)を被処理半導体ウニノ)ri経由するのみで済み
、又、各プロセス部に設置された装置はプロセス上流用
出来ないものを除いてどのプロセス工程のものも処理出
来稼動率は向上する0なか、上記実施例にかいては半導
体プロセスをS屋の1階分だけについて示したが、中央
のFA機能を複数階に延長させても良い。
また、上記実施例では建屋の構造を円形構造とした場合
を示したが、円形に限定するものではなく例えば5角形
以上の多角形状としても同等の効果がある。
〔発明の効果〕
以上の様にこの発明によれば、半導体製造工場を円形も
しくは5角形以上の多角形状にし、各クエハプロセスヲ
ハイチャートのごとく配置したので、プロセス装置の有
効活用及び稼動″4を向上させて、建屋敷地面積を小さ
くすることが出来るという効果が得られる。
【図面の簡単な説明】
第1図はこの発明一実施例による半導体製造工場の建屋
レイアウト構造を示す平面図、第2図は第1図側面図、
第3図は従来の半導体製造工場の建屋レイアウト構造を
示す平面図、第4図は第3図の@面図を示す0 図にかいて、(1)は化学処理プロセス部、(2)は写
真製版プロセス部、(3)は拡散プロセス部、(4)i
成膜プロセス部、(5)はイオン注入プロセス部、(6
)はFA機能部、(7)は空調部、(8)は半導体クエ
7%プロセス部、(9)r!ユーテイリイテイ部を示す

Claims (1)

    【特許請求の範囲】
  1. 半導体製造工場の建屋レイアウト構造において、前記建
    屋の構造が上面から見た場合円形もしくは5角形以上の
    多角形状とし、その中央部分には被処理半導体ウェハを
    各半導体プロセス部へ配送するFA機能部とし、その周
    辺の半導体製造プロセス部分は各工程毎にパイチャート
    のごとく分離され配置されていることを特徴とする半導
    体製造工場の建屋レイアウト構造。
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6099599A (en) * 1996-05-08 2000-08-08 Industrial Technology Research Institute Semiconductor device fabrication system
US6748704B2 (en) 2000-10-19 2004-06-15 Renesas Technology Corp. Factory layout
CN105735686A (zh) * 2014-11-20 2016-07-06 中国中元国际工程有限公司 超大型联合厂房及其平面布置方法

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CN105735686B (zh) * 2014-11-20 2018-05-15 中国中元国际工程有限公司 超大型联合厂房及其平面布置方法

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