JPH03250765A - 固体撮像素子 - Google Patents
固体撮像素子Info
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- JPH03250765A JPH03250765A JP2047932A JP4793290A JPH03250765A JP H03250765 A JPH03250765 A JP H03250765A JP 2047932 A JP2047932 A JP 2047932A JP 4793290 A JP4793290 A JP 4793290A JP H03250765 A JPH03250765 A JP H03250765A
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Links
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Landscapes
- Solid State Image Pick-Up Elements (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(イ)産業上の利用分野
本発明は、CCD固体撮像素子に係り、特に暗電流低減
のための基板の構造に関する。
のための基板の構造に関する。
(ロ)従来の技術
CCD固体撮像素子を形成するSi(シリコン)基板に
は、P塑成いはN型が用いられ、基板のタイプに依り素
子構造も異なる。P型基板を用いる場合、基板の一面に
N型の拡散領域を設け、この拡散領域が情報電荷の蓄積
転送チャネルとして用いられる。この拡散領域は、LO
GO9等のチャネル分離領域に依り区画されており、こ
のチャネル分離領域内に拡散領域から漏れ出す過剰な情
報電荷を受けるオーバーフロードレインが形成される。
は、P塑成いはN型が用いられ、基板のタイプに依り素
子構造も異なる。P型基板を用いる場合、基板の一面に
N型の拡散領域を設け、この拡散領域が情報電荷の蓄積
転送チャネルとして用いられる。この拡散領域は、LO
GO9等のチャネル分離領域に依り区画されており、こ
のチャネル分離領域内に拡散領域から漏れ出す過剰な情
報電荷を受けるオーバーフロードレインが形成される。
一方、N型基板を用いる場合、基板の一面にP型の拡散
領域、所謂P−Well領域を形成した後に、このP−
Well領域内に蓄積転送チャネルとなるN型拡散領域
が形成される。このようにN型基板を用いる場合には、
拡散領域内の過剰な情報電荷をN型基板側にυ1出する
縦型オーバーフロードレイン構造となるために、拡散領
域を区画するチヘ・ネル分離領域内にオーバーフ「1−
Fレインを形成する必要がなく、微細化、即ち画素の高
密度化に有効であり、今後の発展が期待される。しかし
ながら、P型基板を用いたCCDに於いても、N型基板
を用いた場合に比して赤外線領域で感度が高く、赤外線
カメラや高感度カメラ等の特定の用途には広く利用され
ている。
領域、所謂P−Well領域を形成した後に、このP−
Well領域内に蓄積転送チャネルとなるN型拡散領域
が形成される。このようにN型基板を用いる場合には、
拡散領域内の過剰な情報電荷をN型基板側にυ1出する
縦型オーバーフロードレイン構造となるために、拡散領
域を区画するチヘ・ネル分離領域内にオーバーフ「1−
Fレインを形成する必要がなく、微細化、即ち画素の高
密度化に有効であり、今後の発展が期待される。しかし
ながら、P型基板を用いたCCDに於いても、N型基板
を用いた場合に比して赤外線領域で感度が高く、赤外線
カメラや高感度カメラ等の特定の用途には広く利用され
ている。
第3図はP型基板を用いたCCDを示す図で、同図(a
)はフレームトランスファ型の撮像部の平面図、同図(
b)はそのX−Y断面図である。
)はフレームトランスファ型の撮像部の平面図、同図(
b)はそのX−Y断面図である。
P型のSi基板(10)の−主面には、チャネル分離領
域(1)で区画されるN型の拡散領域(2)(断面図で
省略しである)が互いに平行に配列され、埋込みチャネ
ル構造を成している。またSi基板(10)上には、拡
散領域(2)と交差し、複数の転送電極(3)がSin
、膜〈4)を介して配列形成される。この転送電極(3
)は、一部が重なり合う2層構造を成しており、このう
ち上層側はチャネル分離領域(1)上でその幅が狭く形
成される。そして、転送電極(3)に、多相、例えば4
相の転送りロック≠、〜≠4が印加されてSi基板(1
0)内を情報電荷が転送される。
域(1)で区画されるN型の拡散領域(2)(断面図で
省略しである)が互いに平行に配列され、埋込みチャネ
ル構造を成している。またSi基板(10)上には、拡
散領域(2)と交差し、複数の転送電極(3)がSin
、膜〈4)を介して配列形成される。この転送電極(3
)は、一部が重なり合う2層構造を成しており、このう
ち上層側はチャネル分離領域(1)上でその幅が狭く形
成される。そして、転送電極(3)に、多相、例えば4
相の転送りロック≠、〜≠4が印加されてSi基板(1
0)内を情報電荷が転送される。
このようなCCDに於いては、Si基板(10)の表面
近傍に結晶欠陥が存在すると、Si基板(10)中を転
送される情報電荷が結晶欠陥にトラップされて転送効率
が低下するため、Si基板(10)表面にはエピタキシ
ャル層(12)が形成きれて結晶欠陥の低減が図られて
いる。即ち、Si基板(10)は、B(ボロン)等のP
型不純物を含むベース領域(11)とこのベース領域(
11)上に積層形成されたP型のエピタキシャル層(1
2)からなり、エピタキシャル層(12〉内に転送チャ
ネルが形成されるように構成きれている。このエピタキ
シャル層(12)は、ベース領域(11)と同程度の不
純物濃度を有しており、抵抗率は10〜20Ω−■程度
に設定される。
近傍に結晶欠陥が存在すると、Si基板(10)中を転
送される情報電荷が結晶欠陥にトラップされて転送効率
が低下するため、Si基板(10)表面にはエピタキシ
ャル層(12)が形成きれて結晶欠陥の低減が図られて
いる。即ち、Si基板(10)は、B(ボロン)等のP
型不純物を含むベース領域(11)とこのベース領域(
11)上に積層形成されたP型のエピタキシャル層(1
2)からなり、エピタキシャル層(12〉内に転送チャ
ネルが形成されるように構成きれている。このエピタキ
シャル層(12)は、ベース領域(11)と同程度の不
純物濃度を有しており、抵抗率は10〜20Ω−■程度
に設定される。
また、製造工程でSi基板(10)表面に付着するNa
(ナトリウム)等のアルカリ金属に依る転送チルネルへ
の影響を低減するために、Si基板(10)にはIG(
イントリンシックゲッタリング)処理が旅される。この
IG処理は、Si基板(10)内部に存在する過飽和酸
素を利用してSi基板(10)内部に偏析領域を形成す
るもので、Si基板(10)を高温に加熱して表面近傍
の酸素を基板外に拡散させた後に内部の酸素を析出許せ
ている。このようなIG処理に依れば、Si基板(10
)の表面近傍が酸素の析出や結晶欠陥のない領域となり
、Si基板(10)内部に不純物を捕捉する領域が形成
される。
(ナトリウム)等のアルカリ金属に依る転送チルネルへ
の影響を低減するために、Si基板(10)にはIG(
イントリンシックゲッタリング)処理が旅される。この
IG処理は、Si基板(10)内部に存在する過飽和酸
素を利用してSi基板(10)内部に偏析領域を形成す
るもので、Si基板(10)を高温に加熱して表面近傍
の酸素を基板外に拡散させた後に内部の酸素を析出許せ
ている。このようなIG処理に依れば、Si基板(10
)の表面近傍が酸素の析出や結晶欠陥のない領域となり
、Si基板(10)内部に不純物を捕捉する領域が形成
される。
(ハ)発明が解決しようとする課題
ところで、小型化が図られている最近のビデオカメラに
於いては、装置の筐体内に極めて多くの回路素子が高密
度に搭載されているために、内部温度の上昇が問題とな
っている。特にCCDは、周辺温度が高くなると暗電流
の増大やノイズの発生等を招くといった問題を有してい
る。このようなノイズのひとつとして、主に高温時に発
生する微小な白点があげられる。このような白点はcc
Dの駆動方法の工夫や、信号処理の段階での映像信号の
補正に依って除去することは困難であり、CCD自体の
対策が望まれる。
於いては、装置の筐体内に極めて多くの回路素子が高密
度に搭載されているために、内部温度の上昇が問題とな
っている。特にCCDは、周辺温度が高くなると暗電流
の増大やノイズの発生等を招くといった問題を有してい
る。このようなノイズのひとつとして、主に高温時に発
生する微小な白点があげられる。このような白点はcc
Dの駆動方法の工夫や、信号処理の段階での映像信号の
補正に依って除去することは困難であり、CCD自体の
対策が望まれる。
そこで本発明は、高温時に於ける微小白点の発生を抑圧
できるCCD固体撮像素子の提供を目的とする。
できるCCD固体撮像素子の提供を目的とする。
(ニ)課題を解決するための手段
本発明は上述の課題を解決するためになされたもので、
半導体基板の一主面にチャネル分離領域で区画されたチ
ャネル領域が形成され、このチャネル領域上に複数の転
送電極が配列形成されるCCD固体撮像素子に於いて、
第1の特徴とするところは、上記半導体基板が、−導電
型のベース領域と、このベース領域上に積Mきれ1Ω−
m以下の抵抗率を有する一導電型の第1のエピタキシャ
ル層と、この第1のエピタキシャル層上に積層され上記
ベース領域と同程度の抵抗率を有する一導電型の第1の
エピタキシャル層と、からなり、この第2のエピタキシ
ャル層内に上記チャネル領域が形成されることにある。
半導体基板の一主面にチャネル分離領域で区画されたチ
ャネル領域が形成され、このチャネル領域上に複数の転
送電極が配列形成されるCCD固体撮像素子に於いて、
第1の特徴とするところは、上記半導体基板が、−導電
型のベース領域と、このベース領域上に積Mきれ1Ω−
m以下の抵抗率を有する一導電型の第1のエピタキシャ
ル層と、この第1のエピタキシャル層上に積層され上記
ベース領域と同程度の抵抗率を有する一導電型の第1の
エピタキシャル層と、からなり、この第2のエピタキシ
ャル層内に上記チャネル領域が形成されることにある。
また第2の特徴とするところは、上記半導体基板が、−
導電型のベース領域と、このベース領域の一面に一導電
型の不純物が注入されて1Ω−m以下の抵抗率を有する
拡散層と、この拡散層上に積層され上記ベース領域と同
程度の抵抗率を有するエピタキシャル層と、からなり、
このエピタキシャル層内に上記チャネル領域が形成され
ることにある。
導電型のベース領域と、このベース領域の一面に一導電
型の不純物が注入されて1Ω−m以下の抵抗率を有する
拡散層と、この拡散層上に積層され上記ベース領域と同
程度の抵抗率を有するエピタキシャル層と、からなり、
このエピタキシャル層内に上記チャネル領域が形成され
ることにある。
そして第3の特徴とするところは、上記半導体基板が、
1Ω−m以下の抵抗率を有する一導電型のベース領域と
、このベース領域上に積層されベース領域より高い抵抗
率を有する一導電型のエピタキシャル層と、からなり、
このエピタキシA・ル層内に上記チャネル領域が形成さ
れることにある。
1Ω−m以下の抵抗率を有する一導電型のベース領域と
、このベース領域上に積層されベース領域より高い抵抗
率を有する一導電型のエピタキシャル層と、からなり、
このエピタキシA・ル層内に上記チャネル領域が形成さ
れることにある。
く本)作 用
本発明に依れば、微小白点の原因となる結晶欠陥を発生
させる重金属等の不純物が、抵抗率の低減のために多量
に含まれる不純物と複合体を形成し、この複合体が半導
体基板内に偏析される。
させる重金属等の不純物が、抵抗率の低減のために多量
に含まれる不純物と複合体を形成し、この複合体が半導
体基板内に偏析される。
従って、活性領域に含まれる鉄、銅等の重金属が除去き
れて結晶欠陥が減少し、微小白点の発生が抑圧される。
れて結晶欠陥が減少し、微小白点の発生が抑圧される。
(へ)実施例
本発明の実施例を図面に従って説明する。
第1図は本発明固体撮像素子の要部断面図であり、第3
図と同一部分が示しである。この図に於いて、電極構造
は第3図と同一で、同一部分には同一符号を付してあり
、また、チャネルストップ領域及び埋込みチャネル構造
を成すN型の拡散領域についても第3図と同一構成とな
っている。
図と同一部分が示しである。この図に於いて、電極構造
は第3図と同一で、同一部分には同一符号を付してあり
、また、チャネルストップ領域及び埋込みチャネル構造
を成すN型の拡散領域についても第3図と同一構成とな
っている。
本発明の特徴とするところは、Si基板(20)のP型
のベース領域(21)とエピタキシャル層(23)との
間にP+型のエピタキシャル層(22)を形成すること
にある。即ち、P型の不純物を含むベース領域(21)
上<7=このベース領域(21)よりP型の不純物、例
えばBを高濃度に含んだエピタキシャル層(22)を積
層した後に、転送チャネルの形成きれるエピタキシャル
層(23)が再度形成される。ベース領域(21)上の
エピタキシャルJ’1i(22)は、ベース領域<21
〉及び転送チヘ・ネルの形成されるエピタキシャル層(
23)より、P型の不純物の濃度が一桁程度高く形成さ
れ、抵抗率は1Ω−m以下に設定される。
のベース領域(21)とエピタキシャル層(23)との
間にP+型のエピタキシャル層(22)を形成すること
にある。即ち、P型の不純物を含むベース領域(21)
上<7=このベース領域(21)よりP型の不純物、例
えばBを高濃度に含んだエピタキシャル層(22)を積
層した後に、転送チャネルの形成きれるエピタキシャル
層(23)が再度形成される。ベース領域(21)上の
エピタキシャルJ’1i(22)は、ベース領域<21
〉及び転送チヘ・ネルの形成されるエピタキシャル層(
23)より、P型の不純物の濃度が一桁程度高く形成さ
れ、抵抗率は1Ω−m以下に設定される。
ベース領域(2I)及びエピタキシャル層(23)の抵
抗率に一ついては、第3図と同一の10〜20Ω−σ程
度である。
抗率に一ついては、第3図と同一の10〜20Ω−σ程
度である。
この上うなSi基板(20)に於いては、エピタキシャ
ル層(22)内に多量に含まれているBがSi基板(2
0〉内に混入しているFe、 Cu等の重金属と複合体
を形成し、重金属が活性領域外にυ1除きれる。このた
め、活性領域の結晶欠陥が減少し、微)」\白点の発生
が抑圧される。従って、エピタキシャル層(21)内の
Bの濃度が高いほど、即ちエピタキシャル層(21)の
抵抗率は低いほど微小山点の発生を抑圧する効果は大き
くなる。
ル層(22)内に多量に含まれているBがSi基板(2
0〉内に混入しているFe、 Cu等の重金属と複合体
を形成し、重金属が活性領域外にυ1除きれる。このた
め、活性領域の結晶欠陥が減少し、微)」\白点の発生
が抑圧される。従って、エピタキシャル層(21)内の
Bの濃度が高いほど、即ちエピタキシャル層(21)の
抵抗率は低いほど微小山点の発生を抑圧する効果は大き
くなる。
また、本実施例に於いては、ベース領域(21)上にP
1型のエピタキシトル層り22)を積層する場合を例示
したが、ベース領域(21)にB等のP型不純物を注入
拡散することで、ベース領域(21)の表面近傍に高濃
度のP+型拡散層を形成した後に、転送チャネルの形成
されるエピタキシャル層(23〉を積層しても良い、こ
の場合、P+型拡散層がP+型のエピタキシャル層(2
2)と同様に作用する。
1型のエピタキシトル層り22)を積層する場合を例示
したが、ベース領域(21)にB等のP型不純物を注入
拡散することで、ベース領域(21)の表面近傍に高濃
度のP+型拡散層を形成した後に、転送チャネルの形成
されるエピタキシャル層(23〉を積層しても良い、こ
の場合、P+型拡散層がP+型のエピタキシャル層(2
2)と同様に作用する。
第2図は、本発明の他の実施例を示す断面図である。こ
の図に於いても、第3図と同一部分を示しである。
の図に於いても、第3図と同一部分を示しである。
ここでSi基板(30)は、高濃度にP型不純物を含む
ベース領域(31)及びベース領域(31)よりP型の
不純物濃度が低いエピタキシャル層(32)からなり、
このエピタキシャル層(32)上に転送電極(3)が配
列形成される。即ち、1Ω−印以下の抵抗率を有するベ
ース領域(31)上に10〜20Ω−σ程度の抵抗率を
有するエピタキシャル領域(32)を積層してSi基板
(30)が形成きれている。従って、ベース領域(31
)自体が第1図のP+型のエピタキシャル領域(22)
と同様に作用し、重金属が除去される。従って、このよ
うなSi基板<31)に於いても、活性領域となるエピ
タキシャル層(32)内(7) 重金属が排除されて結
晶欠陥が減少し、微小山点の発生が抑圧される。
ベース領域(31)及びベース領域(31)よりP型の
不純物濃度が低いエピタキシャル層(32)からなり、
このエピタキシャル層(32)上に転送電極(3)が配
列形成される。即ち、1Ω−印以下の抵抗率を有するベ
ース領域(31)上に10〜20Ω−σ程度の抵抗率を
有するエピタキシャル領域(32)を積層してSi基板
(30)が形成きれている。従って、ベース領域(31
)自体が第1図のP+型のエピタキシャル領域(22)
と同様に作用し、重金属が除去される。従って、このよ
うなSi基板<31)に於いても、活性領域となるエピ
タキシャル層(32)内(7) 重金属が排除されて結
晶欠陥が減少し、微小山点の発生が抑圧される。
尚、本実施例に於いては、フレームトランスファ型のC
CD固体撮像素子について示しであるが、CCDの方式
に拘わらず、インターライン型等に於いても上述の如き
Si基板(20) 、 (30)を採用すれば、微細白
点の発生の抑圧が図れる。
CD固体撮像素子について示しであるが、CCDの方式
に拘わらず、インターライン型等に於いても上述の如き
Si基板(20) 、 (30)を採用すれば、微細白
点の発生の抑圧が図れる。
(ト)発明の効果
本発明に依れば、活性領域の結晶欠陥が低減されるため
に微小白点の発生が抑圧される。従って、周辺温度が高
くなっても安定して良好な映像信号を得ることができ、
ビデオカメラの小型化に依る回路素子の高密度実装に有
効なCCD固体撮像素子を提供できる。
に微小白点の発生が抑圧される。従って、周辺温度が高
くなっても安定して良好な映像信号を得ることができ、
ビデオカメラの小型化に依る回路素子の高密度実装に有
効なCCD固体撮像素子を提供できる。
第1図は本発明固体撮像素子の一実施例を示す断面図、
第2図は他の実施例を示す断面図、第3図は従来の固体
撮像素子を示す平面図及び断面図である。 図 図 1 ・そイ才1し→島伎卆拳幻へ。 2・搭賽Q@竺 20: Si :l各づ口i zj:へ°1−ス斗1りV Ho: ’:i$嗜 へ”−ス卆I煩” 2 工r”7身ち−レノ− 3o 二 S4二ff 31、 べ・−又命シ坊′ 32; 1ピ7ヤーfル眉 第 図(a)
第2図は他の実施例を示す断面図、第3図は従来の固体
撮像素子を示す平面図及び断面図である。 図 図 1 ・そイ才1し→島伎卆拳幻へ。 2・搭賽Q@竺 20: Si :l各づ口i zj:へ°1−ス斗1りV Ho: ’:i$嗜 へ”−ス卆I煩” 2 工r”7身ち−レノ− 3o 二 S4二ff 31、 べ・−又命シ坊′ 32; 1ピ7ヤーfル眉 第 図(a)
Claims (3)
- (1)半導体基板の一主面にチャネル分離領域で区画さ
れたチャネル領域が形成され、このチャネル領域上に複
数の転送電極が配列形成されるCCD固体撮像素子に於
いて、 上記半導体基板が、 一導電型のベース領域と、 このベース領域上に積層され1Ω−cm以下の抵抗率を
有する一導電型の第1のエピタキシャル層と、 この第1のエピタキシャル層上に積層され上記ベース領
域と同程度の抵抗率を有する一導電型の第2のエピタキ
シャル層と、 からなり、この第2のエピタキシャル層内に上記チャネ
ル領域が形成されることを特徴とする固体撮像素子。 - (2)半導体基板の一主面にチャネル分離領域で区画さ
れたチャネル領域が形成され、このチャネル領域上に複
数の転送電極が配列形成されるCCD固体撮像素子に於
いて、 上記半導体基板が、 一導電型のベース領域と、 このベース領域の一面に一導電型の不純物が注入され1
Ω−cm以下の抵抗率を有する拡散層と、この拡散層上
に積層され上記ベース領域と同程度の抵抗率を有する一
導電型のエピタキシャル層と、 からなり、このエピタキシャル層内に上記チャネル領域
が形成されることを特徴とする固体撮像素子。 - (3)半導体基板の一主面にチャネル分離領域で区画さ
れたチャネル領域が形成され、このチャネル領域上に複
数の転送電極が配列形成されるCCD固体撮像素子に於
いて、 上記半導体基板が、 1Ω−cm以下の抵抗率を有する一導電型のベース領域
と、 このベース領域上に積層されベース領域より高い抵抗率
を有する一導電型のエピタキシャル層と、からなり、こ
のエピタキシャル層内に上記チャネル領域が形成される
ことを特徴とする固体撮像素子。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2047932A JPH03250765A (ja) | 1990-02-28 | 1990-02-28 | 固体撮像素子 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2047932A JPH03250765A (ja) | 1990-02-28 | 1990-02-28 | 固体撮像素子 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03250765A true JPH03250765A (ja) | 1991-11-08 |
Family
ID=12789146
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2047932A Pending JPH03250765A (ja) | 1990-02-28 | 1990-02-28 | 固体撮像素子 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03250765A (ja) |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57134960A (en) * | 1981-02-16 | 1982-08-20 | Nippon Telegr & Teleph Corp <Ntt> | Semiconductor device |
| JPS6284560A (ja) * | 1985-07-01 | 1987-04-18 | テキサス インスツルメンツ インコ−ポレイテツド | Ctd/cmosプロセス |
| JPS6466932A (en) * | 1987-09-07 | 1989-03-13 | Fujitsu Ltd | Epitaxial silicon wafer |
| JPH01274468A (ja) * | 1988-04-27 | 1989-11-02 | Nec Corp | 固体撮像素子の製造方法 |
-
1990
- 1990-02-28 JP JP2047932A patent/JPH03250765A/ja active Pending
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57134960A (en) * | 1981-02-16 | 1982-08-20 | Nippon Telegr & Teleph Corp <Ntt> | Semiconductor device |
| JPS6284560A (ja) * | 1985-07-01 | 1987-04-18 | テキサス インスツルメンツ インコ−ポレイテツド | Ctd/cmosプロセス |
| JPS6466932A (en) * | 1987-09-07 | 1989-03-13 | Fujitsu Ltd | Epitaxial silicon wafer |
| JPH01274468A (ja) * | 1988-04-27 | 1989-11-02 | Nec Corp | 固体撮像素子の製造方法 |
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