JPH03268464A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH03268464A
JPH03268464A JP6894890A JP6894890A JPH03268464A JP H03268464 A JPH03268464 A JP H03268464A JP 6894890 A JP6894890 A JP 6894890A JP 6894890 A JP6894890 A JP 6894890A JP H03268464 A JPH03268464 A JP H03268464A
Authority
JP
Japan
Prior art keywords
contact hole
polysilicon
metal wiring
semiconductor device
silicon substrate
Prior art date
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Pending
Application number
JP6894890A
Other languages
English (en)
Inventor
Shinya Kawarabayashi
河原林 真也
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は半導体装置に関するものである。
〔従来の技術〕
第2図は従来の半導体装置を示す断面図で、図において
、(1)はシリコン基板、(5)は絶縁酸化膜、(6)
はコンタクトホール、(7)は上層メタル配線、(3)
はN+拡散層である。
〔発明が解決しようとする課題〕
従来の半導体装置は以上のように構成されていたので、
上層メタル配線のコンタクトホール側壁でのカバレッジ
が悪く、最悪の場合メタル配線の断線等の信頼性上に問
題点があった。
この発明は上記のような問題点を解消する為になされた
もので、上層メタル配線のコンタクトホール側壁でのカ
バレッジの良い半導体装置を得るこ事を目的とする。
〔課題を解決するための手段〕
この発明に係る半導体装置は、上層メタル配線とシリコ
ン基板がコンタクトを取る位置にポリシリコンのパッド
を敷き、コンタクトホールのアスペクト比を下げ上層メ
タル配線のコンタクトホール側壁部を減少させカバレッ
ジを良くしたものである。
〔作用〕
この発明における半導体装置は、シリコン基板上に形成
されたメタルパッドにより、層間絶縁膜の膜厚よりポリ
シリコンバッドの膜厚分だけコンタクトホールの高さが
低くなり、コンタクトホールをウェットエッチ+ドライ
エッチで形成した際のコンタクトホールの側壁部分が減
少し、上層メタル配線のカバレッジが良くなり断線等が
なくなる。
〔実施例〕
以下、この発明の一実施例を図について説明する。
第1図(a)〜(g)はこの発明の一実施例である半導
体装置の製造工程を示す断面図で、図において、(1)
はシリコン基板、(2)はポリシリコン、(3)はN”
拡散層、(4)はレジスト、(5)は層間絶縁膜、(6
)はコンタクトホール、(7)はメタル配線である。
次に製造工程について説明する。
第1図(a)において、シリコン基板(1)上にポリシ
リコン(2)をデポし、その後のN+拡散によりポリシ
リコンの抵抗を下げシリコン基板(1)上にN+拡散層
(3)を形成する。(h)図、(e)図において、ポリ
シリコン(2)上にレジスト(4)を塗布し、後工程で
メタル配線とコンタクトを取る部分のみ、写真製版とド
ライエツチングによりポリシリコン(2)のパッドを形
成する。(d)図において絶縁酸化膜(5)形成する。
(e)図、(f)図において、絶縁酸化膜(4)上にレ
ジスト(4)を塗布し、写真製版とウェット+ドライエ
ツチングによりコンタクトホール(6)を形成する。(
g)図において、コンタクトホール(6)にメタル配線
(7)をデボする。
〔発明の効果〕
以上の様にこの発明によれば、コンタクトホールの底部
にポリシリコンバッドを形成したので、ポリシリコンの
膜厚分だけコンタクトホールの高さが低くなり、コンタ
クトホールの側壁部分か減少し、メタル配線のカバレッ
ジか改善され信頼性が良くなるという効果がある。
【図面の簡単な説明】
第1図(a)〜(g)はこの発明の一実施例による半導
体装置の製造工程を示す断面図、第2図は従来の半導体
装置を示す断面図である。 図において、(1)はシリコン基板、(2)はポリシリ
コン、(3)はN+拡散層、(4)はレジスト、(5)
は層間絶縁膜、(6)はコンタクトホール、(7)はメ
タル配線を示す。 なお、図中、同一符号は同一、又は相当部分を示す。 第1図(Yの1)

Claims (1)

    【特許請求の範囲】
  1.  シリコン基板とメタル配線のコンタクト部において、
    コンタクトホールの底部にポリシリコンパッドを敷き、
    コンタクトホールのアスペクト比を下げメタル配線のコ
    ンタクトホールでのカバレッジを良くした事を特徴とす
    る半導体装置。
JP6894890A 1990-03-19 1990-03-19 半導体装置 Pending JPH03268464A (ja)

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