JPH03271954A - 入出力インターフェース選択方式 - Google Patents
入出力インターフェース選択方式Info
- Publication number
- JPH03271954A JPH03271954A JP7245190A JP7245190A JPH03271954A JP H03271954 A JPH03271954 A JP H03271954A JP 7245190 A JP7245190 A JP 7245190A JP 7245190 A JP7245190 A JP 7245190A JP H03271954 A JPH03271954 A JP H03271954A
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- 238000012546 transfer Methods 0.000 claims abstract description 14
- 238000012545 processing Methods 0.000 claims description 18
- 238000010187 selection method Methods 0.000 claims description 6
- 238000012790 confirmation Methods 0.000 description 2
- 238000002360 preparation method Methods 0.000 description 2
- 238000011161 development Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は入出力インターフェース選択方式に関し、特に
同一の物理インターフェースで数種類のインターフェー
スを実現している場合の入出力インターフェース選択方
式に関する。
同一の物理インターフェースで数種類のインターフェー
スを実現している場合の入出力インターフェース選択方
式に関する。
近年のＶＬＳＩの発展に伴ない、同一のハードウェア（
ＬＳ Ｉ ）で性能の異なる数種類の入出力インターフ
ェースをサポートする様になり、入出力インターフェー
スを選択する手段が必要となってきた。
ＬＳ Ｉ ）で性能の異なる数種類の入出力インターフ
ェースをサポートする様になり、入出力インターフェー
スを選択する手段が必要となってきた。
従来、この種の入出力インターフェースの選択は、スイ
ッチ等により入出力制御装置の種類により各チャネル毎
に設定して行なっている。
ッチ等により入出力制御装置の種類により各チャネル毎
に設定して行なっている。
上述した従来のインターフェース選択方式では、種々の
入出力インターフェースをサポートする機能を有しなが
ら、動的な切替が出来ないとい本発明は方式は、主記憶
装置に接続された入出力処理装置と、前記入出力処理装
置に接続されたチャネル装置と、複数の入出力装置を接
続する入出力制御装置と、前記入出力制御装置と前記チ
ャネル装置とを接続する入出力インターフェースを有す
るデータ処理装置における入出力インターフェース選択
方式において、 前記チャネル装置と前記入出力制御装置は同一のハード
ウェアで接続の種類の入出力インターフェースを制御可
能であり、 前記入出力制御装置は前記入出力インタフェース上のデ
ータ転送に先立って前記複数の種類の入出力インタフェ
ースのいずれかを指示する指示コードを前記入出力イン
タフェースを用いて前記チャネル装置を送信する手段を
有し、 前記チャネル装置は前記指示コードの受信により前記入
出力が処理装置へ割込み要求を生成する手段を有し、 前記入出力処理装置は前記割込み要求に応じて、前記チ
ャネル装置に対し、前記入出力インタフェースの種類を
設定する手段を有し、前記チャネル装置は前記入出力処
理装置からの設定に応じた入出力インターフェースに依
りデータ転送を行なう様にしたことを特徴とする。
入出力インターフェースをサポートする機能を有しなが
ら、動的な切替が出来ないとい本発明は方式は、主記憶
装置に接続された入出力処理装置と、前記入出力処理装
置に接続されたチャネル装置と、複数の入出力装置を接
続する入出力制御装置と、前記入出力制御装置と前記チ
ャネル装置とを接続する入出力インターフェースを有す
るデータ処理装置における入出力インターフェース選択
方式において、 前記チャネル装置と前記入出力制御装置は同一のハード
ウェアで接続の種類の入出力インターフェースを制御可
能であり、 前記入出力制御装置は前記入出力インタフェース上のデ
ータ転送に先立って前記複数の種類の入出力インタフェ
ースのいずれかを指示する指示コードを前記入出力イン
タフェースを用いて前記チャネル装置を送信する手段を
有し、 前記チャネル装置は前記指示コードの受信により前記入
出力が処理装置へ割込み要求を生成する手段を有し、 前記入出力処理装置は前記割込み要求に応じて、前記チ
ャネル装置に対し、前記入出力インタフェースの種類を
設定する手段を有し、前記チャネル装置は前記入出力処
理装置からの設定に応じた入出力インターフェースに依
りデータ転送を行なう様にしたことを特徴とする。
次に本発明について図面を参照して説明する。
第１図は本発明の一実施例を示す。
第１図においては、１は主記憶装置、２は入出力処理装
置、３はチャネル装置、３−１は入出力インターフェー
スの種類に依存しないチャネル共通部、３−２．３−３
は入出力インターフェース固有の機能を制御するインタ
ーフェース制御部、３−４はインターフェース制御部３
−２又は３−３からの出力の切替える選択回路、３−５
は入出力インターフェースの種類を指示する情報を格納
するレジスタ、４は入出力インターフェース１０−１．
１０−２に依りチャネル装置３と接続され配下の入出力
装置５−１〜５〜ｎを制御する入出力制御装置である。
置、３はチャネル装置、３−１は入出力インターフェー
スの種類に依存しないチャネル共通部、３−２．３−３
は入出力インターフェース固有の機能を制御するインタ
ーフェース制御部、３−４はインターフェース制御部３
−２又は３−３からの出力の切替える選択回路、３−５
は入出力インターフェースの種類を指示する情報を格納
するレジスタ、４は入出力インターフェース１０−１．
１０−２に依りチャネル装置３と接続され配下の入出力
装置５−１〜５〜ｎを制御する入出力制御装置である。
本例において、データ転送は主記憶装置１ｔ＋入出力処
理装置２←チヤネル装Ｗ３４−４インターフェース１０
−１．１０−２４＋入出力制御装置←入出力装置のバス
で行なわれる。
理装置２←チヤネル装Ｗ３４−４インターフェース１０
−１．１０−２４＋入出力制御装置←入出力装置のバス
で行なわれる。
インターフェース制御部３−２は高速データストリーミ
ング方式の人出インターフェースをサポートし、インタ
ーフニス制御部３−３は低速の応答確認方式の入出力イ
ンターフェースをサポートする。
ング方式の人出インターフェースをサポートし、インタ
ーフニス制御部３−３は低速の応答確認方式の入出力イ
ンターフェースをサポートする。
入出力制御袋Ｗ４は、データ転送を開始する前にそのデ
ータ転送で使用する入出力インターフェースの種類を指
示するコードをインターフェース１０−１を用いてチャ
ネル装置３へ送信する。
ータ転送で使用する入出力インターフェースの種類を指
示するコードをインターフェース１０−１を用いてチャ
ネル装置３へ送信する。
入出力インターフェースは、通常は応答確認方式となっ
ており、インターフェース制御部３−３に依り制御され
る。従って、指示コードはインターフェース制御部３−
３で受信され、そこから装置チャネル共通部３−１へ、
指示コード受信の通知が行き、チャネル共通部３−１は
人出カ処理装置２へ割込み要求を生成する。割込み要求
は線２−ａの一部を用いて伝えられる。
ており、インターフェース制御部３−３に依り制御され
る。従って、指示コードはインターフェース制御部３−
３で受信され、そこから装置チャネル共通部３−１へ、
指示コード受信の通知が行き、チャネル共通部３−１は
人出カ処理装置２へ割込み要求を生成する。割込み要求
は線２−ａの一部を用いて伝えられる。
入出力処理装置２はチャネル装置３がらの割込みに応じ
、入出力制御装置４がら送られた指示コードを解読し、
レジスタ３−５へ入出力インターフェースの選択情報を
書き込む。
、入出力制御装置４がら送られた指示コードを解読し、
レジスタ３−５へ入出力インターフェースの選択情報を
書き込む。
今、指示コードがデータストリーミング方式を指示して
いた場合、選択回路３−４に依りインターフェース制御
部３−２が選択され、入出力インターフエースを形成す
る。これらの準備が完了すると、入出力処理装置２はチ
ャネル装置３ヘデータ転送の準備が完了したことを通し
、チャネル装置３と入出力制御装置４はインターフェー
ス ０−１ ０−２・・・・・・インターフェース。
いた場合、選択回路３−４に依りインターフェース制御
部３−２が選択され、入出力インターフエースを形成す
る。これらの準備が完了すると、入出力処理装置２はチ
ャネル装置３ヘデータ転送の準備が完了したことを通し
、チャネル装置３と入出力制御装置４はインターフェー
ス ０−１ ０−２・・・・・・インターフェース。
Claims (1)
- 【特許請求の範囲】 主記憶装置に接続された入出力処理装置と、前記入出力
処理装置に接続されたチャネル装置と、複数の入出力装
置を接続する入出力制御装置と、前記入出力制御装置と
前記チャネル装置とを接続する入出力インターフェース
を有するデータ処理装置における入出力イターフェース
選択方式において、 前記チャネル装置と前記入出力制御装置は同一のハード
ウェアで接続の種類の入出力インターフェースを制御可
能であり、 前記入出力制御装置は前記入出力インターフェース上の
データ転送に先立つて前記複数の種類の入出力インター
フェースのいずれかを指示する指示コードを前記入出力
インターフェースを用いて前記チャネル装置を送信する
手段を有し、 前記チャネル装置は前記指示コードの受信により前記入
出力が処理装置へ割込み要求を生成する手段を有し、 前記入出力処理装置は前記割込み要求に応じて、前記チ
ャネル装置に対し、前記入出力インターフェースの種類
を設定する手段を有し、 前記チャネル装置は前記入出力処理装置からの設定に応
じた入出力インターフェースに依りデータ転送を行なう
様にしたことを特徴とする入出力インターフェース選択
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7245190A JPH03271954A (ja) | 1990-03-20 | 1990-03-20 | 入出力インターフェース選択方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7245190A JPH03271954A (ja) | 1990-03-20 | 1990-03-20 | 入出力インターフェース選択方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03271954A true JPH03271954A (ja) | 1991-12-03 |
Family
ID=13489675
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7245190A Pending JPH03271954A (ja) | 1990-03-20 | 1990-03-20 | 入出力インターフェース選択方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03271954A (ja) |
-
1990
- 1990-03-20 JP JP7245190A patent/JPH03271954A/ja active Pending
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