JPH032783B2 - - Google Patents

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JPH032783B2
JPH032783B2 JP57046407A JP4640782A JPH032783B2 JP H032783 B2 JPH032783 B2 JP H032783B2 JP 57046407 A JP57046407 A JP 57046407A JP 4640782 A JP4640782 A JP 4640782A JP H032783 B2 JPH032783 B2 JP H032783B2
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JP
Japan
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cassette
size
voltage
resistor
comparator circuit
Prior art date
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JP57046407A
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JPS58167333A (ja
Inventor
Koji Maruyama
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KASHIO DENSHI KOGYO KK
KASHIO KEISANKI KK
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KASHIO DENSHI KOGYO KK
KASHIO KEISANKI KK
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    • BPERFORMING OPERATIONS; TRANSPORTING
    • B65CONVEYING; PACKING; STORING; HANDLING THIN OR FILAMENTARY MATERIAL
    • B65HHANDLING THIN OR FILAMENTARY MATERIAL, e.g. SHEETS, WEBS, CABLES
    • B65H1/00Supports or magazines for piles from which articles are to be separated

Landscapes

  • Engineering & Computer Science (AREA)
  • Mechanical Engineering (AREA)
  • Sheets, Magazines, And Separation Thereof (AREA)
  • Paper Feeding For Electrophotography (AREA)

Description

【発明の詳細な説明】 この発明は、複写機に装着された用紙カセツト
のサイズを検出する検出装置に関する。
従来、この種の検出装置としては、第1図乃至
第3図に示すものが知られている。複写機本体a
のカセツト差込口bの近傍には、差込口b内にス
イツチ接片が臨む3個のマイクロスイツチC1
C3が配設されている。他方、用紙カセツトdの
一側部には、マイクロスイツチC1〜C3の接片を
押圧して選択的にスイツチングさせるための突起
eが配設されている。この場合、突起eはその配
設位置をカセツトサイズに応じて変えるようにし
たもので、例えば、A4サイズのカセツトdなら
ば、第1図に示す如く、マイクロスイツチC1
対向位置に、また、B4サイズのカセツトd′なら
ば、第2図に示す如く、突起e′はマイクロスイツ
チC2の対向位置に設けられている。而して、マ
イクロスイツチC1〜C3が選択的にスイツチング
されると、第3図に示した表示器fのサイズ表示
ランプf1〜f3のうち対応する表示ランプが点灯す
るようになつている。なお、表示ランプf1〜f3
は、カセツトサイズ、例えば、A4、B4、B5サイ
ズに対応ずけられ、その点灯によつてカセツトサ
イズを指示するものである。
しかしながら、この種のものは、3種類のカセ
ツトサイズを検出するには、最低3個のマイクロ
スイツチを必要とするため、実装スペースが大と
なると共にスイツチ配線の煩雑化、組立工程の増
大化を招き、コストアツプの原因となる。
この発明は、上述した事情を背景になされたも
ので、その目的とするところは、実装スペースや
配線数および組立工数の削減が可能であると共
に、カセツトサイズの検出を確実かつ良好に行う
ようにした複写機のカセツトサイズ検出装置を提
供することにある。
以下、この発明の一実施例を第4図乃至第6図
を参照して具体的に説明する。第5図中1は、カ
セツト差込口2が形成されている複写機本体で、
差込口2の奥部には、一対の電極3,3が配設さ
れている。電極3,3は、平板状に形成されてな
るもので、その板面がカセツト進入方向に対して
直交するように配設されている。そして、電極
3,3は、コイルスプリング4,4の弾性力を受
けて常時差込口2の開口部側に附勢されるように
なつている。更に、電極3,3はリード線5,5
を介して第4図に示す回路の入力端子CA,CB
夫々電気的に接続されるようになつている。
他方、用紙カセツト6の一側部には、電極3,
3の離間間隔に対応する間隔をもつて電極7,7
が配設されていると共に、その内部には電極7,
7間に接続された抵抗RAが配設されている。こ
の抵抗RAはカセツトサイズに応じてその抵抗値
を夫々異ならしめたもので、例えば、A4サイズ
のカセツトであれば、1kΩ、B4サイズのカセツ
トであれば、5kΩの如くとなつている。
次に、第4図に示す回路について説明する。電
源電池Eの出力電圧は比較回路8の動作電圧とし
て供給されると共に、制御回路9のVDDおよび
GND入力端子に夫々供給されている。そして、
電池Eの正極側は抵抗RBの一端に接続され、ま
たその負極側は、複写機本体1にカセツト6が装
着されている状態で、カセツト6側の抵抗RA
一端に接続される。而して、抵抗RAおよびRB
他端は夫々互いに接続され、比較回路8の一入力
端子に抵抗RA,RBによる分圧電圧が抵抗RA,RB
の接続点から被比較電圧V(−)として供給され
る。
制御回路9は、各種動作を制御するもので、マ
イクロ命令を記憶する記憶部や演算・判断部等を
有する構成となつており、各種の制御信号O1
ON、P1〜PNを出力する。制御信号O1〜ONは、対
応する抵抗R1〜RNに供給され、その出力状態に
応じて抵抗R1〜RNを順次選択する信号である。
抵抗R1〜RNの他端は抵抗RCを介して電池Eの正
極側に接続され、比較回路8の+入力端子に抵抗
R1〜RNのうち選択された抵抗と抵抗RCによる分
圧電圧が抵抗R1〜RNと抵抗RCの接続点から基準
電圧V(+)として供給される。
比較回路8は、入力電圧V(−)、V(+)がV
(−)>V(+)のときに2値論理レベルのLowレ
ベル、V(−)<V(+)のときにHighレベルとな
る比較結果信号を出力し、制御回路9に入力信号
IAとして与えるようになつている。なお、RLは比
較回路8の出力側と電池Eの正極側との間に接続
される抵抗である。
制御回路9から出力される制御信号P1〜PNは、
対応するLED(発光ダイオード)ドライバ10−
1〜10−Nに与えられ、夫々駆動信号を出力さ
せる信号である。LEDドライバ10−1〜10
−Nは、インバータによつて構成され、その出力
は、対応するLED11−1〜11−Nの負極側
に接続される。このLED11−1〜11−Nの
正極側は、抵抗RFを介して電池Eの正極側に接
続されている。
次に、上述のように構成されたカセツトサイズ
検出装置の動作を第6図に示すフローチヤートに
従つて説明する。今、カセツト6側の抵抗RAは、
カセツト6のサイズに応じて比較回路8の一方の
入力電圧V(−) V(−)=RA/RA+RB×E が、電池Eの出力電圧が10Vであるときに、A4
サイズで2V、A3サイズで4V、B5サイズで6V、
B4サイズで8Vとなるように設定されているもの
とする。また、抵抗RC、R1〜R4は、比較回路8
の他方の入力電圧V(+)が電池Eの出力電圧が
10Vであるときに、 V(+)=R1/R1+RC×E=3V V(+)=R2/R2+RC×E=5V V(+)=R3/R3+RC×E=7V V(+)=R4/R4+RC×E=9V となるように設定されているものとする。
先ず、ステツプS1では、制御回路9は制御信号
O1〜ONのうち制御信号O1のみをLowレベルとす
る処理を実行する。これにより、抵抗R1に電流
が流れ、比較回路8の+入力端子には、抵抗R1
RCによる分圧電圧、すなわちV(+)=R1/R1+RC× E=3Vが印加されるようになる。次のステツプ
S2では、制御回路9に入力される信号IA、すなわ
ち、比較回路8の比較結果信号がHighレベルで
あるか否か、換言すれば、比較回路8の入力電圧
V(−)、V(+)がV(−)<V(+)であるか否か
が実行される。今、信号IAがHighレベルで電圧
V(−)<V(+)であると判断された場合には、
比較回路8の−入力端子に印加される抵抗RA
RBによる分圧電圧V(−)=RA/RA+RB×Eが電圧V (+)=3Vよりも小さい場合であるから、装着カ
セツト6は電圧V(−)=2VとなるA4サイズのカ
セツトであると判断し、次のステツプS3の実行に
移る。このステツプS3において、制御回路9は制
御信号P1〜PNのうち制御信号P1のみをHighレベ
ルとする処理を実行する。これにより、LEDド
ライバ10−1からは信号P1の反転信号が印加
されるので、次のステツプS4において、LED1
1−1がONされ、A4サイズ大のカセツト6が装
着されたことが明示される。
また、上記ステツプS2で信号IAがHighレベル
でないと判断された場合には、次のステツプS5
進む。このステツプS5で制御回路9は制御信号
O1をHighインピーダンスに戻す処理を実行する。
続いて、次のステツプS6において、制御回路9は
制御信号O2をLowレベルとする処理を実行する。
これにより、抵抗R2に電流が流れ、比較回路8
の+入力端子には、抵抗R2,RCによる分圧電圧、
すなわち、V(+)=R2/R2+RC×E=5Vが印加さ れるようになる。そして、次のステツプS7では信
号IAがHighレベルであるか否かが判断される。
今、信号IAがHighレベルであると判断された場
合には、電圧V(−)は3V<電圧V(−)<5Vで
ある場合であるから、装着カセツト6は、電圧V
(−)=4VとなるA3サイズのカセツトであると判
断し、上述のステツプS3,S4に対応するステツプ
S8,S9を順次実行する。このステツプS8,S9の実
行により、LED11−2がONされ、A3サイズ
大のカセツト6が装着されたことが明示される。
また、上記ステツプS7で信号IAがHighレベル
でないと判断された場合には、上述のステツプ
S5,S6に対応するステツプS10,S11が順次実行さ
れる。これにより、抵抗R3に電流が流れ、比較
回路8の+入力端子には抵抗R3,RCによる分圧
電圧、すなわち、V(+)=R3/R3+RC×E=7Vが 印加されるようになる。そして、次のステツプ
S12では上述のステツプS2あるいはS7と同様の処
理が実行され、その判断結果に応じてステツプ
S13,S14あるいはS15,S16が実行される。ステツ
プS13,S14は上述のステツプS3,S4に対応する処
理を実行するもので、このステツプS13,S14が実
行される場合には、電圧V(−)は、5V<電圧
(−)<7Vの場合で、装着カセツト6は電圧V
(−)=6VとなるB5サイズのカセツトであるか
ら、LED11−3がONされ、B5サイズ大のカ
セツト6が装着されたことが明示される。また、
ステツプS15,S16は上述のステツプS5,S6に対応
する処理を実行するもので、このステツプS15
S16の実行により、抵抗R4に電流が流れ、比較回
路8の+入力端子には、抵抗R4、RCによる分圧
電圧、すなわち、V(+)=R4/R4+RC×E=9Vが 印加されるようになる。そして、次のステツプ
S17では、上述のステツプS2と同様の処理が実行
され、次のサイズであるB4サイズのカセツトが
装着されたか否かが検出される。
以下、上述の同様に、B4サイズのカセツトか
ら任意のNサイズのカセツトに対応する処理が、
ステツプS18乃至S23で順次実行される。この場
合、ステツプS18,S19あるいはS23,S24は、上述
のステツプS3,S4に対応する処理、また、ステツ
プS20乃至S22,S25は、上述のステツプS5,S6
S7に対応する処理である。
このように、制御回路9は制御信号O1〜ON
順次択一的に指定して比較回路8に印加される基
準電圧の大きさを可変させてゆき、比較回路8の
比較結果信号に応じてカセツトサイズA4、A3、
B5、B4、A5に対応するLED11−1〜11−5
を点灯させるようにしたから、多種類のカセツト
サイズの検出をひとつの比較回路8で行うことが
できる。そして、カセツト6側の抵抗RAをカセ
ツトサイズに応じて異ならしめることにより、カ
セツトサイズに対応するLED11−1〜11−
5が選択的に点灯されるので、その検出を確実に
かつ良好に行うことができる。
なお、この発明は、上記実施例に限定されず、
この発明を逸脱しない範囲内において種々変形応
用可能であり、例えば、LEDに限らず、液晶表
示装置であつてもよい。
以上詳細に説明したように、この発明に係るカ
セツトサイズ検出装置によれば、比較回路の一方
の入力端子にカセツト側に配設された抵抗素子を
接続すると共に他方の入力端子に複数の抵抗素子
を接続し、この複数の抵抗素子を順次選択指定し
て比較回路に供給される基準電圧を可変せしめる
と共に、比較回路からの比較結果信号を検出する
制御回路を設けてなるものであるから、カセツト
側の抵抗素子の抵抗値をカセツトサイズに応じて
異ならしめることにより、例えば、複数種類のカ
セツトサイズをひとつの比較回路であつても検出
することができる。また、従来のように多数のマ
イクロスイツチを必要としないので、実装スペー
スおよび配線数、組立工程の削減が可能となり、
コストの低減を図ることができる。
【図面の簡単な説明】
第1図乃至第3図は、従来に係るカセツトサイ
ズ検出装置を示し、第1図は概略構成図、第2図
は第1図と異なる他のサイズのカセツトを示す
図、第3図は回路構成図、第4図乃至第6図はこ
の発明の一実施例を示し、第4図は回路構成図、
第5図は概略構成図、第6図は動作を示すフロー
チヤートである。 1……複写機本体、6……カセツト、8……比
較回路、9……制御回路、11−1〜11−N…
…LED。

Claims (1)

    【特許請求の範囲】
  1. 1 基準電圧源に一方の入力端子が接続される比
    較回路と、カセツト側に配設され、該カセツトの
    装着に伴つて前記比較回路の他方の入力端子に接
    続される被比較電圧発生用の抵抗素子と、前記比
    較回路の出力に応答して装着カセツトのサイズを
    明示する表示器とを具備してなるカセツトサイズ
    検出装置。
JP57046407A 1982-03-25 1982-03-25 カセットサイズ検出装置 Granted JPS58167333A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57046407A JPS58167333A (ja) 1982-03-25 1982-03-25 カセットサイズ検出装置

Applications Claiming Priority (1)

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JP57046407A JPS58167333A (ja) 1982-03-25 1982-03-25 カセットサイズ検出装置

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JPS58167333A JPS58167333A (ja) 1983-10-03
JPH032783B2 true JPH032783B2 (ja) 1991-01-16

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JPS58167333A (ja) 1983-10-03

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