JPH0330944B2 - - Google Patents
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- Publication number
- JPH0330944B2 JPH0330944B2 JP60125635A JP12563585A JPH0330944B2 JP H0330944 B2 JPH0330944 B2 JP H0330944B2 JP 60125635 A JP60125635 A JP 60125635A JP 12563585 A JP12563585 A JP 12563585A JP H0330944 B2 JPH0330944 B2 JP H0330944B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- circuit
- emphasis circuit
- dropout
- emphasis
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は映像信号記録再生装置に関し、特に
画面垂直方向又は斜め方向の信号間の減算、加算
によるプリエンフアシス、デイエンフアシス処理
によるＳ／Ｎ改善とFM信号の欠落を補償するド
ロツプアウト補償に関する。
画面垂直方向又は斜め方向の信号間の減算、加算
によるプリエンフアシス、デイエンフアシス処理
によるＳ／Ｎ改善とFM信号の欠落を補償するド
ロツプアウト補償に関する。
従来この種の装置として第２図に示すものがあ
つた。図において、１は再生FM信号入力端子、
２は入力信号のレベルを一定にするFMAGC回
路、３はFM信号の振幅および位相を補正するイ
コライザー（EQ）回路、４はFM信号をAM検波
し、FM信号の欠落に相当する期間パルスを発生
させるドロツプアウト検波器、５は再生FM信号
を一水平走査期間遅延させる1H遅延線、６は前
記ドロツプアウト検波器４のパルスにより応答す
るスイツチ回路、７はFM検波器、８はデイエン
フアシス回路である。
つた。図において、１は再生FM信号入力端子、
２は入力信号のレベルを一定にするFMAGC回
路、３はFM信号の振幅および位相を補正するイ
コライザー（EQ）回路、４はFM信号をAM検波
し、FM信号の欠落に相当する期間パルスを発生
させるドロツプアウト検波器、５は再生FM信号
を一水平走査期間遅延させる1H遅延線、６は前
記ドロツプアウト検波器４のパルスにより応答す
るスイツチ回路、７はFM検波器、８はデイエン
フアシス回路である。
また、２０は垂直方向の空間周波数の高域成分
をレベル減衰させるバーテイカルデイエンフアシ
ス回路であり、このバーテイカルデイエンフアシ
ス回路２０において、９は加算回路、１０は１水
平走査期間遅延させる1H遅延線、１１はその出
力レベルをK1に合わせる係数回路（k1＜１）、１
２は出力レベルを（１−k1）に合わせる係数回
路、１３は原信号と（１−k1）係数回路の出力信
号とを減算する減算回路、１４は（１／k1）の係
数回路、１５はリミツタ回路、１６は原信号とリ
ミツタ回路出力とを減算する減算回路である。１
７は出力端子を表わす。
をレベル減衰させるバーテイカルデイエンフアシ
ス回路であり、このバーテイカルデイエンフアシ
ス回路２０において、９は加算回路、１０は１水
平走査期間遅延させる1H遅延線、１１はその出
力レベルをK1に合わせる係数回路（k1＜１）、１
２は出力レベルを（１−k1）に合わせる係数回
路、１３は原信号と（１−k1）係数回路の出力信
号とを減算する減算回路、１４は（１／k1）の係
数回路、１５はリミツタ回路、１６は原信号とリ
ミツタ回路出力とを減算する減算回路である。１
７は出力端子を表わす。
次に動作について説明する。
ビデオヘツド（図示せず）よりとり出された再
生FM信号はヘツドAMP回路（図示せず）で増
幅され、入力端子１に入力される。そしてこの信
号はFMAGC回路２においてレベルが一定にされ
た後ドロツプアウト補償回路１００にてFM信号
の欠落が補正され、次にFM検波回路７で復調さ
れる。復調されたビデオ信号は記録時に規定のエ
ンフアシスがかけられているため、それに対応す
るデイエンフアシス特性をもつデイエンフアシス
回路８を通してＳ／Ｎの改善が行なわれている。
生FM信号はヘツドAMP回路（図示せず）で増
幅され、入力端子１に入力される。そしてこの信
号はFMAGC回路２においてレベルが一定にされ
た後ドロツプアウト補償回路１００にてFM信号
の欠落が補正され、次にFM検波回路７で復調さ
れる。復調されたビデオ信号は記録時に規定のエ
ンフアシスがかけられているため、それに対応す
るデイエンフアシス特性をもつデイエンフアシス
回路８を通してＳ／Ｎの改善が行なわれている。
次にバーテイカルデイエンフアシス回路２０に
ついて説明する。第３図ａ〜ｇは、それぞれ第２
図のＡ〜Ｇの各部分における信号の波形図を示
す。Ｂ点での伝達関数Ｇ（Ｓ）は下記となる。
ついて説明する。第３図ａ〜ｇは、それぞれ第２
図のＡ〜Ｇの各部分における信号の波形図を示
す。Ｂ点での伝達関数Ｇ（Ｓ）は下記となる。
Ｇ（Ｓ）＝１／１−K1・e-s〓
τ＝１／fH、fH：ライン周波数
Ａ点での信号をレベル１のステツプ信号と仮定
すると、Ｂ点での波形は前述の伝達関数Ｇ（Ｓ）
に示されるように1H遅延線１０の出力が順次加
算され、第３図のｂの様な波形となり、出力レベ
ルは１／（１−K1）となる。Ｃ点の波形は係数
回路１２によりレベルが１となりｃの様になる。
またＤ点では原信号ａと出力ｃとの減算によりｄ
の波形の信号となる。Ｅ点では係数回路１４によ
り波形ｅとなり、Ｆ点ではリミツタ回路１５によ
り振幅制限され、ｆの波形となる。Ｇ点では原信
号ａと出力ｆとの減算によりｇの様な出力波形が
得られる。以上のような動作により、相関のない
ノイズ成分が平均化されて原信号から除去され、
Ｓ／Ｎ改善がなされている。
すると、Ｂ点での波形は前述の伝達関数Ｇ（Ｓ）
に示されるように1H遅延線１０の出力が順次加
算され、第３図のｂの様な波形となり、出力レベ
ルは１／（１−K1）となる。Ｃ点の波形は係数
回路１２によりレベルが１となりｃの様になる。
またＤ点では原信号ａと出力ｃとの減算によりｄ
の波形の信号となる。Ｅ点では係数回路１４によ
り波形ｅとなり、Ｆ点ではリミツタ回路１５によ
り振幅制限され、ｆの波形となる。Ｇ点では原信
号ａと出力ｆとの減算によりｇの様な出力波形が
得られる。以上のような動作により、相関のない
ノイズ成分が平均化されて原信号から除去され、
Ｓ／Ｎ改善がなされている。
以上のように、従来装置においてはドアロツプ
アウト補償回路とバーテイカルデイエンフアシス
回路はそれぞれ別個に設けられており、このため
それぞれに1H遅延線を必要とし、回路が複雑に
なり、またコストが高価になるという問題点があ
つた。
アウト補償回路とバーテイカルデイエンフアシス
回路はそれぞれ別個に設けられており、このため
それぞれに1H遅延線を必要とし、回路が複雑に
なり、またコストが高価になるという問題点があ
つた。
この発明は上記のような問題点を解消するため
になされたもので、回路の簡素化と同時にビデオ
帯域でドロツプアウト補償をも実現でき、性能向
上を図ることのできる映像信号記録再生装置を提
供することを目的としている。
になされたもので、回路の簡素化と同時にビデオ
帯域でドロツプアウト補償をも実現でき、性能向
上を図ることのできる映像信号記録再生装置を提
供することを目的としている。
この発明に係る映像信号記録再生装置は、再生
FM信号の欠落を検出し、それに対応する信号に
より、バーテイカルデイエンフアシス回路の入力
信号を該バーテイカルデイエンフアシス回路に含
まれる1H遅延線を通した信号を切替えるように
したものである。
FM信号の欠落を検出し、それに対応する信号に
より、バーテイカルデイエンフアシス回路の入力
信号を該バーテイカルデイエンフアシス回路に含
まれる1H遅延線を通した信号を切替えるように
したものである。
この発明においては、FM復調後のビデオ信号
をバーテイカルデイエンフアシス回路を通すこと
によりＳ／Ｎ改善を行なうと同時に、バーテイカ
ルデイエンフアシス回路に含まれる1H遅延線を
使用してドロツプアウト補償を行なう。
をバーテイカルデイエンフアシス回路を通すこと
によりＳ／Ｎ改善を行なうと同時に、バーテイカ
ルデイエンフアシス回路に含まれる1H遅延線を
使用してドロツプアウト補償を行なう。
以下この発明の一実施例を第１図について説明
する。第１図において、１は再生FM信号入力端
子、２はFMAGC回路、３はイコライザー（EQ）
回路、４はドロツプアウト検波器、７はFM検波
器、８はデイエンフアシス回路、３０は前記ドロ
ツプアウト検波器の制御信号により作動するスイ
ツチ回路、４０は1H遅延線１０を通つた信号を
所定ノレベルに合わせる係数回路、２０はバーテ
イカルデイエンフアシス回路、１７は出力端子を
示す。バーテイカルデイエンフアシス回路２０の
構成は前述した従来技術のものと同一である。
する。第１図において、１は再生FM信号入力端
子、２はFMAGC回路、３はイコライザー（EQ）
回路、４はドロツプアウト検波器、７はFM検波
器、８はデイエンフアシス回路、３０は前記ドロ
ツプアウト検波器の制御信号により作動するスイ
ツチ回路、４０は1H遅延線１０を通つた信号を
所定ノレベルに合わせる係数回路、２０はバーテ
イカルデイエンフアシス回路、１７は出力端子を
示す。バーテイカルデイエンフアシス回路２０の
構成は前述した従来技術のものと同一である。
以上のような構成において、再生FM信号の欠
落に対応してドロツプアウト検波器４より制御パ
ルスを発生させ、これに応じてスイツチ３０を切
替える。即ち、通常時はデイエンフアシス回路８
を通つたビデオ信号はこのスイツチ３０を介して
バーテイカルデイエンフアシス回路２０へ供給さ
れる。そしてドロツプアウトが発生した場合に
は、ドロツプアウト検波器４の制御パルスにより
バーテイカルデイエンフアシス回路２０に含まれ
る1H遅延線１０、係数回路１１および第２の係
数回路４０を通した信号に切替えられてドロツプ
アウトの補償が行なわれ、その信号がバーテイカ
ルデイエンフアシス回路２０に供給され、従来と
同様の動作が行なわれる。
落に対応してドロツプアウト検波器４より制御パ
ルスを発生させ、これに応じてスイツチ３０を切
替える。即ち、通常時はデイエンフアシス回路８
を通つたビデオ信号はこのスイツチ３０を介して
バーテイカルデイエンフアシス回路２０へ供給さ
れる。そしてドロツプアウトが発生した場合に
は、ドロツプアウト検波器４の制御パルスにより
バーテイカルデイエンフアシス回路２０に含まれ
る1H遅延線１０、係数回路１１および第２の係
数回路４０を通した信号に切替えられてドロツプ
アウトの補償が行なわれ、その信号がバーテイカ
ルデイエンフアシス回路２０に供給され、従来と
同様の動作が行なわれる。
このように本実施例では、ドロツプアウトの補
償を、バーテイカルデイエンフアシス回路の1H
遅延線１０を利用して行なうので、回路構成が簡
単となり、また、そのドロツプアウト補償に際
し、ビデオ信号で切替えが行なわれるので、従来
のようにFM帯域で切替えた時に発生するトラン
ジエントノイズ等がなく、精度の高い補償を行な
うことができる。
償を、バーテイカルデイエンフアシス回路の1H
遅延線１０を利用して行なうので、回路構成が簡
単となり、また、そのドロツプアウト補償に際
し、ビデオ信号で切替えが行なわれるので、従来
のようにFM帯域で切替えた時に発生するトラン
ジエントノイズ等がなく、精度の高い補償を行な
うことができる。
なお、上記実施例では係数回路４０の入力信号
を係数回路１１の通した信号としたが、直接1H
遅延線１０の出力を入力信号としてもよい。また
ドロツプアウト検波器４の配置は、上記実施例の
位置に限られるものではない。
を係数回路１１の通した信号としたが、直接1H
遅延線１０の出力を入力信号としてもよい。また
ドロツプアウト検波器４の配置は、上記実施例の
位置に限られるものではない。
以上のように、この発明によれば、ドロツプア
ウトの補償をバーテイカルデイエンフアシス回路
と組み合わせて構成したので、装置が安価にな
り、かつ精度の高いドロツプアウト補償を行なう
ことができる効果がある。
ウトの補償をバーテイカルデイエンフアシス回路
と組み合わせて構成したので、装置が安価にな
り、かつ精度の高いドロツプアウト補償を行なう
ことができる効果がある。
第１図は本発明の一実施例による映像信号記録
再生装置の要部ブロツク構成図、第２図はその従
来例を示す図、第３図はバーテイカルデイエンフ
アシス回路の動作を説明するための波形図であ
る。 ４……ドロツプアウト検波器、８……デイエン
フアシス回路、１０……1H遅延線、２０……バ
ーテイカルデイエンフアシス回路、３０……スイ
ツチ回路。なお、図中同一符号は同一又は相当部
分を示す。
再生装置の要部ブロツク構成図、第２図はその従
来例を示す図、第３図はバーテイカルデイエンフ
アシス回路の動作を説明するための波形図であ
る。 ４……ドロツプアウト検波器、８……デイエン
フアシス回路、１０……1H遅延線、２０……バ
ーテイカルデイエンフアシス回路、３０……スイ
ツチ回路。なお、図中同一符号は同一又は相当部
分を示す。
Claims (1)
- 【特許請求の範囲】 １ プリエンフアシス回路を通した映像信号を周
波数変調して得た被変調波を記録媒体に記録し、
該記録媒体から再生した被変調波をFM復調した
後、第１のデイエンフアシス回路を通して再生信
号を得る映像信号記録再生装置において、 上記第１のデイエンフアシス回路の出力を入力
として垂直方向の空間周波数の高域成分を低域成
分に比して相対的にレベル減衰させる第２のデイ
エンフアシス回路と、 上記再生FM信号に欠落が生じたとき該欠落期
間に相当する期間ドロツプアウト補償信号を出力
するドロツプアウト検出手段と、 上記ドロツプアウト補償信号を受けて上記欠落
期間上記第２のデイエンフアシス回路への入力信
号を該第２のデイエンフアシス回路内の遅延線を
通した信号に切替える切替手段とを備えたことを
特徴とする映像信号記録再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60125635A JPS61284873A (ja) | 1985-06-10 | 1985-06-10 | 映像信号記録再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60125635A JPS61284873A (ja) | 1985-06-10 | 1985-06-10 | 映像信号記録再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61284873A JPS61284873A (ja) | 1986-12-15 |
| JPH0330944B2 true JPH0330944B2 (ja) | 1991-05-01 |
Family
ID=14914914
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60125635A Granted JPS61284873A (ja) | 1985-06-10 | 1985-06-10 | 映像信号記録再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61284873A (ja) |
-
1985
- 1985-06-10 JP JP60125635A patent/JPS61284873A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61284873A (ja) | 1986-12-15 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |