JPH0334141U - - Google Patents
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- Publication number
- JPH0334141U JPH0334141U JP9358489U JP9358489U JPH0334141U JP H0334141 U JPH0334141 U JP H0334141U JP 9358489 U JP9358489 U JP 9358489U JP 9358489 U JP9358489 U JP 9358489U JP H0334141 U JPH0334141 U JP H0334141U
- Authority
- JP
- Japan
- Prior art keywords
- reset
- modules
- request information
- processor
- multiprocessor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Hardware Redundancy (AREA)
- Multi Processors (AREA)
Description
第１図は第１図は本考案を施したリセツト装置
の構成を示す回路図、第２図は第１図のリセツト
装置を施したモジユールを有するマイクロプロセ
ツサシステムの構成を示すブロツク図、第３図は
第２図におけるモジユール間の動作を示すシーケ
ンス図、第４図は第２図におけるモジユールの処
理動作を示すフローチヤート、第５図は従来技術
におけるマルチプロセツサシステムの接続構成を
示すブロツク図、第６図は第５図におけるモジユ
ール間の動作を示すシーケンス図、第７図は従来
の一般的なリセツト装置の構成を示す回路図であ
る。 Ｒ１〜Ｒ４……抵抗、Ｃ５……コンデンサ、６
……リセツトＳＷ、７，８……インバータ、９〜
１１……オープンコレクタインバータ、１２……
ＣＰＵ、１３……システムリセツト線、１４……
システムバス、１５……ワンシヨツトマルチバイ
ブレータ、１６，１７……Ｉ／Ｏアドレスコーダ
、１８……コントロールバス、１９……アドレス
バス、２０……データバス、２０〜２４……モジ
ユール、２５〜２７……ＣＰＵ、２８〜３１……
状態監視回路、３２〜３５……リセツト要求情報
出力回路、３６〜３９……リセツト装置、４０…
…割込み（コマンド）信号、４１……割込み（レ
スポンス）信号、４２……システムリセツトコン
トローラ、４３……リセツトコントローラ、４４
……メモリ、４５……メモリＩ／Ｆ、４６……バ
スインタフエース、４７……バスドライバ、４８
……タイマ、４９……リセツトコントローラ、５
０……メモリ、５１……メモリＩ／Ｆ、５２……
バスインタフエース、５３……バスドライバ、５
４……タイマ、５５〜５８……モジユール、５９
〜６２……ＣＰＵ、６３……割込み（コマンド）
信号、６４……割込み（レスポンス）信号、Ｒ７
１〜Ｒ７５……抵抗、Ｃ７６……コンデンサ、７
７……インバーダ、７８，７９……オープンコレ
クタインバータ。
の構成を示す回路図、第２図は第１図のリセツト
装置を施したモジユールを有するマイクロプロセ
ツサシステムの構成を示すブロツク図、第３図は
第２図におけるモジユール間の動作を示すシーケ
ンス図、第４図は第２図におけるモジユールの処
理動作を示すフローチヤート、第５図は従来技術
におけるマルチプロセツサシステムの接続構成を
示すブロツク図、第６図は第５図におけるモジユ
ール間の動作を示すシーケンス図、第７図は従来
の一般的なリセツト装置の構成を示す回路図であ
る。 Ｒ１〜Ｒ４……抵抗、Ｃ５……コンデンサ、６
……リセツトＳＷ、７，８……インバータ、９〜
１１……オープンコレクタインバータ、１２……
ＣＰＵ、１３……システムリセツト線、１４……
システムバス、１５……ワンシヨツトマルチバイ
ブレータ、１６，１７……Ｉ／Ｏアドレスコーダ
、１８……コントロールバス、１９……アドレス
バス、２０……データバス、２０〜２４……モジ
ユール、２５〜２７……ＣＰＵ、２８〜３１……
状態監視回路、３２〜３５……リセツト要求情報
出力回路、３６〜３９……リセツト装置、４０…
…割込み（コマンド）信号、４１……割込み（レ
スポンス）信号、４２……システムリセツトコン
トローラ、４３……リセツトコントローラ、４４
……メモリ、４５……メモリＩ／Ｆ、４６……バ
スインタフエース、４７……バスドライバ、４８
……タイマ、４９……リセツトコントローラ、５
０……メモリ、５１……メモリＩ／Ｆ、５２……
バスインタフエース、５３……バスドライバ、５
４……タイマ、５５〜５８……モジユール、５９
〜６２……ＣＰＵ、６３……割込み（コマンド）
信号、６４……割込み（レスポンス）信号、Ｒ７
１〜Ｒ７５……抵抗、Ｃ７６……コンデンサ、７
７……インバーダ、７８，７９……オープンコレ
クタインバータ。
Claims (1)
- それぞれにプロセツサを含み、かつ、システム
バスを介して互いのプロセツサの異常状態を検出
する状態監視回路を持つ複数のモジユールを有し
、種々の処理を該複数のモジユールで分散して行
うマルチプロセツサシステムにおいて、上記複数
のモジユールの各々には、上記状態監視回路によ
る異常状態検出動作に基づきリセツト要求情報を
出力するリセツト要求情報出力回路と該リセツト
要求情報に基づき、上記プロセツサにリセツトを
掛けるリセツト手段を設けたことを特徴とするマ
ルチプロセツサシステムリセツト装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9358489U JPH0334141U (ja) | 1989-08-09 | 1989-08-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9358489U JPH0334141U (ja) | 1989-08-09 | 1989-08-09 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0334141U true JPH0334141U (ja) | 1991-04-03 |
Family
ID=31642956
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9358489U Pending JPH0334141U (ja) | 1989-08-09 | 1989-08-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0334141U (ja) |
-
1989
- 1989-08-09 JP JP9358489U patent/JPH0334141U/ja active Pending
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