JPH0339945U - - Google Patents

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JPH0339945U
JPH0339945U JP10047489U JP10047489U JPH0339945U JP H0339945 U JPH0339945 U JP H0339945U JP 10047489 U JP10047489 U JP 10047489U JP 10047489 U JP10047489 U JP 10047489U JP H0339945 U JPH0339945 U JP H0339945U
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JP
Japan
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clock signal
pll circuit
reproduces
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buffer memory
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Landscapes

  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の一実施例の構成を示すブロ
ツク図。第２図はこの考案の一実施例の適用例の
他の一例を示すブロツク図。第３図は従来技術の
構成を示すブロツク図。 １…第１段目のＰＬＬ回路、２…バツフアメモ
リ、３…電圧制御発振器、５…ライトアドレスカ
ウンタ、６…リードアドレスカウンタ、７…アド
レス差検出回路、８…ローパスフイルタ、１０…
タイムベースコレクタ、１１…第２段目のＰＬＬ
回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 受信データから第１クロツク信号を再生し、か
    つカウント出力で受信データを記憶するバツフア
    メモリのライトアドレスを指定するライトアドレ
    スカウンタへ再生した第１クロツク信号を供給す
    る第１段目のＰＬＬ回路と、第２クロツク信号を
    再生し、かつバツフアメモリのリードアドレスを
    指定するリードアドレスカウンタへ再生した第２
    クロツク信号を供給する第２段目のＰＬＬ回路と
    からなる２重ＰＬＬ回路において、ライトアドレ
    ス値をＷＡ、リードアドレス値をＲＡおよびオフ
    セツトアドレス値をＯＡとしたとき〔ＷＡ−（Ｒ
    Ａ＋ＯＡ）〕の正負を検出するアドレス差検出回
    路を第２段目のＰＬＬ回路の位相比較器としたこ
    とを特徴とする２重ＰＬＬ方式。
JP1989100474U 1989-08-30 1989-08-30 ２重ｐｌｌ装置 Expired - Lifetime JPH0720974Y2 (ja)

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JP1989100474U JPH0720974Y2 (ja) 1989-08-30 1989-08-30 ２重ｐｌｌ装置

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JPH0339945U true JPH0339945U (ja) 1991-04-17
JPH0720974Y2 JPH0720974Y2 (ja) 1995-05-15

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11112338A (ja) * 1997-09-30 1999-04-23 Yamaha Corp 周波数制御方式

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62291230A (ja) * 1986-05-29 1987-12-18 ノ−ザン・テレコム・リミテツド 同期デ−タ信号生成のために非同期デ−タ信号を同期化する方法及び装置

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62291230A (ja) * 1986-05-29 1987-12-18 ノ−ザン・テレコム・リミテツド 同期デ−タ信号生成のために非同期デ−タ信号を同期化する方法及び装置

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH11112338A (ja) * 1997-09-30 1999-04-23 Yamaha Corp 周波数制御方式

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JPH0720974Y2 (ja) 1995-05-15

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