JPH0352716B2 - - Google Patents
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- Publication number
- JPH0352716B2 JPH0352716B2 JP59264839A JP26483984A JPH0352716B2 JP H0352716 B2 JPH0352716 B2 JP H0352716B2 JP 59264839 A JP59264839 A JP 59264839A JP 26483984 A JP26483984 A JP 26483984A JP H0352716 B2 JPH0352716 B2 JP H0352716B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- digital
- circuit
- blanking period
- analog
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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Landscapes
- Color Television Systems (AREA)
- Processing Of Color Television Signals (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、テレビジヨンの複合映像信号などの
カラー画像を記憶して再生する装置に関する。
カラー画像を記憶して再生する装置に関する。
背景技術
従来のテレビジヨン受信機は、アナログ信号処
理によつて複合映像信号を出力させ、この信号は
同期信号に応答して逐次陰極線管においてカラー
画像として再生されるものである。
理によつて複合映像信号を出力させ、この信号は
同期信号に応答して逐次陰極線管においてカラー
画像として再生されるものである。
一方、最近のIC（集積回路）や、LSI（大規模集
積回路）の技術進歩に伴い、複合映像信号をデジ
タル信号に変換して処理するデジタル信号処理が
行なわれるようになり、このデジタル処理過程に
おいて、デジタル信号に変換後、少なくとも１走
査線より数フレームまでの映像信号をメモリにス
トアし、所定の信号操作を行なつたのちに、随時
アナログ信号に変換して陰極線管においてカラー
画像を再生するようにしたテレビジヨン受信機が
開発されている。
積回路）の技術進歩に伴い、複合映像信号をデジ
タル信号に変換して処理するデジタル信号処理が
行なわれるようになり、このデジタル処理過程に
おいて、デジタル信号に変換後、少なくとも１走
査線より数フレームまでの映像信号をメモリにス
トアし、所定の信号操作を行なつたのちに、随時
アナログ信号に変換して陰極線管においてカラー
画像を再生するようにしたテレビジヨン受信機が
開発されている。
発明が解決しようとする問題点
このような先行技術では、メモリに映像信号と
同期信号とがストアされるため、大容量のメモリ
を必要とし、回路の小形化を図ることができな
い。そこで、陰極線管に画像表示される映像信号
のみをメモリにストアして帰線消去期間部分を除
去するような構成も考えた場合、色信号の帰線消
去期間部分は３原色信号に再現するために基準レ
ベルとなる重要な要素であるため、これを再び再
生するための手段が必要となる。
同期信号とがストアされるため、大容量のメモリ
を必要とし、回路の小形化を図ることができな
い。そこで、陰極線管に画像表示される映像信号
のみをメモリにストアして帰線消去期間部分を除
去するような構成も考えた場合、色信号の帰線消
去期間部分は３原色信号に再現するために基準レ
ベルとなる重要な要素であるため、これを再び再
生するための手段が必要となる。
本発明は、上述の技術的課題を解決し、メモリ
の容量を少なくし、かつ簡単な構成で色信号の帰
線消去期間部分の再生を行なうことができるよう
にした映像信号の記憶再生装置を提供することで
ある。
の容量を少なくし、かつ簡単な構成で色信号の帰
線消去期間部分の再生を行なうことができるよう
にした映像信号の記憶再生装置を提供することで
ある。
実施例
第１図は、本発明の一実施例のブロツク図であ
る。この色信号処理回路１は基本的には、輝度信
号Ｙと、第１および第２色差信号Ｒ−Ｙ，Ｂ−Ｙ
とをアナログ／デジタル変換するアナログ／デジ
タル変換回路２と、アナログ／デジタル変換回路
２からのデジタル信号のうち、帰線消去期間の信
号を除去してストアするメモリ３と、メモリ３か
らのデジタル信号を読み出してデジタル／アナロ
グ変換するデジタル／アナログ変換回路４と、デ
ジタル／アナログ変換回路４からのアナログ信号
の帰線消去期間に調整可能な直流バイアス信号を
与える電圧調整手段である直流バイアス回路５と
を含む。アナログ／デジタル変換回路２、メモリ
３、デジタル／アナログ変換回路４および後述す
る制御回路７は、メモリ手段を構成する。
る。この色信号処理回路１は基本的には、輝度信
号Ｙと、第１および第２色差信号Ｒ−Ｙ，Ｂ−Ｙ
とをアナログ／デジタル変換するアナログ／デジ
タル変換回路２と、アナログ／デジタル変換回路
２からのデジタル信号のうち、帰線消去期間の信
号を除去してストアするメモリ３と、メモリ３か
らのデジタル信号を読み出してデジタル／アナロ
グ変換するデジタル／アナログ変換回路４と、デ
ジタル／アナログ変換回路４からのアナログ信号
の帰線消去期間に調整可能な直流バイアス信号を
与える電圧調整手段である直流バイアス回路５と
を含む。アナログ／デジタル変換回路２、メモリ
３、デジタル／アナログ変換回路４および後述す
る制御回路７は、メモリ手段を構成する。
映像信号であるテレビジヨンの複合映像信号は
映像信号処理回路６において輝度信号Ｙと、色差
信号Ｒ−Ｙ，Ｂ−Ｙとに復調され、水平同期信号
Ｈおよび垂直同期信号Ｖが分離される。この映像
信号処理回路６からの輝度信号Ｙおよび色差信号
Ｒ−Ｙ，Ｂ−Ｙをラインｌ１，ｌ２，ｌ３をそれ
ぞれ介してアナログ／デジタル変換回路２に与え
られる。アナログ／デジタル変換回路２におい
て、アナログ／デジタル変換された各デジタル信
号は、後述する制御回路７からのサンプリングク
ロツクlaに同期して、ラインｌ１１，ｌ１２，ｌ
１３にそれぞれ導出される。ラインｌ１１〜ｌ１
３からの各デジタル信号は、帰線消去期間に含ま
れるデジタル信号を除いてメモリ３にストアされ
る。このメモリ３は、各デジタル信号をストアす
る容量を備えており、後述の表示手段である陰極
線管CRTの画面に表示される水平走査期間のデ
ジタル信号のみが制御回路７からのアドレス信号
lbに従つてストアされる。これによつて、陰極線
管CRTに画像表示されることのない水平帰線消
去期間のデジタル信号の分だけメモリ３の容量を
小さくすることができる。このメモリ３にストア
されたデジタル信号は、アドレス信号lbにしたが
つてラインｌ２１，ｌ２２，ｌ２３に読み出さ
れ、ラツチ回路８にそれぞれ与えられる。ラツチ
回路８からは制御回路７からの転送クロツクlcに
従つて、各デジタル信号がラインｌ３１，ｌ３
２，ｌ３３に出力され、デジタル／アナログ変換
回路４にそれぞれ与えられる。デジタル／アナロ
グ変換回路４からのアナログの輝度信号Ｙは、ラ
インｌ４１を介して復原手段であるマトリクス回
路９に与えられ、またデジタル／アナログ変換回
路４からのアナログの色差信号Ｒ−Ｙ，Ｂ−Ｙ
は、ラインｌ４２，ｌ４３を介して直流バイアス
回路５に入力され、この直流バイアス回路５にお
いて後述するように帰線消去期間に、直流バイア
ス信号が与えられた色差信号Ｒ−Ｙ，Ｂ−Ｙは、
ラインｌ５２，ｌ５３を介してマトリクス回路９
にそれぞれ与えられる。マトリクス回路９におい
て輝度信号Ｙと色差信号Ｒ−Ｙ，Ｂ−Ｙとから原
色信号が再生され、ラインlxを介して陰極線管
CRTに与えられ、カラー画像が再生される。
映像信号処理回路６において輝度信号Ｙと、色差
信号Ｒ−Ｙ，Ｂ−Ｙとに復調され、水平同期信号
Ｈおよび垂直同期信号Ｖが分離される。この映像
信号処理回路６からの輝度信号Ｙおよび色差信号
Ｒ−Ｙ，Ｂ−Ｙをラインｌ１，ｌ２，ｌ３をそれ
ぞれ介してアナログ／デジタル変換回路２に与え
られる。アナログ／デジタル変換回路２におい
て、アナログ／デジタル変換された各デジタル信
号は、後述する制御回路７からのサンプリングク
ロツクlaに同期して、ラインｌ１１，ｌ１２，ｌ
１３にそれぞれ導出される。ラインｌ１１〜ｌ１
３からの各デジタル信号は、帰線消去期間に含ま
れるデジタル信号を除いてメモリ３にストアされ
る。このメモリ３は、各デジタル信号をストアす
る容量を備えており、後述の表示手段である陰極
線管CRTの画面に表示される水平走査期間のデ
ジタル信号のみが制御回路７からのアドレス信号
lbに従つてストアされる。これによつて、陰極線
管CRTに画像表示されることのない水平帰線消
去期間のデジタル信号の分だけメモリ３の容量を
小さくすることができる。このメモリ３にストア
されたデジタル信号は、アドレス信号lbにしたが
つてラインｌ２１，ｌ２２，ｌ２３に読み出さ
れ、ラツチ回路８にそれぞれ与えられる。ラツチ
回路８からは制御回路７からの転送クロツクlcに
従つて、各デジタル信号がラインｌ３１，ｌ３
２，ｌ３３に出力され、デジタル／アナログ変換
回路４にそれぞれ与えられる。デジタル／アナロ
グ変換回路４からのアナログの輝度信号Ｙは、ラ
インｌ４１を介して復原手段であるマトリクス回
路９に与えられ、またデジタル／アナログ変換回
路４からのアナログの色差信号Ｒ−Ｙ，Ｂ−Ｙ
は、ラインｌ４２，ｌ４３を介して直流バイアス
回路５に入力され、この直流バイアス回路５にお
いて後述するように帰線消去期間に、直流バイア
ス信号が与えられた色差信号Ｒ−Ｙ，Ｂ−Ｙは、
ラインｌ５２，ｌ５３を介してマトリクス回路９
にそれぞれ与えられる。マトリクス回路９におい
て輝度信号Ｙと色差信号Ｒ−Ｙ，Ｂ−Ｙとから原
色信号が再生され、ラインlxを介して陰極線管
CRTに与えられ、カラー画像が再生される。
一方、信号処理回路１において複合映像信号か
ら分離された水平同期信号Ｈおよび垂直同期信号
Ｖは、ラインlH，lVを介して制御回路７にそれ
ぞれ与えられる。制御回路７は高精度の水晶発振
子などによつて実現される発振回路１０からの基
準クロツクおよび前記同期信号Ｈ，Ｖに同期した
サンプリングクロツクla、アドレス信号lbおよび
転送クロツクlcを作成する。このサンプリングク
ロツクlaは前述のようにアナログ／デジタル変換
回路２に与えられ、アドレス信号lbはメモリ３に
与えられ、また、転送クロツクlcはラツチ回路８
に与えられる。制御回路７には制御回路７のオン
動作およびオフ動作を行なうためのスイツチＳが
設けられる。スイツチＳが、一時的にオン状態に
なつたとき、そのオン状態のタイミングで映像処
理回路１からの１フイールドまたは１フレーム分
の映像信号が、陰極線管CRTに静止画像として
再現され、またスイツチＳを間欠的にオン状態と
したとき、そのオン動作のタイミングで陰極線管
CRTには、動画像が間欠的に静止して再現され
ることができる。
ら分離された水平同期信号Ｈおよび垂直同期信号
Ｖは、ラインlH，lVを介して制御回路７にそれ
ぞれ与えられる。制御回路７は高精度の水晶発振
子などによつて実現される発振回路１０からの基
準クロツクおよび前記同期信号Ｈ，Ｖに同期した
サンプリングクロツクla、アドレス信号lbおよび
転送クロツクlcを作成する。このサンプリングク
ロツクlaは前述のようにアナログ／デジタル変換
回路２に与えられ、アドレス信号lbはメモリ３に
与えられ、また、転送クロツクlcはラツチ回路８
に与えられる。制御回路７には制御回路７のオン
動作およびオフ動作を行なうためのスイツチＳが
設けられる。スイツチＳが、一時的にオン状態に
なつたとき、そのオン状態のタイミングで映像処
理回路１からの１フイールドまたは１フレーム分
の映像信号が、陰極線管CRTに静止画像として
再現され、またスイツチＳを間欠的にオン状態と
したとき、そのオン動作のタイミングで陰極線管
CRTには、動画像が間欠的に静止して再現され
ることができる。
第２図は、直流バイアス回路５の電気回路図で
あり、第３図は色差信号Ｒ−ＹまたはＢ−Ｙの波
形図である。直流バイアス回路５は、第２図に示
すようにトランジスタTr１，Tr２，Tr３を含
む。トランジスタTr１のベースにはラインｌ４
２を介して、デジタル／アナログ変換回路４から
の色差信号Ｒ−Ｙが入力され、トランジスタTr
２のベースにはラインｌ４３を介して、デジタ
ル／アナログ変換回路４から色差信号Ｂ−Ｙが入
力されまたトランジスタTr３のベースにはライ
ンｌ６２を介して、同期信号lH，lVが入力され
る。
あり、第３図は色差信号Ｒ−ＹまたはＢ−Ｙの波
形図である。直流バイアス回路５は、第２図に示
すようにトランジスタTr１，Tr２，Tr３を含
む。トランジスタTr１のベースにはラインｌ４
２を介して、デジタル／アナログ変換回路４から
の色差信号Ｒ−Ｙが入力され、トランジスタTr
２のベースにはラインｌ４３を介して、デジタ
ル／アナログ変換回路４から色差信号Ｂ−Ｙが入
力されまたトランジスタTr３のベースにはライ
ンｌ６２を介して、同期信号lH，lVが入力され
る。
トランジスタTr１，Tr２の各ベースには帰線
消去期間中にバイアス調整用可変抵抗器VRによ
つて制御されるトランジスタTr３のバイアス電
圧が加わるように構成される。たとえば第３図に
示されるような色差信号がデジタル／アナログ変
換回路４から出力された場合を想定すると、この
水平帰線期間だけトランジスタTr３がオフとな
り、バイアス調整用可変抵抗器VRによつてレベ
ル調整されたバイアス電圧が、ダイオードＤ１，
Ｄ２を介してトランジスタTr１，Tr２の各ベー
スにそれぞれ加えられる。トランジスタTr３は、
垂直帰線期間においても水平帰線期間と同様にオ
フとなる。トランジスタTr３がオンとなるとき
は、コレクタ電圧が零に近くなり、ダイオードＤ
１，Ｄ２が逆バイアスされるので、バイアス電圧
は加えられない。バイアス電圧のレベルをバイア
ス調整用可変抵抗器VRによつて第３図に示され
るデジタル／アナログ変換回路４の出力の帰線消
去期間に適当なバイアスを加えることにより最適
な色バランスに調整することができる。また、バ
イアス調整用可変抵抗器VRを調整することによ
つて、アナログ／デジタル変換回路２の基準電圧
に依存しなくて色差信号の色バランスの変化を防
ぐことができる。また、バイアス調整用可変抵抗
器VRによつて、レベル調整された直流バイアス
信号をアナログ変換された色差信号の帰線消去期
間に付加するだけで、色バランスの調整を行うこ
とができるので、コストの低減化、信頼性の向上
を図ることができる。
消去期間中にバイアス調整用可変抵抗器VRによ
つて制御されるトランジスタTr３のバイアス電
圧が加わるように構成される。たとえば第３図に
示されるような色差信号がデジタル／アナログ変
換回路４から出力された場合を想定すると、この
水平帰線期間だけトランジスタTr３がオフとな
り、バイアス調整用可変抵抗器VRによつてレベ
ル調整されたバイアス電圧が、ダイオードＤ１，
Ｄ２を介してトランジスタTr１，Tr２の各ベー
スにそれぞれ加えられる。トランジスタTr３は、
垂直帰線期間においても水平帰線期間と同様にオ
フとなる。トランジスタTr３がオンとなるとき
は、コレクタ電圧が零に近くなり、ダイオードＤ
１，Ｄ２が逆バイアスされるので、バイアス電圧
は加えられない。バイアス電圧のレベルをバイア
ス調整用可変抵抗器VRによつて第３図に示され
るデジタル／アナログ変換回路４の出力の帰線消
去期間に適当なバイアスを加えることにより最適
な色バランスに調整することができる。また、バ
イアス調整用可変抵抗器VRを調整することによ
つて、アナログ／デジタル変換回路２の基準電圧
に依存しなくて色差信号の色バランスの変化を防
ぐことができる。また、バイアス調整用可変抵抗
器VRによつて、レベル調整された直流バイアス
信号をアナログ変換された色差信号の帰線消去期
間に付加するだけで、色バランスの調整を行うこ
とができるので、コストの低減化、信頼性の向上
を図ることができる。
効 果
以上のように本発明によれば、映像信号に含ま
れる輝度信号Ｙ，第１および第２色差信号Ｒ−
Ｙ，Ｂ−Ｙを、水平帰線消去期間中または垂直帰
線消去期間中にメモリ手段２，３，４，７にスト
アしないので、メモリ手段２，３，４，７の必要
とするメモリの容量を少なくすることができる。
また、調整可能な直流電圧をメモリ手段２，３，
４，７から読出した第１および第２色差信号Ｒ−
Ｙ，Ｂ−Ｙに与えるという簡単な構成によつて、
映像信号の復原を行うことができる。
れる輝度信号Ｙ，第１および第２色差信号Ｒ−
Ｙ，Ｂ−Ｙを、水平帰線消去期間中または垂直帰
線消去期間中にメモリ手段２，３，４，７にスト
アしないので、メモリ手段２，３，４，７の必要
とするメモリの容量を少なくすることができる。
また、調整可能な直流電圧をメモリ手段２，３，
４，７から読出した第１および第２色差信号Ｒ−
Ｙ，Ｂ−Ｙに与えるという簡単な構成によつて、
映像信号の復原を行うことができる。
また本発明によれば、電圧調整手段５が第１お
よび第２色差信号Ｒ−Ｙ，Ｂ−Ｙに調整可能な直
流電圧を与えることによつて、映像信号の色バラ
ンスを調整することができる。
よび第２色差信号Ｒ−Ｙ，Ｂ−Ｙに調整可能な直
流電圧を与えることによつて、映像信号の色バラ
ンスを調整することができる。
第１図は本発明の一実施例のブロツク図、第２
図は直流バイアス回路５の電気回路図、第３図は
色差信号の波形図である。 １……色信号処理回路、２……アナログ／デジ
タル変換回路、３……メモリ、４……デジタル／
アナログ変換回路、５……直流バイアス回路、
Tr１〜Tr３……トランジスタ、VR……バイア
ス調整用可変抵抗器。
図は直流バイアス回路５の電気回路図、第３図は
色差信号の波形図である。 １……色信号処理回路、２……アナログ／デジ
タル変換回路、３……メモリ、４……デジタル／
アナログ変換回路、５……直流バイアス回路、
Tr１〜Tr３……トランジスタ、VR……バイア
ス調整用可変抵抗器。
Claims (1)
- 【特許請求の範囲】 １ 映像信号に含まれる輝度信号Ｙと、第１およ
び第２の色信号Ｒ−Ｙ，Ｂ−Ｙとを、水平帰線消
去期間中または垂直帰線消去期間中の各信号Ｙ，
Ｒ−Ｙ，Ｂ−Ｙを除去してストアするメモリ手段
２，３，４，７と、 メモリ手段２，３，４，７のストア内容に応答
して、第１および第２色差信号Ｒ−Ｙ，Ｂ−Ｙを
読出した信号に対して、水平帰線消去期間中また
は垂直帰線消去期間中に、調整可能な直流電圧を
与える電圧調整手段５と、 メモリ手段２，３，４，７からの輝度信号Ｙ
と、電圧調整手段５からの第１および第２色差信
号Ｒ−Ｙ，Ｂ−Ｙとに応答して、各信号Ｙ，Ｒ−
Ｙ，Ｂ−Ｙを用いてメモリ手段２，３，４，７に
ストアされる前の映像信号を復原する復原手段９
と、 復原手段５からの出力に応答し、復原された映
像信号を表示する表示手段CRTとを含むことを
特徴とする映像信号の記憶再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26483984A JPS61142892A (ja) | 1984-12-15 | 1984-12-15 | 映像信号の記憶再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26483984A JPS61142892A (ja) | 1984-12-15 | 1984-12-15 | 映像信号の記憶再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61142892A JPS61142892A (ja) | 1986-06-30 |
| JPH0352716B2 true JPH0352716B2 (ja) | 1991-08-12 |
Family
ID=17408924
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26483984A Granted JPS61142892A (ja) | 1984-12-15 | 1984-12-15 | 映像信号の記憶再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61142892A (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5762680A (en) * | 1980-10-03 | 1982-04-15 | Nippon Telegr & Teleph Corp <Ntt> | Display controller |
-
1984
- 1984-12-15 JP JP26483984A patent/JPS61142892A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61142892A (ja) | 1986-06-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |