JPH0358119A - 外部記憶装置の二重化方式 - Google Patents
外部記憶装置の二重化方式Info
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- JPH0358119A JPH0358119A JP1194983A JP19498389A JPH0358119A JP H0358119 A JPH0358119 A JP H0358119A JP 1194983 A JP1194983 A JP 1194983A JP 19498389 A JP19498389 A JP 19498389A JP H0358119 A JPH0358119 A JP H0358119A
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- 238000003860 storage Methods 0.000 title claims abstract description 17
- 230000009977 dual effect Effects 0.000 title abstract 2
- 238000000034 method Methods 0.000 claims description 7
- 230000014759 maintenance of location Effects 0.000 abstract 1
- 230000002159 abnormal effect Effects 0.000 description 5
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は外部記憶装置の二重化方式に関し、特に二つの
外部記憶装置への入出力制御方式を伴った外部記憶装置
の二重化方式に関する。
外部記憶装置への入出力制御方式を伴った外部記憶装置
の二重化方式に関する。
従来、この種の二重化方式では、入出力要求処理を要求
する側でそれぞれの外部記憶装置に対して順に入出力要
求を行っていた。
する側でそれぞれの外部記憶装置に対して順に入出力要
求を行っていた。
上述した従来の外部記憶装置の二重化方式では、入出力
要求処理側で個別に入出力要求を出すので二重化を意識
する必要があるという欠点がある。
要求処理側で個別に入出力要求を出すので二重化を意識
する必要があるという欠点がある。
また、一方の装置に出力直後に入出力要求処理がダウン
したり、またはコンピュータそのものがダウンしたとき
、二つの外部記憶装置の内容が保障できないという欠点
がある。
したり、またはコンピュータそのものがダウンしたとき
、二つの外部記憶装置の内容が保障できないという欠点
がある。
本発明の外部記憶装置の二重化方式は、コンピュータの
外部記憶装置の二重化方式において、二重化する外部記
憶装置を主装置と副装置とに定義し、それらに同一情報
を書き込む機能とそれらの一方を読み込む機能とを有し
て構戒される。
外部記憶装置の二重化方式において、二重化する外部記
憶装置を主装置と副装置とに定義し、それらに同一情報
を書き込む機能とそれらの一方を読み込む機能とを有し
て構戒される。
次に、本発明について図面を参照して詳細に説明する。
第１図を参照すると、本発明の一実施例はコンピュータ
１の中に入出力要求処理機構２と入出力制御機構３とを
備え、コンピュータ１に外部記憶装置として、主装置４
と副装置５とが接続されている。入出力制御機構３は、
第２図で示される論理装置名と物理装置番号との対応表
を有しており、この対応表をもとに論理装置名から物理
装置番号へ変換して、後に述べる入出力制御を行う。
１の中に入出力要求処理機構２と入出力制御機構３とを
備え、コンピュータ１に外部記憶装置として、主装置４
と副装置５とが接続されている。入出力制御機構３は、
第２図で示される論理装置名と物理装置番号との対応表
を有しており、この対応表をもとに論理装置名から物理
装置番号へ変換して、後に述べる入出力制御を行う。
第３図は入出力要求処理機構２からの入力要求２１の例
について、入出力制御機構３での処理を説明している。
について、入出力制御機構３での処理を説明している。
第４図は入出力要求処理２からの出力要求２４の例につ
いて、入出力制御機構３での処理を説明している。
いて、入出力制御機構３での処理を説明している。
次に、入出力制御機構３の処理を具体的に第３図および
第４図を使って説明する。
第４図を使って説明する。
第３図で示される入出力要求処理２から論理装置名“０
１″に対して入力要求２１が入出力制御機構に対して出
され、入出力制御機構３は第２図の論理装置と物理装置
対応表より物理装置番号゜“ａ ｂ ”を得てまず主装
置４に入力要求コマンドの実行を行う。入力要求コマン
ドの終了時点で終了ステータスのチェックを行い正常終
了２２であれば、正常終了ステータスを入出カ要求処理
２へ返して入力要求２１を完了する。上に述べた終了ス
テータスが異常終了のときくステップ３２）、副装置５
の物理装置番号“’ ｃ ｄ ”を得て副装置５に入力
要求コマンドを実行する（ステップ３３）。
１″に対して入力要求２１が入出力制御機構に対して出
され、入出力制御機構３は第２図の論理装置と物理装置
対応表より物理装置番号゜“ａ ｂ ”を得てまず主装
置４に入力要求コマンドの実行を行う。入力要求コマン
ドの終了時点で終了ステータスのチェックを行い正常終
了２２であれば、正常終了ステータスを入出カ要求処理
２へ返して入力要求２１を完了する。上に述べた終了ス
テータスが異常終了のときくステップ３２）、副装置５
の物理装置番号“’ ｃ ｄ ”を得て副装置５に入力
要求コマンドを実行する（ステップ３３）。
入力要求コマンドの終了時点で終了ステータスのチェッ
クを行い（ステップ３４）、正常終了なら入出力要求処
理２へ正常終了ステータスを返して入力要求２１を完了
する。異常終了なら入出カ要求処理２の入力要求２１に
対して異常終了２３を返して入力要求２１を完了する。
クを行い（ステップ３４）、正常終了なら入出力要求処
理２へ正常終了ステータスを返して入力要求２１を完了
する。異常終了なら入出カ要求処理２の入力要求２１に
対して異常終了２３を返して入力要求２１を完了する。
第４図で示される入出力要求処理２がら論理装置名“０
１″に対して出カ要求２４が入出カ制御機構３に対して
出され、入出カ制御機構３は入カ時と同様にまず副装置
５の物理装置番号” ｃ ｄ ”を得て出力要求コマン
ドの実行を副装置５に対して行う（ステップ３５）。出
カコマンドの終了時点で終了ステータスのチェックを行
い（ステップ３６）、異常終了なら副装置のエラー処理
例えば装置切放し処理等の処理を行う（ステップ３Ｂ＞
。
１″に対して出カ要求２４が入出カ制御機構３に対して
出され、入出カ制御機構３は入カ時と同様にまず副装置
５の物理装置番号” ｃ ｄ ”を得て出力要求コマン
ドの実行を副装置５に対して行う（ステップ３５）。出
カコマンドの終了時点で終了ステータスのチェックを行
い（ステップ３６）、異常終了なら副装置のエラー処理
例えば装置切放し処理等の処理を行う（ステップ３Ｂ＞
。
正常終了のとき副装置５と同様に主装置４に出力コマン
ドを実行する〈ステップ３７）。出力コマンドの終了時
点で終了ステータスのチェックを行い（ステップ３８）
、異常終了なら副装置５のエラー処理と同様に主装置４
のエラー処理を行う（ステップ３つ）。そのときすでに
実行済の副装置５が異常終了ならば（ステップ３Ａ）入
出力要求処理２に対して異常終了ステータス２６を返す
。
ドを実行する〈ステップ３７）。出力コマンドの終了時
点で終了ステータスのチェックを行い（ステップ３８）
、異常終了なら副装置５のエラー処理と同様に主装置４
のエラー処理を行う（ステップ３つ）。そのときすでに
実行済の副装置５が異常終了ならば（ステップ３Ａ）入
出力要求処理２に対して異常終了ステータス２６を返す
。
主装置４の終了ステータスが正常終了なら入出力要求処
理２に対して正常終了２５を返し、出力要求２４を完了
する。
理２に対して正常終了２５を返し、出力要求２４を完了
する。
以上説明したように本発明は、入出力要求処理に対して
論理装置名で入出力要求を行うようにすることと、入出
力制御機構で物理装置の主装置，副装置に両方に対して
入出力制御することと、入力に対しては主装置・副装置
の順で入力要求することと、出力に対しては副装置・主
装置の順で出力要求することとにより、入出力要求中の
コンピュータダウンに対しても、主装置・副装置の内容
の統一化がはかれる効果がある。
論理装置名で入出力要求を行うようにすることと、入出
力制御機構で物理装置の主装置，副装置に両方に対して
入出力制御することと、入力に対しては主装置・副装置
の順で入力要求することと、出力に対しては副装置・主
装置の順で出力要求することとにより、入出力要求中の
コンピュータダウンに対しても、主装置・副装置の内容
の統一化がはかれる効果がある。
第１図は本発明の一実施例の構戊を示すブロック図、第
２図は論理装置と物理装置との対応を示すテーブルの説
明図、第３図は入力処理手順を示す流れ図、第４図は出
力処理手順を示す流れ図である． １・・・コンピュータ、２・・・入出力要求処理、３・
・・入出力制御機構、４・・・主装置、５・・・副装置
。
２図は論理装置と物理装置との対応を示すテーブルの説
明図、第３図は入力処理手順を示す流れ図、第４図は出
力処理手順を示す流れ図である． １・・・コンピュータ、２・・・入出力要求処理、３・
・・入出力制御機構、４・・・主装置、５・・・副装置
。
Claims (1)
- コンピュータの外部記憶装置の二重化方式において、二
重化する外部記憶装置を主装置と副装置とに定義し、そ
れらに同一情報を書き込む機能とそれらの一方を読み込
む機能とを有して成ることを特徴とする外部記憶装置二
重化方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1194983A JPH0358119A (ja) | 1989-07-26 | 1989-07-26 | 外部記憶装置の二重化方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1194983A JPH0358119A (ja) | 1989-07-26 | 1989-07-26 | 外部記憶装置の二重化方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0358119A true JPH0358119A (ja) | 1991-03-13 |
Family
ID=16333589
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1194983A Pending JPH0358119A (ja) | 1989-07-26 | 1989-07-26 | 外部記憶装置の二重化方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0358119A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08286839A (ja) * | 1995-02-13 | 1996-11-01 | Tsubasa Syst Kk | コンピュータシステム及び中継器 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62139172A (ja) * | 1985-12-13 | 1987-06-22 | Nec Corp | 磁気デイスク制御装置 |
| JPS62154365A (ja) * | 1985-12-27 | 1987-07-09 | Toshiba Corp | デ−タ記憶再生装置 |
-
1989
- 1989-07-26 JP JP1194983A patent/JPH0358119A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62139172A (ja) * | 1985-12-13 | 1987-06-22 | Nec Corp | 磁気デイスク制御装置 |
| JPS62154365A (ja) * | 1985-12-27 | 1987-07-09 | Toshiba Corp | デ−タ記憶再生装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08286839A (ja) * | 1995-02-13 | 1996-11-01 | Tsubasa Syst Kk | コンピュータシステム及び中継器 |
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