JPH0369151A - Mos型半導体集積回路装置 - Google Patents

Mos型半導体集積回路装置

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JPH0369151A
JPH0369151A JP20619689A JP20619689A JPH0369151A JP H0369151 A JPH0369151 A JP H0369151A JP 20619689 A JP20619689 A JP 20619689A JP 20619689 A JP20619689 A JP 20619689A JP H0369151 A JPH0369151 A JP H0369151A
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JP
Japan
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region
circuit element
semiconductor
element formation
charge storage
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Pending
Application number
JP20619689A
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English (en)
Inventor
Etsuko Ishii
悦子 石井
Takeshi Fukuda
毅 福田
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NEC IC Microcomputer Systems Co Ltd
Original Assignee
NEC IC Microcomputer Systems Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体集積回路装置に関し、特に電荷蓄積領
域を有するMOS型半導体集積回路装置に関する。
〔従来の技術〕
第4図は従来のMOS型半導体集積回路装置の一例を示
す半導体チップの平面図である。従来、その種のMOS
型半導体集積回路装置は、例えば、第4図に示すように
、−導電型半導体基板上に接地電位領域4とMOS)ラ
ンジスタで構成される論理素子領域3とが並べて複数個
形成され、一つの半導体回路素子形成領域2を構成して
いた。また、この半導体回路素子形成領域2の周辺には
、入出力端子であるポンディングパッド5が形成されて
おり、さらに、半導体基板上の第1の酸化膜と、その上
に形成された多結晶シリコン膜と、その多結晶シリコン
膜上の第2の酸化膜とでなる電荷蓄積領域1aが、半導
体素子形成領域の中に分散して形成されていた。
〔発明が解決しようとする課題〕
上述した従来のMOS型半導体集積回路装置は、電荷蓄
積領域を半導体回路素子形成領域内のみでしか形成しな
いため、MOS型半導体集積回路装置の面積を小さくで
きないという欠点がある。
本発明の目的は、かかる欠点を解消するMOS型半導体
集積回路装置を提供することにある。
〔課題を解決するための手段〕
本発明のMOS型半導体集積回路装置は、半導体基板上
に形成されたMOSトランジスタでなる論理回路素子を
有する半導体回路素子形成領域と、この半導体回路素子
形成領域の周囲を囲むように形成された二層の酸化膜に
挟まれた多結晶シリコン膜とでなる電荷蓄積領域とを有
している。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図は本発明のMOS型半導体集積回路装置の一実施
例を示す半導体チップの平面図、第2図は第1図の半導
体チップのA部を拡大して示した部分拡大平面図、第3
図は第2図のBB断面図である。このMOS型半導体集
積回路装置は、第1図に示すように、半導体回路素子形
成領域2の外周を囲むように、電荷蓄積領域1が連続し
て形成されることである。それ以外は従来例と同じであ
る。すなわち、この電荷蓄積領域1は第2図及び第3図
に示すように、半導体基板6と半導体基板6上に設けた
第1の酸化膜11と、第1の酸化膜11上に設けた多結
晶シリコン膜7と、多結晶シリコン膜7上に設けた第2
の酸化膜12からなるMOS構造に形成されている。ま
た、前述したように、第4図の従来の電荷蓄積領域1a
を、半導体回路素子形成領域2の周囲に形成することに
より、半導体回路素子形成領域2はMOS型半導体集積
回路装置を動作させるための逆導電型の論理素子領域3
のみとなり、前述の半導体回路素子形成領域2内に形成
される電荷蓄積領域1として用いていた面積を削除し、
半導体回路素子領域の面積の縮小化することが出来、ま
た、MOS型半導体集積回路装置の全体の面積を縮小化
を図ることができる。また、半導体回路素子形成領域内
に電荷蓄積領域が存在しないため、接地電位領域の電位
の浮上りや、接地電位領域の電位低下による論理回路素
子への悪影響がなくなるという利点もある。
〔発明の効果〕
以上説明したように本発明は、半導体回路素子形成領域
内に形成していた電荷蓄積領域を、半導体回路素子形成
領域外に形成することで、半導体集積回路素子内で電荷
蓄積部として用いていた面積を削除することができ、半
導体回路素子形成領域の面積の縮小化を図れるとともに
外形を小型化を図ることができる半導体集積回路装置が
得られるという効果がある。
膜、11・・・第1の酸化膜、12・・・第2の酸化膜

Claims (1)

    【特許請求の範囲】
  1. 半導体基板上に形成されたMOSトランジスタでなる論
    理回路素子を有する半導体回路素子形成領域と、この半
    導体回路素子形成領域の周囲を囲むように形成された二
    層の酸化膜に挟まれた多結晶シリコン膜とでなる電荷蓄
    積領域とを有することを特徴とするMOS型半導体集積
    回路装置。
JP20619689A 1989-08-08 1989-08-08 Mos型半導体集積回路装置 Pending JPH0369151A (ja)

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