JPH0380404A - 磁気ディスク装置 - Google Patents
磁気ディスク装置Info
- Publication number
- JPH0380404A JPH0380404A JP21687389A JP21687389A JPH0380404A JP H0380404 A JPH0380404 A JP H0380404A JP 21687389 A JP21687389 A JP 21687389A JP 21687389 A JP21687389 A JP 21687389A JP H0380404 A JPH0380404 A JP H0380404A
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- JP
- Japan
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- circuit
- oscillation
- write
- writing
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は磁気ディスク装置に関し、特にコンピュータシ
ステム等の補助記憶装置として使用される磁気ディスク
装置の構成回路である書込み回路に関する。
ステム等の補助記憶装置として使用される磁気ディスク
装置の構成回路である書込み回路に関する。
従来技術
従来、この種のディスク装置の書込み回路は、外部から
の書込み制御信号に従って外部からの書込みデータ信号
をそのまま磁化パターンとして書込むことによりその動
作を終了していた。
の書込み制御信号に従って外部からの書込みデータ信号
をそのまま磁化パターンとして書込むことによりその動
作を終了していた。
しかし、上述した従来の書込み回路による書込み動作で
は外部からの書込み信号の終了時点が外部からの書込み
データ信号と同期がとられているようなことはなく、書
込み動作の終了時点では磁気ヘッド部に流れている電流
は最大となっている確率が高い。
は外部からの書込み信号の終了時点が外部からの書込み
データ信号と同期がとられているようなことはなく、書
込み動作の終了時点では磁気ヘッド部に流れている電流
は最大となっている確率が高い。
このため、電流が最大さなった時点で書込み動作が終了
となった場合には、書込み動作中に発生した強い磁界に
よって発生した磁気的な歪が書込み終了後にもヘッド部
に残留してしまう。この歪は外部からの磁気的又は機械
的な応力により発散するが、その時のノイズによって読
出しデータに誤りを生ずる場合があるという欠点があっ
た。
となった場合には、書込み動作中に発生した強い磁界に
よって発生した磁気的な歪が書込み終了後にもヘッド部
に残留してしまう。この歪は外部からの磁気的又は機械
的な応力により発散するが、その時のノイズによって読
出しデータに誤りを生ずる場合があるという欠点があっ
た。
発明の目的
本発明は上述した従来の欠点を解決するためになされた
ものであり、その目的は書込み終了時における磁気的な
歪を減少し、信頼性の高い磁気ディスク装置を提供する
ことである。
ものであり、その目的は書込み終了時における磁気的な
歪を減少し、信頼性の高い磁気ディスク装置を提供する
ことである。
発明の構成
本発明による磁気ディスク装置は、書込みデータに応じ
たデータ信号を磁気ヘッド巻線に印加して磁気媒体に対
して書込みを行う磁気ディスク装置であって、次第に発
振周波数が高くなる発振信号を送出する発振手段を有し
、書込み動作終了時に前記データ信号の代わりに前記発
振信号を前記磁気ヘッド巻線に入力するようにしたこと
を特徴とする。
たデータ信号を磁気ヘッド巻線に印加して磁気媒体に対
して書込みを行う磁気ディスク装置であって、次第に発
振周波数が高くなる発振信号を送出する発振手段を有し
、書込み動作終了時に前記データ信号の代わりに前記発
振信号を前記磁気ヘッド巻線に入力するようにしたこと
を特徴とする。
実施例
以下、図面を用いて本発明の詳細な説明する。
第１図は本発明による磁気ディスク装置の一実施例の書
込み回路の構成を示すブロック図である。
込み回路の構成を示すブロック図である。
図において、本発明の一実施例による磁気ディスク装置
における書込み回路は発振回路１と、遅延回路２と、セ
レクタ回路３と、書込みドライバ回路４と、磁気ヘッド
５とを含んで構成されている。なお、１０は書込み制御
信号、１１は書込みデータ信号である。
における書込み回路は発振回路１と、遅延回路２と、セ
レクタ回路３と、書込みドライバ回路４と、磁気ヘッド
５とを含んで構成されている。なお、１０は書込み制御
信号、１１は書込みデータ信号である。
発振回路１はその出力１２の発振周波数が次第に高くな
るように構成されている。なお、その内部構成について
は後述する。
るように構成されている。なお、その内部構成について
は後述する。
遅延回路２は入力される書込み制御信号の後縁を遅らせ
る機能を有するものであり、時定数回路を含んで構成さ
れている。
る機能を有するものであり、時定数回路を含んで構成さ
れている。
セレクタ回路３は書込み制御信号１０の論理レベルに応
じて書込みデータ信号１１と発振回路１の出力１２とを
択一的に送出するものである。
じて書込みデータ信号１１と発振回路１の出力１２とを
択一的に送出するものである。
書込み制御信号１０は発振回路１の周波数制御用入力端
子と、遅延回路２の入力端子と、セレクタ回路３の選択
制御用の入力端子とに入力されている。また、書込みデ
ータ信号１１及び発振回路１の出力１２はともにセレク
タ回路３の被選択入力ＯＵ ’Ｅ’に入力されている。
子と、遅延回路２の入力端子と、セレクタ回路３の選択
制御用の入力端子とに入力されている。また、書込みデ
ータ信号１１及び発振回路１の出力１２はともにセレク
タ回路３の被選択入力ＯＵ ’Ｅ’に入力されている。
セレクタ回路３からの選択出力１３は書込みドライバ回
路４の書込み電流反転用の入力端子に入力されている。
路４の書込み電流反転用の入力端子に入力されている。
また、遅延回路２の出力１４は書込みドライバ回路４の
書込み／非書込み切替入力端子に入力されている。
書込み／非書込み切替入力端子に入力されている。
磁気ヘッド５は書込ドライバ回路４に接続されており、
その巻線には書込み電流１５が流れることとなる。
その巻線には書込み電流１５が流れることとなる。
次に、第２図を用いて本回路の動作を説明する。
第２図は第１図の各部の信号を示すタイムチャートであ
る。図においては、書込み制御信号１０と、書込みデー
タ信号１１と、発振回路１の出力１２と、遅延回路２の
出力１４と、選択出力１３と、書込み電流１５とが示さ
れている。なお、信号１０から１４については各信号の
論理レベルを表し、１５については磁気ヘッド５に流れ
る書込み電流１５の電流値を表すものとする。
る。図においては、書込み制御信号１０と、書込みデー
タ信号１１と、発振回路１の出力１２と、遅延回路２の
出力１４と、選択出力１３と、書込み電流１５とが示さ
れている。なお、信号１０から１４については各信号の
論理レベルを表し、１５については磁気ヘッド５に流れ
る書込み電流１５の電流値を表すものとする。
いま、書込み制御信号１０がイネーブル状態（−“０”
）になると遅延回路２の出力１４もローレベルとなる（
時刻Ｔｌ）。このとき、セレクタ回路３は書込みデータ
信号１１を選択する。すると、書込みドライバ回路４は
、選択出力１３に従って反転を行いながら書込み電流１
５を出力し、データの書込み動作を行う。
）になると遅延回路２の出力１４もローレベルとなる（
時刻Ｔｌ）。このとき、セレクタ回路３は書込みデータ
信号１１を選択する。すると、書込みドライバ回路４は
、選択出力１３に従って反転を行いながら書込み電流１
５を出力し、データの書込み動作を行う。
次に、書込み制御信号１０がディスエーブル状ａ（−７
１″）になると、セレクタ回路３は発振回路の出力１２
を選択する（時刻Ｔ２）。一方、発振回路１の出力１２
は書込み制御信号１０がディスエーブル状態になった時
点より所定の周波数から次第に高い周波数の発振へと移
行する。
１″）になると、セレクタ回路３は発振回路の出力１２
を選択する（時刻Ｔ２）。一方、発振回路１の出力１２
は書込み制御信号１０がディスエーブル状態になった時
点より所定の周波数から次第に高い周波数の発振へと移
行する。
このため、書込み電流１５は磁気ヘッド５の巻線による
インダクタンス等による立上りの遅れにより次第に減衰
してゆき、最後には流れなくなる。
インダクタンス等による立上りの遅れにより次第に減衰
してゆき、最後には流れなくなる。
この減衰により、磁気ヘッド５はバルクイレーズ（ｒ３
ｕｌｋ Ｅｒａｓｅ） 、すなわち交流消磁が行われた
状態となり、先述した磁気的な歪は残らないのである。
ｕｌｋ Ｅｒａｓｅ） 、すなわち交流消磁が行われた
状態となり、先述した磁気的な歪は残らないのである。
次に、第３図及び第４図を用いて第１図中の発振回路１
の内部構成について説明する。第３図及び第４図はとも
に発振回路１の内部構成例を示すブロック図であり、第
１図、第２図と同等部分は同一符号により示されている
。また、第３図にはアナログ的手法を用いた構成例、第
４図にはディジタル的手法を用いた構成例が示されてい
る。
の内部構成について説明する。第３図及び第４図はとも
に発振回路１の内部構成例を示すブロック図であり、第
１図、第２図と同等部分は同一符号により示されている
。また、第３図にはアナログ的手法を用いた構成例、第
４図にはディジタル的手法を用いた構成例が示されてい
る。
第３図（ａ）において、発振回路１はインバー夕３０と
、トランジスタＴｒと、抵抗Ｒ１及びＲ２と、コンデン
サＣと、電圧制御発振回路（以下、ＶＣＯと略す）３１
と、パルス幅を整えるための単安定マルチバイブレータ
（以下、ＭＭと略す）３２とを含んで構成されている。
、トランジスタＴｒと、抵抗Ｒ１及びＲ２と、コンデン
サＣと、電圧制御発振回路（以下、ＶＣＯと略す）３１
と、パルス幅を整えるための単安定マルチバイブレータ
（以下、ＭＭと略す）３２とを含んで構成されている。
なお、抵抗Ｒ１は電源電圧Ｖｃｃにプルアップされてい
る。
る。
かかる構成とされた発振回路１の動作について第３図（
ｂ）に示されているタイムチャートを用いて説明する。
ｂ）に示されているタイムチャートを用いて説明する。
まず、書込み制御信号１０がディスエーブル状態、すな
わちハイレベルであるとき、トランジスタＴｒはオフ状
態となる。すると、ＶＣＯ３１から送出され〜ＩＭ３２
によってパルス幅が整えられた出力１２は電圧Ｖｃｃの
値に応じた一定の周波数を有している。
わちハイレベルであるとき、トランジスタＴｒはオフ状
態となる。すると、ＶＣＯ３１から送出され〜ＩＭ３２
によってパルス幅が整えられた出力１２は電圧Ｖｃｃの
値に応じた一定の周波数を有している。
いま、時刻ＴＩにおいて書込み制御信号１０がイネーブ
ル状態、すなわちローレベルになると、トランジスタＴ
ｒはオン状態となる。すると、ＶＣＯ３１への入力信号
２０はローレベルになる。
ル状態、すなわちローレベルになると、トランジスタＴ
ｒはオン状態となる。すると、ＶＣＯ３１への入力信号
２０はローレベルになる。
なお、実際には一定の時定数をもってローレベルに変化
する。
する。
よって、ＶＣＯ３１から送出されＭＭ３２によってパル
ス幅が整えられた出力１２の周波数は時刻Ｔｌ以前より
低くなる。ここで、書込み動作が行われるのである。
ス幅が整えられた出力１２の周波数は時刻Ｔｌ以前より
低くなる。ここで、書込み動作が行われるのである。
書込み動作が終了し、書込み制御信号１０が時刻Ｔ２に
おいてディスエーブル状態、すなわちハイレベルになる
と、トランジスタＴ「は再びオフ状態となる。すると、
コンデンサＣが徐々に充電されてゆき、ＶＣＯ３１への
入力信号２０は抵抗Ｒ１とコンデンサＣとの時定数に応
じた曲線を描きながらハイレベルへと変化する。
おいてディスエーブル状態、すなわちハイレベルになる
と、トランジスタＴ「は再びオフ状態となる。すると、
コンデンサＣが徐々に充電されてゆき、ＶＣＯ３１への
入力信号２０は抵抗Ｒ１とコンデンサＣとの時定数に応
じた曲線を描きながらハイレベルへと変化する。
すると、この入力信号２０がローレベルからハイレベル
へとゆるやかに変化する間にＶＣＯ３１から送出されＭ
Ｍ ３２によってパルス幅が整えられた出力１２の周
波数は徐々に高くなり、もとの周波数に戻ることとなる
。よって、この出力１２をセレクタ回路３を介して書込
みドライバ回路４に入力すれば、磁気ヘッド５は先述の
ように交流消磁されるのである。
へとゆるやかに変化する間にＶＣＯ３１から送出されＭ
Ｍ ３２によってパルス幅が整えられた出力１２の周
波数は徐々に高くなり、もとの周波数に戻ることとなる
。よって、この出力１２をセレクタ回路３を介して書込
みドライバ回路４に入力すれば、磁気ヘッド５は先述の
ように交流消磁されるのである。
また、第４図（ａ）において、発振回路１は発振器４０
と、アンド回路４１と、カウンタ４２と、デコーダ４３
と、ナンド回路４４と、インバータ４５とを含んで構成
されている。なお、書込み制御信号１０はカウンタ４２
のマスタリセット端子Ｍｌ？に入力されている。
と、アンド回路４１と、カウンタ４２と、デコーダ４３
と、ナンド回路４４と、インバータ４５とを含んで構成
されている。なお、書込み制御信号１０はカウンタ４２
のマスタリセット端子Ｍｌ？に入力されている。
かかる構成とされた発振回路１の動作について第４図（
ｂ）に示されているタイムチャートを用いて説明する。
ｂ）に示されているタイムチャートを用いて説明する。
図においては、発振器４０の出力２１と、書込み制御信
号１０と、アンド回路４１の出力２２と、カウンタ４２
の出力２３と、カウンタ４２の出力２４と、発振回路ｌ
の出力１２とが示されている。なお、出力２３はカウン
タ４２のキャリに相当する信号である。
号１０と、アンド回路４１の出力２２と、カウンタ４２
の出力２３と、カウンタ４２の出力２４と、発振回路ｌ
の出力１２とが示されている。なお、出力２３はカウン
タ４２のキャリに相当する信号である。
まず、時刻Ｔｌにおいて書込み制御信号１０がイネーブ
ル状態、すなわち、ローレベルになると、カウンタ４２
はリセットされた状態となり、その出力２４は送出され
なくなる。ここで、書込み動作が行われる。書込動作が
終了し、書込み制御信号１０が時刻Ｔ２においてディス
エーブル状態、すなわちハイレベルになると、カウンタ
４２のリセット状態が解除される。
ル状態、すなわち、ローレベルになると、カウンタ４２
はリセットされた状態となり、その出力２４は送出され
なくなる。ここで、書込み動作が行われる。書込動作が
終了し、書込み制御信号１０が時刻Ｔ２においてディス
エーブル状態、すなわちハイレベルになると、カウンタ
４２のリセット状態が解除される。
すると、カウンタ４２はアンド回路４１を介して入力さ
れる発振器４０の出力２１の立上りタイミング毎に出力
２４の値をＤ １．Ｄ ２．・・・とカウントアツプし
て行く。この出力２４はデコーダ４３によってデコード
される。ここで、デコーダ４３のデコード出力はインバ
ータ４５によって反転された発振器４０の出力２１とと
もにナンド回路４４に入力されているため、発振回路１
の出力１２のパルス幅が徐々に短くなるように予めデコ
ード条件を定めておけば、必要とする信号が得られる。
れる発振器４０の出力２１の立上りタイミング毎に出力
２４の値をＤ １．Ｄ ２．・・・とカウントアツプし
て行く。この出力２４はデコーダ４３によってデコード
される。ここで、デコーダ４３のデコード出力はインバ
ータ４５によって反転された発振器４０の出力２１とと
もにナンド回路４４に入力されているため、発振回路１
の出力１２のパルス幅が徐々に短くなるように予めデコ
ード条件を定めておけば、必要とする信号が得られる。
よって、この出力１２をセレクタ回路３を介して書込み
ドライバ回路４に入力すれば、磁気ヘッド５は先述のよ
うに交流消磁されるのである。
ドライバ回路４に入力すれば、磁気ヘッド５は先述のよ
うに交流消磁されるのである。
なお、カウンタ４２からキャリ信号である出力２３が送
出されると、アンド回路４１によって発振器４０の出力
２１が抑止され、カウンタ４２のカウント動作は停止す
る。
出されると、アンド回路４１によって発振器４０の出力
２１が抑止され、カウンタ４２のカウント動作は停止す
る。
発明の効果
以上説明したように本発明は、磁気ディスク装置の書込
み回路内に交流消磁を行う手段を設け、書込み動作終了
時に消磁を行うことにより、書込終了時において磁気ヘ
ッドに残る歪を減らすことができ、歪の発散時における
ノイズによるデータの読出し誤りをなくし、磁気ディス
ク装置の信頼性を向上させることができるという効果が
ある。
み回路内に交流消磁を行う手段を設け、書込み動作終了
時に消磁を行うことにより、書込終了時において磁気ヘ
ッドに残る歪を減らすことができ、歪の発散時における
ノイズによるデータの読出し誤りをなくし、磁気ディス
ク装置の信頼性を向上させることができるという効果が
ある。
第１図は本発明の実施例による磁気ディスク装置の書込
み回路の構成を示すブロック図、第２図は第１図の各部
の信号を示すタイムチャート、第３図及び第４図は第１
図中の発振回路の内部構成例を示す回路図及びその動作
を示すタイムチャートである。 主要部分の符号の説明
み回路の構成を示すブロック図、第２図は第１図の各部
の信号を示すタイムチャート、第３図及び第４図は第１
図中の発振回路の内部構成例を示す回路図及びその動作
を示すタイムチャートである。 主要部分の符号の説明
Claims (1)
- （１）書込みデータに応じたデータ信号を磁気ヘッド巻
線に印加して磁気媒体に対して書込みを行う磁気ディス
ク装置であって、次第に発振周波数が高くなる発振信号
を送出する発振手段を有し、書込み動作終了時に前記デ
ータ信号の代わりに前記発振信号を前記磁気ヘッド巻線
に入力するようにしたことを特徴とする磁気ディスク装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21687389A JPH0380404A (ja) | 1989-08-23 | 1989-08-23 | 磁気ディスク装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21687389A JPH0380404A (ja) | 1989-08-23 | 1989-08-23 | 磁気ディスク装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0380404A true JPH0380404A (ja) | 1991-04-05 |
Family
ID=16695256
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21687389A Pending JPH0380404A (ja) | 1989-08-23 | 1989-08-23 | 磁気ディスク装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0380404A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03127303A (ja) * | 1989-10-12 | 1991-05-30 | Nec Gumma Ltd | 磁気記録装置の書込み回路 |
| JPH06203311A (ja) * | 1992-12-28 | 1994-07-22 | Teac Corp | 磁気記録再生装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5099524A (ja) * | 1973-12-28 | 1975-08-07 | ||
| JPS519417A (en) * | 1974-07-12 | 1976-01-26 | Fujitsu Ltd | Jikihetsudono shojihoshiki |
-
1989
- 1989-08-23 JP JP21687389A patent/JPH0380404A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5099524A (ja) * | 1973-12-28 | 1975-08-07 | ||
| JPS519417A (en) * | 1974-07-12 | 1976-01-26 | Fujitsu Ltd | Jikihetsudono shojihoshiki |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03127303A (ja) * | 1989-10-12 | 1991-05-30 | Nec Gumma Ltd | 磁気記録装置の書込み回路 |
| JPH06203311A (ja) * | 1992-12-28 | 1994-07-22 | Teac Corp | 磁気記録再生装置 |
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