JPH0385815A - リセット回路 - Google Patents
リセット回路Info
- Publication number
- JPH0385815A JPH0385815A JP22145189A JP22145189A JPH0385815A JP H0385815 A JPH0385815 A JP H0385815A JP 22145189 A JP22145189 A JP 22145189A JP 22145189 A JP22145189 A JP 22145189A JP H0385815 A JPH0385815 A JP H0385815A
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- JP
- Japan
- Prior art keywords
- voltage
- power supply
- reset
- resistor
- circuit
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、集積回路のパワーオンリセット信号を生成す
るリセット回路に係り、特に可変電圧の直流電源の出力
電圧をＯｖがら除々に加えた際に好適なリセット信号を
生成するリセット回路に関する。
るリセット回路に係り、特に可変電圧の直流電源の出力
電圧をＯｖがら除々に加えた際に好適なリセット信号を
生成するリセット回路に関する。
従来パワーオンリセット信号を生成するリセット回路は
第５図に示す構成が知られており、スイッチＳＷを入れ
たとき抵抗Ｒを介するコンデンサＣの充電期間を利用し
、Ｌｏｗの信号を負荷りへ出力してリセットを行ってい
た。かかる従来技術に関連する文献として特開昭６０−
４５２２１号公報が挙げられる。
第５図に示す構成が知られており、スイッチＳＷを入れ
たとき抵抗Ｒを介するコンデンサＣの充電期間を利用し
、Ｌｏｗの信号を負荷りへ出力してリセットを行ってい
た。かかる従来技術に関連する文献として特開昭６０−
４５２２１号公報が挙げられる。
上記従来技術は、電源電圧がＯｖから除々に増加してい
く際に出力されるリセット信号について配慮がされてお
らず、制御用集積回路付蛍光ランプなどに調光器を介し
て電源電圧を除々に制御用の集積回路に供給した際、集
積回路はパワーオンリセットができなかった。
く際に出力されるリセット信号について配慮がされてお
らず、制御用集積回路付蛍光ランプなどに調光器を介し
て電源電圧を除々に制御用の集積回路に供給した際、集
積回路はパワーオンリセットができなかった。
以下、このことを第３図を参照して詳しく説明する。
第３図は従来技術におけるリセット回路の基本的な回路
構成を改めて示す回路図である。図中、１４は可変直流
電圧源、８はツェナーダイオード、９は抵抗器、１０は
コンデンサ、１３はリセット端子のある集積回路である
９電圧源工４より急激に直流電圧Ｖ、を加えた場合、抵
抗器９、コンデンサ１０の時定数の関係により、集積回
路１３の電源電圧ＶＣＣ印加時にリセット信号が入力さ
れる。しかしながら電圧ｇ１４の出力電圧■□ を抵抗
器９、コンデンサ１０の時定数の関係より十分遅い時間
でＯｖから除々に加えていった場合、第４図に示すよう
に第３図中、集積回路１３に入力されるリセット信号は
集積回路工３の電源電圧ｖＣＣと同じ電圧値となるため
集積回路１３はリセットされないという問題があった。
構成を改めて示す回路図である。図中、１４は可変直流
電圧源、８はツェナーダイオード、９は抵抗器、１０は
コンデンサ、１３はリセット端子のある集積回路である
９電圧源工４より急激に直流電圧Ｖ、を加えた場合、抵
抗器９、コンデンサ１０の時定数の関係により、集積回
路１３の電源電圧ＶＣＣ印加時にリセット信号が入力さ
れる。しかしながら電圧ｇ１４の出力電圧■□ を抵抗
器９、コンデンサ１０の時定数の関係より十分遅い時間
でＯｖから除々に加えていった場合、第４図に示すよう
に第３図中、集積回路１３に入力されるリセット信号は
集積回路工３の電源電圧ｖＣＣと同じ電圧値となるため
集積回路１３はリセットされないという問題があった。
第４図の横軸はＯｖから除々に電源電圧を加えた際の電
圧源１４の電圧値を示す。
圧源１４の電圧値を示す。
本発明の目的は、上記問題点を解決し可変電圧源の動作
を損わず、リセット信号を発生することのできるリセッ
ト回路を提供することにある。
を損わず、リセット信号を発生することのできるリセッ
ト回路を提供することにある。
上記目的は、集積回路の電源電圧となる電圧ＶＣＣの他
に、ＶＣＣより小さな基準電圧Ｖ工と第２の電圧を発生
し、Ｖｌから得られた基準電圧と第２の電圧との比較結
果をリセット信号とすることにより遠戚される。
に、ＶＣＣより小さな基準電圧Ｖ工と第２の電圧を発生
し、Ｖｌから得られた基準電圧と第２の電圧との比較結
果をリセット信号とすることにより遠戚される。
直流電源の電圧を分割する直列に接続された第１〜第３
の抵抗器と同じく直流電源の電圧を分割する直列に接続
された第４・第５の抵抗器としてそれぞれ高電位側から
Ｒ，、Ｒ，、Ｒ，とＲ，、Ｒ。
の抵抗器と同じく直流電源の電圧を分割する直列に接続
された第４・第５の抵抗器としてそれぞれ高電位側から
Ｒ，、Ｒ，、Ｒ，とＲ，、Ｒ。
を接続し、Ｒ２，Ｒ，と並列にツェナーダイオードを逆
方向に接続する。このとき直流電源の最大電圧値を■。
方向に接続する。このとき直流電源の最大電圧値を■。
、ツェナーダイオードのツェナー電圧をＶｚとしたとき
の２式を満足するように各抵抗値を設定する。抵抗器Ｒ
３の両端電圧Ｖ１と抵抗器５の両端電圧Ｖ。
３の両端電圧Ｖ１と抵抗器５の両端電圧Ｖ。
を電圧比較手段へ入力し比較することでリセット信号を
出力する。こうすることで直流電源の電圧値をＯｖから
除々に上げていっても正しくリセットを行える。
出力する。こうすることで直流電源の電圧値をＯｖから
除々に上げていっても正しくリセットを行える。
以下、本発明の一実施例を第１図、第２図により説明す
る。第↓図は蛍光ランプを調光制御する回路の一部を示
し、１００Ｖの商用交流電源１・導通角制御回路２・整
流回路３・平滑コンデンサ４からなる点線で囲んだ箇所
は可変電圧の直流電源回路である。導通角制御回路２に
より平滑コンデンサ４の両端にＯ〜１． ＯＯＶの直流
電圧Ｖ４が得られる。直流電圧ｖ４をＯｖから除々に加
えていった場合、抵抗器６，７１．７２及びツェナーダ
イオード５．８のツェナー電圧Ｖｚにより抵抗器７１．
７２の両端に第２図中、ＶＣＣの直流電圧を得る。リセ
ット端子のある集積回路１３を初期化（リセット）させ
るためには、ｖＣＣが印加されたときリセットを入れて
やる必要がある。抵抗器９，１０及び保護用のツェナー
ダイオード８により抵抗器１０の両端電圧ｖ１゜をＶＣ
Ｃより小さい電圧値に設定してやり第２図中、■１゜の
直流電圧を得る。抵抗器７２の両端に得られる電圧ｖ７
□とｖｉ。をコンパレータ１２に入力し比較する。
る。第↓図は蛍光ランプを調光制御する回路の一部を示
し、１００Ｖの商用交流電源１・導通角制御回路２・整
流回路３・平滑コンデンサ４からなる点線で囲んだ箇所
は可変電圧の直流電源回路である。導通角制御回路２に
より平滑コンデンサ４の両端にＯ〜１． ＯＯＶの直流
電圧Ｖ４が得られる。直流電圧ｖ４をＯｖから除々に加
えていった場合、抵抗器６，７１．７２及びツェナーダ
イオード５．８のツェナー電圧Ｖｚにより抵抗器７１．
７２の両端に第２図中、ＶＣＣの直流電圧を得る。リセ
ット端子のある集積回路１３を初期化（リセット）させ
るためには、ｖＣＣが印加されたときリセットを入れて
やる必要がある。抵抗器９，１０及び保護用のツェナー
ダイオード８により抵抗器１０の両端電圧ｖ１゜をＶＣ
Ｃより小さい電圧値に設定してやり第２図中、■１゜の
直流電圧を得る。抵抗器７２の両端に得られる電圧ｖ７
□とｖｉ。をコンパレータ１２に入力し比較する。
抵抗器６をＲ工、７１をＲ，，７２をＲ１，９をＲ４゜
１０をＲ，：Ｖ４の最大値をＶ４（ｍａｘ）としたとき ならば ”’ Ｖｚ）−２Ｌ−Ｖ、でＶ、＞Ｖ。。
１０をＲ，：Ｖ４の最大値をＶ４（ｍａｘ）としたとき ならば ”’ Ｖｚ）−２Ｌ−Ｖ、でＶ、＞Ｖ。。
Ｒ，＋Ｒ，Ｒ，＋ Ｒ。
−」Ｌ−Ｖｚ＜ ”’ Ｖ、テＶｔｚ＜Ｖｚ。
Ｒ２＋Ｒ３Ｒ４＋Ｒ。
となるのでコンパレータ１２の出力端子にｖｌ。の電圧
値がＶ７□の電圧値を越えるまでＬｏｗとなる第２図中
のＲＥＳＥＴ電圧が得られ、これをリセット信号とする
ことで集積回路１３の電ｇ電圧ｖＣＣが印加されるとき
リセットをかけることができ、集積回路１３は初期化さ
れる。
値がＶ７□の電圧値を越えるまでＬｏｗとなる第２図中
のＲＥＳＥＴ電圧が得られ、これをリセット信号とする
ことで集積回路１３の電ｇ電圧ｖＣＣが印加されるとき
リセットをかけることができ、集積回路１３は初期化さ
れる。
第２図の横軸は可変電圧の直流電源をＯｖから除々に電
圧を加えた際の電圧源の電圧値を示す。
圧を加えた際の電圧源の電圧値を示す。
上記集積回路１３はＬ ｏｗ −Ｅ ｎａｂｌａのリセ
ット端子となっているがコンパレータ１２の入力を入れ
換えることによりＨｉｇｈ −Ｅ ｎａｂｌｅのリセッ
ト信号を得ることも可能である。
ット端子となっているがコンパレータ１２の入力を入れ
換えることによりＨｉｇｈ −Ｅ ｎａｂｌｅのリセッ
ト信号を得ることも可能である。
また、コンパレータを介してリセット信号を出力しであ
るため抵抗器６，７１，７２，９，１０の比率を変える
ことでｖｌ。、■７□の電圧値をかえ、任意の状態で集
積回路１３にリセットをかけることが可能である。
るため抵抗器６，７１，７２，９，１０の比率を変える
ことでｖｌ。、■７□の電圧値をかえ、任意の状態で集
積回路１３にリセットをかけることが可能である。
更に、０■から除々にＶ４の電圧値を上げていかず急激
にＶ、を入れてやりＶＣＣをＯＮした場合にも、抵抗器
１０と並列にコンデンサ１１を挿入してやることで抵抗
器９とコンデンサ１１の時定数の関係により集積回路１
３はリセットされる。
にＶ、を入れてやりＶＣＣをＯＮした場合にも、抵抗器
１０と並列にコンデンサ１１を挿入してやることで抵抗
器９とコンデンサ１１の時定数の関係により集積回路１
３はリセットされる。
また、■、２の代わりに集積回路のしきい値電圧を電圧
比較の対象とすることで、コンパレータを介さずにＶｉ
。をリセット信号としても集積回路をリセットすること
ができる。
比較の対象とすることで、コンパレータを介さずにＶｉ
。をリセット信号としても集積回路をリセットすること
ができる。
本発明によれば、導通角制御回路等を用いた可変電圧の
直流電源を使用して電源電圧をＯＶから除々に印加した
場合でもリセット信号を生成できるので可変電圧の直流
電源を利用する幅広い電子回路をパワーオンリセットで
きるという効果がある。
直流電源を使用して電源電圧をＯＶから除々に印加した
場合でもリセット信号を生成できるので可変電圧の直流
電源を利用する幅広い電子回路をパワーオンリセットで
きるという効果がある。
第１図は本発明の一実施例を示す回路図、第２図は第１
図における要部電圧波形を示すタイミングチャート、第
３図はパワーオンリセット回路の基本構成を示す回路図
、第４図は第３図における要部電圧波形を示すタイミン
グチャート、第５図は従来のリセット回路図、である。 １・・・交流電源、 ２・・・導通角制御回路、 ３・・・整流回路、 ４・１１・・・平滑コンデンサ、 ５・８・・・ツェナーダイオード、 ６・７１・７２・９・１０・・・抵抗器、１２゛・コン
パレータ、 １３・・・リセット端子付集積回路、 １４・・・可変電圧の直流電源。 田ｌて］ ＼ 策 図 策 図 にＣ −一−−−−レＶ４ 第 ３ 図 第 図 １ 第 図
図における要部電圧波形を示すタイミングチャート、第
３図はパワーオンリセット回路の基本構成を示す回路図
、第４図は第３図における要部電圧波形を示すタイミン
グチャート、第５図は従来のリセット回路図、である。 １・・・交流電源、 ２・・・導通角制御回路、 ３・・・整流回路、 ４・１１・・・平滑コンデンサ、 ５・８・・・ツェナーダイオード、 ６・７１・７２・９・１０・・・抵抗器、１２゛・コン
パレータ、 １３・・・リセット端子付集積回路、 １４・・・可変電圧の直流電源。 田ｌて］ ＼ 策 図 策 図 にＣ −一−−−−レＶ４ 第 ３ 図 第 図 １ 第 図
Claims (1)
- 【特許請求の範囲】 １、徐々に立ち上がって一定の最大電圧に達する直流電
源を負荷へ供給すると共に、該直流電源から前記負荷を
パワーオンリセットするためのリセット信号を生成して
供給するリセット回路において、 前記直流電源電圧を分割するための直列接続された第１
乃至第３の抵抗器と、同様に前記直流電源電圧を分割す
るための直列接続された第４及び第５の抵抗器と、前記
第２の抵抗器と第３の抵抗器との直列接続回路に逆極性
に接続された定電圧ダイオードと、前記第３の抵抗器の
両端より取り出された第１の電圧Ｖ１と前記第５の抵抗
器の両端より取り出された第２の電圧Ｖ２とを入力され
て比較しＶ１＞Ｖ２となったとき前記負荷に対してリセ
ット信号を出力する比較回路と、を具備し、 かつ前記第１乃至第５の各抵抗器の抵抗値をＲ１，Ｒ２
，Ｒ３，Ｒ４，Ｒ５とするとき、Ｒ５／（Ｒ４＋Ｒ５）
＜Ｒ３／（Ｒ１＋Ｒ２＋Ｒ３）なる関係が成立し、更に
、前記直列電源の最大電圧をＶ０、定電圧ダイオードの
ツェナー電圧をＶ＿ｚとするとき、 ｛Ｒ３／（Ｒ２＋Ｒ３）｝Ｖ＿ｚ＜ ｛Ｒ５／（Ｒ４＋Ｒ５）｝Ｖ０なる 関係が成立していることを特徴とするリセット回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22145189A JPH0385815A (ja) | 1989-08-30 | 1989-08-30 | リセット回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22145189A JPH0385815A (ja) | 1989-08-30 | 1989-08-30 | リセット回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0385815A true JPH0385815A (ja) | 1991-04-11 |
Family
ID=16766937
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22145189A Pending JPH0385815A (ja) | 1989-08-30 | 1989-08-30 | リセット回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0385815A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05291918A (ja) * | 1992-04-07 | 1993-11-05 | Mitsubishi Electric Corp | 混成集積回路 |
-
1989
- 1989-08-30 JP JP22145189A patent/JPH0385815A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05291918A (ja) * | 1992-04-07 | 1993-11-05 | Mitsubishi Electric Corp | 混成集積回路 |
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