JPH0397751U - - Google Patents

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JPH0397751U
JPH0397751U JP365490U JP365490U JPH0397751U JP H0397751 U JPH0397751 U JP H0397751U JP 365490 U JP365490 U JP 365490U JP 365490 U JP365490 U JP 365490U JP H0397751 U JPH0397751 U JP H0397751U
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memory
central processing
system bus
processing unit
register
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JP365490U
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【図面の簡単な説明】
第１図はこの考案の一実施例を示す図、第２図
はマルチプロセツサシステムを説明するための図
、第３図は従来の装置を示す図である。 図において１は中央処理装置、２はシステムバ
ス、３は中央処理回路、４はメモリ、５はメモリ
容量レジスタ、６はメモリ空間指定レジスタ、７
はアドレス比較回路、８はバス交換回路、９は比
較変換回路、１０はセレクタである。なお、図中
同一符号は同一または相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の中央処理装置が１つのシステムバスに接
    続され、前記システムバスを介して複数の中央処
    理装置内のメモリとデータ授受を行いながらデー
    タ処理を行う前記中央処理装置において、当該中
    央処理装置のメモリ容量を保持するメモリ容量レ
    ジスタと、システムバスから見た当該中央処理装
    置のメモリの領域情報を保持するメモリ空間指定
    レジスタと、当該中央処理装置がメモリアクセス
    する場合に、そのメモリアドレスがシステムバス
    から見た当該装置のメモリの領域内のアドレスで
    あるか否かをメモリ空間指定レジスタと比較し、
    判定すると同時に当該メモリのアドレスに変換し
    て出力する比較変換回路を持つことにより当該メ
    モリにアクセス可能としたことを特徴とする中央
    処理装置。
JP365490U 1990-01-19 1990-01-19 Pending JPH0397751U (ja)

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JP365490U JPH0397751U (ja) 1990-01-19 1990-01-19

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JP365490U JPH0397751U (ja) 1990-01-19 1990-01-19

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JPH0397751U true JPH0397751U (ja) 1991-10-08

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ID=31507463

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JP365490U Pending JPH0397751U (ja) 1990-01-19 1990-01-19

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