JPH0398584U - - Google Patents
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- Publication number
- JPH0398584U JPH0398584U JP712090U JP712090U JPH0398584U JP H0398584 U JPH0398584 U JP H0398584U JP 712090 U JP712090 U JP 712090U JP 712090 U JP712090 U JP 712090U JP H0398584 U JPH0398584 U JP H0398584U
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- supplied
- base
- video signal
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 230000005669 field effect Effects 0.000 claims description 5
- 239000002131 composite material Substances 0.000 claims 7
- 238000010586 diagram Methods 0.000 description 7
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical compound C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 description 1
Landscapes
- Studio Circuits (AREA)
Description
第1図はこの考案の第1実施例の構成を示す回
路図。第2図はこの考案の第1実施例における電
界効果トランジスタのゲート・ソース間電圧対ド
レイン電流特性図。第3図はこの考案の第1実施
例の作用説明に供する波形図。第4図はこの考案
の第2実施例の構成を示す回路図。第5図はこの
考案の第3実施例の構成を示す回路図。第6図は
従来例の構成を示す回路図。第7図は従来例の作
用の説明に供する波形図。 Q1……電界効果トランジスタ、Q2,Q3,
Q4およびQ5……トランジスタ、11……ペデ
スタルクランプ回路、12……ローパスフイルタ
、13……リレー。
路図。第2図はこの考案の第1実施例における電
界効果トランジスタのゲート・ソース間電圧対ド
レイン電流特性図。第3図はこの考案の第1実施
例の作用説明に供する波形図。第4図はこの考案
の第2実施例の構成を示す回路図。第5図はこの
考案の第3実施例の構成を示す回路図。第6図は
従来例の構成を示す回路図。第7図は従来例の作
用の説明に供する波形図。 Q1……電界効果トランジスタ、Q2,Q3,
Q4およびQ5……トランジスタ、11……ペデ
スタルクランプ回路、12……ローパスフイルタ
、13……リレー。
Claims (1)
- 【実用新案登録請求の範囲】 (1) フエード制御信号がゲートもしくはベース
に供給される第1のトランジスタと、一端にペデ
スタルクランプされたコンポジツト映像信号が供
給され、かつ他端に第1のトランジスタが直列接
続される抵抗とで構成された減衰回路と、 差動接続された第2および第3のトランジスタ
で構成され、第2のトランジスタのベースにペデ
スタルクランプされたコンポジツト映像信号が供
給され、かつ第3のトランジスタのベースに第1
のトランジスタの出力が供給されて低電位側のベ
ース電位に対応した電圧が出力されるエミツタホ
ロワを備え、 エミツタホロワの出力をフエーダ出力とするこ
とを特徴とする映像信号のフエーダ回路。 (2) フエード制御信号がゲートに供給される電
界効果トランジスタと、一端にペデスタルクラン
プされたコンポジツト映像信号が供給され、かつ
他端に電界効果トランジスタが直列接続される抵
抗とで構成された減衰回路と、 フエードオフ時にオフ状態に制御され、かつフ
エードオフ時以外のときにオン状態に制御される
第の4トランジスタと、 差動接続された第2および第3のトランジスタ
で構成され、第2のトランジスタのベースにペデ
スタルクランプされたコンポジツト映像信号が供
給され、かつ第3のトランジスタのベースに第4
のトランジスタを介して電界効果トランジスタの
出力が供給されて低電位側のベース電位に対応し
た電圧が出力されるエミツタホロワを備え、 エミツタホロワの出力をフエーダ出力とするこ
とを特徴とする映像信号のフエーダ回路。 (3) フエード制御信号がゲートもしくはベース
に供給される第1のトランジスタと、一端にペデ
スタルクランプされたコンポジツト映像信号が供
給され、かつ他端に第1のトランジスタが直列接
続される抵抗とで構成された減衰回路と、 差動接続された第2および第3のトランジスタ
で構成され、第2のトランジスタのベースにペデ
スタルクランプされたコンポジツト映像信号が供
給され、かつ第3のトランジスタのベースに第1
のトランジスタの出力が供給されて低電位側のベ
ース電位に対応した電圧が出力されるエミツタホ
ロワと、 エミツタホロワの出力端に接続されるローパス
フイルタと、 フエードオン時にのみローパスフイルタを挿入
状態に、フエードオン時以外のときにローパスフ
イルタを短絡状態に制御する切替手段と を備えたことを特徴とする映像信号のフエーダ回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP712090U JPH0810989Y2 (ja) | 1990-01-30 | 1990-01-30 | 映像信号のフェーダ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP712090U JPH0810989Y2 (ja) | 1990-01-30 | 1990-01-30 | 映像信号のフェーダ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0398584U true JPH0398584U (ja) | 1991-10-14 |
| JPH0810989Y2 JPH0810989Y2 (ja) | 1996-03-29 |
Family
ID=31510780
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP712090U Expired - Lifetime JPH0810989Y2 (ja) | 1990-01-30 | 1990-01-30 | 映像信号のフェーダ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0810989Y2 (ja) |
-
1990
- 1990-01-30 JP JP712090U patent/JPH0810989Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0810989Y2 (ja) | 1996-03-29 |
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