JPH04124865A - 半導体パッケージ - Google Patents

半導体パッケージ

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JPH04124865A
JPH04124865A JP24532790A JP24532790A JPH04124865A JP H04124865 A JPH04124865 A JP H04124865A JP 24532790 A JP24532790 A JP 24532790A JP 24532790 A JP24532790 A JP 24532790A JP H04124865 A JPH04124865 A JP H04124865A
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JP
Japan
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terminal
board
package
package substrate
semiconductor
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Application number
JP24532790A
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English (en)
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JP2522598B2 (ja
Inventor
Hitoshi Arai
荒井 斉
Koji Minami
浩司 南
Akitsugu Maeda
晃嗣 前田
Takeshi Kano
武司 加納
Toru Higuchi
徹 樋口
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
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Publication date
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    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistors
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/3405Edge mounted components, e.g. terminals

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  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 【産業上の利用分野】
本発明は、ICなどの半導体を実装した半導体パッケー
ジに関するものである。
【従来の技術】
半導体パッケージは、パッケージ基板にIC等の半導体
を搭載すると共に外部への接続端子となる複数本の端子
をパッケージ基板に取着し、そして半導体を樹脂で封止
することによって製造されている。 上記のようにして半導体パッケージを製造するにあたっ
て、パッケージ基板に端子を接続する際には、パッケー
ジ基板に対する端子の位置合わせをおこなう必要がある
。パッケージ基板に対する端子の取付位置がずれると、
パッケージ基板に設けた回路のうち所定の回路に端子を
接続することができなくなったり、他の回路に端子が短
絡されたりするおそれがあり、このために従来から各種
の治具等を用いてパッケージ基板に対する端子の位置合
わせをおこなうようにしていた。
【発明が解決しようとする課題】
しかし、パッケージ基板に端子を取着するにあたって治
具等を用いると、半導体パッケージを組み立てる際の作
業工数が増えると共に作業が繁雑になるという問題があ
った。 本発明は上記の点に鑑みて為されたものであり、治具等
を用いる必要なくパッケージ基板の正確な位置に端子を
取着することができる半導体パッケージを提供すること
を目的とするものである。
【課題を解決するための手段】
本発明は、半導体1を搭載したパッケージ基板2に端子
3を取着することによって形成される半導体バラゲージ
において、端子3の基部に位置決め部4を設け、位置決
め部4をパッケージ基板2の側面に当接させた状態で端
子3をパッケージ基板2に取着して成ることを特徴とす
るものである
【作 用】
本発明にあっては、端子3の基部に位置決め部4を設け
、位置決め部4をパッケージ基板2の側面に当接させた
状態で端子3をパッケージ基板2に取着するようにして
いるために、パッケージ基板2の外形を基準として位置
決め部4でパッケージ基板2に対する端子3の基部の位
置決めをおこなうことができ、治具等を特に必要とする
ことなくパッケージ基板2の正確な位置に端子3を取着
することができる。
【実施例】
以下本発明を実施例によって詳述する。 第1図は本発明の一実施例を示すものであってパッケー
ジ基板2はプリント配線板などで作成されるものであり
、その表面や内層に回路7が形成しである。また金属片
で作成される端子3の基部には、パッケージ基板2の外
形寸法に合わせた位置で長手方向に対して直角に屈曲し
て位置決め部4が形成しである。そしてパッケージ基板
2に端子3を取着するにあたっては、パッケージ基板2
の側端に位置決め部4を当接させて位置決めした状態で
、端子3の基端の接合部8をパッケージ基板2の表面の
パッド部9に半田10等で接続固着させることによって
おこなうことができる。このように端子3をパッケージ
基板2に取着するにあたって、パッケージ基板2の側端
に位置決め部4が当接されることによって、端子3の接
合部8がパッケージ基板2の奥行き方向での位置決めが
なされ、接合部8をパッド部9に位置ずれなく正確に接
続させることができるものである。そして、パッケージ
基板2にその中央部にIC等の半導体1を搭載して金線
等のワイヤー13で回路7と接続することによって、回
路7及びパッド部9を介して端子3と接続し、さらに半
導体1やパッケージ基板2及び端子3の基部を樹脂で封
止することによって、半導体バラゲージに仕上げること
ができる。尚、上記実施例のように端子3の一部を屈曲
して位置決め部4を設けることによって、端子3の剛性
を高めることができるものである。また上記のように端
子3をパッケージ基板2に位置決めして取着できるため
に、パッケージ基板2に取着する複数本の各端子3,3
・・・の整列度を維持することができ、端子3同士が接
触して短絡が発生することを防止することもできる。 第2図は本発明の他の実施例を示すものであり、端子3
の位置決め部4を端子3の基部の屈曲した屈曲部3aの
外周に樹脂モールドや樹脂塗布、樹脂テープの巻き付け
などで絶縁体11を設けることによって形成しである。 このものでは、絶縁体11がパッケージ基板2の側面に
当接されて端子3の位置決めがおこなわれるものであり
、従ってパッケージ基板2の側端面に内層の回路7が露
出していても、この回路7は端子3には接触することが
なく、端子3が回路7に短絡されることを防ぐことがで
きる。 第3図の実施例では、絶縁体11を端子3にその長手方
向に対して直角に突出するよう゛に固着して、絶縁体1
1で位置決め部4を形成するようにしである。従ってこ
のものでは端子3を屈曲する必要がなく、真っすぐの形
状の端子3をパッケージ基板2に取着することができる
。 第4図の実施例は、位置決め部4を構成する絶縁体11
をパッケージ基板2の側端縁に沿って長い板状に形成す
るようにしたものであり、このものでは絶縁体11を封
止樹脂12の流れ止めの堰として利用して、パッケージ
基板2の上に実装した半導体1を封止樹脂12で封止す
ることができる。
【発明の効果】
上述のように本発明にあっては、端子の基部に位置決め
部を設け、位置決め部をパッケージ基板の側面に当接さ
せた状態で端子をパッケージ基板に取着するようにした
ので、位置決め部をパッケージ基板の側面に当接させる
ことによってパッケージ基板の外形を基準としてパッケ
ージ基板に対する端子の基部の位置決めをおこなうこと
ができ、治具等を特に必要とすることなくパッケージ基
板の正確な位置に端子を位置決めして取着することがで
きるものである。
【図面の簡単な説明】
第1図は本発明の一実施例の側面図、第2図及び第3図
はそれぞれ同上の他の実施例の側面図、第4図は同上の
さらに他の実施例の断面図である1は半導体、2はパッ
ケージ基板、3は端子、4は位置決め部である。

Claims (1)

    【特許請求の範囲】
  1. (1)半導体を搭載したパッケージ基板に端子を取着す
    ることによって形成される半導体パッケージにおいて、
    端子の基部に位置決め部を設け、位置決め部をパッケー
    ジ基板の側面に当接させた状態で端子をパッケージ基板
    に取着して成ることを特徴とする半導体パッケージ。
JP2245327A 1990-09-14 1990-09-14 半導体パッケ―ジ Expired - Lifetime JP2522598B2 (ja)

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JPH04124865A true JPH04124865A (ja) 1992-04-24
JP2522598B2 JP2522598B2 (ja) 1996-08-07

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09181245A (ja) * 1995-12-27 1997-07-11 Nec Yamaguchi Ltd 半導体集積回路装置

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5794959A (en) * 1980-12-03 1982-06-12 Hitachi Ltd Tape loading device
JPS6258049U (ja) * 1985-09-30 1987-04-10

Patent Citations (2)

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