JPH04192916A - 出力回路の保護回路 - Google Patents
出力回路の保護回路Info
- Publication number
- JPH04192916A JPH04192916A JP32694990A JP32694990A JPH04192916A JP H04192916 A JPH04192916 A JP H04192916A JP 32694990 A JP32694990 A JP 32694990A JP 32694990 A JP32694990 A JP 32694990A JP H04192916 A JPH04192916 A JP H04192916A
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- JP
- Japan
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- output
- circuit
- turned
- transistor
- diode
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は半導体集積回路によって形成される出力回路
の保護回路に関するものである。
の保護回路に関するものである。
第２図は従来の出力回路の回路図で、図において、（１
） （２）はＮＡＮＤゲート、（３） （４）はインバ
ータ、（５） ｆ６＋はＮ！ＪＯＳ ）ランジスタ、（
２３）は抵抗である。次に動作について説明する。
） （２）はＮＡＮＤゲート、（３） （４）はインバ
ータ、（５） ｆ６＋はＮ！ＪＯＳ ）ランジスタ、（
２３）は抵抗である。次に動作について説明する。
出力回路がショートしてトランジスタ（１）あるいは（
２）に過大な電流か流れても、それに対する保護は直列
に入れられた抵抗（２３）により行っていた。
２）に過大な電流か流れても、それに対する保護は直列
に入れられた抵抗（２３）により行っていた。
しかし、この抵抗（２３）は過大電流をカットするのて
はなく、電流を制限するたけなので、半導体チップの発
熱は続く。
はなく、電流を制限するたけなので、半導体チップの発
熱は続く。
従来の出力回路の保護は以上のように構成されていたの
で、出力回路かショートしたときの半導体チップの発熱
は阻止することがてきないという問題点かあった。
で、出力回路かショートしたときの半導体チップの発熱
は阻止することがてきないという問題点かあった。
この発明は上記のような問題点を解消するためになされ
たもので、出力回路かショートしたときの半導体チップ
の発熱を抑えることのできる出力回路の保護回路を得る
ことを目的とする。
たもので、出力回路かショートしたときの半導体チップ
の発熱を抑えることのできる出力回路の保護回路を得る
ことを目的とする。
この発明に係る出力回路の保護回路は、出力回路かショ
ートしたときの出力トランジスタの発熱を熱的結合を持
ったダイオードを設けて検知し、出力トランジスタをＯ
ＦＦさせるようにしたものである。
ートしたときの出力トランジスタの発熱を熱的結合を持
ったダイオードを設けて検知し、出力トランジスタをＯ
ＦＦさせるようにしたものである。
二の発明における熱的結合ダイオードは、出力回路かシ
ョートしても出力トランジスタかＯＦＦするため、出力
トランジスタの発熱は起こらない。
ョートしても出力トランジスタかＯＦＦするため、出力
トランジスタの発熱は起こらない。
以下、この発明の一実施例を図について説明する。第１
図はこの発明の一実施例である出力回路の保護回路の回
路図である。
図はこの発明の一実施例である出力回路の保護回路の回
路図である。
図において、（］） （２） Ｇシロ９）はＮＡＮＤゲ
ート、（３） （４）（５）はインバータ、（５） （
６） （２２）はＮＭＯ３＋−ランンスタ、（７１（８
）０υハダイオート、＋９１ ＧＯ） （１２ハ抵抗、
（１３Ｏ４） ハ誤差増幅器、Ｏ５ＯＢ ハ波形整形回
路、（１７１ハＮＯＲゲート、（２１）はクロソフトイ
ンバータである。
ート、（３） （４）（５）はインバータ、（５） （
６） （２２）はＮＭＯ３＋−ランンスタ、（７１（８
）０υハダイオート、＋９１ ＧＯ） （１２ハ抵抗、
（１３Ｏ４） ハ誤差増幅器、Ｏ５ＯＢ ハ波形整形回
路、（１７１ハＮＯＲゲート、（２１）はクロソフトイ
ンバータである。
次に動作について説明する。
保護回路の出力中か“Ｈ”となると、出力トランジスタ
（５）あるいは（６）のどちらかかＯＮする。しかし、
出力トランジスタかＯＮシていて、ＤｏｕｔかＧＮＤと
ショートしｔ：場合か、出力トランジスタ（６）かＯＮ
していて、ＤｏｕｔかＶ（（ショートした場合は、出力
トランジスタ（５）あるいは（６）に過大な電流か流れ
、トランジスタ（５）または（６）か発熱する。
（５）あるいは（６）のどちらかかＯＮする。しかし、
出力トランジスタかＯＮシていて、ＤｏｕｔかＧＮＤと
ショートしｔ：場合か、出力トランジスタ（６）かＯＮ
していて、ＤｏｕｔかＶ（（ショートした場合は、出力
トランジスタ（５）あるいは（６）に過大な電流か流れ
、トランジスタ（５）または（６）か発熱する。
以降トランジスタ（５）がＯＮしていて、ＤｏｕｔかＧ
ＮＤにショートした場合について説明するか、もう１つ
の場合についても同一の考えか適用できる。トランジス
タ（５）の発熱によりダイオード（７）の逆リーク電流
は増加し、Ａ点の電位は高くなる。このときダイオード
（７）は、出力トランジスタ（５）と熱的結合が必要で
ある。ダイオードＣＩｌ＋は、出力トランジスタ（５）
、（６）による発熱の影響を受けないとこに置く必要か
あり、半導体チップの平均的温度を検出する役目を持つ
。
ＮＤにショートした場合について説明するか、もう１つ
の場合についても同一の考えか適用できる。トランジス
タ（５）の発熱によりダイオード（７）の逆リーク電流
は増加し、Ａ点の電位は高くなる。このときダイオード
（７）は、出力トランジスタ（５）と熱的結合が必要で
ある。ダイオードＣＩｌ＋は、出力トランジスタ（５）
、（６）による発熱の影響を受けないとこに置く必要か
あり、半導体チップの平均的温度を検出する役目を持つ
。
ＡとＣの電位差を誤差増幅器０３で、検出し、波形整形
回路０９て波形整形を行う。ＮＯＲゲートα力の出力は
Ａ＜ＣてかつＢ＜Ｃのときのみ“Ｈ”となる。従って、
ＮＡＮＤゲートａ秒と０９）で形成されたＲ−Ｓクリッ
プクロップに入力され、ＮＡＮＤゲートａｇ）の出力は
、■か“Ｌ”になるまで“Ｈ“を保つ。ここて丁は電源
投入時に“Ｌ”となり、その後は“Ｈ”を保つ信号であ
る。ＮＡＮＤゲート０９）の出力か“Ｈ”となると出力
中は“Ｌ”となり、出力トランジスタ（５）はＯＦＦと
する。この後、ショートの原因を除き、電源を再投入す
れば正常動作を行う二とかてきる。
回路０９て波形整形を行う。ＮＯＲゲートα力の出力は
Ａ＜ＣてかつＢ＜Ｃのときのみ“Ｈ”となる。従って、
ＮＡＮＤゲートａ秒と０９）で形成されたＲ−Ｓクリッ
プクロップに入力され、ＮＡＮＤゲートａｇ）の出力は
、■か“Ｌ”になるまで“Ｈ“を保つ。ここて丁は電源
投入時に“Ｌ”となり、その後は“Ｈ”を保つ信号であ
る。ＮＡＮＤゲート０９）の出力か“Ｈ”となると出力
中は“Ｌ”となり、出力トランジスタ（５）はＯＦＦと
する。この後、ショートの原因を除き、電源を再投入す
れば正常動作を行う二とかてきる。
以上のようにこの発明によれば、出力回路かショートし
た場合の半導体チップの発熱を阻止できるという効果が
ある。
た場合の半導体チップの発熱を阻止できるという効果が
ある。
第１図はこの発明の一実施例を示すである出力回路の保
護回路の回路図、第２図は従来の出力回路の回路図であ
る。 図において、（１） （２） （１１１００９）はＮＡ
ＮＤゲート、＋３） （４） ２０はインバータ、＋５
） （６） （２２）はＮＭＯ３トランジスタ、（７）
（８）ａυはダイオード、＋９） ００） （ＩＺは
抵抗、０３ Ｃ１４）は誤差増幅器、ａりＧＧは波形整
形回路、（ＪＴＩ ｌ：ｉ ＮＤＲゲート、（２］）は
クロソフトインバータを示す。 なお、図中、同一符号は同一、又は相当部分を示す。
護回路の回路図、第２図は従来の出力回路の回路図であ
る。 図において、（１） （２） （１１１００９）はＮＡ
ＮＤゲート、＋３） （４） ２０はインバータ、＋５
） （６） （２２）はＮＭＯ３トランジスタ、（７）
（８）ａυはダイオード、＋９） ００） （ＩＺは
抵抗、０３ Ｃ１４）は誤差増幅器、ａりＧＧは波形整
形回路、（ＪＴＩ ｌ：ｉ ＮＤＲゲート、（２］）は
クロソフトインバータを示す。 なお、図中、同一符号は同一、又は相当部分を示す。
Claims (1)
- 外部回路に信号を出力するトランジスタに熱的結合を
持ったダイオードと、このダイオードを用い、前記トラ
ンジスタの発熱量を検知し、前記トランジスタをＯＦＦ
させることを特徴とする出力回路の保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32694990A JPH04192916A (ja) | 1990-11-27 | 1990-11-27 | 出力回路の保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32694990A JPH04192916A (ja) | 1990-11-27 | 1990-11-27 | 出力回路の保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04192916A true JPH04192916A (ja) | 1992-07-13 |
Family
ID=18193575
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32694990A Pending JPH04192916A (ja) | 1990-11-27 | 1990-11-27 | 出力回路の保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04192916A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19980042392A (ko) * | 1996-11-14 | 1998-08-17 | 가나이쯔도무 | 제어 신호의 입력을 차단하는 보호 기능을 갖는 스위치 회로 |
-
1990
- 1990-11-27 JP JP32694990A patent/JPH04192916A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR19980042392A (ko) * | 1996-11-14 | 1998-08-17 | 가나이쯔도무 | 제어 신호의 입력을 차단하는 보호 기능을 갖는 스위치 회로 |
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