JPH0422268A - ディザマトリクスの閾値選択方法及びその回路 - Google Patents

ディザマトリクスの閾値選択方法及びその回路

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JPH0422268A
JPH0422268A JP2127594A JP12759490A JPH0422268A JP H0422268 A JPH0422268 A JP H0422268A JP 2127594 A JP2127594 A JP 2127594A JP 12759490 A JP12759490 A JP 12759490A JP H0422268 A JPH0422268 A JP H0422268A
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JP
Japan
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dither matrix
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JP2127594A
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Tetsuya Inoue
哲也 井上
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [概 要] ディザマトリクス内の閾値選択周期性を画素データに依
存して変えるディザマトリクスの閾値選択方法及びその
回路に関し、 モアレ縞の発生防止を図ることを目的とし、主走査方向
内の第1の所定数の画素データ毎の該画素データ及び画
素データクロックパルスに応答して第1のアップダウン
制御信号を発生する第1のアップダウン制御回路と、副
走査方向における第2の所定数の画像ライン毎の該画像
ライン上の所定の画素データ及び撮像ラインクロックパ
ルスに応答して第2のアップダウン制御信号を発生する
第2のアップダウン制御回路と、各画素データクロンク
及び第1のアップダウン制御信号に応答して主走査方向
のディザマトリクス閾値選択情報を出力する第1のリン
グ形式のアップダウンカラ/りと、各画像ラインクロッ
ク及び第2のアップダウン制御信号に応答して副走査方
向のディザマトリクス閾値選択情報を出力する第2のリ
ング形式のアップダウンカウンタと、ディザマトリクス
と、第1及び第2のアップダウンカウンタの出力に応答
してディザマトリクス内の閾値を出力するセレクタとを
設けて構成した。
[産業上の利用分野] 本発明は、ディザマトリクス内の閾値選択周期性を画素
データに依存して変えるディザマトリクスの閾値選択方
法及びその回路に関する。
画像データ通信の分野においては、その伝送対象となる
原画は、多階調の原画である場合が多く、そのような多
階調の原画も、そうでない原画と同様の技法による画像
データへの変換を行なうと、原画内に存在する微妙な濃
淡変化を表現し得なかったり、或いは原画内に存在しな
い濃淡変化を伝送される画像データ内に含められてしま
うと言うような不都合が生じるが、これは、画像伝送上
好ましくない。
〔従来の技術〕
従来方式の1つとして、原画内の多階調データを白黒画
素データへ変換して伝送する際に、単純に多階調データ
に対する固定の閾値を設定し、この固定の閾値と前記多
階調データとの比較により原画内の多階調画素データの
白黒画素データへの変換を行なうと言う白黒画素データ
発生方式がある。この方式では、前記固定の閾値以上、
又はそれ未満の微妙な濃淡変化を前記固定の閾値により
消されて表現し得ないため、原画の忠実な原画データを
伝送しえない(第4図参照)。
そのような不具合を回避するための1つの手段としてデ
ィザマトリクスを用いる白黒画素データ発生方式もある
。この方式は、第5図に示すように原画内の16階調画
素データとの比較に用いられる閾値を予め決められたパ
ターンで設定しているディザマトリクス50内の各閾値
を各入力16階調画素データ毎にディザマトリクス50
から選択出力するようにしている。ディザマトリクス5
0は、4ビツトレジスタ工6個から成る。そのディザマ
トリクス50から閾値の選択は、カウンタ52.54と
、4ビツトセレクタ56とを用いて行なわれる。カウン
タ52は、副走査方向における1撮像ライン(ラスター
)毎のクロックパルスA4つに対して2ビツトを出力す
るリングカウンタであり、カウンタ54は、主走査方向
における各撮像ラインにスター)上の各画素毎のクロ・
ンクバルス84つに対して2ビツトを出力するリングカ
ウンタである。これらの2つのカウンタ5254から周
期的に出力されて来る4ビツトにより、ディザマトリク
ス50から出力されている閾値の内の1つの閾値は、前
記両カウンタ52,54のカウント出力値を発生せしめ
る原画の画素データに周期的に対応させられた閾値とし
て選択出力される。
このようにすることにより、第6図に示すように同一の
原画であっても、それに対して擬似的な濃淡を表現する
ことが出来るから、前述のように閾値を固定とすること
から生ずる弊害の緩和に役立つ。このディザマトリクス
を用いて原画の白黒画素データへの変換は、解像度の劣
化が顕在化して来ない解像度以上でディザマトリクスを
用いる必要がある。ディザマトリクスを用いての原画の
白黒画素データへの変換において用いられる各閾値は、
当該画素データについての閾値としては必ずしも妥当な
閾値とはならないからである。
〔発明が解決しようとする課題〕
前述のディザマトリクスを用いる白黒画素データ発生方
式は、その白黒画素データ発生に際して予め用意された
一定サイズのディザマトリクス内の閾値を周期的に呼び
出すものであるから、その一定サイズのディザマトリク
ス内に予め設定されている閾値パターンの周期を超える
周期の濃淡変化が原画の中に生ずる場合には、出力白黒
画素データの中には現れなかった原画にはない周期的な
模様が、出力白黒画素データ(出力画像)の中には現れ
てしまう。この模様は、一般に“モアレ縞”と呼ばれる
ものである。このモアレ縞は、画質低下の要因となる。
本発明は、斯かる問題点に鑑みて創作されたもので、モ
アレ縞の発生防止を図り得るディザマトリクスの閾値選
択方法及びその回路を提供することをその目的とする。
〔課題を解決するための手段〕
第1の発明は、主走査方向における第1の所定数の画素
データ毎に該画素データに応じて該主走査方向のディザ
マトリクス閾値選択情報の発生を変更し、副走査方向に
おける第2の所定数の撮像ライン毎に該撮像ライン上の
所定の画素データに応じて該副走査方向のディザマトリ
クス閾値選択情報の発生を変更し、発生された画ディザ
マトリクス閾値選択情報対応の閾値をディザマトリクス
から出力せしめるようにして、構成される。
第2の発明は、第1図は本発明の原理ブロック図を示す
ように、主走査方向内の第1の所定数の画素データ毎の
該画素データ及び前記主走査方向の各画素データクロッ
クパルスに応答して第1のアンプダウン制御信号を発生
する第1のアップダウン制御回路2と、副走査方向にお
ける第2の所定数の画像ライン毎の該画像ライン上の所
定の画素データ及び前記副走査方向の各撮像ラインクロ
ックパルスに応答して第2のアップダウン制御信号を発
生する第2のアップダウン制御回路4と、前記主走査方
向の各画素データクロックパルス及び前記第1のアップ
ダウン制御信号に応答して前記主走査方向のディザマト
リクス閾値選択情報を出力する第1のリング形式のアッ
プダウンカウンタ6と、前記副走査方向の各画像ライン
クロックパルス及び前記第2のアップダウン制御信号に
応答して前記副走査方向のディザマトリクス閾値選択情
報を出力する第2のリング形式のアップダウンカウンタ
8と、ディザマトリクス10と、前記第1のリング形式
のアップダウンカウンタ6及び第2のリング形式のアッ
プダウンカウンタ8の各ディザマトリクス閾値選択情報
に応答して該画ディザマトリクス閾値選択情報に対応す
る前記ディザマトリクス10内の閾値を出力するセレク
タ12とから構成される。
〔作 用〕
第1のアップダウン制御信号は、主走査方向内の第1の
所定数の画素データ毎の該画素データに応じて決められ
、第2のアップダウン制御信号は、主走査方向内の第1
の所定数の画素データ毎の該画素データに応じて決めら
れる。
そして、アップダうンカウンタ6,8のカウント動作は
、それぞれ第1のアップダウン制御回路2からの第1の
アップダウン制御信号によって設定され、又第2のアッ
プダウン制御回路4からの第2のアップダウン制御信号
によって設定される。
このようにして設定された第1のリング形式のアップダ
ウンカウンタ6から発生される主走査方向のディザマト
リクス閾値選択情報、及び第2のリング形式のアップダ
ウンカウンタ8からの副走査方向のディザマトリクス閾
値選択情報は、セレクタ4へ供給される。
従って、ディザマトリクス2内の閾値の選択は、入力画
素データに応じて決められるアップダウンカウンタ6か
らの主走査方向のディザマトリクス閾値選択情報、及び
アップダウンカウンタ8からの副走査方向のディザマト
リクス閾値選択情報によって制御されるから、ディザマ
トリクス2内の閾値の選択の周期性は、入力画素データ
に応じて変更される。よって、選択の固定周期性では、
生じてしまうモアレ縞の出力画像への誘発を防止し得る
。これは、一定サイズのディザマトリクスを可変サイズ
のディザマトリクスへの修正機能を付与する手段を提供
する。
〔実施例〕
第2図は本発明の一実施例を示す。30.3234.3
6はディザマトリクス、カウンタ、セレクタであり、こ
れらの内、ディザマトリクス30、セレクタ36は第4
図におけるディザマトリクス50、セレクタ56に対応
するが、カウンタ3234は、カウンタ52.54と異
なってリング形式のアップダウンカウンタである。
これらのアップダウンカウンタ32.34のアップダウ
ンカウント制御は、リングカウンタ3840、及びフリ
ップフロップ回路42.44により行なう。リングカウ
ンタ38のクロック入力には、副走査方向における1撮
像ライン(ラスター)毎のクロックパルスAが入力され
、その16個のクロックパルスAで一巡するものである
。リングカウンタ40のクロック入力には、主走査方向
における各撮像ライン(ラスター)上の各画素毎のクロ
ックパルスBが入力され、その16個のクロックパルス
Bで一巡するものである。フリップフロップ回路42.
44のデータ入力には、4ビツトの16階調の画素デー
タの内のビットMSBが入力される。それらのフリップ
フロップ42,440クロツク入力CKには、ディザマ
トリクスの構成の大きさに応じたリングカウンタ38.
40のカウントビット出力が用いられる。例えば、この
実施例で用いるディザマトリクスの大きさを4×4の大
きさとしたときには、リングカウンタ38.40のカウ
ントビット出力CTIが接続される。これに対応して、
アップダウンカウンタ32゜34のカウントビット出力
QA、QBが、161セレクタ36の選択入力へ接続さ
れる。前記大きさのディザマトリクスを構成する16個
のレジスタは、階調度数に応じて決まるビット数のレジ
スタである。例えば、各レジスタが4ビツトであれば、
その4ビツトは、前述のような第6図の(A)に示す1
6階調の画素データとの比較に用いられる第6図の(B
)に示す閾値を表す4ビツトと同じである。
第2図において、リング形式のアップダウンカウンタ4
0は、第1図の第1のアップダウン制御回路2に対応し
、リング形式のアップダウンカウンタ38は、第1図の
第1のアップダウン制御回路4に対応する。リング形式
のアップダウンカウンタ34は、第1図の第1のリング
形式のアップダウンカウンタ6に対応し、リング形式の
アップダウンカウンタ32は、第1図の第1のリング形
式のアップダウンカウンタ8に対応する。ディザマトリ
クス30は、第1図のディザマトリクス10に対応し、
セレクタ36は、第1図のセレクタ12に対応する。
前述のように構成される本発明の閾値選択回路の動作を
第3図を参照して以下に説明する。4×4の大きさのデ
ィザマトリクスを用いる場合について説明する。
本発明の閾値選択回路が動作状態にあって、そのフリッ
プフロップ回路42.44がセットされてアップダウン
カウンタ32.34のいずれもアップカウントの動作状
態に設定されているものとする。
この動作状態において入力されて来るクロックパルスA
によるカウンタ32のカウント動作も、クロックパルス
Bによるカウンタ32のカウント動作も、「従来の技術
」の項で説明した動作と同じである。即ち、リング形式
でアップカウントの動作を反復して繰り返す。従って、
それら両カウンタ32.34のカウント出力QA、QB
を受は取る16−1セレクタ36によってディザマトリ
クス30内の閾値の選択態様も、「従来の技術」の項で
説明した動作と同じとなる。第3図の(B)は、第3図
の(A)に示す基本マトリクス(4×4の大きさのディ
ザマトリクス30が、従来と同様にして周期的に選択す
る様子を示している。第3図の(A)、及び第3図の(
B)に示ず各枡内の2桁の数字ij (i、j=o、1
.2.3)のiは、アップダウンカウンタ32のカウン
ト出力QA、QBによって表される10進数を示し、j
はアップダウンカウンタ34のカウント出力QA。
QBによって表される10進数を示している。この関係
は、第3図の(C)について後述する動作においても同
じである。
前記両カウンタ32,34のカウント出力QA。
QBが、クロックパルスAについても、又クロックパル
スBについても4つのカウント動作を行なう度毎に、リ
ングカウンタ38のカウントビット出力CT1に、4つ
のクロックパルスAをカウントアツプしたことを示す”
 H”レベルの信号(1”のビット)が出力され、リン
グカウンタ40のカウントビット出力CTIには、4つ
のクロックパルスBをカウントアンプしたことを示す“
H”レベルの信号(1”のビット)が出力される。
従って、この両リングカウンタ38,40のカウントビ
ット出力CT1に出力される“H”レベルの信号の発生
時に、その正レベルへの遷移、及びこの時刻における1
6階調を表す画素データのMSBに応じたセット状態が
、フリップフロップ回路42.44に取らしめられる。
従って、前述のアップダウンカウンタ32.34は、M
SBを持たない画素データが継続している場合には、前
述のように4つのクロックパルスA、B毎にそのカウン
ト動作がカウントアツプ動作と、カウントダウン動作と
が交互に切り換えられるが、前記カウント動作切り換え
時刻の画素データがMSBを持つ画素データである場合
には、アップダウンカウンタ32.34の次のカウント
周期のカウント動作は、該次のカウント周期前に取って
いたカウント動作とは逆のカウント動作で前記次のカウ
ント周期のカウント動作を行なう。
これは、原画内の急激な濃淡変化に応じて白黒画素デー
タの生成により適した閾値をディザマトリクスから選択
する手段を提供する。換言すれば、一定サイズのディザ
マトリクスを擬似的にそのサイズ以上のディザマトリク
スを用意したのと等価にする手段を提供する。この手段
により、従来の一定の順序でのディザマトリクスからの
閾値の選択では生じてしまう出力画像内へのモアレ縞の
発生防止に寄与する。
なお、前記実施例においては、カウント動作の切り換え
を16階調等の画素データのMSBに用いる例を示した
が、これに限られない。固定閾値で二値した二値画素デ
ータであってもよい。ディザマトリクスをメモリで構成
し、その選択アドレスとして(ハード、又はソフトの)
アップダウンカウンタの対応出力ビットをハード的に、
又はソフト的に用いるようにしてもよい。
〔発明の効果〕
以上述べたところがら明らかなように本発明によれば、
入力画素データに応じてディザマトリクスの選択周期を
変えるようにしたので、入力画素データとの比較に用い
る閾値の最適化に寄与する。
ディザマトリクスの固定選択周期の場合に生じてしまう
出力画像内のモアレ縞を防止するのに役立つ。ディザマ
トリクスのサイズの擬似的な拡張効果が得られる。
【図面の簡単な説明】
第1図は本発明の原理ブロック図、 第2図は本発明の一実施例を示す図、 第3図は本発明でのディザマトリクスの閾値選択動作説
明図、 第4図は16階調の画素データの白黒画素データへの変
換に固定閾値を用いる場合の説明図、第5図はディザマ
トリクスの閾値選択回路を示す図、 第6図は16階調の画素データの白黒画素データへの変
換にディザマトリクスを用いる場合の説明図である。 第1図及び第2図において、 2は第1のアップダウン制御回路(リング形式のアンプ
ダウンカウンタ38)、 4は第2のアップダウン制御回路(リング形式のアップ
ダウンカウンタ40)、 6は第1のリング形式のアップダウンカウンタ(リング
形式のアップダウンカウンタ34)、8は第2のリング
形式のアップダウンカウンタ(リング形式のアップダウ
ンカウンタ32)、10はディザマトリクス(ディザマ
トリクス30)、 12はセレクタ(セレクタ36)である。 声Iげ!l1月の源、璋フ゛Dツフ1刀第1図

Claims (2)

    【特許請求の範囲】
  1. (1)主走査方向における第1の所定数の画素データ毎
    に該画素データに応じて該主走査方向のディザマトリク
    ス閾値選択情報の発生を変更し、副走査方向における第
    2の所定数の撮像ライン毎に該撮像ライン上の所定の画
    素データに応じて該副走査方向のディザマトリクス閾値
    選択情報の発生を変更し、 発生された画ディザマトリクス閾値選択情報対応の閾値
    をディザマトリクスから出力せしめることを特徴とする
    ディザマトリクスの閾値選択方法。
  2. (2)主走査方向内の第1の所定数の画素データ毎の該
    画素データ及び前記主走査方向の各画素データクロック
    パルスに応答して第1のアップダウン制御信号を発生す
    る第1のアップダウン制御回路(2)と、 副走査方向における第2の所定数の画像ライン毎の該画
    像ライン上の所定の画素データ及び前記副走査方向の各
    画像ラインクロックパルスに応答して第2のアップダウ
    ン制御信号を発生する第2のアップダウン制御回路(4
    )と、 前記主走査方向の各画素データクロックパルス及び前記
    第1のアップダウン制御信号に応答して前記主走査方向
    のディザマトリクス閾値選択情報を出力する第1のリン
    グ形式のアップダウンカウンタ(6)と、 前記副走査方向の各画像ラインクロックパルス及び前記
    第2のアップダウン制御信号に応答して前記副走査方向
    のディザマトリクス閾値選択情報を出力する第2のリン
    グ形式のアップダウンカウンタ(8)と、 ディザマトリクス(10)と、 前記第1のリング形式のアップダウンカウンタ(6)及
    び第2のリング形式のアップダウンカウンタ(8)の各
    ディザマトリクス閾値選択情報に応答して該両ディザマ
    トリクス閾値選択情報に対応する前記ディザマトリクス
    (10)内の閾値を出力するセレクタ(12)とからな
    るディザマトリクスの閾値選択回路。
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