JPH04239365A - 入出力処理装置 - Google Patents
入出力処理装置Info
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- JPH04239365A JPH04239365A JP248791A JP248791A JPH04239365A JP H04239365 A JPH04239365 A JP H04239365A JP 248791 A JP248791 A JP 248791A JP 248791 A JP248791 A JP 248791A JP H04239365 A JPH04239365 A JP H04239365A
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- Japan
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- input
- data
- circuit
- output processing
- output
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- Pending
Links
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- 230000006870 function Effects 0.000 claims abstract description 22
- 238000000034 method Methods 0.000 claims description 6
- 230000000694 effects Effects 0.000 claims description 3
- 230000006837 decompression Effects 0.000 claims description 2
- 230000004913 activation Effects 0.000 claims 1
- 230000002093 peripheral effect Effects 0.000 abstract description 13
- 238000010586 diagram Methods 0.000 description 8
- 238000004891 communication Methods 0.000 description 2
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Landscapes
- Compression, Expansion, Code Conversion, And Decoders (AREA)
- Small-Scale Networks (AREA)
- Information Transfer Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は入出力処理装置に関する
。
。
【０００２】
【従来の技術】情報処理装置の入出力時におけるデータ
転送効率を改善するためにデータ圧縮が行われているが
、従来はソフトウェアによる圧縮か、データ転送効率を
上げ易い特定の装置、例えば磁気テープ装置によってい
る。従って、入出力処理装置にはデータ圧縮機能をもた
せておらず、データを加工することがなかった。
転送効率を改善するためにデータ圧縮が行われているが
、従来はソフトウェアによる圧縮か、データ転送効率を
上げ易い特定の装置、例えば磁気テープ装置によってい
る。従って、入出力処理装置にはデータ圧縮機能をもた
せておらず、データを加工することがなかった。
【０００３】
【発明が解決しようとする課題】上述した従来の入出力
処理装置はデータ圧縮機能を有していないため、データ
圧縮をソフトウェアにより行う場合には性能が低下し、
また特定の装置のみによるデータ圧縮では性能向上要請
が厳しくなっているシステム全体のデータ転送スループ
ットを向上させることができないという問題点がある。
処理装置はデータ圧縮機能を有していないため、データ
圧縮をソフトウェアにより行う場合には性能が低下し、
また特定の装置のみによるデータ圧縮では性能向上要請
が厳しくなっているシステム全体のデータ転送スループ
ットを向上させることができないという問題点がある。
【０００４】
【課題を解決するための手段】第１の本発明の入出力処
理装置は、入出力インタフェースを制御する入出力イン
タフェース制御回路と、データバッファ回路とデータ圧
縮・伸長回路をバイパスする機能とを有するチャネル部
と、該チャネル部を複数接続し内部にプロセッサを持ち
、主記憶と該複数のチャネル部とのデータ転送を制御す
る入出力処理部とにより構成される。
理装置は、入出力インタフェースを制御する入出力イン
タフェース制御回路と、データバッファ回路とデータ圧
縮・伸長回路をバイパスする機能とを有するチャネル部
と、該チャネル部を複数接続し内部にプロセッサを持ち
、主記憶と該複数のチャネル部とのデータ転送を制御す
る入出力処理部とにより構成される。
【０００５】第２の本発明の入出力処理装置は、入出力
インタフェースを制御するチャネル部と、該チャネル部
を複数接続し内部にプロセッサとデータバッファ回路と
データ圧縮・伸長回路と該データ圧縮・伸長回路をバイ
パスする機能を有し主記憶と前記複数のチャネル部との
データ転送を制御する入出力処理部より構成される。
インタフェースを制御するチャネル部と、該チャネル部
を複数接続し内部にプロセッサとデータバッファ回路と
データ圧縮・伸長回路と該データ圧縮・伸長回路をバイ
パスする機能を有し主記憶と前記複数のチャネル部との
データ転送を制御する入出力処理部より構成される。
【０００６】
【実施例】次に本発明について図面を参照して説明する
。
。
【０００７】図１は本発明の一実施例の入出力処理装置
のブロック図である。
のブロック図である。
【０００８】図中、１は入出力処理装置全体を示し、信
号線１０１にてＥＰＵと、信号線１０２にて主記憶と、
信号線１０５にて周辺装置と外部接続される。また、入
出力処理部および複数のチャネル部３を有し、入出力処
理部２と複数のチャネル部３は信号線１０３にて接続さ
れる。
号線１０１にてＥＰＵと、信号線１０２にて主記憶と、
信号線１０５にて周辺装置と外部接続される。また、入
出力処理部および複数のチャネル部３を有し、入出力処
理部２と複数のチャネル部３は信号線１０３にて接続さ
れる。
【０００９】チャネル部３はデータバッファ回路３１，
データ圧縮伸長回路３２，入出力インタフェース制御回
路３３，バイパス回路３３を含む。
データ圧縮伸長回路３２，入出力インタフェース制御回
路３３，バイパス回路３３を含む。
【００１０】データバッファ回路３１は信号線１０４に
てデータ圧縮・伸長回路３２と、信号線１０６にて入出
力インタフェース制御回路３３と接続される。データ圧
縮伸長回路３２は信号線１０７にて入出力インタフェー
ス制御回路３３と、信号線１０９にてバイパス回路３４
と接続される。バイパス回路３４は信号線１０８にて入
出力インタフース制御回路３３に接続される。
てデータ圧縮・伸長回路３２と、信号線１０６にて入出
力インタフェース制御回路３３と接続される。データ圧
縮伸長回路３２は信号線１０７にて入出力インタフェー
ス制御回路３３と、信号線１０９にてバイパス回路３４
と接続される。バイパス回路３４は信号線１０８にて入
出力インタフース制御回路３３に接続される。
【００１１】次に動作について説明する。
【００１２】入出力処理装置１は、システム立上時に信
号線１０５による入出力インタフェースを通して、周辺
装置と通信を行い、その周辺装置がデータ圧縮機能の使
用が可能かどうかを示すステータスを取り込み、入出力
処理部１に記憶しておく。
号線１０５による入出力インタフェースを通して、周辺
装置と通信を行い、その周辺装置がデータ圧縮機能の使
用が可能かどうかを示すステータスを取り込み、入出力
処理部１に記憶しておく。
【００１３】次にＥＰＵから起動がかかると入出力処理
部１でこれを検出し、主記憶からチャネルプログラムを
取り込みチャネル部３を通して、入出力インタフェース
を介し周辺装置にコマンド，フラグを送出する。
部１でこれを検出し、主記憶からチャネルプログラムを
取り込みチャネル部３を通して、入出力インタフェース
を介し周辺装置にコマンド，フラグを送出する。
【００１４】このとき、先に記憶した当該周辺装置のデ
ータ圧縮機能使用可否情報が可であれば続くデータ転送
をデータ圧縮して送る場合に、図２（ａ）の例に示すよ
うに、例えばフラグの予め定めたビットを“１”にして
データ圧縮ありを周辺装置に通知する。
ータ圧縮機能使用可否情報が可であれば続くデータ転送
をデータ圧縮して送る場合に、図２（ａ）の例に示すよ
うに、例えばフラグの予め定めたビットを“１”にして
データ圧縮ありを周辺装置に通知する。
【００１５】コマンド，フラグ転送に続く出力データ転
送は、データバッファ回路３１を通してデータ圧縮・伸
長回路３２にて予め定められた圧縮手法により、データ
を圧縮し入出力インタフェースへ送出する。
送は、データバッファ回路３１を通してデータ圧縮・伸
長回路３２にて予め定められた圧縮手法により、データ
を圧縮し入出力インタフェースへ送出する。
【００１６】入力データ転送の場合は、入出力インタフ
ェースから入力されたデータをデータ圧縮・伸長回路３
２にて、予め定められた伸長方法によりデータを伸長し
、データバッファ回路３１，入出力処理部２を通して主
記憶に転送する。
ェースから入力されたデータをデータ圧縮・伸長回路３
２にて、予め定められた伸長方法によりデータを伸長し
、データバッファ回路３１，入出力処理部２を通して主
記憶に転送する。
【００１７】先に記憶した当該周辺装置のデータ圧縮機
能を使用可否情報が否であれば、入出力処理部２からの
指示により入出力インタフェース制御回路を通して、バ
イパス回路３４を働かせデータ圧縮・伸長機能の使用を
バイパスする。
能を使用可否情報が否であれば、入出力処理部２からの
指示により入出力インタフェース制御回路を通して、バ
イパス回路３４を働かせデータ圧縮・伸長機能の使用を
バイパスする。
【００１８】一方、周辺装置側からの指示により圧縮さ
れたデータ転送を行いたい場合は、図２（ｂ）に示すよ
うに、例えば入出力インタフェースのサービスコードの
予め定めたビットを“１”にして圧縮データ転送が行わ
れる旨を入出力インタフェースのチャネル部をもつ場合
のチャネル部の一部のブロック図を図３に示す。図中４
はチャネル部で、内部にデータ圧縮・伸長回路３２，バ
イパス回路３４，テーブルメモリ３５をもち入出力イン
タフェース１３を通して周辺装置５に接続される。
れたデータ転送を行いたい場合は、図２（ｂ）に示すよ
うに、例えば入出力インタフェースのサービスコードの
予め定めたビットを“１”にして圧縮データ転送が行わ
れる旨を入出力インタフェースのチャネル部をもつ場合
のチャネル部の一部のブロック図を図３に示す。図中４
はチャネル部で、内部にデータ圧縮・伸長回路３２，バ
イパス回路３４，テーブルメモリ３５をもち入出力イン
タフェース１３を通して周辺装置５に接続される。
【００１９】バイパス回路３４は信号線１１でデータ圧
縮・伸長回路３２と、信号線１２でテーブルメモリ３５
と接続される。本ケースはテーブルメモリ３５内に各周
辺装置毎のデータ圧縮・伸長可否情報をもち、データ転
送実行時にこの情報によりバイパス回路３４を制御する
。
縮・伸長回路３２と、信号線１２でテーブルメモリ３５
と接続される。本ケースはテーブルメモリ３５内に各周
辺装置毎のデータ圧縮・伸長可否情報をもち、データ転
送実行時にこの情報によりバイパス回路３４を制御する
。
【００２０】図４はデータ圧縮機能を入出力処理部２に
持たせた本発明の他の実施例である。１０は入出力処理
装置で、内部にデータバッファ回路６１，データ圧縮・
伸長回路６２，プロセッサ６３，バイパス回路６４をも
った入出力処理部６と複数のチャネル部７から構成され
る。本実施例の動作はデータ圧縮・伸長動作を入出力処
理部で行うことの他は先に説明した実施例における動作
と同様である。
持たせた本発明の他の実施例である。１０は入出力処理
装置で、内部にデータバッファ回路６１，データ圧縮・
伸長回路６２，プロセッサ６３，バイパス回路６４をも
った入出力処理部６と複数のチャネル部７から構成され
る。本実施例の動作はデータ圧縮・伸長動作を入出力処
理部で行うことの他は先に説明した実施例における動作
と同様である。
【００２１】
【発明の効果】以上説明したように本発明は入出力処理
装置内にデータ圧縮機能をもたせることにより、ソフト
ウェアの負荷分散が図れるとともに、システム全体のデ
ータ転送スループットを大幅に向上でき性能の高い情報
処理装置を実現できるという効果がある。
装置内にデータ圧縮機能をもたせることにより、ソフト
ウェアの負荷分散が図れるとともに、システム全体のデ
ータ転送スループットを大幅に向上でき性能の高い情報
処理装置を実現できるという効果がある。
【図１】本発明の一実施例による入出力処理装置のブロ
ック図。
ック図。
【図２】（ａ）は入出力装置から圧縮データを転送せし
める時の通信に用いるフラグを示す図、（ｂ）は周辺装
置から圧縮データを転送せしめるときの通信に用いるサ
ービスコードの例を示す図。
める時の通信に用いるフラグを示す図、（ｂ）は周辺装
置から圧縮データを転送せしめるときの通信に用いるサ
ービスコードの例を示す図。
【図３】イモズル方式の入出力インタフェースを制御す
るチャネル部をもつ場合のブロック図。
るチャネル部をもつ場合のブロック図。
【図４】入出力処理部にデータ圧縮機能を持たせた本発
明の他の実施例のブロック図。
明の他の実施例のブロック図。
１，１０ 入出力処理装置
２，６ 入出力処理部
３，４，７ チャネル部
５ 周辺装置
３１，６１ データバッファ回路３２，６２
データ圧縮・伸長回路３３ 入出力インタフ
ェース制御回路３４，６４ バイパス回路 ３５ テーブルメモリ ６３ プロセッサ
データ圧縮・伸長回路３３ 入出力インタフ
ェース制御回路３４，６４ バイパス回路 ３５ テーブルメモリ ６３ プロセッサ
Claims (6)
- 【請求項１】 入出力インタフェースを制御する入出
力インタフェース制御回路と、データバッファ回路とデ
ータ圧縮・伸長回路をバイパスする機能とを有するチャ
ネル部と、該チャネル部を複数接続し内部にプロセッサ
を持ち、主記憶と該複数のチャネル部とのデータ転送を
制御する入出力処理部とにより構成される入出力処理装
置。 - 【請求項２】 本処理装置を含むシステムの立上げ時
に当該複数のチャネルの入出力インタフェースにつなが
れた相手装置と通信し、データ圧縮・伸長機能の使用可
否を問合せる機能を持つことを特徴とする請求項１記載
の入出力処理装置。 - 【請求項３】 入出力処理装置から圧縮データのデー
タ転送を行わせしめる時に、当該実行チャネル部の入出
力インタフェースに接続された相手装置にその旨を通知
する手段を持つことを特徴とする請求項１記載の入出力
処理装置。 - 【請求項４】 データ転送実行チャネル部の入出力イ
ンタフェースに接続された相手装置が圧縮データのデー
タ転送を行わせしめるために、その旨通知したことを判
断し、データ圧縮・伸長機能を働かすことを特徴とする
請求項１記載の入出力処理装置。 - 【請求項５】 イモズル方式の入出力インタフェース
を制御するチャネル部を有する場合に、入出力インタフ
ェースに接続された複数の相手装置の数だけ、データ圧
縮・伸長機能の使用可否を登録するテーブルをもちデー
タ転送実行時に該テーブルの内容により、バイパス機能
を働かす制御を行うチャネル部を持つことを特徴とする
請求項１記載の入出力処理装置。 - 【請求項６】 入出力インタフェースを制御するチャ
ネル部と、該チャネル部を複数接続し内部にプロセッサ
とデータバッファ回路とデータ圧縮・伸長回路と該デー
タ圧縮・伸長回路をバイパスする機能を有し主記憶と前
記複数のチャネル部とのデータ転送を制御する入出力処
理部より構成される入出力処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP248791A JPH04239365A (ja) | 1991-01-14 | 1991-01-14 | 入出力処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP248791A JPH04239365A (ja) | 1991-01-14 | 1991-01-14 | 入出力処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04239365A true JPH04239365A (ja) | 1992-08-27 |
Family
ID=11530721
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP248791A Pending JPH04239365A (ja) | 1991-01-14 | 1991-01-14 | 入出力処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04239365A (ja) |
-
1991
- 1991-01-14 JP JP248791A patent/JPH04239365A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20000314 |