JPH04306930A - クロック異常検出器 - Google Patents

クロック異常検出器

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JPH04306930A
JPH04306930A JP3071713A JP7171391A JPH04306930A JP H04306930 A JPH04306930 A JP H04306930A JP 3071713 A JP3071713 A JP 3071713A JP 7171391 A JP7171391 A JP 7171391A JP H04306930 A JPH04306930 A JP H04306930A
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JP
Japan
Prior art keywords
clock
outputs
output
comparator
cka
Prior art date
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Pending
Application number
JP3071713A
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English (en)
Inventor
Naohide Kuroda
黒田 直秀
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Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、端末装置の電源投入時
のクロック安定化状態の検出及び伝送路断時のクロック
断の検出に用いるクロック異常検出器に関する。
【0002】
【従来の技術】クロック断検出回路は、伝送路上から抽
出したクロックに端末内の基準クロックを同期させて使
用する場合のクロックの異常検出に用いられるが、従来
は特公平3−16442に示されるように、伝送路から
抽出したクロックと端末装置内の基準クロックとのビー
ト周波数を求め、該ビート周波数を計数、比較して異常
を検出していた。
【0003】
【発明が解決しようとする課題】従来の方法では、2つ
のクロックが互いに整数倍の関係に無い場合、両クロッ
クの最大公約数となる周波数まで分周してからビート周
波数を検出する必要が有る為に検出周期が長くなり、ク
ロック断や著しいジッター等を早期、確実に検出するこ
とは困難であった。
【0004】本発明はかかる点を改善し、その目的とす
るところはクロック断及びクロック変動を迅速、確実に
検出する手段を提供することにある。
【0005】
【課題を解決するための手段】本発明のクロック異常検
出器は、伝送路から抽出したクロックに端末装置内の基
準クロックを同期化させて使用する端末装置のクロック
異常検出器において、伝送路から抽出したクロック(C
K1 )及び端末装置内の基準クロック(CK2)の内
どちらか一方を分周比M1 で分周した出力CKA (
周波数fA )及び他方を分周比M2 で分周した出力
CKB (周波数fB)を用い(但し、M1 ,M2 
は、2・fA >fB を満たす任意の自然数)、CK
A の立ち上がりを計数して出力し、    リセット
パルスによりリセットされるカウンタ1と、CKAの立
ち下がりを計数して出力し、前記リセットパルスにより
リセットされるカウンタ2と、前記カウンタ1及びカウ
ンタ2の出力を加算し、その和N1 を出力する加算器
と、前記加算器の出力N1 と、値N2 (但しN2 
は、N2 ・fB <2・fA <(N2 +1)・f
B を満たす任意の自然数)を比較し、N1 <N2 
を検出し出力する比較器1と、前記加算器の出力N1 
と(N2 +1)を比較し、N1>(N2 +1)を検
出し出力する比較器2と、前記比較器1及び比較器2の
出力とタイミングパルスを入力としてクロックの状態を
判定し状態を示すフラグを出力する判定器と、CKB 
を取り込んで、前記リセットパルス及びタイミングパル
スを発生させるタイミング発生器から成ることを特徴と
する。
【0006】また、本発明のクロック異常検出器は、前
記加算器の出力N1 と、ある自然数N3 (但しN3
 は、2・fA /fB の少数部分Mが、M<0.5
ならN3 =(N2 +1)、M>0.5ならN3 =
N2 )を比較し、N1 =N3 を検出する比較器3
と、前記タイミング発生器の出力するタイミングパルス
のタイミングで比較器3の出力がN1 ≠N3 ならカ
ウントアップ、N1 =N3 ならリセットするカウン
タ2と、前記タイミングパルスのタイミングで比較器3
の出力がN1 =N3 の時、カウンタ2の出力N4 
と(K−1)を比較(但しKは、M<0.5の時K<1
/M<(K+1)、M>0.5の時K<1/(M−0.
5)<(K+1)となる自然数)し、N4 <(K−1
)を検出する比較器4と、前記N4 とKを比較し、N
4 >Kを検出する比較器5と、前記比較器1、比較器
2、比較器4、比較器5の出力及びタイミングパルスか
らクロックの状態を判定し、状態を示すフラグを出力す
る判定器を持つことを特徴とする。
【0007】
【実施例】図1は、本発明の第一の実施例を示すブロッ
ク図である。
【0008】分周器11,12は、それぞれ1/M1 
,1/M2 の分周器であり、CK1 及びCK2 を
分周してCKA 及びCKB を出力する。このうち、
CKB はタイミング発生器61の入力となり、リセッ
トパルス及びタイミングパルスの基準となる。他方、C
KA はカウンタ21及び22のクロックとなる。
【0009】カウンタ21は、隣り合うリセットパルス
間のCKA の立ち上がりの数を、カウンタ22は立ち
下がりの数を計数し、出力する。
【0010】カウンタ21及び22の出力は、加算器3
1で加算され、隣り合うリセットパルス間のCKA の
状態変化の回数N1 として出力される。
【0011】ここで、リセットパルスの間隔はCKB 
の周波数によって決まるから、CKA及びCKB の周
波数をそれぞれfA 及びfB と置いた時、N2 ・
fB <2・fA <(N2 +1)・fB となる自
然数N2 に対して、N2 <N1 (N2 +1)と
いう関係が成立する。比較器41及び42はN1 とN
2がこの関係を満たすか判定するためのもので、比較器
41はN1 >(N2 +1)の場合、比較器42はN
1<N2 の場合に、エラー信号を出力する。
【0012】エラー信号は判定器51に取り込まれ、エ
ラーフラグ出力EFの基準となる。もしCKA が本来
の周波数より高いか、CKB が本来の周波数より低い
場合、N1 >(N2 +1)となり比較器41がエラ
ー信号を出力するために、EFはエラー信号を出力する
。逆に、CKA が本来の周波数より低いかCKB が
本来の周波数より高い場合にはN1 <N2 となり、
比較器42がエラー信号を出力するために、EFはエラ
ー信号を出力する。
【0013】ここで、比較器の出力の時間的な変化につ
いて考える。リセットパルス直後はカウンタ21及び2
2がリセットされた状態になっている為、N1 =0と
なっている。従って、当然N1 <N2 となる為比較
器42はエラー信号を出力している。CKA の状態変
化が起きる毎にカウンタ21又は22のどちらかがカウ
ントアップし、従ってN1 も1づつ増加する。そして
、N1 =N2 となった時点で比較器42のエラー出
力は停止し、次のリセットパルスまで停止した状態が継
続する。即ち、比較器42がエラー信号を出力するのは
、回路の動作上、リセット信号が発生する毎に起きる現
象であり、それ自体はクロックの異常とは1対1で対応
していない。 故に、N1 <N2 の異常判定は、CKB の一周期
の終了直前、即ち次回のリセットパルスの直前に、タイ
ミングパルスに同期して行なう必要がある。
【0014】逆に、比較器41は、N1 >(N2 +
1)を検出した場合にエラー信号を出力しているが、こ
の状態は、N1 とN2 の定義N2 <N1 <(N
2 +1)から考えると、CKA とCKB が正常な
状態に有る限り起こり得ない。更に、N1 >(N2 
+1)となる原因の一つとして、CKB の切断状態と
いう可能性が有り、この場合にはタイミングパルスが発
生しない。従ってN1 >(N2 +1)の場合の異常
判定は、タイミングパルスとは無関係に、比較器41が
エラー信号を出力した時点で、EFはエラー信号を出力
する必要がある。
【0015】図2は、第一の実施例のタイミングチャー
トの例である。
【0016】ある周波数のCKA (101)に対して
、CKB の周波数が変化した場合の比較器及び判定器
の出力を示している。
【0017】(a)は、本来の周波数関係に有る場合で
あり、CKB (111)及びそれに対応するタイミン
グパルス(121)及びリセットパルス(131)を示
している。(b)は、CKB (112)の周波数が通
常時よりも高い場合であり、タイミングパルス(122
)の立ち下がりの時点でN1 <N2 の場合、比較器
42のエラー信号出力(142)が‘H’レベルとなる
ために、判定器51はクロックの異常と判定し、エラー
フラグ出力(152)は‘H’レベルとなる。(c)は
、CKB (113)の周波数が通常時より低い場合で
あり、N1 >(N2 +1)となった時点で比較器4
1の出力(163)は‘H’レベルとなり、判定器51
はクロックの異常と判定してエラーフラグ出力(153
)は‘H’レベルとなる。
【0018】図3は、本発明の第二の実施例を示すブロ
ック図である。
【0019】本実施例では、タイミングパルス間のCK
A の状態変化の回数の端数分M(Mは、2・fA /
fB の少数部分に等しい)を利用してクロック異常の
検出精度を上げている。即ち、M<0.5の場合、K<
1/M<(K+1)となる自然数Kを考えれば、隣り合
ったタイミングパルスの間のCKA の状態変化の回数
が(N2 +1)回となるのは、タイミングパルスがK
又は(K+1)回発生する内の一回であり、M>0.5
の場合、K<1/(M−0.5)<(K+1)となる自
然数Kを考えれば、隣り合ったタイミングパルスの間の
CKA の状態変化の回数がN2 回となるのは、タイ
ミングパルスがK又は(K+1)回発生する内の一回で
ある。
【0020】実際の回路は、第一の実施例の回路に加え
て、加算器36の出力N1 と自然数N3 (但しN3
 は、M<0.5の時(N2 +1)、M>0.5の時
N2 )を比較する比較器48と、タイミングパルスの
立ち下がりで比較器48の出力が‘H’レベル(N1 
=N3 )の時リセットし、‘L’レベルの時カウント
アップする同期式リセットのカウンタ76と、タイミン
グパルスの立ち下がりで、比較器48の出力が‘H’レ
ベルの場合にカウンタ76の出力N5 と(K−1)を
比較し、N4 <(K−1)ならエラー信号を出力する
比較器77と、N4 とKを比較しN4 >Kならエラ
ー信号を出力する比較器78とを持ち、クロック異常の
判定条件としては、判定器56の入力として比較器77
及び78の出力が加わっている。
【0021】図4は、第二の実施例のタイミングチャー
トの例である。
【0022】ある周波数のCKB から生成したタイミ
ングパルス(301)に対して、CKA の周波数が変
化した場合の比較器及び判定器の出力の変化を示してい
る。 (a)はCKA (311)が本来の周波数の場合であ
り、比較器48の出力(321)は、タイミングパルス
の立ち下がりでは、‘H’レベルと‘L’レベルを一回
おきに繰り返している。(b)では、CKA (312
)の周波数が通常より高い為に、比較器48の出力(3
22)がタイミングパルスの立ち下がりの時点で二回続
けて‘H’レベルとなった場合、カウンタ76の値N4
 =0となっている為にN4<(K−1)が成立して比
較器77の出力(332)がエラー信号を出力し、判定
器56のエラーフラグ出力(352)も‘H’レベルと
なる。(c)では、CKA (313)の周波数が通常
より高いために、カウンタ76の出力N4 がN4 =
3となった時点でN4 >K(K=2故)となるために
比較器78のエラー出力(343)が‘H’レベルとな
り、同時に判定器56の出力(353)も‘H’レベル
となる。
【0023】
【発明の効果】以上述べたように、本発明のクロック異
常検出器の構成によると、整数倍の関係に無いクロック
の異常を短時間に検出し、またはクロックの安定を検出
することが可能となるために、装置の早期立ち上げ等に
大きく寄与することができるという効果がある。
【図面の簡単な説明】
【図1】本発明の一実施例を示すブロック図。
【図2】図1の回路の動作説明用タイミングチャートを
示す図。
【図3】本発明の他の実施例を示すブロック図。
【図4】図3の回路の動作説明用タイミングチャートを
示す図。
【符号の説明】
11,12,16,17  分周器 21,22,26,27  カウンタ 31,36  加算器 41,42,46,47,48  比較器51,56 
 判定器 41,42,46,47,48  比較器51,56 
 判定器 61,66  タイミング発生器 76,77  検出器 101,311,312,313  CKA111,1
12,113  CKB  121,122,123,301  タイミングパルス
131,132,133  リセットパルス142  
比較器1出力 152,153  判定器出力(EF:エラーフラグ)
163  比較器2出力 321,322,323  比較器3出力332  比
較器4出力 343  比較器5出力

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】伝送路から抽出したクロックに端末装置内
    の基準クロックを同期化させて使用する端末装置のクロ
    ック異常検出器において、伝送路から抽出したクロック
    (CK1 )及び端末装置内の基準クロック(CK2 
    )の内どちらか一方を分周比M1 で分周した出力CK
    A (周波数fA )及び他方を分周比M2 で分周し
    た出力CKB (周波数fB )を用い(但し、M1 
    ,M2は、2・fA >fB を満たす任意の自然数)
    、CKA の立ち上がりを計数して出力し、リセットパ
    ルスによりリセットされるカウンタ1と、CKAの立ち
    下がりを計数して出力し、前記リセットパルスによりリ
    セットされるカウンタ2と、前記カウンタ1及びカウン
    タ2の出力を加算し、その和N1 を出力する加算器と
    、前記加算器の出力N1 と、値N2 (但しN2 は
    、N2 ・fB <2・fA <(N2 +1)・fB
     を満たす任意の自然数)を比較し、N1 <N2 を
    検出し出力する比較器1と、前記加算器の出力N1 と
    (N2+1)を比較し、N1 >(N2 +1)を検出
    し出力する比較器2と、前記比較器1及び比較器2の出
    力とタイミングパルスを入力としてクロックの状態を判
    定し状態を示すフラグを出力する判定器と、CKB を
    取り込んで、前記リセットパルス及びタイミングパルス
    を発生させるタイミング発生器から成ることを特徴とす
    るクロック異常検出器。
  2. 【請求項2】「請求項1」のクロック異常検出器におい
    て、前記加算器の出力N1 と、ある自然数N3 (但
    しN3 は、2・fA /fB の少数部分Mが、M<
    0.5ならN3 =(N2 +1)、M>0.5ならN
    3 =N2 )を比較し、N1 =N3 を検出する比
    較器3と、前記タイミング発生器の出力するタイミング
    パルスのタイミングで比較器3の出力がN1 ≠N3 
    ならカウントアップ、N1 =N3 ならリセットする
    カウンタ2と、前記タイミングパルスのタイミングで比
    較器3の出力がN1 =N3 の時、カウンタ2の出力
    N4と(K−1)を比較(但しKは、M<0.5の時K
    <1/M<(K+1)、M>0.5の時K<1/(M−
    0.5)<(K+1)となる自然数)し、N4 <(K
    −1)を検出する比較器4と、前記N4 とKを比較し
    、N4 >Kを検出する比較器5と、前記比較器1、比
    較器2、比較器4、比較器5の出力及びタイミングパル
    スからクロックの状態を判定し、状態を示すフラグを出
    力する判定器を持つことを特徴とするクロック異常検出
    器。
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