JPH04348047A - 半導体集積回路電極 - Google Patents

半導体集積回路電極

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JPH04348047A
JPH04348047A JP3149948A JP14994891A JPH04348047A JP H04348047 A JPH04348047 A JP H04348047A JP 3149948 A JP3149948 A JP 3149948A JP 14994891 A JP14994891 A JP 14994891A JP H04348047 A JPH04348047 A JP H04348047A
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JP
Japan
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electrode
integrated circuit
semiconductor integrated
bonding
insulating film
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JP3149948A
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English (en)
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Tatsuyoshi Sasada
笹田 達義
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Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、半導体集積回路電極
に関し、特に、超音波熱圧着等の手段によってボンディ
ングボールが圧接して接合される半導体集積回路電極に
関するものである。
【0002】
【従来の技術】図4は、従来の半導体集積回路電極にワ
イヤ先端部のボンディングボールを接合した状態を示す
断面図である。
【0003】図において、1は半導体基板、2はフィー
ルド酸化膜(絶縁膜)、3は第1のアルミ電極、4は層
間膜(第2の絶縁膜)、5は第2のアルミ電極、5aは
第2のアルミ電極5における表面、6はパッシベーショ
ン膜、7はボンディングボール、8はボンディングボー
ルである。
【0004】次に、上記半導体集積回路電極の形成工程
について説明する。先ず、半導体基板1上にフィールド
酸化膜(絶縁膜)2を形成する。次に、フィールド酸化
2上にアルミ層を形成し、写真製版,エッチング技術を
用いて第1のアルミ電極3を形成する。次に、基板1の
全面にSiO2 による絶縁膜を形成した後、写真製版
,エッチング技術を用いて第1のアルミ電極3の表面を
覆う絶縁膜を除去して層間膜4を形成する。次に、第1
のアルミ電極3と層間膜4との表面を覆うようにアルミ
層を形成した後、写真製版,エッチング技術により第2
のアルミ電極5を形成する。そして、最後に、SiN膜
を基板1の全面に形成した後、通常の写真製版,エッチ
ング技術により第2のアルミ電極5上に形成されたSi
N膜を除去して、パッシベーション膜6を形成し、半導
体集積回路電極が形成される。
【0005】次に、以上のようにして形成された電極の
最上面、即ち、第2のアルミ電極5の表面に、ボンディ
ングワイヤ8の先端部に形成された真球状のボンディン
グボール7を適当な温度,荷重の条件下に超音波併用に
より圧接すると、ボンディングワイヤ7と第2のアルミ
電極5との接合部が形成される。
【0006】このように、従来の半導体集積回路におけ
る電極とホンディングワイヤ8との接続は、半導体集積
回路電極の最上層の第2のアルミ電極5の平坦な表面5
aに、ボンディングワイヤ8の先端に形成されたボンデ
ィングボール7を適当な温度,荷重の条件下で超音波併
用して圧接し、前記第2のアルミ電極の平坦な表面5a
とボンディングボール7との接合部を形成することによ
り行われていた。
【0007】
【発明が解決しようとする課題】ところで、半導体集積
回路装置の小型化にともない、電極自体も縮小して形成
することがある。しかしながら、電極を縮小して形成す
るとワイヤが接続される電極表面、即ち、上記の半導体
集積回路電極における第2のアルミ電極5の電極表面5
aも自ずと小さくなり、その結果、ボンディングボール
7と第2のアルミ電極5の表面5aとの接触する面積が
減少して双方の接着力が低下し、樹脂封止の際や保管時
の急激な温度変化によってボンディングボールはがれ等
の不具合を発生するようになり、半導体集積回路の信頼
性を低下させる等の問題点を生じさせていた。
【0008】この発明は、上記のような問題点を解消す
るためになされたもので、ボンディングボールの電極部
への接着力が増し、電極部を縮小して形成した場合にも
、ボンディングボールはがれ等の不具合の発生を抑制す
ることができる半導体集積回路電極を得ることを目的と
している。
【0009】
【課題を解決するための手段】この発明にかかる半導体
集積回路電極は、半導体基板上に形成された絶縁膜と該
絶縁膜上に形成された少なくとも一層の金属層を有する
電極において、前記絶縁膜と前記少なくとも一層の金属
層との間に突起状電極を設け、前記金属層の最上層の表
面になめらかな凹凸を形成したものである。
【0010】更に、この発明にかかる半導体集積回路は
、半導体基板上に形成された絶縁膜と該絶縁膜上に形成
された複数の金属層とを有する電極部において、前記絶
縁膜上に形成された複数の金属層の最上層を除く他の一
層を不連続な層構造に形成し、前記金属層の最上層の表
面になめらかな凹凸を形成したものである。
【0011】
【作用】この発明においては、半導体集積回路電極を構
成する金属層の最上層の表面になめらかな凹凸を形成し
たので、ボンディングボールを前記金属層の表面に圧接
して接合する際、ボンディングボールと金属層との接触
面積か増大し、これにより、接合部における接着力を高
めることができる。
【0012】
【実施例】以下、この発明の一実施例を図について説明
する。図1は、この発明の一実施例による半導体集積回
路電極にボンディングボール7を圧接して接合した接合
部を示す断面図であり、図において、1は半導体基板、
2はフィールド酸化膜としての絶縁膜、3は第1のアル
ミ電極、4は層間膜としての第2の絶縁層、5は第2の
アルミ電極、5aは第2のアルミ電極5の表面、6はパ
ッシベーション膜としての絶縁膜、7はボンディングボ
ール、8はボンディングワイヤ、9はフィールド酸化膜
2上に形成された突起状のポリシリコン電極である。 尚、図中、図4と同一符号は同一或いは相当する部分を
示す。
【0013】次に、上記電極部の形成工程を説明する。 図3は、図1に示す電極部の形成工程を示す工程断面図
であり、先ず、半導体基板1上にSiO2 からなるフ
ィールド酸化膜2を形成する。次に、該フィールド酸化
膜2上にCVD法等によりポリシリコンを堆積し、その
上にレジストを塗布し、露光,現像を行ってレジストパ
ターンを形成する。そして、該レジストパターンをマス
クとしたエッチングにより不要なポリシリコンを除去し
、更に、不要なレジストを除去して図3(a) に示す
ポリシリコン電極9を形成する。
【0014】次に、図3(b) に示すように、基板1
の全面にアルミをスパッタ蒸着してアルミ層を形成し、
通常の写真製版,エッチング技術によりポリシリコン電
極9を覆うように第1のアルミ電極3を形成する。続い
て、図3(c) に示すように、SiO2 からなる絶
縁膜を基板1の全面に蒸着し、通常の写真製版,エッチ
ング技術により前記第1のアルミ電極3上に形成された
絶縁膜を除去して層間膜4を形成する。
【0015】次に、図3(d) に示すように、前記第
1のアルミ電極3と前記層間膜4を覆うようにスパッタ
蒸着してアルミ層を形成し、通常の写真製版,エッチン
グ技術により第2のアルミ電極5を形成する。そして、
最後に図3(e) に示すように、基板1の全面にSi
Nを蒸着し、通常の写真製版,エッチング技術により前
記第2のアルミ電極5上に形成されたSiN膜を除去し
てパッシベーション膜6を形成し、電極が完成する。こ
こで、以上のようにして形成された電極は最上層の第2
のアルミ電極5の表面5aになめらかな凹凸が形成され
ている。
【0016】次に、上記得られた第2のアルミ電極5の
表面5aに、Auからなるボンディングワイヤ8の先端
を溶融して形成した真球状のボンディングボール7を適
当な温度,荷重の条件下で超音波併用して圧接して双方
が接合する。この時、ボンディングボール7と第2のア
ルミ電極5の表面5aの接合部は従来に比べて広い接触
面に接合されており、これによって、接合部における第
2のアルミ電極5の表面5aとボンディングボール7と
の接着力を向上することができる。
【0017】このような本実施例による半導体集積回路
電極は、フィールド酸化膜2上に形成された突起状のポ
リシリコン電極9と、該ポリシリコン電極9を覆うよう
に形成された第1のアルミ電極3と第2のアルミ電極5
とを備えているので、第2のアルミ電極5の表面5aに
はなめらかな凹凸が形成され、ボンディングボール7を
第2のアルミ電極5の表面5aに接合する際の接触面が
拡大し、ボンディングボールはがれが等の不具合が減少
する。
【0018】尚、上記実施例におけるポリシリコン電極
9の形成は、ウエハプロセス内における半導体基板1上
の図示しない他の領域にポリシリコンによるゲート酸化
膜等を形成する際、レジストパターンのパターン制御を
行って上記ゲート酸化膜と同時に形成したものであり、
従来からのウエハプロセスに新たな工程を追加すること
なく突起状の電極を形成することができる。
【0019】また、上記実施例ではポリシリコンによっ
て突起状の電極を形成したが、他の酸化物から突起状の
電極を形成しても、上記実施例と同様の効果を奏する。
【0020】次に、この発明の第2の実施例を図につい
て説明する。図2は、本発明の第2の実施例による半導
体集積回路電極にボンディングボール7を圧接して接続
したその接合部を示す断面図であり、図において、1は
半導体基板、2はフィールド酸化膜としての絶縁膜、3
は第1のアルミ電極、4は層間膜としての第2の絶縁層
、5は第2のアルミ電極、5aは第2のアルミ電極5の
表面、6はパッシベーション膜、7はボンディングボー
ル、8はボンディングワイヤである。
【0021】本実施例による電極は、前述した実施例に
おける電極の形成工程において突起状のポリシリコン電
極を形成せず、第1のアルミ電極を形成する際に第1の
アルミ電極を不連続な層構造に形成しており、この第1
のアルミ電極3を覆うように形成した第2のアルミ電極
5のの表面5aには滑らかな凹凸が形成されている。
【0022】また、電極とボンディングワイヤとの接続
は、前述した実施例と同様に第2のアルミ電極5の表面
5aに、Auからなるボンディングワイヤ8の先端を溶
融して得られた真球状のボンディングボール7を適当な
温度,荷重の条件下で超音波併用して圧接し、電極とボ
ンディグワイヤ8の接合が行われる。そして、ボンディ
ングボール7と第2のアルミ電極5の表面5aの接合部
は広い接触面にて接合されて接合部の接着力が向上する
【0023】このような本実施例による半導体集積回路
電極では、フィールド酸化膜2上に不連続な層構造に形
成された第1のアルミ電極3と、第1のアルミ電極3を
覆うように形成された第2のアルミ電極5を備えている
ので、第2のアルミ電極5の表面5aにはなめらかな凹
凸が形成され、ボンディングボール8は広い接触面にて
第2のアルミ電極5の表面5aに接合されるので、ボン
ディングボールはがれ等の不具合が減少し、装置自体の
信頼性が向上する。
【0024】
【発明の効果】以上のように、この発明にかかる半導体
集積回路によれば、電極部の最上層になめらかな凹凸が
形成されているので、金属層の表面と接合されるボンデ
ィングボールの表面との接合面が拡大し、その結果、接
合部におけるの接着力が向上してボンディングボールは
がれ等の不具合が低減された信頼性の高い半導体集積回
路を得ることができる効果がある。
【図面の簡単な説明】
【図1】この発明の一実施例による半導体集積回路の電
極部にボンディングワイヤを接続した状態を示す断面図
である。
【図2】この発明の一実施例による半導体集積回路の電
極部にボンディングワイヤを接続した状態を示す断面図
である。
【図3】図1に示す半導体集積回路の電極部の形成工程
を示す断面図である。
【図4】従来の半導体集積回路の電極部にボンディング
ワイヤを接続した状態を示す断面図である。
【符号の説明】
1    半導体基板 2    絶縁膜(フィールド酸化膜)3    第1
のアルミ電極 4    絶縁膜(層間膜) 5    第2のアルミ電極 5a  第2のアルミ電極の表面 6    パッシベーション膜 7    ボンディングボール 8    ボンディングワイヤ 9    ポリシリコン電極

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】  半導体基板上に形成された絶縁膜と、
    該絶縁膜上に形成された少なくとも一層の金属層とを備
    えた半導体集積回路電極において、上記絶縁膜と上記少
    なくとも一層の金属層との間に突起状電極が設けられ、
    前記金属層における最上層の表面にはなめらかな凹凸が
    形成されていることを特徴とする半導体集積回路電極。
  2. 【請求項2】  半導体基板上に形成された絶縁膜と、
    該絶縁膜上に形成された複数の金属層とを備えた半導体
    集積回路電極において、上記絶縁膜上に形成された複数
    の金属層の最上層を除く層が不連続な層構造に形成され
    、前記複数の金属層における最上層の表面にはなめらか
    な凹凸が形成されていることを特徴半導体集積回路電極
JP3149948A 1991-05-24 1991-05-24 半導体集積回路電極 Pending JPH04348047A (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0543544U (ja) * 1991-11-12 1993-06-11 日本無線株式会社 電子素子の接続端子構造
US7196000B2 (en) * 2002-10-22 2007-03-27 Samsung Electronics Co., Ltd. Method for manufacturing a wafer level chip scale package
CN108493200A (zh) * 2018-05-28 2018-09-04 武汉华星光电半导体显示技术有限公司 一种阵列基板的制作方法、阵列基板及显示装置
WO2021240748A1 (ja) * 2020-05-28 2021-12-02 三菱電機株式会社 半導体装置およびその製造方法ならびに電力変換装置

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0543544U (ja) * 1991-11-12 1993-06-11 日本無線株式会社 電子素子の接続端子構造
US7196000B2 (en) * 2002-10-22 2007-03-27 Samsung Electronics Co., Ltd. Method for manufacturing a wafer level chip scale package
CN108493200A (zh) * 2018-05-28 2018-09-04 武汉华星光电半导体显示技术有限公司 一种阵列基板的制作方法、阵列基板及显示装置
WO2021240748A1 (ja) * 2020-05-28 2021-12-02 三菱電機株式会社 半導体装置およびその製造方法ならびに電力変換装置
JPWO2021240748A1 (ja) * 2020-05-28 2021-12-02

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