JPH0436655U - - Google Patents

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JPH0436655U
JPH0436655U JP7841990U JP7841990U JPH0436655U JP H0436655 U JPH0436655 U JP H0436655U JP 7841990 U JP7841990 U JP 7841990U JP 7841990 U JP7841990 U JP 7841990U JP H0436655 U JPH0436655 U JP H0436655U
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JP
Japan
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cpu
peripheral circuit
signal
cycle
circuit
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JP7841990U
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Description

【図面の簡単な説明】
第1図はこの考案の第1の実施例に係るマイク
ロコンピユータシステムの構成を示すブロツク図
、第2図は第1図中の一部の具体的な構成を示す
ブロツク図、第3図は第1図中のCPUの動作を
示すフローチヤート、第4図はLCDコントロー
ラに対するライトサイクル時の第1図の動作を示
すタイムチヤート、第5図はLCDコントローラ
に対するリードサイクル時の第1図の動作を示す
タイムチヤートである。第6図は従来のマイクロ
コンピユータシステムの構成を示すブロツク図、
第7図は第6図のCPUの動作を示すフローチヤ
ートである。 主な符号の説明、10……CPU、12……L
CDコントローラ、112……アドレスデコーダ
、120……ウエイト回路、140……データバ
ツフア回路、150……イネーブル信号作成回路

Claims (1)

  1. 【実用新案登録請求の範囲】 Tサイクルを基本サイクルとするCPUと、E
    サイクルを基本サイクルとするCPU用の周辺回
    路との間に介装したインターフエース回路におい
    て、 CPU側から周辺回路選択アドレスを入力する
    と周辺回路選択信号を出力するアドレスデコーダ
    と、 アドレスデコーダから周辺回路選択信号が出力
    されたとき、所定の一定期間ウエイト信号を発生
    してCPUにウエイトを掛けさせるウエイト回路
    と、 アドレスデコーダから周辺回路選択信号が出力
    されたとき、リードサイクル時はCPUがリード
    ストローブ信号出力中の所定の一定期間、ライト
    サイクル時はCPUがライトストロープ信号出力
    中の所定の一定期間アクテイブとなるイネーブル
    信号を作成し、周辺回路に出力するイネーブル信
    号作成回路と、 CPUと周辺回路との間に介装されてデータ授
    受タイミングを調整するデータバツフア回路と、 を備え、かつ、CPUのライトストローブ端子を
    周辺回路のリード/ライトストローブ端子と接続
    したこと、 を特徴とするインターフエース回路。
JP7841990U 1990-07-24 1990-07-24 Pending JPH0436655U (ja)

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JP7841990U JPH0436655U (ja) 1990-07-24 1990-07-24

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JPH0436655U true JPH0436655U (ja) 1992-03-27

Family

ID=31621675

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JP7841990U Pending JPH0436655U (ja) 1990-07-24 1990-07-24

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