JPH01127040U - - Google Patents

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JPH01127040U
JPH01127040U JP2437788U JP2437788U JPH01127040U JP H01127040 U JPH01127040 U JP H01127040U JP 2437788 U JP2437788 U JP 2437788U JP 2437788 U JP2437788 U JP 2437788U JP H01127040 U JPH01127040 U JP H01127040U
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cpu
set time
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chip
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【図面の簡単な説明】
第１図は、本考案に係るデータ入出力装置の構
成図、第２図は、本考案に係るデータ入出力装置
の動作に関するタイムチヤート、第３図は、本考
案に係るデータ入出力装置の動作フローチヤート
、第４図は、従来の本考案に係るデータ入出力装
置の構成図である。 １…ＣＰＵ、２…アドレズバス、３…アドレス
デコーダ、４…データバス、５…メモリー部（チ
ツプ）、６…タイマー（チツプ）、７…ジヤンパ
ーピン、１０…セレクターラツチ（セレクター、
チツプ）、ＣＳ１，ＣＳ２…チツプ選択信号。

Claims (1)

  1. 【実用新案登録請求の範囲】 ＣＰＵから出力されるアドレスデータに対応す
    るチツプに、チツプ選択信号を出力するアドレス
    デコーダと、 前記ＣＰＵにウエイト命令を設定時間だけ出力
    し、前記ＣＰＵ及び前記チツプ相互間のデータ授
    受タイミングを設定するタイマーと、 前記アドレスデコーダから所定のチツプ選択信
    号が出力された場合に、前記ＣＰＵから出力され
    た前記設定時間に関するデータを入力し、当該デ
    ータに基づいて前記設定時間を選択するセレクタ
    ーと、 を有することを特徴とするデータ入出力装置。
JP2437788U 1988-02-25 1988-02-25 Pending JPH01127040U (ja)

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JP2437788U JPH01127040U (ja) 1988-02-25 1988-02-25

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JP2437788U JPH01127040U (ja) 1988-02-25 1988-02-25

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JPH01127040U true JPH01127040U (ja) 1989-08-30

Family

ID=31244174

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2437788U Pending JPH01127040U (ja) 1988-02-25 1988-02-25

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JP (1) JPH01127040U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011044557A (ja) * 2009-08-20 2011-03-03 Fujitsu Ltd マルチチップモジュールの製造方法及びマルチチップモジュール

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* Cited by examiner, † Cited by third party
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